JPH0235229U - - Google Patents
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- Publication number
- JPH0235229U JPH0235229U JP11153488U JP11153488U JPH0235229U JP H0235229 U JPH0235229 U JP H0235229U JP 11153488 U JP11153488 U JP 11153488U JP 11153488 U JP11153488 U JP 11153488U JP H0235229 U JPH0235229 U JP H0235229U
- Authority
- JP
- Japan
- Prior art keywords
- input signal
- register
- comparison circuit
- circuit
- signal
- Prior art date
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- Pending
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- 238000010586 diagram Methods 0.000 description 3
- 239000000872 buffer Substances 0.000 description 1
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- Input From Keyboards Or The Like (AREA)
Description
第１図は本考案回路の原理図、第２図は本考案
回路を用いたシステムの一実施例のブロツク図、
第３図は従来システムの一例のブロツク図である
。 図において、１，２１はバツフア、２，２４は
レジスタ、３，２２は比較回路、４は制御手段、
６，２３はプロセツサ、２５はインバータを示す
。
回路を用いたシステムの一実施例のブロツク図、
第３図は従来システムの一例のブロツク図である
。 図において、１，２１はバツフア、２，２４は
レジスタ、３，２２は比較回路、４は制御手段、
６，２３はプロセツサ、２５はインバータを示す
。
Claims (1)
- 【実用新案登録請求の範囲】 バツハア１に入来する入力信号を該バツハア１
から出力させて読取を行なう入力信号続取回路に
おいて、 読取られた入力信号を格納するレジスタ２と、 該バツハア１に入来する入力信号と該レジスタ
２に格納された信号とを比較する比較回路３と、 該比較回路３の比較結果が不一致のとき該バツ
ハア１に入力信号の出力を指示する制御手段４と
を有してなる入力信号読取回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11153488U JPH0235229U (ja) | 1988-08-25 | 1988-08-25 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11153488U JPH0235229U (ja) | 1988-08-25 | 1988-08-25 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0235229U true JPH0235229U (ja) | 1990-03-07 |
Family
ID=31349664
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11153488U Pending JPH0235229U (ja) | 1988-08-25 | 1988-08-25 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0235229U (ja) |
-
1988
- 1988-08-25 JP JP11153488U patent/JPH0235229U/ja active Pending
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