JPH0486346U - - Google Patents

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JPH0486346U
JPH0486346U JP1990130203U JP13020390U JPH0486346U JP H0486346 U JPH0486346 U JP H0486346U JP 1990130203 U JP1990130203 U JP 1990130203U JP 13020390 U JP13020390 U JP 13020390U JP H0486346 U JPH0486346 U JP H0486346U
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JP
Japan
Prior art keywords
cpu
circuit
sent
operated
controls
Prior art date
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Pending
Application number
JP1990130203U
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English (en)
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Publication date
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Pending legal-status Critical Current

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  • Mobile Radio Communication Systems (AREA)
  • Microcomputers (AREA)
  • Transceivers (AREA)

Description

【図面の簡単な説明】
第１図はこの考案の一実施例による制御回路を
示す回路図、第２図はこの考案の他の実施例を示
す回路図、第３図は従来の制御回路を示す図であ
る。 図において、１はＣＰＵ、２はシリアル信号デ
ータポート、３はシリアル信号クロツクポート、
４はシリアル信号ストローブポート、５〜７はＩ
Ｃ、８はパラレル信号、９は同期シリアル出力部
である。なお、図中、同一符号は同一、または相
当部分を示す。

Claims (1)

    【実用新案登録請求の範囲】
  1. システム全体の制御を行うＣＰＵからの入出力
    信号によつて操作される複数のＩＣによつて構成
    された回路において、各ＩＣ内にＬＡＴＣＨ回路
    を持たせることにより、ＣＰＵよりシリアルデー
    タを送出することによつて、同一ポートより複数
    の制御機能を持たせることを特徴とする携帯用無
    線機制御回路。
JP1990130203U 1990-11-30 1990-11-30 Pending JPH0486346U (ja)

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JP1990130203U JPH0486346U (ja) 1990-11-30 1990-11-30

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JP1990130203U JPH0486346U (ja) 1990-11-30 1990-11-30

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JPH0486346U true JPH0486346U (ja) 1992-07-27

Family

ID=31877563

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JP1990130203U Pending JPH0486346U (ja) 1990-11-30 1990-11-30

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