JPH0482752U - - Google Patents
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- Publication number
- JPH0482752U JPH0482752U JP12560790U JP12560790U JPH0482752U JP H0482752 U JPH0482752 U JP H0482752U JP 12560790 U JP12560790 U JP 12560790U JP 12560790 U JP12560790 U JP 12560790U JP H0482752 U JPH0482752 U JP H0482752U
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- JP
- Japan
- Prior art keywords
- input
- output
- interrupt
- circuit
- coupled
- Prior art date
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- Pending
Links
- 239000004065 semiconductor Substances 0.000 claims description 3
- 238000010586 diagram Methods 0.000 description 2
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- Microcomputers (AREA)
Description
第１図はこの考案の一実施例による半導体集積
回路のブロツク図第２図は従来の半導体集積回路
のブロツク図である。 図において、１はワンチツプマイコン、２は割
り込み回路、３は入出力兼用端子、４はデータラ
ツチ回路、５は出力バツフア回路、６は方向レジ
スタ、７は出力バツフア回路の制御入力、８は出
力バツフア回路の出力、９はデータラツチ回路の
出力、１０は割り込み要求出力、１１は割り込み
極性設置入力を示す。なお、図中、同一符号は同
一、または相当部分を示す。
回路のブロツク図第２図は従来の半導体集積回路
のブロツク図である。 図において、１はワンチツプマイコン、２は割
り込み回路、３は入出力兼用端子、４はデータラ
ツチ回路、５は出力バツフア回路、６は方向レジ
スタ、７は出力バツフア回路の制御入力、８は出
力バツフア回路の出力、９はデータラツチ回路の
出力、１０は割り込み要求出力、１１は割り込み
極性設置入力を示す。なお、図中、同一符号は同
一、または相当部分を示す。
Claims (1)
- 【実用新案登録請求の範囲】 入出力兼用端子と、 出力が上記入出力兼用端子に結合されている出
力デイスエーブル機能を備えた出力バツフア回路
と、 出力が上記出力バツフア回路の入力に結合され
ているデータラツチ回路と、 割り込み入力と割り込み極性選択入力を有し上
記割り込み入力が、上記入出力兼用端子に結合さ
れており、上記割り込み極性選択入力が上記デー
タラツチ回路の出力に結合されている割り込み回
路とを備えたことを特徴とする半導体集積回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12560790U JPH0482752U (ja) | 1990-11-27 | 1990-11-27 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12560790U JPH0482752U (ja) | 1990-11-27 | 1990-11-27 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0482752U true JPH0482752U (ja) | 1992-07-17 |
Family
ID=31873199
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12560790U Pending JPH0482752U (ja) | 1990-11-27 | 1990-11-27 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0482752U (ja) |
-
1990
- 1990-11-27 JP JP12560790U patent/JPH0482752U/ja active Pending