JPH023926A - 配線の形成方法 - Google Patents

配線の形成方法

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Publication number
JPH023926A
JPH023926A JP15442488A JP15442488A JPH023926A JP H023926 A JPH023926 A JP H023926A JP 15442488 A JP15442488 A JP 15442488A JP 15442488 A JP15442488 A JP 15442488A JP H023926 A JPH023926 A JP H023926A
Authority
JP
Japan
Prior art keywords
film
gold
mask
wiring
eliminated
Prior art date
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Pending
Application number
JP15442488A
Other languages
English (en)
Inventor
Hiroshi Kumamoto
洋 熊本
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP15442488A priority Critical patent/JPH023926A/ja
Publication of JPH023926A publication Critical patent/JPH023926A/ja
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  • Electrodes Of Semiconductors (AREA)
  • Drying Of Semiconductors (AREA)
  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は配線の形成方法に関し、特に半導体装置の金め
つき配線を含む配線の形成方法に関する。
〔従来の技術〕
従来の金めつき配線を含む配線の形成方法を第3図を用
いて説明する。
まず第3図(a)に示すように、半導体基板1の上にS
iC2等からなる絶縁M2を形成した後、スパッタ蒸着
法によりTi等からなる下層の金属膜3A及び金膜4を
形成する。
次に第3図(b)に示すように、フォトレジスト5を形
成したのち開口部10を設け、この開口部10に電解め
っき法により金めつき層7を形成する。
次に第3図(C)に示すように金めつき層7を完全に覆
うようなフォトレジストからなるマスク8を形成する。
次に第1−図(d)に示すように、マスク8を用いスパ
ッタ蒸着した金M4及び下層の金属膜3Aを除去するこ
とにより下層の金属膜3Aと金膜4とからなる第1の配
線及び、下層の金属膜3A、金膜4及び金めつき層7と
からなる第2の配線を形成していた。
〔発明が解決しようとする課題〕
上述した従来の配線の形成方法は、金めつき層7を形成
した後、金めつき層7を完全に覆うフォトレジストから
なるマスク8で電解金めっき時の給電用金属であるスパ
ッタ蒸着しな金膜4及び下層の金属膜3Aを除去するよ
うになっているので、金めつき層7が2〜3μmと厚い
場合、金めつき層7を完全に覆うマスク8の膜厚も厚く
しなければならないため、微細な配線形成が困難である
という欠点がある。
〔課題を解決するための手段〕
本発明の1配線の形成方法は、絶縁膜上に給電用金属膜
及び金膜を順次形成する工程と、前記金膜を選択的に除
去する工程と、電解めっき法により前記金膜の一部上に
金めつき層を形成する工程と、前記金めっき層及び金膜
をマスクとして前記給電用金属膜を除去する工程とを含
んで構成される。
〔実施例〕
次に本発明について図面を参照して説明する。
第1図(a)〜(b)は本発明第1の実施例を説明する
ための工程順に示した半導体チップの断面図である。
まず第1図(a>に示すように、半導体基板1上に51
02M等からなる厚さ1μmの絶縁膜2を形成したのち
、スパッタ蒸着法によりTiからなる厚さ0.1μmの
給電用金属膜3と厚さ0.5)xmの金膜4を形成する
。次でフォトレジスト膜を形成したのちバターニングし
配線パターンを転写したマスク5を形成する。
次に第1図(b)に示すように、マスク5を用い、金膜
4をイオンミリング法により選択的に除去したのち、マ
スク5を除く。
次に第1図(C)に示すように、金膜4の一部上に開口
したフォトレジストからなるマスク6を形成したのち、
給電用金属膜3を電解金めっきの給電金属として金めつ
き層7を形成する。
次に第1図(d)に示すように、マスク6を除去したの
ち金めっき層7及び金膜4をマスクに給電用金属膜3を
反応性イオンエツチング法により除去し、給電用金属J
IM3と金膜4からなる第1.の配線及び給電用金属膜
3、金属4及び金めつき層7からなる低抵抗の第2の配
線を形成する。
このように第1の実施例によれば、配線の幅は第1図(
b)に示した金M4の幅と同一に形成できるなめ、微細
な配線を形成することができる。
第2図(a)〜(d)は本発明の第2の実施例を説明す
るための工程順に示した半導体チップの断面図である。
まず第2図(a)に示すように、半導体基板1上に絶縁
膜2、給電用金属膜3及びスパッタ蒸着法による金膜4
を形成した後、フォトレジストからなるマスク5を形成
し電解めっき法により金めつき層7を金膜4以上の膜厚
に形成する。
次に第2図(b)に示すように、マスク5を除去したの
ち、金めつき層7をマスクとしてイオンミリング法によ
り金膜4を除去する。
次に第2図(c)に示すように、フォトレジストで金め
つき層7の一部上に開口したマスク8を形成したのち電
解めっき法により、第2の金めつき層9を形成する。
次に第2図(d)に示すように金めつき層7と金膜4と
をマスクとして、反応性イオンエツチング法により給電
用金属膜3を除去し、給電用金属膜3、金膜4、金めつ
き層7からなる第1の配線と、この上面に第2の金めつ
き層9を有する第2の配線を形成する。
この第2の実施例では、金めつき層7をスパッタ蒸着の
金M4より厚く形成するようになっているので、配線形
成後の金膜の厚さを第1の実施例よりも厚くすることが
できるので配線抵抗をより低減できる利点がある。
尚、上記実施例においては給電用金属膜としてTiを用
いた場合について説明したが、これに限定されるもので
はな(、’I” i NやPL等を用いることができる
〔発明の効果〕
以上説明したように本発明は、絶縁膜上に給電用金属膜
及び金膜を形成した後、金膜の一部を除去し、電解めっ
き法により金膜の一部上に、金めつき屑を形成した後、
金めつき層及び金膜をマスクとして、給電用金属膜を除
去することにより、微細な配線を形成できるという効果
がある。従って半導体装置をより小型化できる。
【図面の簡単な説明】
第1図(a) 〜<d)及び第2図(a) 〜(d)は
本発明の第1及び第2実施例を説明するための工程順に
示した半導体チップの断面図、第3図(a)〜(d)は
従来の配線の形成方法を説明するための工程順に示した
半導体チップの断面図である。 1・・・半導体基板、2・・・絶縁体、3・・・給電用
金属膜、3A・・・下層の金属膜、4・・・金膜、5.
6.8・・・マスク、7・・・金めつき層、9・・・第
2の金めつき層。 力 ? 図

Claims (1)

    【特許請求の範囲】
  1. 絶縁膜上に給電用金属膜及び金膜を順次形成する工程と
    、前記金膜を選択的に除去する工程と、電解めっき法に
    より前記金膜の一部上に金めっき層を形成する工程と、
    前記金めっき層及び金膜をマスクとして前記給電用金属
    膜を除去する工程とを含むことを特徴とする配線の形成
    方法。
JP15442488A 1988-06-21 1988-06-21 配線の形成方法 Pending JPH023926A (ja)

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JP15442488A JPH023926A (ja) 1988-06-21 1988-06-21 配線の形成方法

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JPH023926A true JPH023926A (ja) 1990-01-09

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6599834B2 (en) * 2001-05-28 2003-07-29 Sharp Kabushiki Kaisha Process of manufacturing a semiconductor device with an electroplated wiring layer
JP2006346109A (ja) * 2005-06-15 2006-12-28 Toyota Motor Corp 生体情報検出センサー及び生体状態検出装置

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6599834B2 (en) * 2001-05-28 2003-07-29 Sharp Kabushiki Kaisha Process of manufacturing a semiconductor device with an electroplated wiring layer
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