JPH0242141U - - Google Patents
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- Publication number
- JPH0242141U JPH0242141U JP11840388U JP11840388U JPH0242141U JP H0242141 U JPH0242141 U JP H0242141U JP 11840388 U JP11840388 U JP 11840388U JP 11840388 U JP11840388 U JP 11840388U JP H0242141 U JPH0242141 U JP H0242141U
- Authority
- JP
- Japan
- Prior art keywords
- cpu
- interrupt
- board
- system bus
- interrupt request
- Prior art date
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- Pending
Links
- 238000010586 diagram Methods 0.000 description 5
- 239000013256 coordination polymer Substances 0.000 description 1
Landscapes
- Multi Processors (AREA)
- Bus Control (AREA)
Description
第１図は本考案のブロツク図、第２図は実施例
の構成図、第３図は割込回路の詳細な回路図、第
４図は従来方式の構成図、第５図は従来方式の構
成図である。 １……マルチＣＰＵシステムバス、２……ＣＰ
Ｕボード、３……プロセツサ部、４……割込回路
。
の構成図、第３図は割込回路の詳細な回路図、第
４図は従来方式の構成図、第５図は従来方式の構
成図である。 １……マルチＣＰＵシステムバス、２……ＣＰ
Ｕボード、３……プロセツサ部、４……割込回路
。
Claims (1)
- 【実用新案登録請求の範囲】 マルチＣＰＵシステムバスに接続されるＣＰＵ
ボードにおいて、 前記マルチＣＰＵシステムバスに接続され、前
記ＣＰＵボード内で少なくとも処理を行うプロセ
ツサ部と、 前記マルチＣＰＵシステムバスに接続され、該
マルチＣＰＵシステムバスより割込要求が加わつ
た時に前記プロセツサ部に割込要求信号を加える
割込回路とを有し、 マルチＣＰＵシステムバスに接続された他の回
路からの割込要求をＣＰＵボード間の割込線を介
さずにＣＰＵボード内のＣＰＵに割込要求を加え
ることを特徴とする割込回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11840388U JPH0242141U (ja) | 1988-09-09 | 1988-09-09 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11840388U JPH0242141U (ja) | 1988-09-09 | 1988-09-09 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0242141U true JPH0242141U (ja) | 1990-03-23 |
Family
ID=31362733
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11840388U Pending JPH0242141U (ja) | 1988-09-09 | 1988-09-09 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0242141U (ja) |
-
1988
- 1988-09-09 JP JP11840388U patent/JPH0242141U/ja active Pending
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