JPS6130148U - 共有メモリつきマルチプロセツサ - Google Patents

共有メモリつきマルチプロセツサ

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JPS6130148U
JPS6130148U JP11232784U JP11232784U JPS6130148U JP S6130148 U JPS6130148 U JP S6130148U JP 11232784 U JP11232784 U JP 11232784U JP 11232784 U JP11232784 U JP 11232784U JP S6130148 U JPS6130148 U JP S6130148U
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JP
Japan
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processor
slave
master
bus control
shared memory
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JP11232784U
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JPH0215152Y2 (ja
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恭之 安間
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NEC Corp
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NEC Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案の一実施例のブロック図、第２図は第１
図における主従プロセッサのメモリ配置図である。 図において、１・・・・・・主プロセッサ、２・晶・・
バスコントローラ、３・・…・従フロセッサ、４・・・
・・・主メッセージレジスタ、、５・・・・・・従メッ
セージレジスタ、６，８・・・・・・（メモリ）スイッ
チ回路、７，９・・・・・・共有メモリ、１０・・・・
・・固有メモリ、１１・・・・・・主バス、１２・・・
・・・メモリバス、でアル。

Claims (1)

    【実用新案登録請求の範囲】
  1. 主プロセッサと、この主プロセッサの指令によって動作
    する従プロセッサと、これら主従プロセッサの間のバス
    人出力をデコードするバス制御回路と、このバス制御回
    路の出力によらて前記主プロセッサから前記従プロセッ
    サへおよびこの従フロセッサから主プロセッサへの各メ
    ッセージを一時保持するレジスタと、前記主および従プ
    ロセッサの各メモリのうち各機能ごとに分割して共有き
    れうるメモリ領域からなる共有メモリと、この共有メモ
    リと前記主あるいは従プロセッサとの接続を前記バス制
    御部からの指令によって切換えるメモリスインチ回路と
    を含む共有メモリつきマルチプロセッサ。
JP11232784U 1984-07-24 1984-07-24 共有メモリつきマルチプロセツサ Granted JPS6130148U (ja)

Priority Applications (1)

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JP11232784U JPS6130148U (ja) 1984-07-24 1984-07-24 共有メモリつきマルチプロセツサ

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Application Number Priority Date Filing Date Title
JP11232784U JPS6130148U (ja) 1984-07-24 1984-07-24 共有メモリつきマルチプロセツサ

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Publication Number Publication Date
JPS6130148U true JPS6130148U (ja) 1986-02-22
JPH0215152Y2 JPH0215152Y2 (ja) 1990-04-24

Family

ID=30671389

Family Applications (1)

Application Number Title Priority Date Filing Date
JP11232784U Granted JPS6130148U (ja) 1984-07-24 1984-07-24 共有メモリつきマルチプロセツサ

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JP (1) JPS6130148U (ja)

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Publication number Publication date
JPH0215152Y2 (ja) 1990-04-24

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