JPH0242506A - シーケンス・プログラム・チェック方式 - Google Patents
シーケンス・プログラム・チェック方式Info
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- JPH0242506A JPH0242506A JP63193686A JP19368688A JPH0242506A JP H0242506 A JPH0242506 A JP H0242506A JP 63193686 A JP63193686 A JP 63193686A JP 19368688 A JP19368688 A JP 19368688A JP H0242506 A JPH0242506 A JP H0242506A
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- Japan
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- program
- ladder diagram
- operator
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- 238000010586 diagram Methods 0.000 claims abstract description 52
- 238000000034 method Methods 0.000 claims description 12
- 230000001343 mnemonic effect Effects 0.000 claims description 7
- 239000003086 colorant Substances 0.000 claims 1
- 230000002452 interceptive effect Effects 0.000 abstract description 3
- 238000012545 processing Methods 0.000 description 3
- 238000003672 processing method Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 2
- 239000003795 chemical substances by application Substances 0.000 description 1
- 238000012217 deletion Methods 0.000 description 1
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- 238000012986 modification Methods 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
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- Stored Programmes (AREA)
- Programmable Controllers (AREA)
- Testing And Monitoring For Control Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はシーケンス・プログラム・チェック方式に関し
、特に、入力されたニーモニック形式のプログラムをラ
ダー図に変換して表示装置に表示させ、その表示された
ラダー図を見てオペレータがプログラムの適否を判断す
るシーケンス・プログラム・チェック方式に関する。
、特に、入力されたニーモニック形式のプログラムをラ
ダー図に変換して表示装置に表示させ、その表示された
ラダー図を見てオペレータがプログラムの適否を判断す
るシーケンス・プログラム・チェック方式に関する。
従来、第４図（ａ）に例示したようなニーモニック形式
のプログラムをオペレータが順次キーインし、変換され
たラダー図を表示装置の表示画面上に表示させていた。
のプログラムをオペレータが順次キーインし、変換され
たラダー図を表示装置の表示画面上に表示させていた。
第４図（ａ）のプログラムによる演算結果の状態を第４
図（ｂ）に対比的に示す。まず、ステップ１のリード命
令にて接点Ａ（アドレスＸＯ，Ｏ）がスタック・レジス
タのＳＴｏにセットされる。次いでステップ２のリード
・スタック命令にて、レジスタの内容が１ビツト左にシ
フトされ、接点Ｂ（アドレスＲ１，４）がＳＴＯへ退避
させられる。ステップ３のオア・スタック命令にて、Ｓ
ＴＩに入っている信号とＳＴＯに入っている信号との論
理和がＳＴＯに取り出される。ステップ４のリード・ス
タック命令にて、レジスタが左ヘシフトされ、接点Ｃ（
Ｙｌ、２）がＳＴＯへ退避させられる。ステップ５のリ
ード。
図（ｂ）に対比的に示す。まず、ステップ１のリード命
令にて接点Ａ（アドレスＸＯ，Ｏ）がスタック・レジス
タのＳＴｏにセットされる。次いでステップ２のリード
・スタック命令にて、レジスタの内容が１ビツト左にシ
フトされ、接点Ｂ（アドレスＲ１，４）がＳＴＯへ退避
させられる。ステップ３のオア・スタック命令にて、Ｓ
ＴＩに入っている信号とＳＴＯに入っている信号との論
理和がＳＴＯに取り出される。ステップ４のリード・ス
タック命令にて、レジスタが左ヘシフトされ、接点Ｃ（
Ｙｌ、２）がＳＴＯへ退避させられる。ステップ５のリ
ード。
スタック命令にて、レジスタがさらに左ヘシフトされ、
接点Ｄ（Ｘｌ、６）がＳＴＯに退避させられる。ステッ
プ６のオア・スタック命令にて、ＳＴ１に入っている信
号とＳＴＯに入っている信号との論理和演算が行われて
結果がＳＴＯへ取り出され、ＳＴ２に入っている演算結
果がＳＴＩヘシフトされる。ステップ７のアンド・スタ
ック命令にて、ＳＴＩに入っている演算結果とＳＴＯに
入っている演算結果との論理積演算が行われて、結果が
ＳＴＯに取り出される。ステップ８のライト命令にて、
ＳＴＯに入っている演算結果がコイルＷｌ（アドレスＲ
１，７）に出力される。
接点Ｄ（Ｘｌ、６）がＳＴＯに退避させられる。ステッ
プ６のオア・スタック命令にて、ＳＴ１に入っている信
号とＳＴＯに入っている信号との論理和演算が行われて
結果がＳＴＯへ取り出され、ＳＴ２に入っている演算結
果がＳＴＩヘシフトされる。ステップ７のアンド・スタ
ック命令にて、ＳＴＩに入っている演算結果とＳＴＯに
入っている演算結果との論理積演算が行われて、結果が
ＳＴＯに取り出される。ステップ８のライト命令にて、
ＳＴＯに入っている演算結果がコイルＷｌ（アドレスＲ
１，７）に出力される。
第５図に、第４図（ａ）のプログラムから変換されたラ
ダー図を示す。
ダー図を示す。
ニーモニック形式のプログラムにおいて、スタック・レ
ジスタへ退避させる命令とスタック・レジスタから取り
出す命令とは一対のものであるから、同一のネットにお
けるそれらの数は等しくなければならない、しかしなが
らネットが複雑になるにつれて誤りを生じ易くなり、ス
タック・レジスタベ退避させる命令が多すぎたり、スタ
ック・レジスタから取り出す命令が多すぎたりすること
がある。
ジスタへ退避させる命令とスタック・レジスタから取り
出す命令とは一対のものであるから、同一のネットにお
けるそれらの数は等しくなければならない、しかしなが
らネットが複雑になるにつれて誤りを生じ易くなり、ス
タック・レジスタベ退避させる命令が多すぎたり、スタ
ック・レジスタから取り出す命令が多すぎたりすること
がある。
こうした誤ったプログラムがラダー図に変換されて表示
装置に表示される場合に、プログラムに誤りが有ること
を示すメツセージは従来、何ら表示されなかった。従っ
て、オペレータが気付かずに見過ごすことも少なくなか
った。
装置に表示される場合に、プログラムに誤りが有ること
を示すメツセージは従来、何ら表示されなかった。従っ
て、オペレータが気付かずに見過ごすことも少なくなか
った。
本発明はこのような点に鑑みてなされたものであり、１
ネツト中のスタック使用法に誤りがあることを容易に確
認することの出来るシーケンス・プログラム・チェック
方式を提供することを目的とする。
ネツト中のスタック使用法に誤りがあることを容易に確
認することの出来るシーケンス・プログラム・チェック
方式を提供することを目的とする。
本発明では上記課題を解決するために、ニーモニック形
式のプログラムをラダー図に変換して表示装置に表示さ
せ、表示された前記ラダー図を見てオペレータがプログ
ラムの適否を判断するシーケンス・プログラム・チェッ
ク方式において、 スタックレジスタへ退避させる命令と前記スタックレジ
スタから取り出す命令との数が同一ネット中にて食い違
う誤ったプログラムが入力された場合に前記誤ったプロ
グラムに近いニーモニック形式の近似プログラムを仮定
するステップと、前記近似プログラムをラダー図に変換
した仮定ラダー図を前記表示装置に表示させるステップ
と、前記仮定ラダー図の正否をオペレータに問うメツセ
ージを前記表示装置に表示させるステップと、前記仮定
ラダー図の正否をオペレータがキー入力により答えるス
テップと、 オペレータからの前記キー入力が正である場合に前記仮
定ラダー図と前記近似プログラムとを１ネット分のシー
ケンス・プログラムとして確定するステップと、 を有することを特徴とするシーケンス・プログラム・チ
ェック方式、 が提供される。
式のプログラムをラダー図に変換して表示装置に表示さ
せ、表示された前記ラダー図を見てオペレータがプログ
ラムの適否を判断するシーケンス・プログラム・チェッ
ク方式において、 スタックレジスタへ退避させる命令と前記スタックレジ
スタから取り出す命令との数が同一ネット中にて食い違
う誤ったプログラムが入力された場合に前記誤ったプロ
グラムに近いニーモニック形式の近似プログラムを仮定
するステップと、前記近似プログラムをラダー図に変換
した仮定ラダー図を前記表示装置に表示させるステップ
と、前記仮定ラダー図の正否をオペレータに問うメツセ
ージを前記表示装置に表示させるステップと、前記仮定
ラダー図の正否をオペレータがキー入力により答えるス
テップと、 オペレータからの前記キー入力が正である場合に前記仮
定ラダー図と前記近似プログラムとを１ネット分のシー
ケンス・プログラムとして確定するステップと、 を有することを特徴とするシーケンス・プログラム・チ
ェック方式、 が提供される。
スタック・レジスタへ退避させる命令が多すぎる場合に
は、その退避させる命令と対をなす適切な位置にスタッ
ク・レジスタから取り出す命令が有るものとみなした近
似プログラムを仮定する。
は、その退避させる命令と対をなす適切な位置にスタッ
ク・レジスタから取り出す命令が有るものとみなした近
似プログラムを仮定する。
例えば、先ずアンド・スタック命令があるものとみなし
た近似プログラムを仮定し、これを変換して得られる仮
定ラダー図を表示装置に表示させ、同時に、ｒ ＯＫ
？ 」のメツセージを表示させる。
た近似プログラムを仮定し、これを変換して得られる仮
定ラダー図を表示装置に表示させ、同時に、ｒ ＯＫ
？ 」のメツセージを表示させる。
オペレータからの答がｒＹＥＳＪであれば、上記の近似
プログラムと仮定ラダー図とを１ネット分のシーケンス
・プログラムとして確定する。
プログラムと仮定ラダー図とを１ネット分のシーケンス
・プログラムとして確定する。
もし、オペレータからの答が「ＮＯ」であれば、次いで
オア・スタック命令が有るものとみなした近似プログラ
ムを仮定し、同様の処理をする。
オア・スタック命令が有るものとみなした近似プログラ
ムを仮定し、同様の処理をする。
オペレータからの答が再びｒＮＯＪであった場合には、
余分のリード・スタック命令（スタック・レジスタへ退
避させる命令）を削除した近似プログラムを仮定して同
様の処理をする。
余分のリード・スタック命令（スタック・レジスタへ退
避させる命令）を削除した近似プログラムを仮定して同
様の処理をする。
それでも尚、オペレータからの答がｒＮＯＪであった場
合には、エラー・メツセージを表示して検討を促す。
合には、エラー・メツセージを表示して検討を促す。
スタック・レジスタから取り出す命令（アンド・スタッ
ク命令、オア・スタック命令）の方が多すぎる場合には
、その取り出す命令を削除した近似プログラムを仮定し
、これを変換して得られる仮定ラダー図を表示装置に表
示させ、同時に、ｒ ＯＫ ’ｉ’ 」のメツセージを
表示させる。オペレータからのキー入力がｒＹＥＳＪな
らば、上記の近似プログラムと仮定ラダー図とを１ネッ
ト分のシーケンス・プログラムとして確定する。
ク命令、オア・スタック命令）の方が多すぎる場合には
、その取り出す命令を削除した近似プログラムを仮定し
、これを変換して得られる仮定ラダー図を表示装置に表
示させ、同時に、ｒ ＯＫ ’ｉ’ 」のメツセージを
表示させる。オペレータからのキー入力がｒＹＥＳＪな
らば、上記の近似プログラムと仮定ラダー図とを１ネッ
ト分のシーケンス・プログラムとして確定する。
以下、本発明の一実施例を図面に基づいて説明する。
第１図（ａ）ないしくｇ）に、本発明のシーケンス・プ
ログラム・チェック方式の処理方法を説明するための図
を示す。スタック・レジスタへ退避させる命令が多すぎ
る、誤ったプログラムの例が第１図（ａ）に示されてい
る。このままでラダー図に変換した場合には、ステップ
２のリード・スタック命令（ＲＤ＝ＳＴＫ Ｘｏ、１
）は画面に表示不可能であり、潜在的なプログラムミス
として残ることになる。
ログラム・チェック方式の処理方法を説明するための図
を示す。スタック・レジスタへ退避させる命令が多すぎ
る、誤ったプログラムの例が第１図（ａ）に示されてい
る。このままでラダー図に変換した場合には、ステップ
２のリード・スタック命令（ＲＤ＝ＳＴＫ Ｘｏ、１
）は画面に表示不可能であり、潜在的なプログラムミス
として残ることになる。
そこで第１図（ｂ）に示すような、対をなすアンド・ス
タック命令（ＡＮＤ −５ＴＫ）を挿入した近似プログ
ラムを仮定する。次いで、この近似プログラムを変換し
て得られる仮定のラダー図を表示装置の画面上に表示さ
せ、同時に、仮定ラダー図の正否を問うメツセージとし
てｒ ＯＫ ？ Ｊを表示させる。この段階が第１図（
ｃ）に示されている。オペレータからのキー入力がｒＹ
ＥＳＪならば、第１図（ｂ）のプログラムと第１図（Ｃ
）のラダー図とを（同一のものであるが）ｌネット分の
シーケンス・プログラムとして確定する。
タック命令（ＡＮＤ −５ＴＫ）を挿入した近似プログ
ラムを仮定する。次いで、この近似プログラムを変換し
て得られる仮定のラダー図を表示装置の画面上に表示さ
せ、同時に、仮定ラダー図の正否を問うメツセージとし
てｒ ＯＫ ？ Ｊを表示させる。この段階が第１図（
ｃ）に示されている。オペレータからのキー入力がｒＹ
ＥＳＪならば、第１図（ｂ）のプログラムと第１図（Ｃ
）のラダー図とを（同一のものであるが）ｌネット分の
シーケンス・プログラムとして確定する。
オペレータからのキー入力がｒＮＯ，ならば、次に、第
１図（ｄ）に示すような、オア・スタック命令（ＯＲ−
５ＴＫ）を挿入した近似プログラムを仮定する。次いで
、この近似プログラムを変換したラダー図とｒ Ｑ Ｋ
？ Ｊとを画面に表示させる。この段階が第１図（ｅ
）に示されている。オペレータからのキー入力がｒＹＥ
ｓＪならば、第１図（ｄ）のプログラムと第１図（ｅ）
のラダー図とが１ネット分のシーケンス・プログラムと
して確定される。
１図（ｄ）に示すような、オア・スタック命令（ＯＲ−
５ＴＫ）を挿入した近似プログラムを仮定する。次いで
、この近似プログラムを変換したラダー図とｒ Ｑ Ｋ
？ Ｊとを画面に表示させる。この段階が第１図（ｅ
）に示されている。オペレータからのキー入力がｒＹＥ
ｓＪならば、第１図（ｄ）のプログラムと第１図（ｅ）
のラダー図とが１ネット分のシーケンス・プログラムと
して確定される。
オペレータからのキー入力が再びｒＮＯＪならば、次に
、余分なリード・スタック命令を削除した、第１図（ｆ
）に示すような近似プログラムを仮定する０次いで、こ
の近似プログラムを変換して得られるラダー図とｒ Ｏ
Ｋ ？ Ｊのメツセージとを画面に表示させる。この段
階が第１図（ｇ）に示されている。オペレータからの答
がｒＹＥｓＪならば、第１図（ｆ）のプログラムと第１
図（ｇ）のラダー図とが１ネット分のシーケンス・プロ
グラムとして確定される。
、余分なリード・スタック命令を削除した、第１図（ｆ
）に示すような近似プログラムを仮定する０次いで、こ
の近似プログラムを変換して得られるラダー図とｒ Ｏ
Ｋ ？ Ｊのメツセージとを画面に表示させる。この段
階が第１図（ｇ）に示されている。オペレータからの答
がｒＹＥｓＪならば、第１図（ｆ）のプログラムと第１
図（ｇ）のラダー図とが１ネット分のシーケンス・プロ
グラムとして確定される。
それでも尚、オペレータからのキー入力が「ＮＯ」であ
れば、エラー・メツセージを表示して検討を促す。
れば、エラー・メツセージを表示して検討を促す。
第２図（ａ）ないしくＣ）に、スタック・レジスタから
取り出す命令が多すぎる場合の、本発明のシーケンス・
プログラム・チェック方式の説明図を示す。第２図（ａ
）において、ステップ２のリード・スタック命令とステ
ップ３のアンド・スタック命令とが対をなして、第２図
（Ｃ）のラダー図における接点Ｓを表現している。しか
しながら、第２図（ａ）のステップ４のアンド・スタッ
ク命令は余分のものである。従って、第２図（ａ）のプ
ログラムをラダー図に変換した場合にもステップ４のア
ンド・スタック命令は表現不可能であり、気付かれない
まま、バグとして潜在する危険がある。
取り出す命令が多すぎる場合の、本発明のシーケンス・
プログラム・チェック方式の説明図を示す。第２図（ａ
）において、ステップ２のリード・スタック命令とステ
ップ３のアンド・スタック命令とが対をなして、第２図
（Ｃ）のラダー図における接点Ｓを表現している。しか
しながら、第２図（ａ）のステップ４のアンド・スタッ
ク命令は余分のものである。従って、第２図（ａ）のプ
ログラムをラダー図に変換した場合にもステップ４のア
ンド・スタック命令は表現不可能であり、気付かれない
まま、バグとして潜在する危険がある。
そこで、余分のアンド・スタック命令を削除した、第２
図（ｂ、）のような近似プログラムを仮定する。次に、
この近似プログラムを変換した仮定ラダー図を画面に表
示させる。また、この仮定ラダー図の正否を問うメツセ
ージとしてｒ ＯＫ ？ 」を表示させる。オペレータ
からのキー入力が［ＹＥＳＪであれば、第２図（ｂ）の
近似プログラムと第２図（ｃ）の仮定ラダー図とを、１
ネット分のシーケンス・プログラムとして確定する。
図（ｂ、）のような近似プログラムを仮定する。次に、
この近似プログラムを変換した仮定ラダー図を画面に表
示させる。また、この仮定ラダー図の正否を問うメツセ
ージとしてｒ ＯＫ ？ 」を表示させる。オペレータ
からのキー入力が［ＹＥＳＪであれば、第２図（ｂ）の
近似プログラムと第２図（ｃ）の仮定ラダー図とを、１
ネット分のシーケンス・プログラムとして確定する。
もし、オペレータからのキー入力がｒＮＯＪならば、エ
ラー・メツセージを表示して検討を促す。
ラー・メツセージを表示して検討を促す。
以上の説明により明らかなようにｒ ＯＫ ？ Ｊのメ
ツセージが表示されることによりオペレータは何らかの
プログラム・ミスの有ったことに気付くことが出来、ま
た、そのプログラム・ミスを対話形式にて容易に修正す
ることが出来る。
ツセージが表示されることによりオペレータは何らかの
プログラム・ミスの有ったことに気付くことが出来、ま
た、そのプログラム・ミスを対話形式にて容易に修正す
ることが出来る。
仮定ラダー図と確定したラダー図とは、表示装置の画面
上における反転表示により区別して表示するのが効果的
である。また、反転表示の代わりに色彩を変更して表示
するようにしてもよい。
上における反転表示により区別して表示するのが効果的
である。また、反転表示の代わりに色彩を変更して表示
するようにしてもよい。
第３図に本発明を実施するためのプログラム作成装置と
ＰＣ（プログラマブル・コントローラ）のハードウェア
のブロック図を示す。図において、ｌはプログラム作成
装置、２は表示画面でありＣＲＴ、液晶表示装置等が使
用される。表示画面２には、第１図（Ｃ）、（ｅ）、（
ｇ）及び第２図（ｃ）に示す表示画面が表示される。３
はファンクションキーであり、削除、複写、変更等のフ
ァンクションを指令する。４は操作キーである。
ＰＣ（プログラマブル・コントローラ）のハードウェア
のブロック図を示す。図において、ｌはプログラム作成
装置、２は表示画面でありＣＲＴ、液晶表示装置等が使
用される。表示画面２には、第１図（Ｃ）、（ｅ）、（
ｇ）及び第２図（ｃ）に示す表示画面が表示される。３
はファンクションキーであり、削除、複写、変更等のフ
ァンクションを指令する。４は操作キーである。
プログラム作成装置１はマイクロプロセッサ構成となっ
ており、上記に説明した表示処理はプログラム作成装置
１内のマイクロプロセッサによって処理される。
ており、上記に説明した表示処理はプログラム作成装置
１内のマイクロプロセッサによって処理される。
１０はＰＣ（プログラマブル・コントローラ）、１１は
ＰＣ全体を制御するプロセッサである。１２は入力回路
であり、外部からの信号を受け、信号レベルを変換して
バスに転送する。１３は出力回路であり、内部の出力信
号を外部へ出力する。
ＰＣ全体を制御するプロセッサである。１２は入力回路
であり、外部からの信号を受け、信号レベルを変換して
バスに転送する。１３は出力回路であり、内部の出力信
号を外部へ出力する。
２０はＲＯＭであり、その内部にはラダープログラムの
実行を管理する管理プログラム２１と工作機械等を制御
するためのラダー言語で作成されたラダープログラム２
２等が格納されている。３０はＲＡＭであり、各種のデ
ータが格納されており、入力信号、出力信号、補助リレ
ー信号、内部レジスタ信号もここに格納される。
実行を管理する管理プログラム２１と工作機械等を制御
するためのラダー言語で作成されたラダープログラム２
２等が格納されている。３０はＲＡＭであり、各種のデ
ータが格納されており、入力信号、出力信号、補助リレ
ー信号、内部レジスタ信号もここに格納される。
４０はプログラム作成装置用のインタフェースであり、
バスとプログラム作成装置を接続するためのインタフェ
ース回路である。
バスとプログラム作成装置を接続するためのインタフェ
ース回路である。
以上説明したように本発明では、プログラムの１ネツト
中にスタック使用ミスが有った場合に、そのミスの存在
にオペレータが気付くことが出来、また、対話形式で容
易にそのミスを修正できるようにしたので、デバッグに
要する時間が短縮され、シーケンス・プログラム全体の
作成時間が大幅に短縮される。
中にスタック使用ミスが有った場合に、そのミスの存在
にオペレータが気付くことが出来、また、対話形式で容
易にそのミスを修正できるようにしたので、デバッグに
要する時間が短縮され、シーケンス・プログラム全体の
作成時間が大幅に短縮される。
第１図（ａ）ないしくｇ）はスタック・レジスタへ退避
させる命令が多すぎる場合の本発明のシーケンス・プロ
グラム・チェック方式の処理方法を示す説明図、 第２図（ａ）ないしくＣ）はスタック・レジスタから取
り出す命令が多すぎる場合の、本発明による処理方法を
示す説明図、 第３図は本発明を実施するためのプログラム作成装置と
ＰＣ（プログラマブル・コントローラ）のハードウェア
のブロック図、 第４図（ａ）及び（ｂ）はプログラム例と演算結果の状
態とを対比的に示した従来技術の説明図、第５図は第４
図のプログラムを変換して得られるラダー図である。 ＡＭ ４０・ インタフェース 特許出願人 ファナック株式会社 代理人 弁理士 服部毅巖 １−・・・・・・−一−−−−−・プログラム作成装置
２・・・−−−−一−・・・・・・−表示画面３−・−
−−−−一−−・・ファンクションキー４−−−一−・
−・−・操作キー １０・−一−−−−−−−・・−・・ＰＣ（７’ログラ
マプル・コントローラ） １１−・−・−・・−・プロセンサ ２０−・・−・−・・・−・ＲＯＭ 第４図 第５図 第 図
させる命令が多すぎる場合の本発明のシーケンス・プロ
グラム・チェック方式の処理方法を示す説明図、 第２図（ａ）ないしくＣ）はスタック・レジスタから取
り出す命令が多すぎる場合の、本発明による処理方法を
示す説明図、 第３図は本発明を実施するためのプログラム作成装置と
ＰＣ（プログラマブル・コントローラ）のハードウェア
のブロック図、 第４図（ａ）及び（ｂ）はプログラム例と演算結果の状
態とを対比的に示した従来技術の説明図、第５図は第４
図のプログラムを変換して得られるラダー図である。 ＡＭ ４０・ インタフェース 特許出願人 ファナック株式会社 代理人 弁理士 服部毅巖 １−・・・・・・−一−−−−−・プログラム作成装置
２・・・−−−−一−・・・・・・−表示画面３−・−
−−−−一−−・・ファンクションキー４−−−一−・
−・−・操作キー １０・−一−−−−−−−・・−・・ＰＣ（７’ログラ
マプル・コントローラ） １１−・−・−・・−・プロセンサ ２０−・・−・−・・・−・ＲＯＭ 第４図 第５図 第 図
Claims (3)
- （１）ニーモニック形式のプログラムをラダー図に変換
して表示装置に表示させ、表示された前記ラダー図を見
てオペレータがプログラムの適否を判断するシーケンス
・プログラム・チェック方式において、 スタックレジスタへ退避させる命令と前記スタックレジ
スタから取り出す命令との数が同一ネット中にて食い違
う誤ったプログラムが入力された場合に前記誤ったプロ
グラムに近いニーモニック形式の近似プログラムを仮定
するステップと、前記近似プログラムをラダー図に変換
した仮定ラダー図を前記表示装置に表示させるステップ
と、前記仮定ラダー図の正否をオペレータに問うメッセ
ージを前記表示装置に表示させるステップと、前記仮定
ラダー図の正否をオペレータがキー入力により答えるス
テップと、 オペレータからの前記キー入力が正である場合に前記仮
定ラダー図と前記近似プログラムとを１ネット分のシー
ケンス・プログラムとして確定するステップと、 を有することを特徴とするシーケンス・プログラム・チ
ェック方式。 - （２）前記仮定ラダー図と前記確定したラダー図とを、
前記表示装置における反転表示により区別して表示する
ことを特徴とする特許請求の範囲第１項記載のシーケン
ス・プログラム・チェック方式。 - （３）前記仮定ラダー図と前記確定したラダー図とを、
前記表示装置における色彩変更により区別して表示する
ことを特徴とする特許請求の範囲第１項記載のシーケン
ス・プログラム・チェック方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63193686A JPH0242506A (ja) | 1988-08-03 | 1988-08-03 | シーケンス・プログラム・チェック方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63193686A JPH0242506A (ja) | 1988-08-03 | 1988-08-03 | シーケンス・プログラム・チェック方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0242506A true JPH0242506A (ja) | 1990-02-13 |
Family
ID=16312097
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63193686A Pending JPH0242506A (ja) | 1988-08-03 | 1988-08-03 | シーケンス・プログラム・チェック方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0242506A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002229927A (ja) * | 2001-02-01 | 2002-08-16 | Howa Mach Ltd | フラグ情報による制御プログラム及び入出力制御方法 |
-
1988
- 1988-08-03 JP JP63193686A patent/JPH0242506A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2002229927A (ja) * | 2001-02-01 | 2002-08-16 | Howa Mach Ltd | フラグ情報による制御プログラム及び入出力制御方法 |
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