JPH0247774A - 表示システム及び方法 - Google Patents

表示システム及び方法

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JPH0247774A
JPH0247774A JP1155976A JP15597689A JPH0247774A JP H0247774 A JPH0247774 A JP H0247774A JP 1155976 A JP1155976 A JP 1155976A JP 15597689 A JP15597689 A JP 15597689A JP H0247774 A JPH0247774 A JP H0247774A
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JP
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display
bit
image
pels
pel
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JP1155976A
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Paul D Dinicola
ポール・デヴイド・デイニコラ
Francois N Dumas
フランコインス・ノーマンド・ダーマス
John Joseph Lawless
ジヨン・ジヨセフ・ローレス
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International Business Machines Corp
Original Assignee
International Business Machines Corp
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Publication date
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    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G5/00—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
    • G09G5/02—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators characterised by the way in which colour is displayed
    • G09G5/022—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators characterised by the way in which colour is displayed using memory planes
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G5/00—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
    • G09G5/36—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators characterised by the display of a graphic pattern, e.g. using an all-points-addressable [APA] memory
    • G09G5/39—Control of the bit-mapped memory
    • G09G5/395—Arrangements specially adapted for transferring the contents of the bit-mapped memory to the screen

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  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • General Physics & Mathematics (AREA)
  • Theoretical Computer Science (AREA)
  • Controls And Circuits For Display Device (AREA)
  • Digital Computer Display Output (AREA)
  • Processing Or Creating Images (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 Ａ、産業上の利用分野 本発明は、−船釣には、コンピュータ表示システムに関
し、具体的にはイメージを複数のカラーで表示し、デー
タを多くのソフトウェア・アプリケーション・プログラ
ムから表示し、あるいはいくつかの陰極線管（ＣＲＴ）
もしくはコンピュータ及びデータ処理システムで普通に
使用されている表示装置上でいくつかのイメージを組合
せるハードウェア及びソフトウェアに関する。より具体
的には、本発明はカラーもしくはグレーの多くの陰影（
シェード）による図形もしくは文字出力の表示及び１以
上の表示オブジェクトのアニメーション即ち移動が望ま
れる場合のデータの表示に関する。
Ｂ、従来技術 図形表示システムは表示すべき図形もしくは文字情報を
表わすデータを離散的な画素即ちペルにエンコードする
。代表的にはランダム・ラフセス・メモリ（ＲＡＭ）で
あるディジタル・メモリが、表示フレームを構成するエ
ンコード化ペルを記憶する。次に図形表示が記憶された
ペル・データをアクセスするビデオ・プロセッサによっ
て発生され、データをカラーもしくは多くのグレーの陰
影のイメージを発生するための表示モニタに必要な信号
にデコードし、この信号をＣＲＴもしくは他の表示モニ
タに転送する。ペルは表示モニタのフェイス・プレート
のラスク走査として迅速に表示される０代表的な場合は
水平方向である走査は、多くの走査線より成り、各走査
線は多くのペルより成る。
メモリ中に記憶されたペル・データは代表的な場合、２
つの形式のうちの一方でデコードされる。
ビット・エンコード図形システムでは、各ペルはいくつ
かの、たとえば３つの２進単位、即ちビットで表わされ
る。ビットはプレーン中に組織化され、各プレーンは表
示モニタ上の各ペルに対して１ビツトを有する。従って
特定のペルを表わすデータの３ビツトは、３つの別個の
ビット・プレーン中の同じ垂直及び水平オフセット位置
に記憶される。最終のビデオ表示スクリーンは同時にビ
ット・プレーンをアクセスし、得られた３ビツトの組を
交換テーブルに送り、カラーもしくはグレーの陰影を発
生するのに必要な制御信号を発生することによって発生
される。個々のビット・プレーンは最終表示構造を発生
するのに必要な一部だけを含み５表示イメージ構造が実
現されるのは、３つのプレーンの組合せ、及び関連する
カラーもしくはグレーの陰影のデコードによってだけで
ある。
エンコーディングの第２の方法は、横方向ビット・エン
コーディングである。この方法では、ビットの順次的組
合せが表示イメージの各ペルのエンコードに使用される
。たとえば２ビツトのシーケンスを使用して表示モニタ
上の各ペルがエンコードれる。もし各ペルをエンコード
するのに１ビツトしか使用されないと、このビットはペ
ルがオンであるかオフであるかを単に示すだけである。
もしオンならば、システムの指定した前景カラーが表示
され、そうでない時は背景カラーが表示される。もしペ
ル当り２ビツトが使用される時は、非Ｏ値は３つの前景
カラーのうちどれが表示されるかを示す。横方向ビット
・エンコード・イメージは単一のビット・プレート中に
記憶でき、たとえば左から右そして上から下へ、相対的
スクリーン位置で順次アクセスされる。
従来技術の中には、ビット・プレーン及び横方向ビット
・エンコード図形表示システムの両方のいくつかの例が
ある。
米国特許第４６９１２９５号はビット・エンコード図形
表示に４ビツト・プレーンを使用した図形システムを開
示している。この特許は、これ等のビット・プレーンを
一群として使用して、単一のビット・エンコード・イメ
ージを形成する事、個々のビット・プレーンからのデー
タの選択的表示が可能である。しかしながら、この特許
はビット・エンコード・モードもしくは横方ビット・エ
ンコード・モードの両方で動作して、異なった″パーソ
ナリティ″を有するシステムを構成できる表示システム
を開示していない。
他の装置は多くのメモリ・バッファを使用して、スクリ
ーン上に一連の横方向ビット・エンコード・イメージを
記憶して発生している。米国特許第４６５３０２０号は
多くのバッファを使用して、多くのアプリケーションか
ら発生されるエンフード文字を記憶するシステムを開示
している。バッファの各々は表示スクリーン上の別個の
ウィンドー中に表示する。いくつかのバッファからのデ
ータの組合せは行われていない。この特許は文字の表示
にのみ関し１図形イメージの表示には関していない。
米国特許第４３１７１１４号は、いくつかの横方向ビッ
ト・エンコード・イメージ・プレーンが上位コンピュー
タ・システムからのデータと重亜され、混合されて、最
終の表示スクリーン・イメージを形成している。この特
許はバッファの多重使用を開示していす、イメージの混
合を制御する方法を開示していない。
米国特許第４６８２２９７号は別個のメモリ・バッファ
からの多くのイメージを混合することによる合成イメー
ジを形成する図形表示システムを開示している。透明カ
ラーが存在する個所では、背景のイメージが眺められる
ようにする透明カラーの選択によってイメージが混合さ
れている。この具体例は移動するオブジェクトの表示を
発生するのに有用である。それは移動するオブジェクト
が単一プレーン上で移動（即ち消去及び再表示）でき、
このオブジェクトが非移動オブジェクトを含む他のプレ
ーンと混合できるからである６しかしながら、この特許
は２つのイメージ・バッファだけを混合する装置を与え
ている。この装置は３もしくはそれ以上のバッファには
容易には拡張できず、バッファの２重使用を開示してい
ない。
従って、従来技術の表示システムは代表的には、２つの
イメージ・エンコード方法の一方だけを支援するか、主
に１つの方法を支援して、第２の方法は限定的な支援を
受けているに過ぎない。この機能的硬直性は特定の図形
表示システムの応用を制限し、特に汎用表示システムの
分野で著しく不利である。
Ｃ１発明が解決しようとする問題点 本発明の目的は、図形表示環境において、ビット・エン
コード及ヒ多重プレーン横方向エンコード技術の両方向
を支援する、ハードウェア及びソフトウェア装置及び方
法を与えることにある。
Ｄ０問題点を解決するための手段 単一のハードウェア構造体に、ビット・エンコードを使
用して広範囲のカラーの表示を支援でき。
横方向のビット・エンコードを使用していくつかの独立
したアプリケーション・プログラムの表示もしくは多重
イメージ混合を支援するのに使用される多くの独立した
メモリ・バッファが与えられる。
たとえば、ハードウェア中に３つのバッファが使用され
る時は、システムは２３＝８のカラーのビット・エンコ
ード及び表示もしくは３つの独立したアプリケーション
もしくはイメージの集合の横方向ビット・エンコードを
支援する。横方向ビット・エンコード・メモリ・バッフ
ァからのイメージはハードウェアもしくはソフトウェア
を使用して混合されて合成イメージを与えることができ
、見かけのイメージの移動もしくはアニメーションを支
援することができる。イメージの混合がハードウェアで
具体化されると、イメージは合成イメージを含む中間フ
レーム・バッファを発生しないで組み合され、直接ビデ
オ表示モニタに書込むことができる。この技術は限られ
た処理能力を有するコンピュータ装置中の表示システム
の効率を改善する。それは１つのプレーン中のオブジェ
クトの移動もしくは任意のプレーン中のイメージの変更
に、中間フレーム・バッファの完全な再生の必要がない
からである。横方向ビット・エンコード・バッファは各
々プロセッサ中で実行されている個別のアプリケージ言
ン・プログラムに関連でき、そのアプリケーションから
の出力メツセージを捕えることができる。表示システム
は、結果の独立したイメージを別個に表示モニタ上に表
示するように構成でき、もしくは２以上のイメージを組
合して、合成表示イメージが形成できる。最後に、３つ
のバッファをリンクして、リンクされたイメージがあた
かも１つの大きなページをなしているかのように、滑ら
かな画面移動が可能である。
Ｆ、実施例 本発明は１表示装置上に図形イメージを表示するための
図形表示システムに関する。本発明はラスク走査陰極線
管（ＣＲＴ）表示装置で使用するように説明されるが、
その概念はガス・パネル及び液晶表示装置を含む、他の
多くのタイプにも適用できる。
本発明の図形表示システムを第１図のブロック図に示す
。アプリケーションもしくはオペレーティング・システ
ム・プログラムを実行しているプロセッサ１０は出力メ
ツセージを発生して、これをデータ経路１１に沿って図
形表示アダプタ２０に送る。図形表示アダプタ２０はそ
の主要機能として出力メツセージを、ビデオ表示モニタ
５０上に表示を発生するための制御信号を発生するのに
適した形に変換する。表示モニタ５０は、好ましい実施
例では、たとえばＩＢＭモデル５２７２カラー表示モニ
タのような、赤、緑及び青の制御信号に応答する標準の
表示モニタである。赤、緑及び青の制御信号の値は表示
モニタの適切な点に必要なカラーのイメージを発生させ
る。
本発明を具体化した図形表示アダプタは、次の主要部品
を有する。プロセッサ１０から出力メツセージは様式化
されてメモリ・バッファ、即ちビット・プレーン２４．
２６．２８及び３０中に記憶される。各ビット・プレー
ンは最小限度５表示モニタ５０の１スクリーンを充填す
るのに十分な記憶位置を含んでいる。たとえば、好まし
い実施例では、表示モニタは、各々７２０のペルを有す
る３５０本の水平線を表示できる容量を有する。
従って、例示のシステムでは、各ビット・プレーンは少
なくとも２５２０００ビツトを含まなければならない。
ビット・エンコーディングには各プレーン中にペル当り
１ビツトを必要とするが、横方向のビット・エンコーデ
ィングでは数ビットを必要とする。
イネーブル・プレーン・レジスタ２２はプロセッサ１０
からの制御信号１２に応答して図形表示アダプタのエン
コード状態を選択する。図形表示エンコード状態は多重
プレーン・ビット・エンコードもしくは単一プレーン横
方向ビット・エンコード状態のいずれかである。もし横
方向ビット・エンコード状態が選択されている時は、イ
ネーブル・プレーン・レジスタ・２２はビット・プレー
ンを選択してプロセッサ１ｏからのデータを受取る。
イメージ混合器（兼ビデオ制御選択器）３２はビット・
プレーン（メモリ・バッファ）２４．２６．２８及び３
ｏからエンコード化された図形データを読取って、必要
なデコーディング及びイメージ混合を行う。もしビット
・プレーン・エコーディングが使用されている時には、
イメージ混合器３２はビット・プレーンから対応するビ
ットを選択し、これ等をカラー変換テーブル３４に渡す
。
テーブル３４はこのコードを適切な赤、緑及び前制御信
号に変換する。この制御信号はデータ・チャネル４０を
介して表示モニタ５０に渡される。
横方向ビット・エンコード状態では、イメージ混合器３
２は、ビット・プレーン優先順位に従ってビット・プレ
ーンに含まれたイメージを組合す。
特定のプレーンからのイメージの表示は（イメージ混合
器前）ビデオ制御選択器３２によってイネーブルされ、
表示のために１以上のプレーンがイネーブルされる。混
合されたイメージはカラー変換テーブル３４に渡され、
テーブル３４は適切な制御信号をデータ・チャネル４０
を介して表示モニタ５０に渡す。
第２図及び第３図は、ペル・データの、ビット・プレー
ンを使用するビット・エンコーディングと横方向ビット
・エンコーディングの差を示す、第２図は３つのビット
・プレーン７０．７２及び７４を示している。スクリー
ン上の所定の位置に対応するペルは３つのビット・プレ
ーンの各々中の対応するビットによって表わされる。た
とえば、第２図で、最初のペルはビットｃｏ、ｃｌ、Ｃ
２によって表わされている。表示イメージの次のペルは
各プレーン中の次のビット位置、即ちｄｏ、ｄｌ、ｄ２
によって表わされている。任意の１つのプレーン中に記
憶されている情報は表示モニタ上にペルを発生するのに
必要な情報の一部を表わすに過ぎない。プレーンのどれ
もイメージの全構造を表わしていず、最終イメージを明
らかにするのは、いくつかのプレーンの組合せだけであ
る。
データは各ビット・プレーンの同じ相対位置から同時に
読取られる。たとえば、ビットＣ０１Ｃ１及びＣ２がビ
ット・プレーンから読取られて、表示のための単一のペ
ルが形成される。Ｃ０１Ｃ１及びＣ２によって表わされ
たペルのデコーディングを次の表に示す。Ｃ０１Ｃ１及
びＣ２が夫々値１．１、Ｏを有する場合は、表示モニタ
上のこの位置でシアンのカラーが発生される（変換テー
ブル中でｃｏは最下位のビットであることに注意された
い）。
表 イメージの横方向ビット・エンコーディングでは、１つ
のイメージを記憶するのに唯１のビット・プレーン８０
が使用される。他のプレーン８２及び８４は他のイメー
ジを記憶している。第３図で、ペルはビット・プレーン
８０中の最初の３つのビットｅＯ，ｅ１、Ｃ２にエンコ
ードされている。
この出力によって、このペルに表示されるべき前景カラ
ー（もしあれば）が決定される。横方向ビット・、エン
コーデンでは、イメージの全フオームが単一のビット・
プレーンで表わされている。
本発明の強調すべき特徴は、ビット・プレーン２４．２
６．２８．３０の各々をビット・プレーン・エンコード
・モードもしくは横方向ビット・エンコード・モードの
両方で使用できる能力にある。上述のように、従来技術
の装置はペル・エンコーデング方法の一方だけを、代表
的な場合具体化してる。ある場合は、従来技術の装置は
ビット・プレーン・エンコーディングを支援し、ビット
・プレーンの１つが横方向ビット・エンコード・モード
に使用できているだけである。本発明に従えば、図形ア
ダプタ中に存在するビット・プレーンのすべてが、横方
向ビット・エンコード・モードで同時に使用可能である
。イネーブル・プレーン・レジスタ２２はアダプタがビ
ット・プレーン・モードにあるか横方向ビット・モード
にあるかどうかを決定し、アダプタが横方向ビット・モ
ードにある時は、イネーブル・プレーン・レジスタ２２
がプロセッサ１０からの出力の・特定のビット・プレー
ン２４．２６．２８もしくは３０への関連付けを制御す
る。このようにして、プロセッサ１゜中で実行中の異な
るアプリケーションは各々異なるビット・プレーンに書
込むことができ、あるいは１つのアプリケーションが１
つのイメージの別個の成分を別個のプレーン上に記憶し
て、後に混合することができる。たとえば、プレーンは
中間のオブジェクトの見かけ上の移動が望まれる場合に
、背景、前景及び中間のオブジェクトに使用できる。こ
れ等のビット・プレーンは次に別個に読取られて、表示
モニタ５０上に書込むことができる。
本発明は又別個の横方向ビット・エンコード・プレーン
からのイメージを組合す手段を与える。
イメージの混合はビット・プレーンからのデータを読取
り、イメージのデータを組合せて、これを直接表示モニ
タに送るイメージ混合器（兼ビデオ制御選択器）３２に
よって遂行される。中間フレーム・バッファはイメージ
混合動作の結果を記憶する必要がない。このことは、ビ
ット・プレーンの１つを変更しても、中間プレーム・バ
ッファの完全な再生を必要としないので著しい利点であ
る。
この改良イメージ混合法は表示モニタ上のアニメーショ
ンにとって特に有用である。このイメージ混合論理によ
って、移動するオブジェクトに関連する前景及び背景オ
ブジェクトの適切な処理が可能になる。
単一のアプリケーションによって、３つの異なるビット
・プレーンに書込むことができるようにすることができ
る。たとえば、ビット・プレーン２４が前景オブジェク
トを保持し、ビット・プレーンが移動オブジェクトを保
持し、他方ビット・プレーン２８が背景オブジェクトを
保持するように設計できる。第５図はこの概念の適用を
示す。
第５Ｃ図に示したような木は前景ビット・プレーン２６
に書込むことができる。ボールは第５Ｂ図に示したよう
に移動オブジェクト・プレーン２６に書込むことができ
る。最後に、家は第５Ａ図に示したように、背景ビット
・プレーン２８に書込むことができる。イメージ混合器
３２はこれ等３つのビット・プレーンの各々からのペル
・データを組合して、第５Ｄ図に示した表示を表示モニ
タ５０上に発生する。この表示では、木は家とボールの
両方の手前に現われ、ボールは家の手前に現われている
。もしボールの移動がアニメートされていて、ボールが
図面の左から右へ移動される時は、移動オブジェクト・
ビット・プレーン２６だけを変更すればよい。イメージ
混合器３２は３つのビット・プレーンからのペルを適切
な順序に組合せることによって１表示モニタ上に適切な
表示を発生し続ける。移動することによって露出される
ようになる背景オブジェクトの隠された部分を再発生し
なければならないことによって生ずる非効率性はなくな
る。
イメージ混合器３２の論理ブロック図を第４図に示す。
この論理はソフトウェアもしくはハードウェア論理回路
のいずれかで具体化できることば明らかであろう。好ま
しい実施例では、この論理はプロセッサ１０に必要とさ
れる処理ワークロードを減少するために、ハードウェア
で具体化される。これによって、プロセッサ１０の容量
が小さい場合でも、極めて効率的で信頼性のおける図形
表示システムを与えるという利点が与えられる。
第４図を参照すると、横方向ビット・エンコード・デー
タは、ビデオ選択制御器３３によってイネーブルされた
ビット・プレーン２４．２６及び２８の各々から同時に
アクセスできる。アクセルされた各ペルは表示のための
ブランクもしくは非ブランクのイメージを表わしている
。好ましい実施例では、ブランクのイメージは２進０に
よって表わされる（即ち、もし３ビツト横方向エンコー
デイングを使用しているのであれば、ペルの値は２進’
ｏ　ｏ　ｏ’　によって表わされる）。表示の優先順位
が確立されて、ビット・プレーン２４がビット・プレー
ン２６の上に１桑して表示され、これ等の両ビット・プ
レーンがビット・プレーン２８の上に表示される。比較
器がプレーン１から非Ｏペル・コードが読取られたと判
断すると、このコードは赤、緑及び青色の出力９１．９
２及び９３を通して転送される。ビット・プレーン２４
からのビット・コードは０であるが、プレーン２６から
のビット・コードが非Ｏである時は、ビット・プレーン
２６からのイメージが表示される。同じように、プレー
ン２４及びプレーン２６からのビット・コードがＯで、
プレーン２８からのコードが非０の時は、プレーン２８
のコードが表示される。最後に、３つのペル・コードす
べてが０ならば、背景カラーが表示される。
代替動作形式として、メモリ・バッファ２４．２６．２
８の各々は別個のアプリケーションからのエンコードさ
れた表示イメージを記憶できる。
イネーブル・プレーン・レジスタ２２は特定のメモリ・
バッファをアプリケーションと関連付ける。
ビデオ選択制御器３３が制御信号に応答して、イメージ
の１つを表示する。
さらに他の動作形式では、ビット・プレーンは単一の大
きなイメージの記憶領域を形成するように連結できる（
第６図）。このイメージは、あたかもこれが連続したイ
メージであるかのように、表示モニタ上になめらかに画
面移動できる。この連結はイメージ混合器３２、並びに
具体的には、表示モニタ５ｏとビデオ選択制御器３３間
の相互作用によって制御され、データが連続的に表示さ
れる。
Ｆ０発明の効果 本発明に従えば、図形表示環境において、ビット・エン
コード及び多重プレーン横方向エンコード技術の両方を
支援する、ハードウェア及びソフトウェア装置及び方法
が与えられる。
【図面の簡単な説明】
第１図は、本発明を具体化した図形表示システムの主要
要素のブロック図である。 第２図は、ビット・エンコード化ペルのメモリの図であ
る。 第３図は、横方向ビット・エンコード化ペルのメモリの
図である。 第４図は１本発明に従うイメージ混合のための論理ブロ
ック図である。 第５図は、本発明に従うイメージ混合の具体例を示した
図である。 第６図は、本発明に従う大きなイメージの連結の具体例
を示した図である。 １０・・・・・・プロセッサ、２０・・・・・・図形表
示アダプタ、２２・・・・・・イネーブル・プレーン・
レジスタ、２４．２６．２８．３０・・・・・・ビット
・プレーン、３２・・・・・・イメージ混合器兼ビデオ
制御選択器、３４・・・・・・カラー変換テーブル、５
０・・・・・・表示モニタ出願人　　インターナショナ
ル・ビジネス・マシーンズ・コーポレーション 代理人　　弁理士　　山　　本　　仁　　朗（外１名）

Claims (2)

    【特許請求の範囲】
  1. （１）（イ）複数のペルによって表わされる図形イメー
    ジを記憶するために、複数のメモリ・バッファで組織化
    されていて、上記ペルの各々がエンコードされて、上記
    複数のメモリ・バッファ中の夫々の位置に記憶される第
    １の表示システム状態もしくは上記ペルの各々がエンコ
    ードされて、上記メモリ・バッファの１つの相継ぐ位置
    中に記憶される第２の表示システム状態で動作可能なメ
    モリ装置と、 （ロ）上記第１の表示システム状態と上記第２の表示シ
    ステム状態間で選択を行う状態制御装置と、 （ハ）上記複数のメモリ・バッファの１つもしくはそれ
    以上を、１つもしくはそれ以上のエンコード化図形イメ
    ージ発生アプリケーション・プログラムと関連付けて、
    表示システムが上記第２の表示システム状態にある時に
    動作する制御装置と、 （ニ）上記複数のメモリ・バッファの１つもしくはそれ
    以上からペルを表示装置に転送せしめる選択装置と、 （ホ）イメージ表示の優先順位に従って、上記複数のメ
    モリ・バッファの１つもしくはそれ以上からの上記ペル
    を表示のために組合せるイメージ混合装置とを有する、 表示装置上に図形イメージを表示する表示システム。
  2. （２）図形表示装置の表示領域に表示するための、各々
    ペルで表わされたイメージを含む複数のメモリ・バッフ
    ァ中にエンコード化ペルとして記憶されたイメージを組
    合して表示する方法であって、該方法は上記表示領域中
    の位置に対応する各ペルの記憶装置について次の段階を
    繰返す、イメージを組合して表示する方法。 （イ）同じ表示領域の位置に対応するペルを上記複数の
    メモリ・バッファの各々から同時にアクセスし、 （ロ）上記複数のメモリ・バッファの各々について表示
    の優先順位を決定し、 （ハ）上記表示の優先順位の順序で、各対応するペルを
    調べて、上記ペルが上記表示領域の非ブランク・イメー
    ジ部分を表わすかどうかを判断し、 （ニ）もし上記ペルが上記表示領域の非ブランク・イメ
    ージ部分を表わすならば、上記調べたペルを表示し、 （ホ）一度１つのペルが表示されると、残りの対応する
    ペルを無視し、 （ヘ）もし上記対応するペルのどれも非ブランク・イメ
    ージ部分を表わさない時は、背景カラーを表示する。
JP1155976A 1988-07-22 1989-06-20 表示システム及び方法 Pending JPH0247774A (ja)

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