JPH0247850U - - Google Patents
Info
- Publication number
- JPH0247850U JPH0247850U JP12641688U JP12641688U JPH0247850U JP H0247850 U JPH0247850 U JP H0247850U JP 12641688 U JP12641688 U JP 12641688U JP 12641688 U JP12641688 U JP 12641688U JP H0247850 U JPH0247850 U JP H0247850U
- Authority
- JP
- Japan
- Prior art keywords
- level
- reset signal
- counter
- clock
- reception
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000005540 biological transmission Effects 0.000 claims 1
- 230000001360 synchronised effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 4
Landscapes
- Synchronisation In Digital Transmission Systems (AREA)
Description
第1図は、本考案の第1の実施例を示すブロツ
ク図、第2図は第1図の詳細を示す回路図、第3
図は第2図のタイミング図、第4図は本考案の第
2の実施例を示す回路図である。 1……カウンタ、2……バツフア、3……1/2
分周器、4……カウンタ、5……比較器、6……
1/2分周器、21〜28……Dフリツプフロツプ
、31〜37……2入力XORゲート、41……
7入力ORゲート、51〜52……2入力AND
ゲート、61……2入力ORゲート、71……2
入力NORゲート、81……NOTゲート、10
1〜116……J−Kフリツプフロツプ。
ク図、第2図は第1図の詳細を示す回路図、第3
図は第2図のタイミング図、第4図は本考案の第
2の実施例を示す回路図である。 1……カウンタ、2……バツフア、3……1/2
分周器、4……カウンタ、5……比較器、6……
1/2分周器、21〜28……Dフリツプフロツプ
、31〜37……2入力XORゲート、41……
7入力ORゲート、51〜52……2入力AND
ゲート、61……2入力ORゲート、71……2
入力NORゲート、81……NOTゲート、10
1〜116……J−Kフリツプフロツプ。
Claims (1)
- 伝送路上の受信データと受信局が独自で生成す
るシステムクロツクから受信データに同期した受
信クロツクを生成するDPLL方式において、受
信データが“0”の間だけ、システムクロツクを
第1のカウンタに出力するバツフアと、リセツト
信号が“L”レベルになるとカウント値を00に
クリアして、前記リセツト信号が“H”レベルに
戻つた後第1の1/2分周器から伝達されるクロツ
ク数をカウントする第1のカウンタと、前記リセ
ツト信号が“L”レベルになるとその全出力を“
L”レベルとし前記リセツト信号が“H”レベル
に戻り、かつ前記受信データが“0”から“1”
となると前記第1のカウンタの値を取り込み、そ
の内容を出力、保持するラツチと、前記リセツト
信号が“L”レベルになるとカウント値を00に
クリアして、前記リセツト信号が“H”に戻つた
後、前記受信データが“0”から“1”となると
、前記システムクロツクをカウントし、カウント
値が前記ラツチの内容と等しくなるとカウント値
を00として再びカウント動作を行う第2のカウ
ンタと、前記ラツチの内容と前記第2のカウンタ
の内容を比較して、一致すると“L”レベルを出
力、それ以外は“H”レベルを出力する比較器と
、前記バツフアから出力される前記システムクロ
ツクを2分周する前記第1の1/2分周器と前期比
較器の出力を2分周し、受信クロツクを出力する
第2の1/2分周器とを含むことを特徴とする受信
クロツク発生回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12641688U JPH0247850U (ja) | 1988-09-27 | 1988-09-27 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12641688U JPH0247850U (ja) | 1988-09-27 | 1988-09-27 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0247850U true JPH0247850U (ja) | 1990-04-03 |
Family
ID=31377922
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12641688U Pending JPH0247850U (ja) | 1988-09-27 | 1988-09-27 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0247850U (ja) |
-
1988
- 1988-09-27 JP JP12641688U patent/JPH0247850U/ja active Pending
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| JPS6347105Y2 (ja) | ||
| CA1090888A (en) | Data buffer retiming circuit | |
| JPH0247850U (ja) | ||
| GB1534053A (en) | Distinguishing valid from invalid transitions in a two level logic signal | |
| ATE31583T1 (de) | Phasendetektor zur verwendung in synchronisationsvorrichtungen. | |
| GB1360148A (en) | Devices for synchronising telegraph signals | |
| JP2764590B2 (ja) | 信号中継装置 | |
| JPS5814107B2 (ja) | デ−タ伝送における受信デ−タ検出方法 | |
| JPH0453081Y2 (ja) | ||
| JPH0644756B2 (ja) | 同期クロツク発生回路 | |
| JPS62160834A (ja) | Ais信号受信回路 | |
| KR950001927B1 (ko) | 디지탈 데이타 동기 신호 검출회로 | |
| JPH0311977Y2 (ja) | ||
| JPH0377564U (ja) | ||
| JPS63113344U (ja) | ||
| JPS61103946U (ja) | ||
| JP2605051B2 (ja) | 通信装置 | |
| JPS58188952A (ja) | パラレル・シリアル・デ−タ伝送回路 | |
| JPS6017053U (ja) | 伝送エラ−検出器 | |
| JPH08331189A (ja) | クロック位相同期回路 | |
| JPS60247343A (ja) | 同期クロツク発生回路 | |
| JPH03172037A (ja) | シリアルデータ転送装置 | |
| JPS6056094U (ja) | 音程判別器 | |
| JPH0431845U (ja) | ||
| GB946492A (en) | Improvements in or relating to telegraph systems |