JPH0257632U - - Google Patents

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JPH0257632U
JPH0257632U JP13768388U JP13768388U JPH0257632U JP H0257632 U JPH0257632 U JP H0257632U JP 13768388 U JP13768388 U JP 13768388U JP 13768388 U JP13768388 U JP 13768388U JP H0257632 U JPH0257632 U JP H0257632U
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counted
output
predetermined
cycle
clock signal
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  • Manipulation Of Pulses (AREA)

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【図面の簡単な説明】
第1図は、この考案の一実施例の構成を示すブ
ロツク図である。第2図は、この考案の他の実施
例の構成を示すブロツク図である。第3図は、第
1図および第2図に示すMビツトプリスケーラ5
の動作を示したタイミングチヤートである。第4
図は、第2図の実施例において、PWM出力のH
パルスおよびLパルスの幅の設定値と、Mビツト
プリスケーラ5における設定値との関係を示した
タイムチヤートである。第5図は、従来のPWM
回路の一例の構成を示すブロツク図である。第6
図は、従来のPWM回路の他の例の構成を示した
ブロツク図である。第7図は、第6図に示すPW
M回路の動作を示したタイムチヤートである。第
8図は、第6図に示すPWM回路の動作を示した
タイムチヤートである。 図において、1はプログラマブルのNビツトダ
ウンカウンタ、2はT型フリツプフロツプ、3お
よび30はデータロード回路、4,41および4
2はデータレジスタ、5はMビツトプリスケーラ
、51はプログラマブルのMビツトダウンカウン
タ、52はデータレジスタを示す。
補正 平1.11.6 図面の簡単な説明を次のように補正する。 明細書第17頁第20行の「第6図に示す」を
「第5図に示す」に補正する。

Claims (1)

  1. 【実用新案登録請求の範囲】 予め定められた第1の設定値から基準クロツク
    信号を計数しその計数値が所定の値に達すると出
    力の状態を反転する第1のサイクルと、当該第1
    のサイクルの終了後予め定められた第2の設定値
    から基準クロツク信号を計数しその計数値が所定
    の値に達すると出力の状態を再び反転する第2の
    サイクルとを交互に繰返し、前記第1および第2
    の設定値のいずれか一方あるいは両方を変えるこ
    とにより出力パルスのデユーテイ比を変化させる
    ようなパルス幅変調回路において、 その分周比が任意に設定可能でかつ当該分周比
    で前記基準クロツク信号を分周するための可変分
    周手段を備え、当該可変分周手段の出力を計数す
    るようにしたことを特徴とする、パルス幅変調回
    路。
JP13768388U 1988-10-20 1988-10-20 Pending JPH0257632U (ja)

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