JPH0268931A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPH0268931A JPH0268931A JP22097588A JP22097588A JPH0268931A JP H0268931 A JPH0268931 A JP H0268931A JP 22097588 A JP22097588 A JP 22097588A JP 22097588 A JP22097588 A JP 22097588A JP H0268931 A JPH0268931 A JP H0268931A
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Landscapes
- Electrodes Of Semiconductors (AREA)
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、半導体装置の製造工程における高融点金属ポ
リサイドの配線を、半導体基板の主面上に形成する方法
に関する。
リサイドの配線を、半導体基板の主面上に形成する方法
に関する。
従来の技術
近年、半導体装置の高速化が進むに従い、高融点金属ポ
リサイドを用いた配線が使用されるようになった。また
、入力回路の保護抵抗など抵抗が必要な箇所がある。
リサイドを用いた配線が使用されるようになった。また
、入力回路の保護抵抗など抵抗が必要な箇所がある。
以下に、従来の2種類の膜厚の高融点金属ポリサイドの
配線を同一主面上に形成する方法を第2図(a)〜(j
)の工程順断面図に従って説明する。第2図(a)に示
すシリコン基板1に、第2図(b)に示すように、酸化
技術等を用いて、第1ゲート絶縁膜2、CVD技術等を
用いて、第1多結晶シリコン膜3を形成する。次に、第
2図(C)に示すように、第1多結晶シリコン膜上に、
第1高融点金属シリサイド膜4を堆積する。次に、第2
図(d)に示すように、第1高融点金属ポリサイドの配
線形成用のフォトレジストマスクパタン10を形成し、
第2図(e)のように、第1高融点金属シリサイド膜、
第1多結晶シリコン膜、第1ゲート絶縁膜のエツチング
を行う。前記フォトレジストマスクバタン10を除去し
、第2図げ)に示すように、酸化技術等により第2ゲー
ト絶縁膜11を形成し、第2図(g)に示すように、C
VD技術を用いて第2多結晶シリコン膜12を形成する
。次に、第2図(Wに示すように、第2多結晶シリコン
膜12上に、第2高融点金属シリサイド膜13を堆積す
る。次に、第2図(i)に示すように、第2高融点金属
ポリサイドの配線形成用のフォトレジストマスクパタン
14を形成し、第2高融点金属シリサイド膜、第2多結
晶シリコン膜、第2ゲート絶縁膜のエツチングを行い、
第2図(j)のように、膜厚の違う高融点金属ポリサイ
ドの配線層を形成する。
配線を同一主面上に形成する方法を第2図(a)〜(j
)の工程順断面図に従って説明する。第2図(a)に示
すシリコン基板1に、第2図(b)に示すように、酸化
技術等を用いて、第1ゲート絶縁膜2、CVD技術等を
用いて、第1多結晶シリコン膜3を形成する。次に、第
2図(C)に示すように、第1多結晶シリコン膜上に、
第1高融点金属シリサイド膜4を堆積する。次に、第2
図(d)に示すように、第1高融点金属ポリサイドの配
線形成用のフォトレジストマスクパタン10を形成し、
第2図(e)のように、第1高融点金属シリサイド膜、
第1多結晶シリコン膜、第1ゲート絶縁膜のエツチング
を行う。前記フォトレジストマスクバタン10を除去し
、第2図げ)に示すように、酸化技術等により第2ゲー
ト絶縁膜11を形成し、第2図(g)に示すように、C
VD技術を用いて第2多結晶シリコン膜12を形成する
。次に、第2図(Wに示すように、第2多結晶シリコン
膜12上に、第2高融点金属シリサイド膜13を堆積す
る。次に、第2図(i)に示すように、第2高融点金属
ポリサイドの配線形成用のフォトレジストマスクパタン
14を形成し、第2高融点金属シリサイド膜、第2多結
晶シリコン膜、第2ゲート絶縁膜のエツチングを行い、
第2図(j)のように、膜厚の違う高融点金属ポリサイ
ドの配線層を形成する。
発明が解決しようとする課題
従来の技術では、違う膜厚の高融点金属ポリサイドの配
線を別々に形成しなければならず、工程の複雑化及び歩
留りの低下の要因となっていた。
線を別々に形成しなければならず、工程の複雑化及び歩
留りの低下の要因となっていた。
本発明の目的は、高融点金属ポリサイドの配線形成工程
において、高融点金属ポリサイド膜を選択的に除去する
ことにより、違う膜厚の高融点金属ポリサイドの配線を
同時に形成することである。
において、高融点金属ポリサイド膜を選択的に除去する
ことにより、違う膜厚の高融点金属ポリサイドの配線を
同時に形成することである。
課題を解決するための手段
この目的を達成するためには、高融点金属ポリサイド上
にプラズマCVD法により、シリコン窒化膜を形成する
ことにより、高融点金属ポリサイド膜がシリコン窒化膜
の応力によりはがれる。次に、シリコン窒化膜を除去す
ることにより、はがれた高融点金属ポリサイド膜も除去
される。そこで、高融点金属ポリサイド周辺の一部にシ
リコン酸化膜を形成すると、シリコン窒化膜の応力に影
響を受けないので、同シリコン窒化膜の付着した部分の
高融点金属シリサイド膜の一部がはがれることはなく、
ここで、シリコン窒化膜を除去しても高融点金属ポリサ
イド膜が除去されることはない。このことを利用して、
主面上にシリコン酸化膜成長後、高融点金属ポリサイド
膜を除去したい部分のシリコン酸化膜を選択的にエツチ
ングすることにより、高融点金属ポリサイド膜を選択的
に除去することができる。
にプラズマCVD法により、シリコン窒化膜を形成する
ことにより、高融点金属ポリサイド膜がシリコン窒化膜
の応力によりはがれる。次に、シリコン窒化膜を除去す
ることにより、はがれた高融点金属ポリサイド膜も除去
される。そこで、高融点金属ポリサイド周辺の一部にシ
リコン酸化膜を形成すると、シリコン窒化膜の応力に影
響を受けないので、同シリコン窒化膜の付着した部分の
高融点金属シリサイド膜の一部がはがれることはなく、
ここで、シリコン窒化膜を除去しても高融点金属ポリサ
イド膜が除去されることはない。このことを利用して、
主面上にシリコン酸化膜成長後、高融点金属ポリサイド
膜を除去したい部分のシリコン酸化膜を選択的にエツチ
ングすることにより、高融点金属ポリサイド膜を選択的
に除去することができる。
作用
本発明によると、違う膜厚の高融点金属ポリサイドの配
線を同時に、選択的に形成することにより、工程の簡略
化ができ、歩留りが向上する。
線を同時に、選択的に形成することにより、工程の簡略
化ができ、歩留りが向上する。
実施例
本発明の実施例を第1図(a)〜(給の工程順断面図に
従って説明する。第1図(a)に示すシリコン基板1に
、第1図(b)に示すように、第1ゲート絶縁膜2を4
0nm程度、第1多結晶シリコン膜3を300nm程度
形成する。次に、第1図(C)に示すように、第1多結
晶シリコン膜上に、第1高融点金属ポリサイド膜4を2
00nm程度形成する。
従って説明する。第1図(a)に示すシリコン基板1に
、第1図(b)に示すように、第1ゲート絶縁膜2を4
0nm程度、第1多結晶シリコン膜3を300nm程度
形成する。次に、第1図(C)に示すように、第1多結
晶シリコン膜上に、第1高融点金属ポリサイド膜4を2
00nm程度形成する。
次に、第1図(d)に示すように、2種類の膜厚をもつ
高融点金属ポリサイドの配線の形成用マスクパタン5を
形成し、第1高融点金属ポリサイド膜4、第1多結晶シ
リコン膜3.第1ゲート絶縁膜2のエツチングを行い、
第1図(e)に示す構造を得る。次に、第1図(f)に
示すように、高融点金属ポリサイド配線4上に、シリコ
ン酸化膜6を350nm程度形成する。次に、第1図(
g)に示すように、異種膜厚の高融点金属ポリサイド配
線形成用のフォトレジストマスクパタン7を形成し、シ
リコン酸化膜のエツチングを行い、第1図(h)のよう
に、一方の側の高融点金属ポリサイド膜の所定厚さ表面
層を露出させ、2種類の膜厚の高融点金属ポリサイドの
配線部分に分ける。次に、第1図(i)に示すように、
プラズマCVD法により、シリコン窒化膜8を1μm程
度形成する。この段階で、一方の側の高融点金属ポリサ
イド膜は、シリコン酸化膜6から露出された表面層が所
定厚さだけ剥離する。次に、シリコン窒化膜8を、例え
ば150℃程度に熱したリン酸に浸し除去すると、第1
図(j)に示すように、違う膜厚の高融点金属ポリサイ
ドの配線9が形成される。次に第1図(k)に示すよう
に、フッ酸水溶液により酸化膜を除去する。
高融点金属ポリサイドの配線の形成用マスクパタン5を
形成し、第1高融点金属ポリサイド膜4、第1多結晶シ
リコン膜3.第1ゲート絶縁膜2のエツチングを行い、
第1図(e)に示す構造を得る。次に、第1図(f)に
示すように、高融点金属ポリサイド配線4上に、シリコ
ン酸化膜6を350nm程度形成する。次に、第1図(
g)に示すように、異種膜厚の高融点金属ポリサイド配
線形成用のフォトレジストマスクパタン7を形成し、シ
リコン酸化膜のエツチングを行い、第1図(h)のよう
に、一方の側の高融点金属ポリサイド膜の所定厚さ表面
層を露出させ、2種類の膜厚の高融点金属ポリサイドの
配線部分に分ける。次に、第1図(i)に示すように、
プラズマCVD法により、シリコン窒化膜8を1μm程
度形成する。この段階で、一方の側の高融点金属ポリサ
イド膜は、シリコン酸化膜6から露出された表面層が所
定厚さだけ剥離する。次に、シリコン窒化膜8を、例え
ば150℃程度に熱したリン酸に浸し除去すると、第1
図(j)に示すように、違う膜厚の高融点金属ポリサイ
ドの配線9が形成される。次に第1図(k)に示すよう
に、フッ酸水溶液により酸化膜を除去する。
発明の効果
本発明によれば、異種の膜厚の高融点金属ポリサイドの
配線を同時に、選択的に形成することにより、工程の簡
略化ができ、歩留りが向上する。
配線を同時に、選択的に形成することにより、工程の簡
略化ができ、歩留りが向上する。
第1図は本発明によって、異種の膜厚の高融点金属ポリ
サイドの配線を形成するときの工程順断面図、第2図は
従来の製造方法で、異種の膜厚の高融点金属ポリサイド
の配線を形成するときの工程順断面図である。 1・・・・・・半導体基板、2・・・・・・第1ゲート
絶縁膜、3・・・・・・第1多結晶シリコン膜、4・・
・・・・第1高融点金属ポリサイド膜、5・・・・・・
フォトレジストマスクバタン、6・・・・・・シリコン
酸化膜、7・・・・・・フォトレジストマスクバタン、
8・・・・・・シリコン窒化膜、9・・・・・・異種の
膜厚の高融点金属ポリサイド膜。 代理人の氏名 弁理士 粟野重孝 ほか1多忙 +−−−牛導イ本:!&、オ反 2− 寮fゲート絶橘狭 3−f、 1号緒晶ンヮコン膜 4゛−°第1高睨校¥、塵鴎もシソブイ)′ll菓に・
−シソモノ峻イl:、嘆 8− シリボン菫イし膜 へ 芭
サイドの配線を形成するときの工程順断面図、第2図は
従来の製造方法で、異種の膜厚の高融点金属ポリサイド
の配線を形成するときの工程順断面図である。 1・・・・・・半導体基板、2・・・・・・第1ゲート
絶縁膜、3・・・・・・第1多結晶シリコン膜、4・・
・・・・第1高融点金属ポリサイド膜、5・・・・・・
フォトレジストマスクバタン、6・・・・・・シリコン
酸化膜、7・・・・・・フォトレジストマスクバタン、
8・・・・・・シリコン窒化膜、9・・・・・・異種の
膜厚の高融点金属ポリサイド膜。 代理人の氏名 弁理士 粟野重孝 ほか1多忙 +−−−牛導イ本:!&、オ反 2− 寮fゲート絶橘狭 3−f、 1号緒晶ンヮコン膜 4゛−°第1高睨校¥、塵鴎もシソブイ)′ll菓に・
−シソモノ峻イl:、嘆 8− シリボン菫イし膜 へ 芭
Claims (1)
- 半導体基板の主面上に、高融点金属ポリサイド膜を形成
する工程と、同主面上にシリコン酸化膜を形成する工程
と、前記シリコン酸化膜の一部を除去し、前記高融点金
属ポリサイド膜の所定厚さ表面層を露出する工程と、前
記主面上にシリコン窒化膜を形成する工程と、前記シリ
コン窒化膜を除去して、前記高融点金属ポリサイド膜の
所定厚さ表面層を剥離除去する工程をそなえたことを特
徴とする半導体装置の製造方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22097588A JPH0268931A (ja) | 1988-09-02 | 1988-09-02 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP22097588A JPH0268931A (ja) | 1988-09-02 | 1988-09-02 | 半導体装置の製造方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0268931A true JPH0268931A (ja) | 1990-03-08 |
Family
ID=16759501
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP22097588A Pending JPH0268931A (ja) | 1988-09-02 | 1988-09-02 | 半導体装置の製造方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0268931A (ja) |
-
1988
- 1988-09-02 JP JP22097588A patent/JPH0268931A/ja active Pending
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