JPH0284440U - - Google Patents
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- Publication number
- JPH0284440U JPH0284440U JP16333088U JP16333088U JPH0284440U JP H0284440 U JPH0284440 U JP H0284440U JP 16333088 U JP16333088 U JP 16333088U JP 16333088 U JP16333088 U JP 16333088U JP H0284440 U JPH0284440 U JP H0284440U
- Authority
- JP
- Japan
- Prior art keywords
- signal
- phase difference
- clock
- forming
- outputting
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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- 230000003247 decreasing effect Effects 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 3
- 238000001514 detection method Methods 0.000 description 2
- 230000015572 biosynthetic process Effects 0.000 description 1
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- 238000006243 chemical reaction Methods 0.000 description 1
- 238000003786 synthesis reaction Methods 0.000 description 1
Landscapes
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Description
第１図は本考案回路の一実施例を示す回路図、
第２図、第３図は本考案回路の動作説明に供する
回路図、第４図乃至第６図は本考案の説明に供す
る波形図である。 １，２……演算増幅器、３……インバータ、４
……位相比較器、５……パルス幅／電圧変換回路
、６……包絡線検波回路、７……積分合成回路、
８……電圧制御発振器、９……位相比較部、１２
……補正誤差検出回路、Ｒ１〜Ｒ１６……抵抗、
Ｃ１〜Ｃ７……コンデンサ、Ｃ８……バリキヤツ
プ、Ｌ１……コイル、Ｑ１，Ｑ２……トランジス
タ、Ｑ３，Ｑ４……ＦＥＴ。
第２図、第３図は本考案回路の動作説明に供する
回路図、第４図乃至第６図は本考案の説明に供す
る波形図である。 １，２……演算増幅器、３……インバータ、４
……位相比較器、５……パルス幅／電圧変換回路
、６……包絡線検波回路、７……積分合成回路、
８……電圧制御発振器、９……位相比較部、１２
……補正誤差検出回路、Ｒ１〜Ｒ１６……抵抗、
Ｃ１〜Ｃ７……コンデンサ、Ｃ８……バリキヤツ
プ、Ｌ１……コイル、Ｑ１，Ｑ２……トランジス
タ、Ｑ３，Ｑ４……ＦＥＴ。
Claims (1)
- 【実用新案登録請求の範囲】 デジタルデータ信号から、該デジタルデータ信
号の反転タイミングを司るデータクロツクに相当
する形成クロツク信号を形成するクロツク形成回
路であり、 前記デジタルデータ信号と前記形成クロツク信
号の位相を比較し、位相差に応じてレベルが変化
する位相差情報信号を出力する位相差情報出力手
段と、 前記位相差情報信号に追従してレベル増加し、
且つ前記位相差情報信号が急激にレベル減少する
ときに所定の減少特性でレベル減少する第１の包
絡線信号と、前記位相差情報信号に追従してレベ
ル減少し、且つ前記位相差情報信号が急激にレベ
ル増加するときに所定の増加特性でレベル増加す
る第２の包絡線信号とを出力する包絡線信号出力
手段と、 前記第１と第２の包絡線信号の加算情報と加算
積分情報とを含む補正誤差情報信号を出力する補
正誤差検出手段と、 前記補正誤差情報信号に基づいて周波数制御さ
れる前記形成クロツク信号を出力する形成クロツ
ク信号出力手段とを有することを特徴とするクロ
ツク形成回路。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16333088U JPH0733465Y2 (ja) | 1988-12-16 | 1988-12-16 | クロック形成回路 |
| US07/413,619 US5057705A (en) | 1988-10-04 | 1989-09-28 | Clock formation circuit with phase locked loop control |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16333088U JPH0733465Y2 (ja) | 1988-12-16 | 1988-12-16 | クロック形成回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0284440U true JPH0284440U (ja) | 1990-06-29 |
| JPH0733465Y2 JPH0733465Y2 (ja) | 1995-07-31 |
Family
ID=31447959
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16333088U Expired - Lifetime JPH0733465Y2 (ja) | 1988-10-04 | 1988-12-16 | クロック形成回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0733465Y2 (ja) |
-
1988
- 1988-12-16 JP JP16333088U patent/JPH0733465Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0733465Y2 (ja) | 1995-07-31 |
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