JPH03124249U - - Google Patents

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JPH03124249U
JPH03124249U JP3312390U JP3312390U JPH03124249U JP H03124249 U JPH03124249 U JP H03124249U JP 3312390 U JP3312390 U JP 3312390U JP 3312390 U JP3312390 U JP 3312390U JP H03124249 U JPH03124249 U JP H03124249U
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JP
Japan
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bus
scsi
dma transfer
channel bus
buffer memory
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JP3312390U
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Description

【図面の簡単な説明】
第１図は本考案の原理ブロツク図、第２図は本
考案の一実施例を示す構成ブロツク図、第３図は
ホストアダプタ回路全体の動作を示す概略フロー
チヤート、第４図は第３図において、フエイズ対
応処理の詳細を示すフローチヤート、第５図は本
考案の回路を用いてホストコンピユータからデイ
バイスへデータを書き込む際の動作を示すタイム
チヤート、第６図はＳＣＳＩバスを用いて構成さ
れるコンピユータ・システムの構成概念図、第７
図は第６図において、ホストコンピユータＨＳか
らＳＣＳＩデイバイスＳＤへのＤＭＡ転送の際の
動作を示すタイムチヤートである。 １……ホストコンピユータ、２……ＳＣＳＩデ
イバイス、３……ホストアダプタ回路、３１……
バツフアメモリ、３２……ＤＭＡ転送手段、３３
……制御手段。

Claims (1)

  1. 【実用新案登録請求の範囲】 ＤＭＡ再起動の機能を持たないホストコンピユ
    ータが接続されたチヤネルバスと、ＳＣＳＩデイ
    バイスが接続されたＳＣＳＩバスとの間に接続さ
    れるＳＣＳＩホストアダプタ回路であつて、 ＤＭＡ転送時のデータが格納されるバツフアメ
    モリと、 チヤネルバスとＳＣＳＩバス間、チヤネルバス
    とバツフアメモリの間、バツフアメモリとＳＣＳ
    Ｉバスの間のそれぞれの間のＤＭＡ転送手段と、 このＤＭＡ転送手段を制御する制御手段と を備え、前記制御手段は、 ＤＭＡ転送手段に対して、チヤネルバスからＳ
    ＣＳＩバスに対するＤＭＡ転送およびチヤネルバ
    スからバツフアメモリに対するＤＭＡ転送を同時
    に実行するように指示すると共に、 ホストコンピユータからＳＣＳＩデイバイスへ
    データ転送する場合に、チヤネルバスからＳＣＳ
    Ｉバスに対するＤＭＡ転送とチヤネルバスからバ
    ツフアメモリに対するＤＭＡ転送を並列に実行さ
    せ、 ＳＣＳＩデイバイスによりＤＭＡ転送が一時中
    断されるときは、チヤネルバスからＳＣＳＩバス
    に対するＤＭＡ転送を停止させ、チヤネルバスか
    らバツフアメモリに対するＤＭＡ転送のみ実行さ
    せるように制御することを特徴とするＳＣＳＩホ
    ストアダプタ回路。
JP3312390U 1990-03-29 1990-03-29 Pending JPH03124249U (ja)

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JP3312390U JPH03124249U (ja) 1990-03-29 1990-03-29

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JPH03124249U true JPH03124249U (ja) 1991-12-17

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ID=31536521

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JP3312390U Pending JPH03124249U (ja) 1990-03-29 1990-03-29

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