JPH03127848A - 半導体装置 - Google Patents

半導体装置

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Publication number
JPH03127848A
JPH03127848A JP26764389A JP26764389A JPH03127848A JP H03127848 A JPH03127848 A JP H03127848A JP 26764389 A JP26764389 A JP 26764389A JP 26764389 A JP26764389 A JP 26764389A JP H03127848 A JPH03127848 A JP H03127848A
Authority
JP
Japan
Prior art keywords
film thickness
semiconductor chip
chip
pad
field region
Prior art date
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Pending
Application number
JP26764389A
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English (en)
Inventor
Katsunobu Yoshimura
吉村 克信
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Publication date
Application filed by NEC Corp filed Critical NEC Corp
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は半導体装置に利用され、特に、半導体チップ内
に設けるチエツクパターンを改善した半導体装置に関す
る。
〔概要〕
本発明は、チップ周辺に設けられたフィールド領域を有
する半導体チップを備えた半導体装置において、 前記フィールド領域内に少なくとも一つの膜厚測定用パ
ッドを設けることにより、 製造工程中における膜厚管理が正確に行われるようにし
たものである。
〔従来の技術〕
従来、半導体チップ内のチエツクパターンには、半導体
の各層の膜厚を順次測定するパターンは入っておらず、
膜厚測定は堆積する際いっしょに入れられたりファレン
スウェーハで行われていた。
〔発明が解決しようとする問題点〕
前述した従来の半導体装置における半導体チップには、
各層の膜厚を堆積するたびに順次一定の箇所を測定する
べきパターンが入っていなかったため、最近の微細化の
進展の中で、リファレンスウェーハと実チップ上との膜
堆積の状況がローディング効果等の影響で、異なってく
ることにより、実チップの膜厚モニタができず、正確な
膜厚管理ができない欠点がある。
本発明の目的は、前記の欠点を除去することにより、実
チップの膜厚管理が正確にできる半導体チップを有する
半導体装置を提供することにある。
〔問題点を解決するための手段〕
本発明は、チップ周辺に設けられたフィールド領域を有
する半導体チップを備えた半導体装置において、前記フ
ィールド領域内に設けられた少なくとも一つの膜厚測定
用パッドを有することを特徴とする。
なお、前記膜厚測定用パッドは、フィールド領域の内で
半導体チップの製造工程上で堆積されるべき膜はすべて
成長される位置に設けられ、かつ、その大きさは測定上
よりlOミクロン角以上であり、必要により複数個設け
られることが好ましい。
〔作用〕
膜厚測定用パッドを用いて、個別の実チップごとに、半
導体チップ製造工程上堆積されるすべての膜について、
膜厚測定が可能となり、正確な膜厚管理を行うことがで
きるようになる。
〔実施例〕 次に、本発明の実施例について図面を参照して説明する
第1図は本発明の一実施例の半導体チップを示す上面図
である。半導体チップ4は、チップ周辺に設けられたフ
ィールド領域1と、その内側に設けられた活性領域2と
を有し、さらに、本発明の特徴とするところの、フィー
ルド領域1内に設けられた膜厚測定用パッド3を有して
いる。そして、この膜厚測定用パッド3部分には、半導
体チップ4製造工程中で堆積されるべき膜はすべて成長
されるように設けられ、またその大きさは膜厚測定機の
測定スポットの直径が数ミクロンであるため、10ミク
ロン角に設定される。
第2図は本発明の第二実施例の半導体チップの上面図で
ある。本第二実施例は、第1図の第一実施例の半導体チ
ップ4において、膜厚測定用パッド3を、フィールド領
域1の各辺に一つずつ計4個設けたものである。
本第二実施例によると、膜厚を4箇所で測定し、それを
平均することにより、さらに正確な膜厚管理が可能にな
る。
〔発明の効果〕
以上説明したように、本発明は、半導体チップのフィー
ルド領域上に膜厚測定用パッドを設け、膜が堆積される
たびにそのパッド上の膜厚を測定することにより、実チ
ップ上の膜厚の管理が可能となり、さらに、一定の箇所
を測定することができるので、各層の膜厚の相対関係が
正確に把握できるため、チップのできあがり状態がより
正確にわかり、正しい膜厚管理ができる効果がある。
【図面の簡単な説明】
第1図は本発明の第一実施例の半導体チップの上面図。 第2図は本発明の第二実施例の半導体チップの上面図。 1・・・フィールド領域、2・・・活性領域、3・・・
膜厚測定用パッド、4・・・半導体チップ。

Claims (1)

  1. 【特許請求の範囲】 1、チップ周辺に設けられたフィールド領域を有する半
    導体チップを備えた半導体装置において、前記フィール
    ド領域内に設けられた少なくとも一つの膜厚測定用パッ
    ドを有する ことを特徴とする半導体装置。
JP26764389A 1989-10-12 1989-10-12 半導体装置 Pending JPH03127848A (ja)

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JP26764389A JPH03127848A (ja) 1989-10-12 1989-10-12 半導体装置

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JP26764389A JPH03127848A (ja) 1989-10-12 1989-10-12 半導体装置

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JPH03127848A true JPH03127848A (ja) 1991-05-30

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ID=17447526

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JP26764389A Pending JPH03127848A (ja) 1989-10-12 1989-10-12 半導体装置

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007255698A (ja) * 2006-02-24 2007-10-04 Nok Corp トーショナルダンパ

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2007255698A (ja) * 2006-02-24 2007-10-04 Nok Corp トーショナルダンパ

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