JPH0314083A - 携帯可能電子装置 - Google Patents

携帯可能電子装置

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JPH0314083A
JPH0314083A JP1148994A JP14899489A JPH0314083A JP H0314083 A JPH0314083 A JP H0314083A JP 1148994 A JP1148994 A JP 1148994A JP 14899489 A JP14899489 A JP 14899489A JP H0314083 A JPH0314083 A JP H0314083A
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data
memory
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circuit
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Kiyoyoshi Nara
精悦 奈良
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [発明の目的] (産業上の利用分野) この発明は、たとえばCPU、データメモリ、内部バッ
テリなどを内蔵し、電卓、時刻表示などのカード単体で
用いたり、端末機に挿入することにより用いる多機能の
ICカードなどの携帯可能媒体に関する。
(従来の技術) 従来、CPU (制御素子)、データメモリなどを内蔵
し、キーボード、表示部などを有し、電卓、時刻表示な
どでカード単体で用いたり、端末機に挿入することに用
いられる多機能のICカードが開発されている。上記C
PU、データメモリなどはLSI化されて内蔵されてい
る。
このようなICカードでは、客先提出仕様書にしたがっ
てプログラムの検討を行った後、プログラムの設計、デ
パック、試験などの作業を経て、LSIの製造をマスク
設計がら新規に行うようになっている。この場合、基本
機能はすべて、マスクROMによって構成されるプログ
ラムメモリに搭載された構成となっている。
このため、仕様変更、機能追加を行う場合、その都度L
SIを製作するため、LSIの価格つまりICカードの
価格が高価格化するばがりでなく、開発期間が長くなる
という欠点がある。
(発明が解決しようとする課題) 上記のように、価格が高価格化し、開発期間が長くなる
という欠点を除去するもので、価格の高価格化を防ぎ、
開発期間の短縮化を図ることができる携帯可能媒体を提
供することを目的とする。
[発明の構成] (課題を解決するための手段) この発明の携帯可能媒体は、制御素子と記憶手段とを有
し、オンライン、オフラインにて用いられるものにおい
て、上記記憶手段は基本機能を記憶する書き替え不可能
な第1の記憶エリアとユーザ用のアプリケーションプロ
グラムが記憶可能な書き替え可能な第2の記憶エリアと
を有し、上記第2の記憶エリアのアクセスをオンライン
モードとオフラインモードとで制限する制限手段から構
成されるものである。
(作用) この発明は、制御素子を有し、オンライン、オフライン
にて用いられるものにおいて、上記記憶手段は基本機能
を記憶する書き替え不可能な第1の記憶エリアとユーザ
用のアプリケーションプログラムが記憶可能な書き替え
可能な第2の記憶エリアとを有し、上記第2の記憶エリ
アのアクセスをオンラインモードとオフラインモードと
で制限するようにしたものである。
(実施例) 以下、この発明の一実施例について、図面を参照して説
明する。
第2図において、10は携帯可能媒体としてのICカー
ドであり、種々の機能(用途)を有する多機能カードで
ある。たとえば、端末機(図示しない)と連動して使用
するオンライン機能(オンラインモード)、ICカード
10が単体で動作するオフライン機能(オフラインモー
ド)、および時計のみをカウントしている待ち状態を有
している。
上記オフライン機能としては、電卓として使用できる電
卓モード、利用者により用いられている時計による時刻
を表示する時刻モード、住所、氏名、電話番号等を登録
したり、読出したりする電子ノート(電子幅)モード、
あるいはIC力〜ド10を複数のクレジットカードとし
て利用する買物モードなど単独で使用できるものとなっ
ている。
上記買物モードは、ICカード10の中に使用残高、有
効期限、買物記録等を記憶しておき、買物するたびに使
用した金額をICカード10内の残高から差引くととも
に買物情報を記録するものである。上記ICカード10
内の残高および有効期限が切れた場合は、契約銀行より
秘密コードを発行してもらうことにより、更新されるよ
うになっている。
上記ICカード10の表面に−はカードの規格にあった
位置に配置されたコンタクト部11.20キーからなる
キーボード部12、およびこのキーボード部12の上面
に配置され、液晶表示素子で形成される表示部13が設
けられている。
上記コンタクト部11は、たとえば複数の端子11a〜
llfによって構成されており、動作用の電源電圧(V
cc、+5V)用、EEPROMの書込電源電圧(Vp
p)用、接地用、クロック信号用、リセット信号用、デ
ータ人出力用の端子からなっている。
上記キーボード部12はカードの種類つまり種々のクレ
ジットカード、キャッシュカードなどに対応する処理を
選択する選択キー(TI、T2、T3、T4)12a、
テンキー12b1フアンクシヨンキーとしての4則演算
キーつまり加算(+)キー12c、減算(−)キー12
d1除算(÷)キー12e1乗算(X)キー12f1少
数点(1)キー12g1およびイコール(−)キー12
hによって構成されている。
上記加算キー12cは、NEXTキーつまりオフライン
における日付、時刻表示中にモードを選択するモード選
択キーとして用いられ、上記減算キー12dはBACK
キーつまり表示部13の表示状態を前に戻すキーとして
用いられ、上記乗算キー12fは開始キーとして用いら
れ、上記小数点キー12gはNoキー、終了キーとして
用いられ、上記イコールキー12hはYESキー、パワ
ーオンキーとして用いられるようになっている。
たとえば、パワーオンキーとしてのイコールキー12h
が押されると、後述するCPUはHALT状態が解除さ
れ、動作開始用メツセージの時刻、日付を表示部13に
表示する。
この状態で、テンキー12bを押すとICカード10は
電卓モードになり、四則演算が行えるようになっている
さらに、モード選択キーとしての加算キー12cは、上
記日付、時刻表示中の表示部13の表示状態を別のモー
ドへ進めるキーとして用いられ、表示部13にメニュー
として、電子幅、時刻セット、日付セツ、ト、買物等の
取引等のモードがそのキーを押すたびに表示される。こ
れらのモードを実行する場合に、上記イコールキー12
hとしてのYESキーを押すことにより、そのモードへ
入り、実行可能となる。
上記表示部13は、1桁が5×7のドツトマトリクスで
、1−6桁表示となっている。
第3図はICカード10を扱う端末機(図示しない)た
とえばパーソナルコンピュータ等に用いられるICカー
ド読取書込部16の外観を示すものである。すなわち、
カード挿入口17から挿入されたICカード10におけ
るコンタクト部11と接続することにより、ICカード
1oにおけるメモリのデータを読取ったり、あるいはメ
モリ内にデータを書込むものである。
上記ICカード読取書込部16は、パーソナルコンピュ
ータの本体(図示しない)とケーブルによって接続され
るようになっている。
また、上記ICカード10の電気回路は、第1図に示す
ように構成されている。すなわち、上記コンタクト部1
1、通信制御回路21、リセット制御回路22、電源制
御回路23、たとえば3ボルトの内部バッテリ(内蔵電
源)25、この内部バッテリ25の電圧値が規定以上で
あるが否がをチエツクするバッテリチエツク回路24、
クロック制御回路26、演算クロック発振用の水晶発振
子であり、200KH2の発振周波数(高速クロック)
の信号を出力する発振器27、制御用のCPU (セン
トラル・プロセッシング・ユニット)28、ICカード
10の基本プログラムおよびこれに必要なデータが記録
されているマスクROM29、ワーキング用メモリ30
、暗証番号、およびデータなどが記録されるとともに、
ユーザ別のプログラム、上記基本プログラムが記憶され
、EEFROMで構成されるデータメモリ31、マスク
ROM29とデータメモリ31を制御するメモリ制御回
路40、処理動作中の計時用に用いるタイマ32、カレ
ンダ回路33、基本クロック発振用の水晶発振子であり
、常時、32.768KH2の発振周波数(低速クロッ
ク)の信号を出力している発振器34、表示部制御回路
35、上記表示部13を駆動する表示部ドライバ36、
および上記キーボード部12のキー入力回路としてのキ
ーボードインターフェース38によって構成されている
上記通信制御回路21、CPU28、ROM29、メモ
リ制御回路40、プログラムワーキング用メモリ30、
データメモリ31、タイマ32、カレンダ回路33、表
示部制御回路35、およびキーボードインターフェース
38は、データバス20によって接続されるようになっ
ている。
上記通信制御回路21は、受信時つまり上記ICカード
読取書込部16からコンタクト部11を介して供給され
たシリアルの入出力信号を、パラレルのデータに変換し
てデータバス20に出力し、送信時つまりデータバス2
0から供給されたパラレルのデータを、シリアルの入出
力信号に変換してコンタクト部11を介してICカード
読取書込部16に出力するようになっている。この場合
、その変換のフォーマット内容は、上記端末機と、IC
カード10とで定められている。
リセット制御回路22は、オンラインになった際、リセ
ット信号を発生し、CPU28の起動を行うようになっ
ている。
上記電源制御回路23は、オンラインとなった際、所定
時間経過後に、内部バッテリ25による駆動から外部電
源駆動に切換え、オフラインとなった際、つまり外部電
圧が低下した際、外4部電源による駆動から内部バッテ
リ25による駆動に切換えるものである。
上記クロック制御回路26は、内部バッテリ25でカー
ド動作を行うオフラインモードにおいて、低速クロック
と高速クロックとをタイミングよく切換えるものであり
、またHALT命令実行後、パワーダウンのため200
KH2の発振周波数(高速クロック)の信号を出力する
発振回路(図示しない)を停止し、またCPU28への
クロックの供給も停止し、完全なる停止状態で待機する
ものである。上記クロック制御回路26は、リセット、
HALT命令が実行されると、基本的には時計用が選択
さ、れる構成である。
マスクROM29に記憶される基本プログラムは、クレ
ジット機能、I10制御のためのドライブプログラム、
カレンダ機能、その他各種のサブルーチン機能などであ
る。
上記データメモリ31は、第4図に示すように、ユーザ
用のアプリケーションプログラムが記憶されるユーザ用
アプリケーションプログラム記憶エリア31a1ユーザ
用のデータが記憶されるユーザ用データ記憶エリア31
b1基本プログラムが記憶される保存データ領域として
の基本プログラム用データ記憶エリア31cによって構
成されている。
マスクROM29に記憶される基本プログラムは、LS
Iの製造前に搭載されており、データメモリ31に記憶
されるユーザ用のアプリケーション・プログラムは、カ
ード製造終了後に発行者側でカード発行処理の一部とし
て、上記端末機からローディングされ、搭載されるよう
になっている。
上記メモリ制御回路40は、ソフトのバグあるいはノイ
ズ等で、基本データが破壊されたり、ユーザ領域に不正
なプログラムが侵入するのを防止するために、マスクR
OM29とデータメモリ31の動作を監視したり、デー
タのリード、ライトを制御する、ものである。たとえば
、外部電源Vccが供給されているオンライン時、ユー
ザ領域つまり記憶エリア51aに対するデータのリード
、ライトを許可し、外部@11XVccが供給されてい
ないオフライン時、ユーザ領域つまり記憶エリア51a
に対するデータのリード、ライトを不許可とするもので
ある。
上記カレンダ回路33は、カードの保持者が自由に設定
変更可能な表示用の時計と、たとえば世界の標準時間を
カードの発行時にセットし、その後、変更不可能な取引
用の時計とを有している。
上記表示部制御回路35は、上記CPO28から供給さ
れる表示データを内部のROMで構成されるキャラクタ
ジェネレータ(図示しない)を用いて文字パターンに変
換し、表示部ドライバ36を用いて表示部13で表示す
るものである。
上記キーボードインターフェース38は、キーボード部
12で人力されたキーに対応するキー人力信号に変換し
てCPU28に出力するものである。
上記メモリ制御回路40は、第5図に示すように構成さ
れている。すなわち、上記データメモリ31のユーザ用
アプリケーションプログラム記憶エリア31aを示すデ
ータとして、その記憶エリア31aの開始アドレスの上
位数ビットが記憶されるユーザエリアアドレスメモリ5
1がある。このユーザエリアアドレスメモリ51からの
データはアドレス比較回路52へ出力される。
このアドレス比較回路52はユーザエリアアドレスメモ
リ51から供給されるデータと、上記CPU2gからデ
ータバス20を介して供給されるアクセスアドレスの上
位数ビットとを比較し、を出力し、不一致の場合、不一
致信号として“0”信号を出力するものである。上記ア
ドレス比較回路52からの信号はナンド回路53の一方
の入力端に供給され、このナンド回路53の他方の入力
端には上記コンタクト部11からの外部電源電圧Vcc
がインバータ回路54を介して供給される。
上記ナンド回路53の出力は、データ選択回路55のセ
レクト端Sに供給され、このデータ選択回路55のチッ
プセレクト端C8には上記CPU28からデータバス2
0を介してリード信号が供給され、データ入力端Aには
リードバッファ56に記憶されているデータメモリ31
がらのリードデータが供給され、データ入力端Bにはソ
フト割込み命令コードレジスタ57に記憶されているソ
フト割込み命令コードが供給される。上記データ選択回
路55の出力は、データバス20を介して上記CPU2
8へ出力される。上記CPO28からデータバス20を
介して供給されるリード信号はそのままデータメモリ3
1へ出力される。リードバッファ56は、データメモリ
31から供給されるリードデータを記憶するものである
ソフト割込み命令コードレジスタ57は、CPU28に
対するソフト割込みを発生させるためのソフト割込みベ
クタアドレスroOJ  (マスクROM29における
ソフト割込み命令の開始アドレス)を記憶しているもの
である。上記ソフト割込み命令は、基本プログラムの一
部で、現在実行中のプログラムが無効となるプログラム
であり、マスクROM29に記憶されている。
また、上記CPO28からデータバス20を介して供給
されるライト信号は、ライトデータバッファ58のチッ
プセレクト端C8に供給されるとともに、インバータ回
路59を介してナンド回路60の一方の入力端に供給さ
れる。上記CPU28からデータバス20を介して供給
されるライトデータは、ライトデータバッファ58のデ
ータ入力端に供給される。上記ナンド回路60の他方の
入力端には、上記ナンド回路53からの信号が供給され
、上記ナンド回路60の出力はライト信号としてデータ
メモリ31へ出力される。
次に、このような構成において動作を説明する。
たとえば今、リード時、CPU28からリードアドレス
とリード信号とがデータバス20を介してメモリ制御回
路40に供給される。すなわち、リードアドレスはアド
レス比較回路52へ供給されるとともに、データメモリ
31へ出力され、リード信号はデータ選択回路55のチ
ップセレクト端C8に供給されるとともに、データメモ
リ31へ出力される。これにより、アドレス比較回路5
2はそのリードアドレスとユーザエリアアドレスメモリ
51からのデータとを比較し、リードアドレスがユーザ
用アプリケーションプログラム記憶エリア31a内の場
合、ナンド回路53に′1″信号を出力し、その記憶エ
リア31a外の場合、ナンド回路53に“0”信号を出
力する。
また、外部電源VccがICカード読取書込部16から
コンタクト部11を介してメモリ制御回路40に供給さ
れている場合、インバータ回路54を介してナンド回路
5.3に“0“信号が供給され、外部電源VccがIC
カード読取書込部16からコンタクト部11を介してメ
モリ制御回路40に供給されていない場合、インバータ
回路54を介してナンド回路53に“1”信号が供給さ
れる。
したがって、リードアドレスが記憶エリア31a内で外
部電源Vccが供給されていない(オフライン時)場合
、ナンド回路53はリード禁止信号としての“0“信号
を出力し、それ以外のリードアドレスが記憶エリア31
a外の場合、あるいはリードアドレスが記憶エリア31
a内で外部電源Vccが供給されている(オンライン時
)場合、ナンド回路53はリード許可信号としての“1
″信号を出力する。
これにより、ナンド回路53の出力が“1”信号の場合
、データ選択回路55は入力端Aを選択し、“0”信号
の場合、データ選択回路55は入力端Aを選択する。
また、データメモリ31は、供給されるリード信号とリ
ードアドレスとにより、対応するアドレスのデータを読
出し、リードバッファ56に出力されている。これによ
り、リードバッファ56にリードデータが記憶されてい
る。
この結果、データ選択回路55は入力端Aが選択されて
いる場合、リードバッファ56に記憶されているデータ
メモリ31からのリードデータを選択し、データバス2
0を介してCPU28へ出力する。これにより、リード
データを受取ったCPO28はリード処理を終了する。
また、データ選択回路55は入力端Bが選択されている
場合、ソフト割込み命令コードレジスタ57に記憶され
ているソフト割込み命令コード「00」を選択し、デー
タバス20を介してCPU28へ出力する。これにより
、ソフト割込み命令コード「00」を受取ったCPU2
8は、マスクROM29からソフト割込み命令プログラ
ムを読出し、このプログラムに応じた処理、つまり現在
実行中のプログラムが無効となる処理を行う。
次に、ライト時、CPU28からライトアドレス、ライ
ト信号およびライトデータがデータバス20を介してメ
モリ制御回路40に供給される。
すなわち、ライトアドレスはアドレス比較回路52へ供
給されるとともに、データメモリ31へ出力され、ライ
ト信号はライトデータバッファ58のチップセレクト端
C8に供給されるとともに、インバータ回路59を介し
てナンド回路60へ出力される。これにより、アドレス
比較回路52はそのライトアドレスとユーザエリアアド
レスメモリ51からのデータとを比較し、ライトアドレ
スがユーザ用アプリケーションプログラム記憶エリア3
1a内の場合、ナンド回路53に“1″信号を出力し、
その記憶エリア31a外の場合、ナンド回路53に“0
”信号を出力する。
また、外部電源VccがICカード読取書込部16から
コンタクト部11を介してメモリ制御回路40に供給さ
れている場合、インバータ回路54を介してナンド回路
53に“0“信号が供給され、外部電源VccがICカ
ード読取書込部16からコンタクト部11を介してメモ
リ制御回路40に供給されていない場合、インバータ回
路54を介してナンド回路53に“1”信号が供給され
る。
したがって、ライトアドレスが記憶エリア31a内で外
部電源Vccが供給されていない(オフライン時)場合
、ナンド回路53はライト禁止信号としての“O″信号
出力し、それ以外のライトアドレスが記憶エリア31a
外の場合、あるいはライトアドレスが記憶エリア31a
内で外部電源Vccが供給されている(オンライン時)
場合、ナンド回路53はライト許可信号としての“1“
信号を出力する。
これにより、ナンド回路53の出力が“1”信号の場合
、ナンド回路60のゲートが閉じられたままとなり、“
0“信号の場合、ナンド回路60のゲートが開かれる。
この結果、ナンド回路60のゲートが開かれ、CPU2
8からのライト信号がデータメモリ31へ供給された場
合、データメモリ31は供給されるライトアドレスに上
記ライトデータバッファ58から供給されるライトデー
タを記憶する。また、ナンド回路60のゲートが閉じら
れたままで、CPO28からのライト信号が出力されな
い場合、データメモリ31でライトデータの記憶は行わ
れない。
上記したように、書替え可能なデータメモリにユーザ用
のプログラムを搭載し、リード時、リードアドレスがデ
ータメモリ31内のユーザ用プログラムに対応し、外部
電源が供給されていないオフラインの場合、データメモ
リからのデータの読出しを禁止し、外部電源が供給され
ているオンラインの場合、データメモリからのデータの
読出しを許可し、さらにライト時、ライトアドレスがユ
ーザ用プログラムに対応し、外部電源が供給されていな
いオフラインの場合、データメモリへのデータの書込み
を楚止し、外部電源が供給されているオンラインの場合
、データメモリへのデータの書込みを許可するようにし
たものである。
これにより、仕様変更のたびに、LSIを新規作成する
ことがなく、しかもユーザ用のプログラム動作を監視す
ることで、基本データの破壊防止および不正ソフトの侵
入を防ぐことができる信頼性の高いカードを提供できる
なお、前記実施例では、外部電源が供給されているオン
ラインの場合に、ユーザ用プログラムのリード、ライト
を許可する場合について説明したが、これに限らず、内
部電源が供給されているオフラインの場合に、ユーザ用
プログラムのリード、ライトを許可するようにしても良
い。
また、ICカードを用いたが、これに限らず、データメ
モリと制御素子とを有し、選択的に外部から入出力を行
うものであれば良(、形状もカード状でなく、棒状など
他の形状であっても良い。
[発明の効果コ 以上詳述したようにこの発明によれば、価格の高価格化
を防ぎ、開発期間の短縮化を図ることができる携帯可能
媒体を提供できる。
【図面の簡単な説明】
図面はこの発明の一実施例を説明するためのもので、第
1図はICカードの電気回路の概略構成を示す図、第2
図はICカードの構成を示す平面図、第3図はICカー
ドを取扱う端末機を示す図、第4図はデータメモリの構
成を示す図、第5図はメモリ制御回路の構成を示す図で
ある。 10・・・IC力7ド(携帯可能媒体)、11・・・コ
ンタクト部、12・・・キーボード部、13・・・表示
部、16・・・ICカード読取書込部、28・・・CP
U(制御素子)、29・・・マスクROM (記憶手段
)、31・・・データメモリ(記憶手段) 31a・・
・ユーザ用アプリケーションプログラム記憶エリア、3
1b・・・ユーザ用データ記憶エリア、31c・・・基
本プログラム用データ記憶エリア、40・・・メモリ制
御回路、51・・・ユーザエリアアドレスメモリ、52
・・・アドレス比較回路、53.60・・・ナンド回路
、54.59・・・インバータ回路、55・・・データ
選択回路、56・・・リードバッファ、57・・・ソフ
ト割込み命令コードレジスタ、58・・・ライトデータ
バッファ〇

Claims (1)

    【特許請求の範囲】
  1. 制御素子と記憶手段とを有し、オンライン、オフライン
    にて用いられる携帯可能媒体において、上記記憶手段は
    基本機能を記憶する書き替え不可能な第1の記憶エリア
    とユーザ用のアプリケーションプログラムが記憶可能な
    書き替え可能な第2の記憶エリアとを有し、上記第2の
    記憶エリアのアクセスをオンラインモードとオフライン
    モードとで制限する制限手段を具備したことを特徴とす
    る携帯可能媒体。
JP1148994A 1989-06-12 1989-06-12 携帯可能電子装置 Pending JPH0314083A (ja)

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