JPH0322732A - 高速クロック再生装置 - Google Patents
高速クロック再生装置Info
- Publication number
- JPH0322732A JPH0322732A JP1157837A JP15783789A JPH0322732A JP H0322732 A JPH0322732 A JP H0322732A JP 1157837 A JP1157837 A JP 1157837A JP 15783789 A JP15783789 A JP 15783789A JP H0322732 A JPH0322732 A JP H0322732A
- Authority
- JP
- Japan
- Prior art keywords
- correction
- reception
- phase difference
- reception startup
- phase
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Landscapes
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明はデータ通信等に使用するクロック再生装置に関
する。
する。
従来の技術
第２図は従来のクロック再生装置の構成を示している。
第２図において、１はゼロクロス信号入力端子であり、
ゼロクロス検出部６に接続されている。７はアンプダウ
ンカウンタ７であり、ゼロクロス検出部の出力が固定分
周器１１の出力と共に入力されている。９は補正幅切替
部であり、補正幅設定端子４からの入力によって、可変
分周器１０の分局数を切替える。１２は基準クロックで
ある。
ゼロクロス検出部６に接続されている。７はアンプダウ
ンカウンタ７であり、ゼロクロス検出部の出力が固定分
周器１１の出力と共に入力されている。９は補正幅切替
部であり、補正幅設定端子４からの入力によって、可変
分周器１０の分局数を切替える。１２は基準クロックで
ある。
次に上記従来例の動作について説明する。第２図におい
て、アップダウンカウンタ７により、ゼロクロス信号入
力と固定分周器１１かもの入力の位相差の方向をゼロク
ロス信号が入力されるごとに力．ウントし、一定値にな
ると、可変分周器１０の分周数を切替える。このことに
より、固定分周器１１の出力信号の位相を、ゼロクロス
信号入力に、致するようにしている。
て、アップダウンカウンタ７により、ゼロクロス信号入
力と固定分周器１１かもの入力の位相差の方向をゼロク
ロス信号が入力されるごとに力．ウントし、一定値にな
ると、可変分周器１０の分周数を切替える。このことに
より、固定分周器１１の出力信号の位相を、ゼロクロス
信号入力に、致するようにしている。
このように、上記従来のクロソク再生装置でもゼロクロ
ス信号に同期したクロックを再生することができる。
ス信号に同期したクロックを再生することができる。
発明が解決しようとする課題
しかしながら、上記従来のクロック再生装置では、可変
分周器１０の分周値を、フレーム同期信号の検出等によ
り切替えているため、受信立ち上がり時に大きく位相差
がある場合、高速にクロック再生できないという問題が
あった。
分周器１０の分周値を、フレーム同期信号の検出等によ
り切替えているため、受信立ち上がり時に大きく位相差
がある場合、高速にクロック再生できないという問題が
あった。
本発明はこのような従来の問題を解決するものであり、
高速にクロック再生できる優れたクロック再生装置を提
供することを目的とするものである。
高速にクロック再生できる優れたクロック再生装置を提
供することを目的とするものである。
課題を解決するための手段
本発明は上記目的を達成するために、受信立ち上がり検
出部と、補正回数カウンタを備えたものである。
出部と、補正回数カウンタを備えたものである。
作用
したがって本発明によれば受信立ち上がり検出部によっ
て、受信立ち上がりを検出し、補正回数カウンタによっ
て、受信立ち上がり時からの位相補正回数をカウントし
、そのカウント数によって位相補正幅を順々に小さくし
てゆくことによって一定位相差まで高速に引きこむこと
ができる。
て、受信立ち上がりを検出し、補正回数カウンタによっ
て、受信立ち上がり時からの位相補正回数をカウントし
、そのカウント数によって位相補正幅を順々に小さくし
てゆくことによって一定位相差まで高速に引きこむこと
ができる。
実施例
第１図は本発明の一実施例の構或を示すものである。第
１図において、２はアンＯツク信号入力端子、３はプレ
ス信号入力端子であり、受信立ち上がり検出部５に入力
されている。８は補正回数カウンタであり、アップダウ
ンカウンタ７と、補正幅切替部９との間に接続されてお
り、受信立ち上がり検出部５の出力も接続されている。
１図において、２はアンＯツク信号入力端子、３はプレ
ス信号入力端子であり、受信立ち上がり検出部５に入力
されている。８は補正回数カウンタであり、アップダウ
ンカウンタ７と、補正幅切替部９との間に接続されてお
り、受信立ち上がり検出部５の出力も接続されている。
次に上記実施例の動作について説明する。上記実施例に
おいてアンロソク信号入力端子２とプレス信号入力端子
３からの入力状態により、電源投入時、送信後、周波数
切替後等の受信の立ち上がり時を受信立ち上がり検出部
５において検出し、補正回数カウンタをリセットする。
おいてアンロソク信号入力端子２とプレス信号入力端子
３からの入力状態により、電源投入時、送信後、周波数
切替後等の受信の立ち上がり時を受信立ち上がり検出部
５において検出し、補正回数カウンタをリセットする。
ゼロクロス検出部６で、ゼロクロス信号入力端子１の入
力信号のゼロクロスを検出してパルスを発生し、アップ
ダウンカウンタ７で、固定分周器１１の出力と位相差の
方向を比較し、位相ずれの回数をカウントする。回数が
一定値になると可変分周器１０の分局値を切替えるため
信号を出力する。補正回数カウンタ８ではその信号の出
力された回数をカウントする。補正幅切替部９ではカウ
ント数に従い、可変分周器の分周値を切替える。補正回
数カウンタのカウント数が大きく々るに従い、一回の補
正幅を小さくなるように、可変分周器１０の分局値を切
り替えると、受信立ち上がり時に、位相差が大きい場合
にも、高速に、ゼロクロス信号と同期したクロックを再
成できる。
力信号のゼロクロスを検出してパルスを発生し、アップ
ダウンカウンタ７で、固定分周器１１の出力と位相差の
方向を比較し、位相ずれの回数をカウントする。回数が
一定値になると可変分周器１０の分局値を切替えるため
信号を出力する。補正回数カウンタ８ではその信号の出
力された回数をカウントする。補正幅切替部９ではカウ
ント数に従い、可変分周器の分周値を切替える。補正回
数カウンタのカウント数が大きく々るに従い、一回の補
正幅を小さくなるように、可変分周器１０の分局値を切
り替えると、受信立ち上がり時に、位相差が大きい場合
にも、高速に、ゼロクロス信号と同期したクロックを再
成できる。
発明の効果
実施例より明らかなように本発明によれば受信立ち上が
り時に、補正幅を大きくすることができ、位相差が大き
いときには、補正回数を少なくすることができ、高速々
クロック再生が可能であり、また、補正幅を順々に小さ
くすることにより、定常時には、安定したクロック再生
を行うことができるという利点を有する。
り時に、補正幅を大きくすることができ、位相差が大き
いときには、補正回数を少なくすることができ、高速々
クロック再生が可能であり、また、補正幅を順々に小さ
くすることにより、定常時には、安定したクロック再生
を行うことができるという利点を有する。
第１図は本発明の一実施例におけるクロック再生装置の
概略ブロック図、第２図は従来のクロック再生装置の概
略プロノク図である。 １・・・ゼロクロス信号入力端子、２・・・アンロソク
信号入力端子、３・・・プレス信号入力端子、４・・・
補正幅設定端子、５・・・受信立ち上がり検出部、６・
・・ゼロクロス検出部、７・・・アソグダウンカウンタ
、８・・・補正回数カウ／タ、９・・・補正幅切替部、
１０・・・可変分周期、ｌ１・・・固定分周期、１２・
・・基準クロンク。
概略ブロック図、第２図は従来のクロック再生装置の概
略プロノク図である。 １・・・ゼロクロス信号入力端子、２・・・アンロソク
信号入力端子、３・・・プレス信号入力端子、４・・・
補正幅設定端子、５・・・受信立ち上がり検出部、６・
・・ゼロクロス検出部、７・・・アソグダウンカウンタ
、８・・・補正回数カウ／タ、９・・・補正幅切替部、
１０・・・可変分周期、ｌ１・・・固定分周期、１２・
・・基準クロンク。
Claims (1)
- 受信立ち上がりを検出する立ち上がり検出部と、ゼロク
ロス信号の入力と内部クロックの位相差をカウントする
アップダウンカウンタと、受信立ち上がり時からの位相
補正回数をカウントする補正回数カウンタと、補正回数
によって分周値を切替える可変分周器を備えたクロック
再生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1157837A JP2548381B2 (ja) | 1989-06-20 | 1989-06-20 | 高速クロック再生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1157837A JP2548381B2 (ja) | 1989-06-20 | 1989-06-20 | 高速クロック再生装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0322732A true JPH0322732A (ja) | 1991-01-31 |
| JP2548381B2 JP2548381B2 (ja) | 1996-10-30 |
Family
ID=15658426
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1157837A Expired - Fee Related JP2548381B2 (ja) | 1989-06-20 | 1989-06-20 | 高速クロック再生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2548381B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH065221U (ja) * | 1992-06-18 | 1994-01-21 | シャープ株式会社 | パワーｍｏｓｆｅｔ駆動回路 |
| JP2012008673A (ja) * | 2010-06-23 | 2012-01-12 | Oki Data Corp | 電源装置及びこれを用いた画像形成装置 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61248635A (ja) * | 1985-04-26 | 1986-11-05 | Nec Corp | デイジタル位相同期回路 |
| JPS6464434A (en) * | 1987-09-03 | 1989-03-10 | Nec Corp | Digital phase control circuit |
-
1989
- 1989-06-20 JP JP1157837A patent/JP2548381B2/ja not_active Expired - Fee Related
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61248635A (ja) * | 1985-04-26 | 1986-11-05 | Nec Corp | デイジタル位相同期回路 |
| JPS6464434A (en) * | 1987-09-03 | 1989-03-10 | Nec Corp | Digital phase control circuit |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH065221U (ja) * | 1992-06-18 | 1994-01-21 | シャープ株式会社 | パワーｍｏｓｆｅｔ駆動回路 |
| JP2012008673A (ja) * | 2010-06-23 | 2012-01-12 | Oki Data Corp | 電源装置及びこれを用いた画像形成装置 |
| US8995858B2 (en) | 2010-06-23 | 2015-03-31 | Oki Data Corporation | Power supply device and image formation apparatus |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2548381B2 (ja) | 1996-10-30 |
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