JPH03256418A - 回線切替装置 - Google Patents
回線切替装置Info
- Publication number
- JPH03256418A JPH03256418A JP2056163A JP5616390A JPH03256418A JP H03256418 A JPH03256418 A JP H03256418A JP 2056163 A JP2056163 A JP 2056163A JP 5616390 A JP5616390 A JP 5616390A JP H03256418 A JPH03256418 A JP H03256418A
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- JP
- Japan
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- signal
- clock
- switching
- synchronized
- terminal
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- Granted
Links
- 230000001360 synchronised effect Effects 0.000 claims abstract description 20
- 230000005540 biological transmission Effects 0.000 abstract description 8
- 238000000034 method Methods 0.000 abstract description 5
- 230000000694 effects Effects 0.000 description 3
- 238000010586 diagram Methods 0.000 description 2
- 238000004891 communication Methods 0.000 description 1
- 238000005516 engineering process Methods 0.000 description 1
- 230000003287 optical effect Effects 0.000 description 1
Landscapes
- Communication Control (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
- Time-Division Multiplex Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ディジタル通信方式に利用する。特に、同期
網での任意の回線接続を行う切替手段に関する。
網での任意の回線接続を行う切替手段に関する。
本発明は、受信するディジタル信号を切り替える手段と
、この手段とは別に切り替えたディジタル信号を送信す
る手段を有する回線切替装置において、 スタッフ同期技法で同期網を形成してからクロック信号
を除くディジタル信号を切り替えることにより、 回路規模の縮小を図りかつ送信信号と受信信号とのクロ
スコネクトを実現することができるようにしたものであ
る。
、この手段とは別に切り替えたディジタル信号を送信す
る手段を有する回線切替装置において、 スタッフ同期技法で同期網を形成してからクロック信号
を除くディジタル信号を切り替えることにより、 回路規模の縮小を図りかつ送信信号と受信信号とのクロ
スコネクトを実現することができるようにしたものであ
る。
従来例は、第2図の例に示すように非同期網で構成され
る。伝送路からデータ信号とクロック信号との組の入力
信号1−1〜1−4がインタフェイス回路3〜6にそれ
ぞれ入力する。インタフェイス回路3〜6は伝送路信号
を切替接続が容易にするために装置内信号に変換する。
る。伝送路からデータ信号とクロック信号との組の入力
信号1−1〜1−4がインタフェイス回路3〜6にそれ
ぞれ入力する。インタフェイス回路3〜6は伝送路信号
を切替接続が容易にするために装置内信号に変換する。
伝送路信号は一般にバイポーラ信号または光信号を使用
しているため装置内信号として電気のユニポーラ信号を
用いる。インタフェイス回路3〜6で変換された装置内
信号は回線切替回路7に人力する。回線切替回路7では
入力された信号を任意の出力端子に接続する。これの接
続制御は外部より行われる。
しているため装置内信号として電気のユニポーラ信号を
用いる。インタフェイス回路3〜6で変換された装置内
信号は回線切替回路7に人力する。回線切替回路7では
入力された信号を任意の出力端子に接続する。これの接
続制御は外部より行われる。
また、受信側についても同様の動作を行う。
しかし、この従来例では、各データ信号とこれと同期す
るクロック信号とを常に組で使用する必要があり、切替
を行うときにはデータ信号の切替えのほかにクロック信
号も同時に切替える必要がある。したがって、回路素子
が2倍必要になり消費電力が増える欠点がある。
るクロック信号とを常に組で使用する必要があり、切替
を行うときにはデータ信号の切替えのほかにクロック信
号も同時に切替える必要がある。したがって、回路素子
が2倍必要になり消費電力が増える欠点がある。
本発明はこのような欠点を除去するもので、回路規模が
従来例に較べて縮小された回線切替装置を提供すること
を目的とする。
従来例に較べて縮小された回線切替装置を提供すること
を目的とする。
本発明は、第一端子を経由するデータ信号とこの信号に
同期するクロック信号とからなる1組の信号を所望の第
二端子に与える第一切替手段および第三端子を経由する
データ信号とこの信号に同期するクロック信号とからな
る1組の信号を所望の第四端子に与える第二切替手段と
を備えた回線切替装置において、ひとつのクロックを有
する同期信号を生威し、上記第一端子および上記第三端
子を経由するデータ信号に同期するクロック信号をこの
同期信号に同期させるスタッフ同期手段および上記第一
切替手段および第二切替手段にクロック信号を含まない
データ信号を与える手段を備えたことを特徴とする。ま
た、上記第一切替手段と上記第二切替手段とをクロスコ
ネクトに接続する回路手段を備えても良い。
同期するクロック信号とからなる1組の信号を所望の第
二端子に与える第一切替手段および第三端子を経由する
データ信号とこの信号に同期するクロック信号とからな
る1組の信号を所望の第四端子に与える第二切替手段と
を備えた回線切替装置において、ひとつのクロックを有
する同期信号を生威し、上記第一端子および上記第三端
子を経由するデータ信号に同期するクロック信号をこの
同期信号に同期させるスタッフ同期手段および上記第一
切替手段および第二切替手段にクロック信号を含まない
データ信号を与える手段を備えたことを特徴とする。ま
た、上記第一切替手段と上記第二切替手段とをクロスコ
ネクトに接続する回路手段を備えても良い。
データ信号とクロック信号との組の信号をスタッフ同期
技法で同期化し、この同期化されたデータ信号を切替え
接続する。これにより、クロック信号も併せて切替える
場合に較べて回路規模をほぼ半減することができ、また
、送信側と受信側とのクロスコネクトを可能にする。
技法で同期化し、この同期化されたデータ信号を切替え
接続する。これにより、クロック信号も併せて切替える
場合に較べて回路規模をほぼ半減することができ、また
、送信側と受信側とのクロスコネクトを可能にする。
辺下、本発明の一実施例について図面を参照して説明す
る。第1図はこの実施例の構成を示す。
る。第1図はこの実施例の構成を示す。
すなわち、この実施例は、第一端子を経由するデータ信
号とこの信号に同期するクロック信号とからなる1組の
信号を所望の第二端子に与える第一切替手段である回線
切替回路7および第三端子を経由するデータ信号とこの
信号に同期するクロック信号とからなる1組の信号を所
望の第四端子に与える第二切替手段である回線切替回路
8とを備え、さ、らに、本発明の特徴とする手段として
、ひとつのクロックを有する同期信号を生成し、上記第
一端子および上記第三端子を経由するデータ信号に同期
するタロツク信号をこの同期信号に同期させるスタッフ
同期手段および上記第一切替手段および第二切替手段に
クロック信号を含まないデータ信号を与える手段である
マスク・クロック14、フレームパターン発生回路13
およびインクフェイス回路3′〜12′を備え、また、
上記第一切替手段と上記第二切替手段とをクロスコネク
トに接続する回路手段を備える。
号とこの信号に同期するクロック信号とからなる1組の
信号を所望の第二端子に与える第一切替手段である回線
切替回路7および第三端子を経由するデータ信号とこの
信号に同期するクロック信号とからなる1組の信号を所
望の第四端子に与える第二切替手段である回線切替回路
8とを備え、さ、らに、本発明の特徴とする手段として
、ひとつのクロックを有する同期信号を生成し、上記第
一端子および上記第三端子を経由するデータ信号に同期
するタロツク信号をこの同期信号に同期させるスタッフ
同期手段および上記第一切替手段および第二切替手段に
クロック信号を含まないデータ信号を与える手段である
マスク・クロック14、フレームパターン発生回路13
およびインクフェイス回路3′〜12′を備え、また、
上記第一切替手段と上記第二切替手段とをクロスコネク
トに接続する回路手段を備える。
次に、この実施例の動作を説明する。人力する4本のデ
ィジタル信号はインタフェイス回路3′〜6′でスタッ
フ同期技法により同期信号に同期化される。この同期信
号は、マスク・クロック14を用いてフレームパルス発
生回路13で作られる。
ィジタル信号はインタフェイス回路3′〜6′でスタッ
フ同期技法により同期信号に同期化される。この同期信
号は、マスク・クロック14を用いてフレームパルス発
生回路13で作られる。
また、インタフェイス回路3′〜6′では、伝送路信号
を装置内信号に変換する機能も有する。したがって、回
線切替回路7の入力のデータ信号はすべて同期化される
ことになる。回線切替回路7では、入力4本のデータ信
号を任意の出力に接続することができる。回線切替回路
7で切替えられた信号は再び伝送路信号に変換されて出
力される。
を装置内信号に変換する機能も有する。したがって、回
線切替回路7の入力のデータ信号はすべて同期化される
ことになる。回線切替回路7では、入力4本のデータ信
号を任意の出力に接続することができる。回線切替回路
7で切替えられた信号は再び伝送路信号に変換されて出
力される。
また、受信側でも同じ機能を有し、さらに、回線切替回
路8に入力する信号と回線切替回路7に入力する信号の
フレーム位置を合わせることにより、送信信号と受信信
号との回線接続やこの逆の接続も可能になる。したがっ
て回線切替回路7および8ではマスク・クロック14に
同期しているためにデータ信号のみの切替ですみ、さら
に、送信信号と受信信号とをクロスコネクト接続するこ
とが可能になる。
路8に入力する信号と回線切替回路7に入力する信号の
フレーム位置を合わせることにより、送信信号と受信信
号との回線接続やこの逆の接続も可能になる。したがっ
て回線切替回路7および8ではマスク・クロック14に
同期しているためにデータ信号のみの切替ですみ、さら
に、送信信号と受信信号とをクロスコネクト接続するこ
とが可能になる。
本発明は、以上説明したように、内部マスク・クロック
に入力信号を同期化させることによりデータ信号のみの
回線切替ですむので、回路規模と消費電力とを大幅に下
げることができる効果がある。さらに、送信信号と受信
信号とをクロスコネクトをすることができるので、サー
ビスの大幅な向上が図れる効果がある。
に入力信号を同期化させることによりデータ信号のみの
回線切替ですむので、回路規模と消費電力とを大幅に下
げることができる効果がある。さらに、送信信号と受信
信号とをクロスコネクトをすることができるので、サー
ビスの大幅な向上が図れる効果がある。
第1図は、本発明実施例の構成を示すブロック構成図。
第2図は、従来例の構成を示すブロック構成図。
1−1〜1−8・・・入力信号、2−1〜2−8・・・
出力信号、3〜6.9〜12.3′〜6′、9′〜12
′・・・インタフェイス回路、7.8・・・回線切替回
路、13・・・フレームパターン発生回路、14・・・
マスク・クロック。
出力信号、3〜6.9〜12.3′〜6′、9′〜12
′・・・インタフェイス回路、7.8・・・回線切替回
路、13・・・フレームパターン発生回路、14・・・
マスク・クロック。
Claims (1)
- 【特許請求の範囲】 1、第一端子を経由するデータ信号とこの信号に同期す
るクロック信号とからなる1組の信号を所望の第二端子
に与える第一切替手段および第三端子を経由するデータ
信号とこの信号に同期するクロック信号とからなる1組
の信号を所望の第四端子に与える第二切替手段とを備え
た回線切替装置において、 ひとつのクロックを有する同期信号を生成し、上記第一
端子および上記第三端子を経由するデータ信号に同期す
るクロック信号をこの同期信号に同期させるスタッフ同
期手段および上記第一切替手段および第二切替手段にク
ロック信号を含まないデータ信号を与える手段を備えた
ことを特徴とする回線切替装置。 2、上記第一切替手段と上記第二切替手段とをクロスコ
ネクトに接続する回路手段を備えた請求項1に記載の回
線切替装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2056163A JPH0817359B2 (ja) | 1990-03-06 | 1990-03-06 | 回線切替装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2056163A JPH0817359B2 (ja) | 1990-03-06 | 1990-03-06 | 回線切替装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03256418A true JPH03256418A (ja) | 1991-11-15 |
| JPH0817359B2 JPH0817359B2 (ja) | 1996-02-21 |
Family
ID=13019426
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2056163A Expired - Lifetime JPH0817359B2 (ja) | 1990-03-06 | 1990-03-06 | 回線切替装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0817359B2 (ja) |
-
1990
- 1990-03-06 JP JP2056163A patent/JPH0817359B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0817359B2 (ja) | 1996-02-21 |
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