JPH03257378A - 中間値検出回路 - Google Patents
中間値検出回路Info
- Publication number
- JPH03257378A JPH03257378A JP2057142A JP5714290A JPH03257378A JP H03257378 A JPH03257378 A JP H03257378A JP 2057142 A JP2057142 A JP 2057142A JP 5714290 A JP5714290 A JP 5714290A JP H03257378 A JPH03257378 A JP H03257378A
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- JP
- Japan
- Prior art keywords
- output
- circuit
- schmitt
- level
- voltage
- Prior art date
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- Pending
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- Measurement Of Current Or Voltage (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は入力端子の中間値を検出する中間値検出回路に
関するものである。
関するものである。
従来の技術
一般に家電用のマイクロコンピュータにおいては、１０
０ｖの商用交流電源を供給電源としているため、たとえ
ば停電時にバックアップ電源に切換える必要があるかど
うかを検出しなければならない。また、６０Ｈｚと５０
Ｈｚのいずれの交流電源が供給されているかを検出する
必要もある。
０ｖの商用交流電源を供給電源としているため、たとえ
ば停電時にバックアップ電源に切換える必要があるかど
うかを検出しなければならない。また、６０Ｈｚと５０
Ｈｚのいずれの交流電源が供給されているかを検出する
必要もある。
一般にこのような検出は、商用電源を降圧し、マイクロ
コンピュータあるいはその周辺回路に入力可能なレベル
まで減衰した交流電圧を中間値検出回路に入力し、その
交流電圧の振幅の中間電圧を横切るタイミングを検出す
ることによって、停電が、６０Ｈｚか５０Ｈ７か等の供
給電源の状態を知ることによって行なわれる。
コンピュータあるいはその周辺回路に入力可能なレベル
まで減衰した交流電圧を中間値検出回路に入力し、その
交流電圧の振幅の中間電圧を横切るタイミングを検出す
ることによって、停電が、６０Ｈｚか５０Ｈ７か等の供
給電源の状態を知ることによって行なわれる。
第５図は、このような目的に用いられる従来の中間値検
出回路を示すものである。
出回路を示すものである。
第５図において、入力端子１に加えられた交流電圧は、
スイッチングレベルの異なる２つのインバータ２，３に
加えられる。そして一方のインバータ２の主力をインバ
ータ４で反転した電圧と、他方のインバータ３の出力電
圧とをＡＮＤ回路５に人力して両型圧の論理積をとり、
その出力を中間値検出出力として出力端子６から取り出
すようにしている。
スイッチングレベルの異なる２つのインバータ２，３に
加えられる。そして一方のインバータ２の主力をインバ
ータ４で反転した電圧と、他方のインバータ３の出力電
圧とをＡＮＤ回路５に人力して両型圧の論理積をとり、
その出力を中間値検出出力として出力端子６から取り出
すようにしている。
発明が解決しようとする課題
しかしながら、上記従来の構成においては、ノイズ成分
の入力端子が加わったとき、インバータ２．３のスイッ
チングレベルの近傍で出力にチャタリングが生しる。こ
のようなチャタリングのある出力をマイクロコンピュー
タ（図示せず）に供給し、たとえば割り込み制御信号に
利用すると、マイクロコンピュータが誤動作を起こすと
いう問題がある。
の入力端子が加わったとき、インバータ２．３のスイッ
チングレベルの近傍で出力にチャタリングが生しる。こ
のようなチャタリングのある出力をマイクロコンピュー
タ（図示せず）に供給し、たとえば割り込み制御信号に
利用すると、マイクロコンピュータが誤動作を起こすと
いう問題がある。
本発明はこのような従来の問題を解決する中間値検出回
路を提供するものである。
路を提供するものである。
課題を解決するための手段
この目的を達成するために、本発明は、交流の入力電圧
を、シュミット幅が同一でスイッチングレベルの異なる
第１．第２のシュミット回路に加え、第１のシュミット
回路の反転電圧と第２のシュミット回路の出力電圧の論
理積をとることにより、入力電圧の中間値を検出するよ
うにしたものである。
を、シュミット幅が同一でスイッチングレベルの異なる
第１．第２のシュミット回路に加え、第１のシュミット
回路の反転電圧と第２のシュミット回路の出力電圧の論
理積をとることにより、入力電圧の中間値を検出するよ
うにしたものである。
作用
このようにすれば、第１．第２のシュミット回路のヒス
テリミス幅以下のノイズ電圧が除去できる。このためチ
ャタリング等のノイズに強い中間値検出回路が実現でき
る。
テリミス幅以下のノイズ電圧が除去できる。このためチ
ャタリング等のノイズに強い中間値検出回路が実現でき
る。
実施例
以下、本発明の一実施例を図面とともに説明する。
第１図、第２図は本発明の一実施例における中間値検出
回路のブロック図およびその具体回路を示すものである
。
回路のブロック図およびその具体回路を示すものである
。
第１図、第２図において、入力端子１に加えられた交流
電圧は、第１．第２のシュミット回路７．８に人力され
る。第１のシュミット回路７の出力はインバータ９で反
転される。インバータ９の出力と第２のシュミット回路
８の出力はＡＮＤ回路１０に入力され、その論理積が中
間値検出出力として出力端子６に出力される。
電圧は、第１．第２のシュミット回路７．８に人力され
る。第１のシュミット回路７の出力はインバータ９で反
転される。インバータ９の出力と第２のシュミット回路
８の出力はＡＮＤ回路１０に入力され、その論理積が中
間値検出出力として出力端子６に出力される。
なお、第２図において、Ｐ、−ｐ８はＰチャネルの電界
効果トランジスタ、Ｎｌ 〜ＮＩＯはＮチャネルの電界
効果トランジスタである。
効果トランジスタ、Ｎｌ 〜ＮＩＯはＮチャネルの電界
効果トランジスタである。
第３図は第１．第２のシュミット回路の入出力電圧特性
を示すものであり、実線が第１のシュミット回路７の、
破線が第２のシュミット回路８の入出力電圧特性である
。第３図から明らかなように、第１．第２のシュミット
回路７，８は、シュミット幅は同じでスイッチングレベ
ルが異なっている。
を示すものであり、実線が第１のシュミット回路７の、
破線が第２のシュミット回路８の入出力電圧特性である
。第３図から明らかなように、第１．第２のシュミット
回路７，８は、シュミット幅は同じでスイッチングレベ
ルが異なっている。
第４図は第１図、第２図の各回路ブロックの出力電圧波
形を示している。
形を示している。
以下、第４図を参照しながら、上記実施例の動作を説明
する。
する。
第４図に示すように、入力電圧がＬレベルからＨレベル
へ変化する場合、時刻Ａ点でシュミット回路２のスイッ
チングレベルＶ２Ｈを通過することにより第２のシュミ
ット回路８の出力がＬレベルからＨレベルへ変化すると
同時に、スイッチングレベルがＶ２Ｌと変化し、ヒステ
リシス特性がら、Ｖ２Ｌレヘルまでのノイズが重畳され
ても出力が安定していることがわかる。この時第１のシ
ュミット回路７の出力はＬレベル、インバータ９の出力
はＩＩレベルであるから、ＡＮＤ回路１０の出力はＬレ
ベルからＨレベルへと変化する。さらに時刻Ｂ点で入力
電圧が第１のシュミット回路７のスイッチングレベルＶ
ＩＨを通過すると、第１のシュミット回路７の出力がＬ
レベルからＨレベルへ、したがってインバータ９の出力
がＨレベルからＬレベルへ変化し、ＡＮＤ回路１０にお
ける論理積出力はＨレベルからＬレベルへと変化する。
へ変化する場合、時刻Ａ点でシュミット回路２のスイッ
チングレベルＶ２Ｈを通過することにより第２のシュミ
ット回路８の出力がＬレベルからＨレベルへ変化すると
同時に、スイッチングレベルがＶ２Ｌと変化し、ヒステ
リシス特性がら、Ｖ２Ｌレヘルまでのノイズが重畳され
ても出力が安定していることがわかる。この時第１のシ
ュミット回路７の出力はＬレベル、インバータ９の出力
はＩＩレベルであるから、ＡＮＤ回路１０の出力はＬレ
ベルからＨレベルへと変化する。さらに時刻Ｂ点で入力
電圧が第１のシュミット回路７のスイッチングレベルＶ
ＩＨを通過すると、第１のシュミット回路７の出力がＬ
レベルからＨレベルへ、したがってインバータ９の出力
がＨレベルからＬレベルへ変化し、ＡＮＤ回路１０にお
ける論理積出力はＨレベルからＬレベルへと変化する。
この時第２のシュミット回路８の場合と同様に第１のシ
ュミット回路７でもスイッチングレベルがＶＩＬへと低
下することにより、ノイズによるチャタリングと防止で
きる。さらに時間を経て入力端子がＨレベルからＬレベ
ルへと変化する場合は、時刻Ｃ点において第１のシュミ
ット回路７のスイッチングレベルＶＩＬを通過すると、
その出力がＨレベルからＬレベルへ、したがってインバ
ータ９の出力がＬレベルからＨレベルへ変化し、ＡＮＤ
回路１０における論理積出力がＬレベルからＨレベルへ
変化する。同時に第１のシュミット回路７のスイッチン
グレベルがＶＩＬからＶＩＨへと変化する。さらに時刻
り点になると、入力電圧が第２のシュミット回路８のス
イッチングレベルＶ２Ｌを通過するため、その出力がＩ
］レヘルからＬレベルへ、ＡＮＤ回路１０の論理積出力
がＩ］レヘルからＬレベルへと変化する。これと同時に
第２のシュミット回路８のスイッチングレベルがＶ２Ｈ
へと上昇する。このように第１．第２のシュミット回路
７，８のスイッチングレベルにヒステリシスを設けるこ
とにより、ヒステリシス幅以下のノイズ電圧の影響が除
去され、出力のチャタリングが防止で゛きる。したがっ
て、ＡＮＤ回路１０の出力をマイクロコンピュータの割
り込みｉ１７御信号として用いた場合ても、マイクロコ
ンビ。
ュミット回路７でもスイッチングレベルがＶＩＬへと低
下することにより、ノイズによるチャタリングと防止で
きる。さらに時間を経て入力端子がＨレベルからＬレベ
ルへと変化する場合は、時刻Ｃ点において第１のシュミ
ット回路７のスイッチングレベルＶＩＬを通過すると、
その出力がＨレベルからＬレベルへ、したがってインバ
ータ９の出力がＬレベルからＨレベルへ変化し、ＡＮＤ
回路１０における論理積出力がＬレベルからＨレベルへ
変化する。同時に第１のシュミット回路７のスイッチン
グレベルがＶＩＬからＶＩＨへと変化する。さらに時刻
り点になると、入力電圧が第２のシュミット回路８のス
イッチングレベルＶ２Ｌを通過するため、その出力がＩ
］レヘルからＬレベルへ、ＡＮＤ回路１０の論理積出力
がＩ］レヘルからＬレベルへと変化する。これと同時に
第２のシュミット回路８のスイッチングレベルがＶ２Ｈ
へと上昇する。このように第１．第２のシュミット回路
７，８のスイッチングレベルにヒステリシスを設けるこ
とにより、ヒステリシス幅以下のノイズ電圧の影響が除
去され、出力のチャタリングが防止で゛きる。したがっ
て、ＡＮＤ回路１０の出力をマイクロコンピュータの割
り込みｉ１７御信号として用いた場合ても、マイクロコ
ンビ。
−タが誤動作を起こすことはない。
発明の効果
本発明によれば、第１．第２のシュミット回路のヒステ
リシス幅以下のノイズ電圧を除去し、正確な中間電圧を
検出することができる。
リシス幅以下のノイズ電圧を除去し、正確な中間電圧を
検出することができる。
第１図は本発明の一実施例における中間値検出回路のブ
ロック図、第２図は第１図に示した実施例の具体回路図
、第３図および第４図は第１図。 第２図に示した実施例の動作を説明するための電圧波形
図である。第５図は従来の中間値検出回路のブロック図
である。 １・・・・・・入力端子、６・・・・・・出力端子、７
・・・・・・第１のシュミット回路、８・・・・・・第
２のシュミット回路、９・・・・・・インバータ、１０
・・・・・・ＡＮＤ回路。
ロック図、第２図は第１図に示した実施例の具体回路図
、第３図および第４図は第１図。 第２図に示した実施例の動作を説明するための電圧波形
図である。第５図は従来の中間値検出回路のブロック図
である。 １・・・・・・入力端子、６・・・・・・出力端子、７
・・・・・・第１のシュミット回路、８・・・・・・第
２のシュミット回路、９・・・・・・インバータ、１０
・・・・・・ＡＮＤ回路。
Claims (1)
- 交流の入力電圧を、シュミット幅が同一でスイッチング
レベルの異なる第１、第２のシュミット回路に入力し、
上記第１のシュミット回路の反転電圧と上記第２のシュ
ミット回路の出力電圧をＡＮＤ回路に加え、上記ＡＮＤ
回路の論理積出力を上記入力電圧の中間値として出力す
ることを特徴とする中間値検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2057142A JPH03257378A (ja) | 1990-03-08 | 1990-03-08 | 中間値検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2057142A JPH03257378A (ja) | 1990-03-08 | 1990-03-08 | 中間値検出回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03257378A true JPH03257378A (ja) | 1991-11-15 |
Family
ID=13047326
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2057142A Pending JPH03257378A (ja) | 1990-03-08 | 1990-03-08 | 中間値検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03257378A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2010181331A (ja) * | 2009-02-06 | 2010-08-19 | Nec Access Technica Ltd | ＶｏＩＰアダプタにおけるＡＣアダプタ誤接続防止装置、及び防止方法 |
-
1990
- 1990-03-08 JP JP2057142A patent/JPH03257378A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2010181331A (ja) * | 2009-02-06 | 2010-08-19 | Nec Access Technica Ltd | ＶｏＩＰアダプタにおけるＡＣアダプタ誤接続防止装置、及び防止方法 |
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