JPH0325748B2 - - Google Patents
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- JPH0325748B2 JPH0325748B2 JP19058381A JP19058381A JPH0325748B2 JP H0325748 B2 JPH0325748 B2 JP H0325748B2 JP 19058381 A JP19058381 A JP 19058381A JP 19058381 A JP19058381 A JP 19058381A JP H0325748 B2 JPH0325748 B2 JP H0325748B2
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- JP
- Japan
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- pulse
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- wave signal
- switching
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- 230000001360 synchronised effect Effects 0.000 claims description 8
- 230000001934 delay Effects 0.000 claims 3
- 238000010586 diagram Methods 0.000 description 4
- 230000001172 regenerating effect Effects 0.000 description 4
- 239000003990 capacitor Substances 0.000 description 3
- 230000003111 delayed effect Effects 0.000 description 2
- 230000001960 triggered effect Effects 0.000 description 2
- 238000000034 method Methods 0.000 description 1
- 230000000630 rising effect Effects 0.000 description 1
- 238000007493 shaping process Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G01—MEASURING; TESTING
- G01R—MEASURING ELECTRIC VARIABLES; MEASURING MAGNETIC VARIABLES
- G01R13/00—Arrangements for displaying electric variables or waveforms
- G01R13/20—Cathode-ray oscilloscopes
- G01R13/22—Circuits therefor
- G01R13/32—Circuits for displaying non-recurrent functions such as transients; Circuits for triggering; Circuits for synchronisation; Circuits for time-base expansion
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Pulse Circuits (AREA)
- Tests Of Electronic Circuits (AREA)
Description
【発明の詳細な説明】
本発明は波形表示装置のトリガパルス発生器に
関し、さらに詳言すれば所定デユーテイ比の方形
波信号の1サイクル中の正の期間に出力される第
1の信号と前記方形波信号の1サイクル中におい
て前記正の期間に引続く残余の期間に出力される
第2の信号とが引続いて一入力信号として印加さ
れ該入力信号の成形信号を行なう波形表示装置の
トリガパルス発生器に関する。
関し、さらに詳言すれば所定デユーテイ比の方形
波信号の1サイクル中の正の期間に出力される第
1の信号と前記方形波信号の1サイクル中におい
て前記正の期間に引続く残余の期間に出力される
第2の信号とが引続いて一入力信号として印加さ
れ該入力信号の成形信号を行なう波形表示装置の
トリガパルス発生器に関する。
電子回路または電子機器の特性を測定または調
整する場合に、上記した如き入力信号の波形表示
を行なつて表示された波形を観測する必要がある
場合がある。たとえば、ビデオテープレコーダに
おいて回転磁気ヘツドによりピツクアツプした低
搬送波FM信号を増幅する第1チヤンネル用およ
び第2チヤンネル用再生増幅器の平衡調整等の場
合がその例である。この場合第1チヤンネルの低
搬送波FM信号を増幅する第1チヤンネル用再生
増幅器の出力と、第2チヤンネルの低搬送波FM
信号を増幅する第2チヤンネル用再生増幅器の出
力とを合成した点の出力波形を観測して調整が行
なわれる。この場合に、合成映像信号の垂直同期
信号の立下りに、立下りおよび立上りが同期した
第1図aに示す方形波信号の正の期間にたとえば
第1チヤンネルの出力が、前記正の期間に引続く
1サイクルの残余の期間に第2チヤンネルの出力
が連続して表われる信号が波形表示装置に入力信
号として印加され、たとえばオツシロスコープ上
に表示される波形は第1図bまたはcに示す如く
になる。
整する場合に、上記した如き入力信号の波形表示
を行なつて表示された波形を観測する必要がある
場合がある。たとえば、ビデオテープレコーダに
おいて回転磁気ヘツドによりピツクアツプした低
搬送波FM信号を増幅する第1チヤンネル用およ
び第2チヤンネル用再生増幅器の平衡調整等の場
合がその例である。この場合第1チヤンネルの低
搬送波FM信号を増幅する第1チヤンネル用再生
増幅器の出力と、第2チヤンネルの低搬送波FM
信号を増幅する第2チヤンネル用再生増幅器の出
力とを合成した点の出力波形を観測して調整が行
なわれる。この場合に、合成映像信号の垂直同期
信号の立下りに、立下りおよび立上りが同期した
第1図aに示す方形波信号の正の期間にたとえば
第1チヤンネルの出力が、前記正の期間に引続く
1サイクルの残余の期間に第2チヤンネルの出力
が連続して表われる信号が波形表示装置に入力信
号として印加され、たとえばオツシロスコープ上
に表示される波形は第1図bまたはcに示す如く
になる。
第1図bは各チヤンネルの出力期間わたつて掃
引発振器の出力信号を記録させた磁気テープ(以
下、スイープテープと記す)を再生した場合のオ
ツシロスコープ上の表示波形を示し、第1図cは
所定のパターン画像等を自己録画した磁気テープ
(以下、自己録画テープと記す)を再生した場合
のオツシロスコープ上の表示波形を示している。
引発振器の出力信号を記録させた磁気テープ(以
下、スイープテープと記す)を再生した場合のオ
ツシロスコープ上の表示波形を示し、第1図cは
所定のパターン画像等を自己録画した磁気テープ
(以下、自己録画テープと記す)を再生した場合
のオツシロスコープ上の表示波形を示している。
第1図bおよびcに示す如くオツシロスコープ
上における表示波形は第1チヤンネル出力と第2
チヤンネル出力とに対応して交互に現わる。この
ため第1チヤンネル用および第2チヤンネル用再
生増幅器の調整時、第1および第2チヤンネル出
力の平衡調整時等においては、第1チヤンネル出
力および第2チヤンネル出力に対応する表示波形
を比較するか、または第1チヤンネル出力に対応
する表示波形と第2チヤンネル出力に対応する表
示波形とを独立して同一オツシロスコープ上に引
続いて表示させてその両者を比較することによつ
て調整を行なつていた。
上における表示波形は第1チヤンネル出力と第2
チヤンネル出力とに対応して交互に現わる。この
ため第1チヤンネル用および第2チヤンネル用再
生増幅器の調整時、第1および第2チヤンネル出
力の平衡調整時等においては、第1チヤンネル出
力および第2チヤンネル出力に対応する表示波形
を比較するか、または第1チヤンネル出力に対応
する表示波形と第2チヤンネル出力に対応する表
示波形とを独立して同一オツシロスコープ上に引
続いて表示させてその両者を比較することによつ
て調整を行なつていた。
しかし上記の如き表示方法による波形を観測し
て第1チヤンネル用および第2チヤンネル用再生
増幅器等を調整する場合、第1チヤンネル出力に
対応する表示波形と第2チヤンネル出力に対応す
る表示波形との間に存在している微細なずれ等は
発見し難く、調整が困難で、熟練を必要とする欠
点があつた。
て第1チヤンネル用および第2チヤンネル用再生
増幅器等を調整する場合、第1チヤンネル出力に
対応する表示波形と第2チヤンネル出力に対応す
る表示波形との間に存在している微細なずれ等は
発見し難く、調整が困難で、熟練を必要とする欠
点があつた。
本発明は上記にかんがみなされたもので、第1
チヤンネル出力に対応する表示波形と第2チヤン
ネル出力に対応する表示波形を同一位置において
実質的に同時に波形表示装置に表示させることの
できるトリガパルスを発生することによつて、上
記の欠点を解消することのできるトリガパルス発
生器を提供することを目的とするものである。
チヤンネル出力に対応する表示波形と第2チヤン
ネル出力に対応する表示波形を同一位置において
実質的に同時に波形表示装置に表示させることの
できるトリガパルスを発生することによつて、上
記の欠点を解消することのできるトリガパルス発
生器を提供することを目的とするものである。
以下、本発明を実施例により説明する。
第2図は本発明の一実施例のブロツク図であ
る。
る。
第2図において1は入力端子IN1,IN2に入力
されたスイツチングパルスの何れか一方を、入力
端子SINに印加された選択信号により選択して出
力する選択回路である。
されたスイツチングパルスの何れか一方を、入力
端子SINに印加された選択信号により選択して出
力する選択回路である。
一方、2は制御回路である。制御回路2はDフ
リツプフロツプ2−1,2−2、ナンドゲート2
−3、コンデンサ2−41および抵抗2−42と
からなる微分回路2−4にて構成した3進カウン
タからなり、選択回路1の出力を3進カウントし
て出力する。
リツプフロツプ2−1,2−2、ナンドゲート2
−3、コンデンサ2−41および抵抗2−42と
からなる微分回路2−4にて構成した3進カウン
タからなり、選択回路1の出力を3進カウントし
て出力する。
3は選択回路1の出力および3進カウンタの出
力を入力とするデコーダであり、デコーダ3はイ
ンバータ4、アンドゲート5,6,7からなつて
いる。インバータ4は選択回路1の出力を反転す
る。アンドゲート6は選択回路1の出力とDフリ
ツプフロツプ2−1のQ出力とDフリツプフロツ
プ2−2の出力とを入力とし、選択回路1の出
力パルスの2パルス置きのパルスを出力する。ア
ンドゲート5はインバータ4の出力とDフリツプ
フロツプ2−1の出力とDフリツプフロツプ2
−2のQ出力とを入力とし、アンドゲート6の出
力パルスに引き続く選択回路1の1個目の出力パ
ルス中の位相(π−2π)間を出力パルスとして
出力する。アンドゲート7はインバータ4の出力
とDフリツプフロツプ2−1の出力とDフリツ
プフロツプ2−2の出力とを入力とし、アンド
ゲート5の出力パルスに続く1個目の、インバー
タ4の出力パルスを出力する。すなわち仮にスイ
ツチングパルスがデユーテイ比50%としたとき、
選択回路1の出力パルスの半周期を単位として、
アンドゲート5からは5単位置いたパルス(第1
の出力パルスと記す)を、アンドゲート6から第
1の出力パルスから2単位置いた選択回路1の出
力パルス(第2の出力パルスと記す)を出力させ
る。また、アンドゲート7からは第1の出力パル
スから1単位置いた選択回路1の出力パルス(第
3の出力パルスと記す)を出力させる。
力を入力とするデコーダであり、デコーダ3はイ
ンバータ4、アンドゲート5,6,7からなつて
いる。インバータ4は選択回路1の出力を反転す
る。アンドゲート6は選択回路1の出力とDフリ
ツプフロツプ2−1のQ出力とDフリツプフロツ
プ2−2の出力とを入力とし、選択回路1の出
力パルスの2パルス置きのパルスを出力する。ア
ンドゲート5はインバータ4の出力とDフリツプ
フロツプ2−1の出力とDフリツプフロツプ2
−2のQ出力とを入力とし、アンドゲート6の出
力パルスに引き続く選択回路1の1個目の出力パ
ルス中の位相(π−2π)間を出力パルスとして
出力する。アンドゲート7はインバータ4の出力
とDフリツプフロツプ2−1の出力とDフリツ
プフロツプ2−2の出力とを入力とし、アンド
ゲート5の出力パルスに続く1個目の、インバー
タ4の出力パルスを出力する。すなわち仮にスイ
ツチングパルスがデユーテイ比50%としたとき、
選択回路1の出力パルスの半周期を単位として、
アンドゲート5からは5単位置いたパルス(第1
の出力パルスと記す)を、アンドゲート6から第
1の出力パルスから2単位置いた選択回路1の出
力パルス(第2の出力パルスと記す)を出力させ
る。また、アンドゲート7からは第1の出力パル
スから1単位置いた選択回路1の出力パルス(第
3の出力パルスと記す)を出力させる。
アンドゲート7の出力パルスは遅延手段として
の単安定マルチバイブレータ8に入力して、その
立上りをスイツチングパルスの半周期±α時間だ
け遅延させる。アンドゲート6の出力および単安
定マルチバイブレータ8の出力は、選択回路1の
選択信号により入力信号の一つを選択する選択回
路9に入力する。選択回路9は選択回路1が選択
信号SINにより入力端子IN1の入力信号を選択した
ときにはアンドゲート6の出力を選択して出力
し、入力端子IN2の入力信号を選択したときは単
安定マルチバイブレータ8の出力を選択して出力
するように設定してある。
の単安定マルチバイブレータ8に入力して、その
立上りをスイツチングパルスの半周期±α時間だ
け遅延させる。アンドゲート6の出力および単安
定マルチバイブレータ8の出力は、選択回路1の
選択信号により入力信号の一つを選択する選択回
路9に入力する。選択回路9は選択回路1が選択
信号SINにより入力端子IN1の入力信号を選択した
ときにはアンドゲート6の出力を選択して出力
し、入力端子IN2の入力信号を選択したときは単
安定マルチバイブレータ8の出力を選択して出力
するように設定してある。
アンドゲート5の出力はコンデンサ10−1お
よび抵抗10−2からなる微分回路10に入力
し、選択回路9の出力はコンデンサ11−1およ
び抵抗11−2からなる微分回路11に入力す
る。微分回路10および微分回路11の出力はオ
アゲート12に入力し、オアゲート12の出力は
単安定マルチバイブレータ13に入力して、単安
定マルチバイブレータ13から所定パルス幅のト
リガパルスを得て、このトリガパルスをオツシロ
スコープの外部トリガ信号とする。
よび抵抗10−2からなる微分回路10に入力
し、選択回路9の出力はコンデンサ11−1およ
び抵抗11−2からなる微分回路11に入力す
る。微分回路10および微分回路11の出力はオ
アゲート12に入力し、オアゲート12の出力は
単安定マルチバイブレータ13に入力して、単安
定マルチバイブレータ13から所定パルス幅のト
リガパルスを得て、このトリガパルスをオツシロ
スコープの外部トリガ信号とする。
以上の如く構成した本実施例の作用を、前記し
たビデオテープレコーダの第1チヤンネル用およ
び第2チヤンネル用再生増幅器の調整に使用をす
る場合を例に説明する。
たビデオテープレコーダの第1チヤンネル用およ
び第2チヤンネル用再生増幅器の調整に使用をす
る場合を例に説明する。
いま、入力端子IN1には第1図aに示す方形波
信号と位相同期したスイツチングパルスが印加さ
れるものとする。また入力端子IN2には入力端子
IN1に印加されるスイツチングパルスと同一周波
数で、デユーテイ比が異なるスイツチングパルス
が印加されるものとし、このスイツチングパルス
の立上りの位相は移相できて、入力端子IN1に印
加されるスイツチングパルスの立上りと同一時刻
に立上る様に調整されているものとする。また、
本実施例のトリガパルス発生器からのトリガパル
スでトリガされるオツシロスコープのトリガ極性
は(+)側に選択してあるものとし、かつ前記オ
ツシロスコープには前記した第1チヤンネル用お
よび第2チヤンネル用再生増幅器の出力を合成し
た出力信号が印加されているものとして、その出
力信号はたとえばスイープテープを再生した場合
の出力信号であるものとする。
信号と位相同期したスイツチングパルスが印加さ
れるものとする。また入力端子IN2には入力端子
IN1に印加されるスイツチングパルスと同一周波
数で、デユーテイ比が異なるスイツチングパルス
が印加されるものとし、このスイツチングパルス
の立上りの位相は移相できて、入力端子IN1に印
加されるスイツチングパルスの立上りと同一時刻
に立上る様に調整されているものとする。また、
本実施例のトリガパルス発生器からのトリガパル
スでトリガされるオツシロスコープのトリガ極性
は(+)側に選択してあるものとし、かつ前記オ
ツシロスコープには前記した第1チヤンネル用お
よび第2チヤンネル用再生増幅器の出力を合成し
た出力信号が印加されているものとして、その出
力信号はたとえばスイープテープを再生した場合
の出力信号であるものとする。
選択信号SINにより選択回路1は入力端子IN1側
の入力信号を出力させる。従つて選択回路9はア
ンドゲート6の出力を選択して出力する。
の入力信号を出力させる。従つて選択回路9はア
ンドゲート6の出力を選択して出力する。
入力端子IN1に入力されるスイツチングパルス
は第3図aに示す如き波形aであり、第1図aに
対応している。このスイツチングパルスはインバ
ータ4で反転されて、インバータ4の出力波形b
は第3図bに示す如くになる。
は第3図aに示す如き波形aであり、第1図aに
対応している。このスイツチングパルスはインバ
ータ4で反転されて、インバータ4の出力波形b
は第3図bに示す如くになる。
そこで、カウンタ2のDフリツプフロツプ2−
1のQ出力cおよび出力dは第3図cおよびd
に示す如き波形の出力となる。またDフリツプフ
ロツプ2−2のQ出力eおよび出力fは第3図
eおよびfに示す如き波形の出力となる。
1のQ出力cおよび出力dは第3図cおよびd
に示す如き波形の出力となる。またDフリツプフ
ロツプ2−2のQ出力eおよび出力fは第3図
eおよびfに示す如き波形の出力となる。
従つてアンドゲート5は(d×b×e)の演算
を行ない、その出力は第3図gに示す波形の出力
gを発する。アンドゲート6は(a×c×f)の
演算を行ない、その出力は第3図hに示す波形の
出力hを発する。第3図a,b,gおよびhから
判る如く、アンドゲート5からはスイツチングパ
ルスの2パルス置きに1パルスを出力しており、
アンドゲート6からはアンドゲート5からの出力
パルスに続く1個目のスイツチングパルスの位相
(π−2π)間のパルスを出力パルスとして出力し
ている。
を行ない、その出力は第3図gに示す波形の出力
gを発する。アンドゲート6は(a×c×f)の
演算を行ない、その出力は第3図hに示す波形の
出力hを発する。第3図a,b,gおよびhから
判る如く、アンドゲート5からはスイツチングパ
ルスの2パルス置きに1パルスを出力しており、
アンドゲート6からはアンドゲート5からの出力
パルスに続く1個目のスイツチングパルスの位相
(π−2π)間のパルスを出力パルスとして出力し
ている。
アンドゲート6の出力は選択回路9を通して出
力され、アンドゲート5および選択回路9の出力
はそれぞれ微分回路10および微分回路11によ
り各別に微分されて、オアゲート12により合成
され、オアゲート12の出力iは第3図iに示す
如くになる。すなわち微分回路11の出力は2パ
ルス置きの選択回路1の出力パルスの立上りに同
期して出力され、微分回路10の出力は微分回路
11の出力から選択回路1の出力1.5周期遅れて
出力される。
力され、アンドゲート5および選択回路9の出力
はそれぞれ微分回路10および微分回路11によ
り各別に微分されて、オアゲート12により合成
され、オアゲート12の出力iは第3図iに示す
如くになる。すなわち微分回路11の出力は2パ
ルス置きの選択回路1の出力パルスの立上りに同
期して出力され、微分回路10の出力は微分回路
11の出力から選択回路1の出力1.5周期遅れて
出力される。
第3図iに示したオアゲート12の出力パルス
iにより単安定マルチバイブレータ13はトリガ
されて、単安定マルチバイブレータ13から所定
幅のトリガパルスとして出力されて、オツシロス
コープに印加される。
iにより単安定マルチバイブレータ13はトリガ
されて、単安定マルチバイブレータ13から所定
幅のトリガパルスとして出力されて、オツシロス
コープに印加される。
従つて第3図a,gおよびhのタイミングから
明らかな如く、アンドゲート6の出力パルスの発
生時からスイープテープを再生した第1チヤンネ
ルの出力信号波形がオツシロスコープ上に表示さ
れ、アンドゲート5の出力パルスの発生時から第
2のチヤンネルの出力信号波形が前記第1チヤン
ネルの出力波形上に重なつて第4図aに示す如く
実質上同一時間軸上に表示されることになる。
明らかな如く、アンドゲート6の出力パルスの発
生時からスイープテープを再生した第1チヤンネ
ルの出力信号波形がオツシロスコープ上に表示さ
れ、アンドゲート5の出力パルスの発生時から第
2のチヤンネルの出力信号波形が前記第1チヤン
ネルの出力波形上に重なつて第4図aに示す如く
実質上同一時間軸上に表示されることになる。
このため波形表示から微細な両波形の差異を観
測することができる。この場合、前記第2チヤン
ネルの出力波形はオツシロスコープ上に表示され
ている第1チヤンネルの出力波形に引続く第2チ
ヤンネルの次の第2チヤンネルの出力波形であ
る。
測することができる。この場合、前記第2チヤン
ネルの出力波形はオツシロスコープ上に表示され
ている第1チヤンネルの出力波形に引続く第2チ
ヤンネルの次の第2チヤンネルの出力波形であ
る。
また、自己録音テープを再生した場合も同様で
第4図bに示す如く、第1チヤンネルの出力波形
の表示と、第2チヤンネルの出力波形の表示とが
重なつて表示される。
第4図bに示す如く、第1チヤンネルの出力波形
の表示と、第2チヤンネルの出力波形の表示とが
重なつて表示される。
なお、第4図aおよびbにおいて破線は第1チ
ヤンネルの、実線は第2チヤンネルの出力波形を
示しており、その時間軸も同一である。
ヤンネルの、実線は第2チヤンネルの出力波形を
示しており、その時間軸も同一である。
また、つぎに選択信号SINにより、選択回路1
および9にそれぞれ入力端子IN2側および単安定
マルチバイブレータ8の出力側を選択した場合に
ついて説明する。
および9にそれぞれ入力端子IN2側および単安定
マルチバイブレータ8の出力側を選択した場合に
ついて説明する。
アンドゲート7は(b×d×f)の演算を行な
い、その出力jは第3図jに示す波形の出力を発
する。第3図gとjとから明らかな如く、アンド
ゲート7はアンドゲート5の出力パルスからイン
バータ4の出力パルスの1サイクル次のインバー
タ4の出力パルスに同期したパルスが出力され
る。
い、その出力jは第3図jに示す波形の出力を発
する。第3図gとjとから明らかな如く、アンド
ゲート7はアンドゲート5の出力パルスからイン
バータ4の出力パルスの1サイクル次のインバー
タ4の出力パルスに同期したパルスが出力され
る。
アンドゲート7の出力パルスの立上りは、単安
定マルチバイブレータ8により遅延されて、単安
定マルチバイブレータ8の出力は第3図kに示す
如き出力パルスを発生する。第3図kに示す出力
パルスの立上り時期は単安定マルチバイブレータ
8の設定時間により変化させることができる。従
つて入力端子IN2に印加されているスイツチング
パルスは前記した如く第3図aの入力端子IN1に
印加されるスイツチングパルスの立上りと同時に
立上がるが、デユーテイ比が異なつている場合、
単安定マルチバイブレータ8によつて、入力端子
IN2に印加されたスイツチングパルスのデユーテ
イ比を入力端子IN1に印加されたスイツチングパ
ルスのデユーテイ比と一致させることができる。
このことは第3図kにおいて破線に示す位置にま
で単安定マルチバイブレータ8によつて立上りを
ずらせることで示してある。
定マルチバイブレータ8により遅延されて、単安
定マルチバイブレータ8の出力は第3図kに示す
如き出力パルスを発生する。第3図kに示す出力
パルスの立上り時期は単安定マルチバイブレータ
8の設定時間により変化させることができる。従
つて入力端子IN2に印加されているスイツチング
パルスは前記した如く第3図aの入力端子IN1に
印加されるスイツチングパルスの立上りと同時に
立上がるが、デユーテイ比が異なつている場合、
単安定マルチバイブレータ8によつて、入力端子
IN2に印加されたスイツチングパルスのデユーテ
イ比を入力端子IN1に印加されたスイツチングパ
ルスのデユーテイ比と一致させることができる。
このことは第3図kにおいて破線に示す位置にま
で単安定マルチバイブレータ8によつて立上りを
ずらせることで示してある。
ついでアンドゲート5の出力および選択回路9
の出力はそれぞれ微分回路10および微分回路1
1により微分され、オアゲート12により合成さ
れる。そこでオアゲート12の出力は第3図lに
示す如くになり、単安定マルチバイブレータ8の
設定時間を調整することにより、第1チヤンネル
の出力波形の時間軸上の位置を移動させることが
でき、第2チヤンネルの出力波形と時間軸上で一
致させることができて、前記した入力端子IN1に
印加されているスイツチングパルスを選択した場
合と同様に、第4図a、第4図bと同一の波形表
示をオツシロスコープ上に表示することができ
る。
の出力はそれぞれ微分回路10および微分回路1
1により微分され、オアゲート12により合成さ
れる。そこでオアゲート12の出力は第3図lに
示す如くになり、単安定マルチバイブレータ8の
設定時間を調整することにより、第1チヤンネル
の出力波形の時間軸上の位置を移動させることが
でき、第2チヤンネルの出力波形と時間軸上で一
致させることができて、前記した入力端子IN1に
印加されているスイツチングパルスを選択した場
合と同様に、第4図a、第4図bと同一の波形表
示をオツシロスコープ上に表示することができ
る。
なお、入力端子IN1に印加されるスイツチング
パルスのみを用いる場合は選択回路1、選択回路
9、アンドゲート7および単安定マルチバイブレ
ータ8を省略することができる。また、入力端子
IN2に印加されるスイツチングパルスのみを用い
る場合は選択回路1、選択回路9、アンドゲート
6を省略することができる。
パルスのみを用いる場合は選択回路1、選択回路
9、アンドゲート7および単安定マルチバイブレ
ータ8を省略することができる。また、入力端子
IN2に印加されるスイツチングパルスのみを用い
る場合は選択回路1、選択回路9、アンドゲート
6を省略することができる。
また、カウンタ5をたとえば5進カウンタとし
た場合も同様に構成することができて、この場合
第1チヤンネルの出力波形と、第1チヤンネルの
出力に引続いて出力される第2チヤンネル出力か
ら2つ目の第2チヤンネルの出力波形とが、重な
つて表示されることになる。
た場合も同様に構成することができて、この場合
第1チヤンネルの出力波形と、第1チヤンネルの
出力に引続いて出力される第2チヤンネル出力か
ら2つ目の第2チヤンネルの出力波形とが、重な
つて表示されることになる。
また微分回路10および11に代つて、オアゲ
ート12の出力を微分する微分回路を用いてもよ
い。
ート12の出力を微分する微分回路を用いてもよ
い。
以上説明した如く本発明によれば、所定デユー
テイ比の方形波信号に同期して、(カウンタの進
数−1)置きの第1のトリガパルスと該トリガパ
ルスに引続く(カウンタの進数−2)個目の前記
方形波信号の位相(π−2π)間の第2のトリガ
パルスとが出力されて、波形表示装置上では第1
の信号と第2の信号とを重ねて表示することがで
きる。従つて第1の信号と第2の信号との間の微
細な差異も容易に発見することができる。
テイ比の方形波信号に同期して、(カウンタの進
数−1)置きの第1のトリガパルスと該トリガパ
ルスに引続く(カウンタの進数−2)個目の前記
方形波信号の位相(π−2π)間の第2のトリガ
パルスとが出力されて、波形表示装置上では第1
の信号と第2の信号とを重ねて表示することがで
きる。従つて第1の信号と第2の信号との間の微
細な差異も容易に発見することができる。
第1図a,bおよびcは従来のトリガパルス発
生器によるときの波形表示装置上の波形の説明
図。第2図は本発明の一実施例のブロツク図。第
3図は本発明の一実施例の作用の説明に供するタ
イミンングシート。第4図aおよびbは本発明の
トリガパルス発生器によるときの波形表示装置上
の波形を示す説明図。 1および9…選択回路、2…3進カウンタ、3
…デコーダ、8…遅延回路としての単安定マルチ
バイブレータ、13…単安定マルチバイブレー
タ。
生器によるときの波形表示装置上の波形の説明
図。第2図は本発明の一実施例のブロツク図。第
3図は本発明の一実施例の作用の説明に供するタ
イミンングシート。第4図aおよびbは本発明の
トリガパルス発生器によるときの波形表示装置上
の波形を示す説明図。 1および9…選択回路、2…3進カウンタ、3
…デコーダ、8…遅延回路としての単安定マルチ
バイブレータ、13…単安定マルチバイブレー
タ。
Claims (1)
- 【特許請求の範囲】 1 所定デユーテイ比の方形波信号の1サイクル
中の正の期間に出力される第1の信号と前記方形
波信号の1サイクル中において前記正の期間に引
続く残余の期間に出力される第2の信号とが引続
いて一入力信号として印加されて該入力信号の波
形表示を行なう波形表示装置のトリガパルス発生
器において、前記方形波信号に位相同期したスイ
ツチングパルスを入力とする(2n+1)進カウ
ンタ(nは1以上の整数)と、前記スイツチング
パルスと前記カウンタの出力とを入力として2n
パルス置きの前記スイツチングパルスを第1のパ
ルスとして出力し、かつ前記第1のパルスに続く
(2n−1)個目のスイツチングパルスの位相(π
−2π)間を第2のパルスとして出力するデコー
ダと、該デコーダの出力パルスを合成し前記第1
のおよび第2のパルスの立上りまたは立下りにそ
れぞれ各別に同期したパルスを出力する出力手段
とを備えたことを特徴とするトリガパルス発生
器。 2 所定デユーテイ比の方形波信号の1サイクル
中の正の期間に出力される第1の信号と前記方形
波信号の1サイクル中において前記正の期間に引
続く残余の期間に出力される第2の信号とが引続
いて一入力信号として印加されて該入力信号の波
形表示を行なう波形表示装置のトリガパルス発生
器において、前記方形波信号と同一時刻に立上
り、同一周波数でかつデユーテイ比が異なるスイ
ツチングパルスを入力とする(2n+1)進カウ
ンタ(nは1以上の整数)と、前記スイツチング
パルスと前記カウンタの出力とを入力として2n
パルス置きの前記スイツチングパルスを第1のパ
ルスとして出力し、かつ前記第1のパルスに続く
(2n−1)個目のスイツチングパルスの位相(0
−π)間を第3のパルスとして出力するデコーダ
と、前記第3のパルスの前縁を遅延させる遅延回
路と、前記第1のパルスの前縁および前記遅延回
路の出力パルスの前縁にそれぞれ各別に同期した
パルスを出力する出力手段とを備えたことを特徴
とするトリガパルス発生器。 3 所定デユーテイ比の方形波信号の1サイクル
中の正の期間に出力される第1の信号と前記方形
波信号の1サイクル中において前記正の期間に引
続く残余の期間に出力される第2の信号とが引続
いて一入力信号として印加されて該入力信号の波
形表示を行なう波形表示装置のトリガパルス発生
器において、 前記方形波信号に位相同期した第1のスイツチ
ングパルスと、前記方形波信号と同一時刻に立上
り、同一周波数でかつデユーテイ比が異なる第2
のスイツチングパルスとを入力して第1または第
2のスイツチングパルスを選択して出力する第1
の選択回路と、 前記第1の選択回路の出力パルスを入力とする
(2n+1)進カウンタ(nは1以上の整数)と、
前記第1の選択回路の出力パルスと前記カウンタ
の出力とを入力として2nパルス置きの前記第1
の選択回路の出力パルスを第1のパルスとして出
力し、前記第1のパルスに続く(2n−1)個目
の前記第1の選択回路の出力パルスにおける位相
(π−2π)間を第2のパルスとして出力し、かつ
前記第1のパルスに続く(2n−1)個目の前記
第1の選択回路の出力パルスにおける位相(0−
π)間を第3のパルスとして出力するデコーダ
と、 前記第3のパルスの前縁を遅延させる遅延回路
と、前記遅延回路の出力パルスと前記第2のパル
スとを入力とし前記第1の選択回路において第1
のスイツチングパルスを選択したときは前記第2
のパルスを選択して出力しかつ前記第1の選択回
路において第2のスイツチングパルスを選択した
ときは前記遅延回路からの出力パルスを選択して
出力する第2の選択回路と、 前記第1のパルスの前縁および前記第2の選択
回路の出力パルスの前縁にそれぞれ同期したパル
スを出力する出力手段とを備えたことを特徴とす
るトリガパルス発生器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19058381A JPS5892960A (ja) | 1981-11-30 | 1981-11-30 | トリガパルス発生器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19058381A JPS5892960A (ja) | 1981-11-30 | 1981-11-30 | トリガパルス発生器 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5892960A JPS5892960A (ja) | 1983-06-02 |
| JPH0325748B2 true JPH0325748B2 (ja) | 1991-04-08 |
Family
ID=16260471
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19058381A Granted JPS5892960A (ja) | 1981-11-30 | 1981-11-30 | トリガパルス発生器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5892960A (ja) |
-
1981
- 1981-11-30 JP JP19058381A patent/JPS5892960A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5892960A (ja) | 1983-06-02 |
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