JPH032743U - - Google Patents

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JPH032743U
JPH032743U JP6312189U JP6312189U JPH032743U JP H032743 U JPH032743 U JP H032743U JP 6312189 U JP6312189 U JP 6312189U JP 6312189 U JP6312189 U JP 6312189U JP H032743 U JPH032743 U JP H032743U
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Japan
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output
flip
flop
gate
connect
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JP6312189U
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  • Manipulation Of Pulses (AREA)

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【図面の簡単な説明】
第１図は本考案の一実施例のブロツク図、第２
図は本考案の動作タイミングチヤート、第３図は
本考案による論理表を示す図、第４図は本考案の
他の実施例のブロツク図、第５図は従来の一例の
ブロツク図である。 １０，１１，１２……Ｄ−フリツプフロツプ、
１３……デジタル信号入力端子、１４……エクス
クルシブオアゲート、１５……アンドゲート、１
６……ＲＳ−フリツプフロツプ、１７……分周信
号出力端子。

Claims (1)

  1. 【実用新案登録請求の範囲】 (1) 複数ｎのフリツプフロツプを縦続接続して
    最終段のフリツプフロツプの出力を初段のフリツ
    プフロツプの入力に帰還接続し、フリツプフロツ
    プの入出力間又は帰還路にエクスクルシブオアゲ
    ートを接続し、該フリツプフロツプの出力、該エ
    クスクルシブオアゲートの出力の各論理が１／（
    ２ｎ−１）クロツク周期で循還するリングカウン
    タを構成し、 該フリツプフロツプの出力及び該エクスクルシ
    ブオアゲートの出力のアンドをとるアンドゲート
    を接続して該アンドゲートの出力よりクロツクの
    １／（２ｎ−１）分周出力を得る構成としてなる
    デジタル分周回路。 (2) 複数ｎのフリツプフロツプを縦続接続して
    最終段のフリツプフロツプの出力を初段のフリツ
    プフロツプの入力に帰還接続し、フリツプフロツ
    プの入出力間又は帰還路にエクスクルシブオアゲ
    ートを接続し、該フリツプフロツプの出力、該エ
    クスクルシブオアゲートの出力の各論理が１／（
    ２ｎ−１）クロツク周期で循還するリングカウン
    タを構成し、 クロツク端子にＲＳ−フリツプフロツプを接続
    し、かつ、該フリツプフロツプの出力及び該エク
    スクルシブオアゲートの出力及び該ＲＳ−フリツ
    プフロツプの出力のアンドをとるアンドゲートを
    接続して該アンドゲートの出力よりクロツクの１
    ／２（２ｎ−１）分周出力を得る構成としてなる
    デジタル分周回路。
JP6312189U 1989-05-30 1989-05-30 Pending JPH032743U (ja)

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JP6312189U JPH032743U (ja) 1989-05-30 1989-05-30

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JPH032743U true JPH032743U (ja) 1991-01-11

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