JPH03292164A - サーマルプリンタヘッド駆動回路の制御方法 - Google Patents
サーマルプリンタヘッド駆動回路の制御方法Info
- Publication number
- JPH03292164A JPH03292164A JP2094273A JP9427390A JPH03292164A JP H03292164 A JPH03292164 A JP H03292164A JP 2094273 A JP2094273 A JP 2094273A JP 9427390 A JP9427390 A JP 9427390A JP H03292164 A JPH03292164 A JP H03292164A
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- JP
- Japan
- Prior art keywords
- current control
- switch
- group
- control element
- heat generating
- Prior art date
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- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
本発明はサーマルプリンタのヘッド駆動回路の制御方法
、 特に少ない素子数でヘッド駆動回路を構威し得るように
したサーマルプリンタヘッド駆動回路の制御方法に関す
る。 なお以下各図において同一の符号は同一もしくは相当部
分を示す。
、 特に少ない素子数でヘッド駆動回路を構威し得るように
したサーマルプリンタヘッド駆動回路の制御方法に関す
る。 なお以下各図において同一の符号は同一もしくは相当部
分を示す。
第２図は従来のサーマルプリンタのヘッド駆動回路の構
成例を示す。同図において１ライン分の発熱抵抗体ＲＣ
Ｒ，，Ｒ２〜Ｒ，）が必要個数配置され、前記発熱抵抗
体Ｒに流れる電流をオン、オフ制御するＦＥＴなとの電
流制御素子Ｑ（Ｑ、、Ｑ。 〜Ｑア）が各発熱抵抗体Ｒ８〜Ｒ７に対応じて配置され
る。また各発熱抵抗体Ｒ１〜Ｒ７を流れる電流の制御デ
ータ、つまり各電流制御素子Ｑ１〜Ｑ７の開閉を制御す
る信号はシフトレジスタ回路１により転送分配され、さ
らにラッチ回路２によりこのデータが取り込まれ、イン
バータ３を介して各電流制御素子Ｑ１〜Ｑ４へ出力され
る。
成例を示す。同図において１ライン分の発熱抵抗体ＲＣ
Ｒ，，Ｒ２〜Ｒ，）が必要個数配置され、前記発熱抵抗
体Ｒに流れる電流をオン、オフ制御するＦＥＴなとの電
流制御素子Ｑ（Ｑ、、Ｑ。 〜Ｑア）が各発熱抵抗体Ｒ８〜Ｒ７に対応じて配置され
る。また各発熱抵抗体Ｒ１〜Ｒ７を流れる電流の制御デ
ータ、つまり各電流制御素子Ｑ１〜Ｑ７の開閉を制御す
る信号はシフトレジスタ回路１により転送分配され、さ
らにラッチ回路２によりこのデータが取り込まれ、イン
バータ３を介して各電流制御素子Ｑ１〜Ｑ４へ出力され
る。
前述したように従来のサーマルプリンタのヘッド駆動回
路では、必要個数配置された発熱抵抗体Ｒ１〜Ｒ１と同
数の電流制御素子Ｑ１〜Ｑ７が必要である。このため、
電流制御素子Ｑ Ｉ ”’ Ｑ ｈ ＋ラッチ回路２お
よびシフトレジスタ回路１を一体化したＩＣが使用され
ているが、前記電流制御素子Ｑの増加がこのＩＣのコス
トアップの主原因であり、問題となっている。 そこで本発明の課題は、１個の電流制御素子で２個以上
の発熱抵抗体に流れる電流を制御し得るサーマルプリン
タヘッド駆動回路の制御方法を提供することにある。
路では、必要個数配置された発熱抵抗体Ｒ１〜Ｒ１と同
数の電流制御素子Ｑ１〜Ｑ７が必要である。このため、
電流制御素子Ｑ Ｉ ”’ Ｑ ｈ ＋ラッチ回路２お
よびシフトレジスタ回路１を一体化したＩＣが使用され
ているが、前記電流制御素子Ｑの増加がこのＩＣのコス
トアップの主原因であり、問題となっている。 そこで本発明の課題は、１個の電流制御素子で２個以上
の発熱抵抗体に流れる電流を制御し得るサーマルプリン
タヘッド駆動回路の制御方法を提供することにある。
前記の課題を解決するために本発明の方法は、１１９４
７分の複数の発熱抵抗体（Ｒ，ｌ〜Ｒ５など）を駆動す
るサーマルプリンタのヘッド駆動回路において、 前記発熱抵抗体を複数の群に分けて、この各群ごとにそ
れぞれ１つの電源分配用のスイッチ（Ｓ。 〜Ｓ３など）を設け、 前記の群ごとに当該群の各発熱抵抗体の一端をそれぞれ
当該群に対応する前記スイッチへ接続し、前記の各群か
らそれぞれ１つづつの前記発熱抵抗体を選択して該抵抗
体の他端に１つの対応する電流制御素子（Ｑなど）を接
続し、 この発熱抵抗体の選択と１つの対応する電流制御素子の
接続を順次、残りの前記発熱抵抗体について繰返したの
ち、 前記スイッチの１つをオンし、前記の各電流制御素子を
それぞれ（シフトレジスタ回路ＩＡ、ラッチ回路２Ａな
どを介し）入力したデータに応じてオン、オフさせて、
このオンしたスイッチおよび電流制御素子と直列となっ
た前記発熱抵抗体を加熱し、さらに続けて残りの前記ス
イッチを順次１つづつオンして前記の各電流制御素子を
前記と同様にオン、オフすることを繰返し、１ライン分
のプリントを行うように１するものとする。
７分の複数の発熱抵抗体（Ｒ，ｌ〜Ｒ５など）を駆動す
るサーマルプリンタのヘッド駆動回路において、 前記発熱抵抗体を複数の群に分けて、この各群ごとにそ
れぞれ１つの電源分配用のスイッチ（Ｓ。 〜Ｓ３など）を設け、 前記の群ごとに当該群の各発熱抵抗体の一端をそれぞれ
当該群に対応する前記スイッチへ接続し、前記の各群か
らそれぞれ１つづつの前記発熱抵抗体を選択して該抵抗
体の他端に１つの対応する電流制御素子（Ｑなど）を接
続し、 この発熱抵抗体の選択と１つの対応する電流制御素子の
接続を順次、残りの前記発熱抵抗体について繰返したの
ち、 前記スイッチの１つをオンし、前記の各電流制御素子を
それぞれ（シフトレジスタ回路ＩＡ、ラッチ回路２Ａな
どを介し）入力したデータに応じてオン、オフさせて、
このオンしたスイッチおよび電流制御素子と直列となっ
た前記発熱抵抗体を加熱し、さらに続けて残りの前記ス
イッチを順次１つづつオンして前記の各電流制御素子を
前記と同様にオン、オフすることを繰返し、１ライン分
のプリントを行うように１するものとする。
本発明は一ラインのプリントを少なくとも２回以上に分
割して行うことにより、少なくとも２個以上の発熱抵抗
体を１個の電流制御素子で制御しようとするものである
。
割して行うことにより、少なくとも２個以上の発熱抵抗
体を１個の電流制御素子で制御しようとするものである
。
第１図は本発明の一実施例としての構成を示す回路図で
、第２図に対応するものである。第１図は、３個の発熱
抵抗体を１個の電流制御素子で制御する場合の例である
。同図においては、電源分配スイッチＳ （Ｓｌ、Ｓｌ
、Ｓ３ ）を設け、発熱抵抗体Ｒ１，Ｒ４−・・・・の
一端をそれぞれスイッチＳ１に、同じく発熱抵抗体Ｒ２
，Ｒ５・・・・・の一端をスイッチＳ２に、同じく発熱
抵抗体Ｒ３，Ｒ６・−・・の一端をスイッチＳ３にそれ
ぞれ接続し、さらにこの各スイッチＳ、、Ｓ、、Ｓ、に
接続されたスイッチ別の抵抗群からそれぞれ１個づつ選
択された抵抗としてのＲ１，Ｒ２，Ｒ３の他端を電流制
御素子Ｑ１に、同じく残りの抵抗から１個づつ選択され
た抵抗としてのＲ４，Ｒ５，Ｒ６の他端を電流制御素子
Ｑ２に、それぞれ接続し、残りの抵抗についても図外の
各電流制御素子Ｑに対して同様な接続を繰返す。モして
１ラインをプリントする場合、まずスイッチＳ１を閉じ
、他のスイッチＳ２．Ｓ３は開放する。 次にスイッチＳ１のグループの各発熱抵抗体Ｒ１゜Ｒ４
・−・・・に流れる電流、従って各電流制御素子Ｑｌ、
Ｑ２−−・・・をそれぞれオン、オフ制御するデータを
新たなシフトレジスタ回路ＩＡに入力して、新たなラッ
チ回路２Ａに取り込んだうえ、このデータをインバータ
３を介し各電流制御素子Ｑｌ。 Ｑ２−・・あてに出力し、スイッチＳ１のグループの発
熱抵抗体Ｒ１，Ｒ４・・・・・の発熱によるドツトパタ
ーンのみプリントする。次にスイッチＳ１．３３を開放
し、Ｓ２を閉じて、スイッチＳ２のグルーブの電流制御
データで同様にプリントする。次にスイッチＳ３のグル
ープについても同様にプリントし、合計３回のプリント
により、１ライン分のプリントが完成する。 なお以上の実施例における電源分配スイッチＳ１〜Ｓ３
をＦＥＴ等の半導体スイッチング素子で構成しても本発
明が適用てきることは明らかで、この場合ＩＣを該半導
体スイッチング素子Ｓ１〜Ｓ３と電流制御素子Ｑｌ、Ｑ
２・〜・と一体に構成することができる。
、第２図に対応するものである。第１図は、３個の発熱
抵抗体を１個の電流制御素子で制御する場合の例である
。同図においては、電源分配スイッチＳ （Ｓｌ、Ｓｌ
、Ｓ３ ）を設け、発熱抵抗体Ｒ１，Ｒ４−・・・・の
一端をそれぞれスイッチＳ１に、同じく発熱抵抗体Ｒ２
，Ｒ５・・・・・の一端をスイッチＳ２に、同じく発熱
抵抗体Ｒ３，Ｒ６・−・・の一端をスイッチＳ３にそれ
ぞれ接続し、さらにこの各スイッチＳ、、Ｓ、、Ｓ、に
接続されたスイッチ別の抵抗群からそれぞれ１個づつ選
択された抵抗としてのＲ１，Ｒ２，Ｒ３の他端を電流制
御素子Ｑ１に、同じく残りの抵抗から１個づつ選択され
た抵抗としてのＲ４，Ｒ５，Ｒ６の他端を電流制御素子
Ｑ２に、それぞれ接続し、残りの抵抗についても図外の
各電流制御素子Ｑに対して同様な接続を繰返す。モして
１ラインをプリントする場合、まずスイッチＳ１を閉じ
、他のスイッチＳ２．Ｓ３は開放する。 次にスイッチＳ１のグループの各発熱抵抗体Ｒ１゜Ｒ４
・−・・・に流れる電流、従って各電流制御素子Ｑｌ、
Ｑ２−−・・・をそれぞれオン、オフ制御するデータを
新たなシフトレジスタ回路ＩＡに入力して、新たなラッ
チ回路２Ａに取り込んだうえ、このデータをインバータ
３を介し各電流制御素子Ｑｌ。 Ｑ２−・・あてに出力し、スイッチＳ１のグループの発
熱抵抗体Ｒ１，Ｒ４・・・・・の発熱によるドツトパタ
ーンのみプリントする。次にスイッチＳ１．３３を開放
し、Ｓ２を閉じて、スイッチＳ２のグルーブの電流制御
データで同様にプリントする。次にスイッチＳ３のグル
ープについても同様にプリントし、合計３回のプリント
により、１ライン分のプリントが完成する。 なお以上の実施例における電源分配スイッチＳ１〜Ｓ３
をＦＥＴ等の半導体スイッチング素子で構成しても本発
明が適用てきることは明らかで、この場合ＩＣを該半導
体スイッチング素子Ｓ１〜Ｓ３と電流制御素子Ｑｌ、Ｑ
２・〜・と一体に構成することができる。
本発明によれば１ライン分の複数の発熱抵抗体Ｒ１〜Ｒ
７を駆動するサーマルプリンタのヘッド駆動回路におい
て、 前記発熱抵抗体Ｒ１〜Ｒ７を複数の群に分けて、この各
群ごとにそれぞれ１つの電源分配用のスイッチＳ１〜Ｓ
３を設け、 前記の群ごとに当該群の各発熱抵抗体の一端をそれぞれ
当該群に対応する前記スイッチへ接続し、前記の各群か
らそれぞれ１つづつの前記発熱抵抗体を選択して該抵抗
体の他端に１つの対応する電流制御素子Ｑを接続し、 この発熱抵抗体の選択と１つの対応する電流制御素子の
接続を順次、残りの前記発熱抵抗体について繰返したの
ち、 前記スイッチの１つをオンし、前記の各電流制御素子を
それぞれシフトレジスタ回路ＩＡ、ラッチ回路２Ａを介
し入力したデータに応じてオン、オフさせて、このオン
したスイッチおよび電流制御素子と直列となった前記発
熱抵抗体を加熱し、さらに続けて残りの前記スイッチを
順次１つづつオンして前記の各電流制御素子を前記と同
様にオン。 オフすることを繰返し、１ライン分のプリントを行うよ
うにしたので、 少なくとも２個以上の発熱抵抗体を１個の電流制御素子
でオン、オフ制御することが可能となり、ヘッド駆動回
路の大幅なコストダウンが実現できる。
７を駆動するサーマルプリンタのヘッド駆動回路におい
て、 前記発熱抵抗体Ｒ１〜Ｒ７を複数の群に分けて、この各
群ごとにそれぞれ１つの電源分配用のスイッチＳ１〜Ｓ
３を設け、 前記の群ごとに当該群の各発熱抵抗体の一端をそれぞれ
当該群に対応する前記スイッチへ接続し、前記の各群か
らそれぞれ１つづつの前記発熱抵抗体を選択して該抵抗
体の他端に１つの対応する電流制御素子Ｑを接続し、 この発熱抵抗体の選択と１つの対応する電流制御素子の
接続を順次、残りの前記発熱抵抗体について繰返したの
ち、 前記スイッチの１つをオンし、前記の各電流制御素子を
それぞれシフトレジスタ回路ＩＡ、ラッチ回路２Ａを介
し入力したデータに応じてオン、オフさせて、このオン
したスイッチおよび電流制御素子と直列となった前記発
熱抵抗体を加熱し、さらに続けて残りの前記スイッチを
順次１つづつオンして前記の各電流制御素子を前記と同
様にオン。 オフすることを繰返し、１ライン分のプリントを行うよ
うにしたので、 少なくとも２個以上の発熱抵抗体を１個の電流制御素子
でオン、オフ制御することが可能となり、ヘッド駆動回
路の大幅なコストダウンが実現できる。
第１図は本発明の一実施例としての構成を示す回路図、
第２図は第１図に対応する従来の回路図である。
ＩＡ ：シフトレジスタ回路、２Ａ ：ラッチ回路、Ｒ
（Ｒ１，Ｒ２−−Ｒｎ） ：発熱抵抗体、Ｑ（Ｑｌ、Ｑ
２Ｑｎ） ：電流制御素子、Ｓ （Ｓｌ、 ３２．３３
） ：電−４′
（Ｒ１，Ｒ２−−Ｒｎ） ：発熱抵抗体、Ｑ（Ｑｌ、Ｑ
２Ｑｎ） ：電流制御素子、Ｓ （Ｓｌ、 ３２．３３
） ：電−４′
Claims (1)
- 【特許請求の範囲】 １）１ライン分の複数の発熱抵抗体を駆動するサーマル
プリンタのヘッド駆動回転において、前記発熱抵抗体を
複数の群に分けて、この各群ごとにそれぞれ１つの電源
分配用のスイッチを設け、 前記の群ごとに当該群の各発熱抵抗体の一端をそれぞれ
当該群に対応する前記スイッチへ接続し、前記の各群か
らそれぞれ１つづつの前記発熱抵抗体を選択して該抵抗
体の他端に１つの対応する電流制御素子を接続し、 この発熱抵抗体の選択と１つの対応する電流制御素子の
接続を順次、残り前記発熱抵抗体について繰返したのち
、 前記スイッチの１つをオンし、前記の各電流制御素子を
それぞれ入力したデータに応じてオン、オフさせて、こ
のオンしたスイッチおよび電流制御素子と直列となった
前記発熱抵抗体を加熱し、さらに続けて残りの前記スイ
ッチを順次１つづつオンして前記の各電流制御素子を前
記と同様にオン、オフすることを繰返し、１ライン分の
プリントを行うようにしたことを特徴とするサーマルプ
リンタヘッド駆動回路の制御方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2094273A JPH03292164A (ja) | 1990-04-10 | 1990-04-10 | サーマルプリンタヘッド駆動回路の制御方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2094273A JPH03292164A (ja) | 1990-04-10 | 1990-04-10 | サーマルプリンタヘッド駆動回路の制御方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH03292164A true JPH03292164A (ja) | 1991-12-24 |
Family
ID=14105661
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2094273A Pending JPH03292164A (ja) | 1990-04-10 | 1990-04-10 | サーマルプリンタヘッド駆動回路の制御方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH03292164A (ja) |
-
1990
- 1990-04-10 JP JP2094273A patent/JPH03292164A/ja active Pending
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