JPH0332171A - 雑音抑制装置 - Google Patents
雑音抑制装置Info
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- JPH0332171A JPH0332171A JP1167793A JP16779389A JPH0332171A JP H0332171 A JPH0332171 A JP H0332171A JP 1167793 A JP1167793 A JP 1167793A JP 16779389 A JP16779389 A JP 16779389A JP H0332171 A JPH0332171 A JP H0332171A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
［産業上の利用分野］
この発明は、テレビジョン信号の雑音抑制装置に関する
ものである。 ［従来の技術］ 従来、テレビの再生画像において、画像が動いている場
合、雑音に基づく画質の劣化は視覚上あまり問題となら
ないが、画像の動きの少ない場合あるいは静止画の場合
、雑音に基づく画質の劣化は無視しがたいものとなる。 そこで、この様な雑音による画質の劣化を防ぐ目的でテ
レビジョン信号の雑音抑制装置が案出されている。第４
図は雑音抑制装置の構成を示す図であり、（１）はテレ
ビジョン信号（Ａ）を入力する入力端子、（２）は入力
テレビジョン信号に変数（１−Ｋ）を乗じる係数回路で
ある。 また、（３）は前画像データを記憶して前画像信号ＣＢ
）を出力するフィールドメモリ、（４）はフィールドメ
モリ（３）から出力される前画像信号（Ｂ）と入力端子
（１）から入力されるテレビジョン信号（Ａ）との差を
求めてその差により変数（Ｋ）を決定する動き検出回路
である。 更に、（５）はフィールドメモリ（３）から出力される
前画像信号ＣＢ）に変数（Ｋ）を乗じる係数回路、（６
）は係数回路（２）の出力と係数回路（５）の出力とを
加算する加算回路、（７）は出力端子である。 次に動作について説明する。 入力端子（１）から入力されるテレビジョン信号（Ａ）
は係数回路（２）に入力され、係数回路（２）において
変数（１−Ｋ）を乗じられる。 また、前画像データを記憶しているフィールドメモリ（
３）から出力される前画像信号（Ｂ）は係数回路（５）
に入力されて変数（Ｋ）を乗じられる。 そして、係数回路（２）の出力と係数回路（５）の出力
とは加算回路（６）により加算され、演算出力（１−Ｋ
）Ａ十ＫＢを得て、演算出力（１−Ｋ）Ａ＋ＫＢを出力
端子（７）より出力すると共にフィールドメモリ（３）
に記憶する。 なお、動き検出回路（４）においては、入力端子（１）
から入力されるテレビジョン信号（Ａ）とフィールドメ
モリ（３）から出力される前画像信号（Ｂ）との差を求
め、その絶対値が大きい場合、テレビジョン信号（Ａ）
は動画部分に対応するものと見なしてに−０とし、テレ
ビジョン信号＜Ａ）がそのまま出力されるようにする。 また、テレビジョン信号（Ａ）とフィールドメモリ（３
）から出力される前画像信号（Ｂ）との差の絶対値が小
さい場合、テレビジョン信号（Ａ）は静止画部分に対応
するものとみなして、例えばに−０，５とし、演算出力
（１−Ｋ）Ａ＋ＫＢは（Ａ＋Ｂ）／’ｌとなり、ＡとＢ
との平均を出力信号として取り出し、これにより雑音成
分は抑制される。
ものである。 ［従来の技術］ 従来、テレビの再生画像において、画像が動いている場
合、雑音に基づく画質の劣化は視覚上あまり問題となら
ないが、画像の動きの少ない場合あるいは静止画の場合
、雑音に基づく画質の劣化は無視しがたいものとなる。 そこで、この様な雑音による画質の劣化を防ぐ目的でテ
レビジョン信号の雑音抑制装置が案出されている。第４
図は雑音抑制装置の構成を示す図であり、（１）はテレ
ビジョン信号（Ａ）を入力する入力端子、（２）は入力
テレビジョン信号に変数（１−Ｋ）を乗じる係数回路で
ある。 また、（３）は前画像データを記憶して前画像信号ＣＢ
）を出力するフィールドメモリ、（４）はフィールドメ
モリ（３）から出力される前画像信号（Ｂ）と入力端子
（１）から入力されるテレビジョン信号（Ａ）との差を
求めてその差により変数（Ｋ）を決定する動き検出回路
である。 更に、（５）はフィールドメモリ（３）から出力される
前画像信号ＣＢ）に変数（Ｋ）を乗じる係数回路、（６
）は係数回路（２）の出力と係数回路（５）の出力とを
加算する加算回路、（７）は出力端子である。 次に動作について説明する。 入力端子（１）から入力されるテレビジョン信号（Ａ）
は係数回路（２）に入力され、係数回路（２）において
変数（１−Ｋ）を乗じられる。 また、前画像データを記憶しているフィールドメモリ（
３）から出力される前画像信号（Ｂ）は係数回路（５）
に入力されて変数（Ｋ）を乗じられる。 そして、係数回路（２）の出力と係数回路（５）の出力
とは加算回路（６）により加算され、演算出力（１−Ｋ
）Ａ十ＫＢを得て、演算出力（１−Ｋ）Ａ＋ＫＢを出力
端子（７）より出力すると共にフィールドメモリ（３）
に記憶する。 なお、動き検出回路（４）においては、入力端子（１）
から入力されるテレビジョン信号（Ａ）とフィールドメ
モリ（３）から出力される前画像信号（Ｂ）との差を求
め、その絶対値が大きい場合、テレビジョン信号（Ａ）
は動画部分に対応するものと見なしてに−０とし、テレ
ビジョン信号＜Ａ）がそのまま出力されるようにする。 また、テレビジョン信号（Ａ）とフィールドメモリ（３
）から出力される前画像信号（Ｂ）との差の絶対値が小
さい場合、テレビジョン信号（Ａ）は静止画部分に対応
するものとみなして、例えばに−０，５とし、演算出力
（１−Ｋ）Ａ＋ＫＢは（Ａ＋Ｂ）／’ｌとなり、ＡとＢ
との平均を出力信号として取り出し、これにより雑音成
分は抑制される。
従来の雑音抑制装置は以上のように構成されているので
、例えばに−０，２５とした場合、係数回路（２）にて
に−０，７５を乗じることとなり、Ｋ−０，７５の乗算
回路は複雑化し、装置が大型化するという課題があった
。 この発明は上記のような課題を解消するために成された
もので、変数を画像の動きに応じて制御し得る雑音抑制
装置を得ることを目的とする。 ［課題を解決するための手段］ この発明に係る雑音抑制装置は、入力テレビジョン信号
と記憶手段から出力される前画像信号との差信号を演算
する減算手段と、入力テレビジョン信号もしくは前画像
信号に２ｎからなる変数（ｎは正の整数）を乗じて第１
の信号を得る第１の係数手段と、第１の信号と前記差信
号とを合成して第２の信号を得る加算手段と、第２の信
号に変数（２ｎ）の逆数（１／ ２ ｎ ）を乗する第
２の係数手段と、前記差信号の絶対値の大きさに応じて
変数（２ｎ）を増減する動き検出手段とを備えている。 そして、画像の動きに応じて変数（２ｎ）を制御し得る
ものである。 ［作用］ この発明における雑音抑制装置は、減算手段により入力
テレビジョン信号と記憶手段から出力される前画像信号
との差信号を演算し、かつ第１の係数手段により入力テ
レビジョン信号もしくは前画像信号に変数（２ｎ）を乗
じて第１の信号を得、加算手段により第１の信号と前記
差信号とを合成して第２の信号を得、第２の係数手段に
より第２の信号に変数（２ｎ）の逆数（１／２ｎ）を乗
じた信号を出力する。この際、動き検出手段は差信号の
絶対値の大きさすなわち画像の動きに応じて変数（２ｎ
）を制御する。 〔実施例Ｊ 以下、この発明の一実施例を図について説明する。 第１図は雑音抑制装置の構成を示すブロック図であり、
図において、（１１）はテレビジョン信号（Ａ）を入力
する入力端子、（１２）は入力テレビジョン信号に変数
（Ｋ）を乗じる係数回路である。なお、変数（Ｋ）は２
ｎ（ｎは正の整数）とする。 また、（１３）は前画像データを記憶して前画像信号（
Ｂ）を出力するフィールドメモリ、（１４）はフィール
ドメモリ（１−３）から出力される前画像信号（Ｂ）と
入力端子（１１）から入力されるテレビジョン信号（Ａ
）との差信号（Ｄ）を求める減算回路である。 更に、（１５）はフィールドメモリ（１３）から出力さ
れる前画像信号（Ｂ）に変数（Ｋ）を乗じる係数回路、
（１６）は差信号（Ｄ）と係数回路（１２）の出力との
差信号（（Ｋ−１）Ａ＋Ｂ）を求める減算回路、（１７
）は差信号（Ｄ）と係数回路（１５）の出力との加算信
号（Ａ＋（Ｋ−１）Ｂ）を求める加算回路である。 そして、（１８）は差信号ＣＤ）の大きさにより変数（
Ｋ）を制御する動き検知回路、（１９）は動き検知回路
（１８）により制御されて減算回路（１６）または加算
回路（１７）の内一方の出力を選択するスイッチ回路で
ある。 また、（２０）はスイッチ回路（１９）から出力される
信号に変数（１／Ｋ）を乗じて出力信号（Ｙ）を得る係
数回路、（２１）は出力信号（Ｙ）を出力する出力端子
である。 更に、係数回路（１２）、（１５）、 （２０）は、
第２図に示すように、２個のビットシフト（３０ａ）、
（３０ｂ）とスイッチ回路（３１）とにより構成さ
れている。 ついで、本実施例の作用について説明する。 入力端子（１１）に入力されたテレビジョン信号（Ａ）
は減算回路（１４）に入力され、フィールドメモリ（１
３）から出力される前画像信号（Ｂ）との差信号（Ｄ−
Ａ−８）を求められる。 この差信号（Ｄ）は減算回路（１６）および加算回路（
１７）に入力されると共に動き検出回路（１８）にも入
力される。 また、テレビジョン信号（Ａ）は係数回路（１２）にも
入力され、係数回路（１２）はテレビジョン信号（Ａ）
に変数（Ｋ）を乗じる。 更に、係数回路（１２）により変数（Ｋ）を乗じられた
テレビジョン信号（ＫＡ）は減算回路（１６）に入力さ
れ、減算回路（１４）より出力される差信号ＣＤ）との
差（（Ｋ−１）Ａ十Ｂ）を求められる。 一方、フィールドメモリ（１３）から出力される前画像
信号（Ｂ）は係数回路（１５）にも入力され、係数回路
（１５）は前画像信号（Ｂ）に変数（Ｋ）を乗じる。 そして、係数回路（１５）により変数（Ｋ）を乗じられ
た前画像信号（ＫＢ）は加算回路（エフ）に入力され、
加算回路（１４）より出力される差信号（Ｄ）との和（
Ａ＋ （Ｋ−１）Ｂ）を求められる。 この際、動き検知回路（１８）は差信号（Ｄ）の大きさ
により変数（Ｋ）を制御すると共にスイッチ回路（１９
）を制御して減算回路（１６）または加算回路（１７）
の出力のうち一方の出力を選択する。 例えば、第３図に示すように、差信号（Ｄ）が−α ＜
Ｄ＜α０ の場合はに自１、−α１＜Ｄ≦−α ある
いは α ≦Ｄくα１ の場合は０ に−４、−α ＜Ｄ＜−α あるいは α１≦１ Ｄくα の場合はに−２、−α３くＤ≦−α２あるい
は α ≦Ｄくα３ の場合はに−４、Ｄ≦−α あ
るいは α３≦Ｄの場合はに■１とする。 なお、αｏくαｌくα２くα３とする。 また、スイッチ回路（１９）は −αｏ＜Ｄ＜α Ｄ
≦−α２ あるいは α２≦Ｄの場合は０ ゝ （Ｋ−１）Ａ＋８を選択し、−α２〈Ｄ≦−α０あるい
は α ≦Ｄくα２ の場合はＡ＋（Ｋ−１）Ｂを選択
する。 そして、スイッチ回路（１９）により選択された出力は
係数回路（２０）に入力され、係数回路（２０）により
変数（１／Ｋ）を乗じられ、出力端子（２１）より出力
されると共に、フィールドメモリ（１３）に記憶される
。 従って、差信号（Ｄ）が零にちかい値（−α０＜Ｄ＜α
０）の場合、すなわちテレビジョンの画像の静止画部と
みなされている部分においては、係数回路（２０）の出
力信号（Ｙ）はＹ−Ｂとなり、差信号（Ｄ）の絶対値が
大きくなるにしたがって、Ｙ−（Ａ千３Ｂ）／４、Ｙ−
（Ａ十Ｂ）／２、Ｙ−（３Ａ十Ｂ）／４というように徐
々に出力信号（Ｙ）に占めるテレビジョン信号（Ａ）の
割合が増加し、差信号（Ｄ）が動画部と見なせるＤ≦−
α３ あるいは α３≦Ｄに達するとＹ−Ａとなる。 ［発明の効果］ 以上のように、この発明によれば画像の動きに応じて２
ｎからなる変数（ｎは正の整数）を制御し得るように構
成したので、乗算のための特別な装置を必要とせず、装
置を小形化できる。
、例えばに−０，２５とした場合、係数回路（２）にて
に−０，７５を乗じることとなり、Ｋ−０，７５の乗算
回路は複雑化し、装置が大型化するという課題があった
。 この発明は上記のような課題を解消するために成された
もので、変数を画像の動きに応じて制御し得る雑音抑制
装置を得ることを目的とする。 ［課題を解決するための手段］ この発明に係る雑音抑制装置は、入力テレビジョン信号
と記憶手段から出力される前画像信号との差信号を演算
する減算手段と、入力テレビジョン信号もしくは前画像
信号に２ｎからなる変数（ｎは正の整数）を乗じて第１
の信号を得る第１の係数手段と、第１の信号と前記差信
号とを合成して第２の信号を得る加算手段と、第２の信
号に変数（２ｎ）の逆数（１／ ２ ｎ ）を乗する第
２の係数手段と、前記差信号の絶対値の大きさに応じて
変数（２ｎ）を増減する動き検出手段とを備えている。 そして、画像の動きに応じて変数（２ｎ）を制御し得る
ものである。 ［作用］ この発明における雑音抑制装置は、減算手段により入力
テレビジョン信号と記憶手段から出力される前画像信号
との差信号を演算し、かつ第１の係数手段により入力テ
レビジョン信号もしくは前画像信号に変数（２ｎ）を乗
じて第１の信号を得、加算手段により第１の信号と前記
差信号とを合成して第２の信号を得、第２の係数手段に
より第２の信号に変数（２ｎ）の逆数（１／２ｎ）を乗
じた信号を出力する。この際、動き検出手段は差信号の
絶対値の大きさすなわち画像の動きに応じて変数（２ｎ
）を制御する。 〔実施例Ｊ 以下、この発明の一実施例を図について説明する。 第１図は雑音抑制装置の構成を示すブロック図であり、
図において、（１１）はテレビジョン信号（Ａ）を入力
する入力端子、（１２）は入力テレビジョン信号に変数
（Ｋ）を乗じる係数回路である。なお、変数（Ｋ）は２
ｎ（ｎは正の整数）とする。 また、（１３）は前画像データを記憶して前画像信号（
Ｂ）を出力するフィールドメモリ、（１４）はフィール
ドメモリ（１−３）から出力される前画像信号（Ｂ）と
入力端子（１１）から入力されるテレビジョン信号（Ａ
）との差信号（Ｄ）を求める減算回路である。 更に、（１５）はフィールドメモリ（１３）から出力さ
れる前画像信号（Ｂ）に変数（Ｋ）を乗じる係数回路、
（１６）は差信号（Ｄ）と係数回路（１２）の出力との
差信号（（Ｋ−１）Ａ＋Ｂ）を求める減算回路、（１７
）は差信号（Ｄ）と係数回路（１５）の出力との加算信
号（Ａ＋（Ｋ−１）Ｂ）を求める加算回路である。 そして、（１８）は差信号ＣＤ）の大きさにより変数（
Ｋ）を制御する動き検知回路、（１９）は動き検知回路
（１８）により制御されて減算回路（１６）または加算
回路（１７）の内一方の出力を選択するスイッチ回路で
ある。 また、（２０）はスイッチ回路（１９）から出力される
信号に変数（１／Ｋ）を乗じて出力信号（Ｙ）を得る係
数回路、（２１）は出力信号（Ｙ）を出力する出力端子
である。 更に、係数回路（１２）、（１５）、 （２０）は、
第２図に示すように、２個のビットシフト（３０ａ）、
（３０ｂ）とスイッチ回路（３１）とにより構成さ
れている。 ついで、本実施例の作用について説明する。 入力端子（１１）に入力されたテレビジョン信号（Ａ）
は減算回路（１４）に入力され、フィールドメモリ（１
３）から出力される前画像信号（Ｂ）との差信号（Ｄ−
Ａ−８）を求められる。 この差信号（Ｄ）は減算回路（１６）および加算回路（
１７）に入力されると共に動き検出回路（１８）にも入
力される。 また、テレビジョン信号（Ａ）は係数回路（１２）にも
入力され、係数回路（１２）はテレビジョン信号（Ａ）
に変数（Ｋ）を乗じる。 更に、係数回路（１２）により変数（Ｋ）を乗じられた
テレビジョン信号（ＫＡ）は減算回路（１６）に入力さ
れ、減算回路（１４）より出力される差信号ＣＤ）との
差（（Ｋ−１）Ａ十Ｂ）を求められる。 一方、フィールドメモリ（１３）から出力される前画像
信号（Ｂ）は係数回路（１５）にも入力され、係数回路
（１５）は前画像信号（Ｂ）に変数（Ｋ）を乗じる。 そして、係数回路（１５）により変数（Ｋ）を乗じられ
た前画像信号（ＫＢ）は加算回路（エフ）に入力され、
加算回路（１４）より出力される差信号（Ｄ）との和（
Ａ＋ （Ｋ−１）Ｂ）を求められる。 この際、動き検知回路（１８）は差信号（Ｄ）の大きさ
により変数（Ｋ）を制御すると共にスイッチ回路（１９
）を制御して減算回路（１６）または加算回路（１７）
の出力のうち一方の出力を選択する。 例えば、第３図に示すように、差信号（Ｄ）が−α ＜
Ｄ＜α０ の場合はに自１、−α１＜Ｄ≦−α ある
いは α ≦Ｄくα１ の場合は０ に−４、−α ＜Ｄ＜−α あるいは α１≦１ Ｄくα の場合はに−２、−α３くＤ≦−α２あるい
は α ≦Ｄくα３ の場合はに−４、Ｄ≦−α あ
るいは α３≦Ｄの場合はに■１とする。 なお、αｏくαｌくα２くα３とする。 また、スイッチ回路（１９）は −αｏ＜Ｄ＜α Ｄ
≦−α２ あるいは α２≦Ｄの場合は０ ゝ （Ｋ−１）Ａ＋８を選択し、−α２〈Ｄ≦−α０あるい
は α ≦Ｄくα２ の場合はＡ＋（Ｋ−１）Ｂを選択
する。 そして、スイッチ回路（１９）により選択された出力は
係数回路（２０）に入力され、係数回路（２０）により
変数（１／Ｋ）を乗じられ、出力端子（２１）より出力
されると共に、フィールドメモリ（１３）に記憶される
。 従って、差信号（Ｄ）が零にちかい値（−α０＜Ｄ＜α
０）の場合、すなわちテレビジョンの画像の静止画部と
みなされている部分においては、係数回路（２０）の出
力信号（Ｙ）はＹ−Ｂとなり、差信号（Ｄ）の絶対値が
大きくなるにしたがって、Ｙ−（Ａ千３Ｂ）／４、Ｙ−
（Ａ十Ｂ）／２、Ｙ−（３Ａ十Ｂ）／４というように徐
々に出力信号（Ｙ）に占めるテレビジョン信号（Ａ）の
割合が増加し、差信号（Ｄ）が動画部と見なせるＤ≦−
α３ あるいは α３≦Ｄに達するとＹ−Ａとなる。 ［発明の効果］ 以上のように、この発明によれば画像の動きに応じて２
ｎからなる変数（ｎは正の整数）を制御し得るように構
成したので、乗算のための特別な装置を必要とせず、装
置を小形化できる。
第１図はこの発明の一実施例による雑音抑制装置の構成
を示すブロック図、第２図は係数回路の構成を示すブロ
ック図、第３図は本発明の詳細な説明するための図、第
４図は従来の雑音抑制装置の構成を示すブロック図であ
る。 図中、（１３）は記憶手段、（１４）は減算手段、（１
５）は第１の係数手段、（１８）は動き検出手段、（２
０）は第２の係数手段である。 なお、図中同一符号は同一または相当部分を示す。
を示すブロック図、第２図は係数回路の構成を示すブロ
ック図、第３図は本発明の詳細な説明するための図、第
４図は従来の雑音抑制装置の構成を示すブロック図であ
る。 図中、（１３）は記憶手段、（１４）は減算手段、（１
５）は第１の係数手段、（１８）は動き検出手段、（２
０）は第２の係数手段である。 なお、図中同一符号は同一または相当部分を示す。
Claims (1)
- 入力テレビジョン信号と記憶手段から出力される前画像
信号との差信号を演算する減算手段と、入力テレビジョ
ン信号もしくは前画像信号に２ｎからなる変数（ｎは正
の整数）を乗じて第１の信号を得る第１の係数手段と、
第１の信号と前記差信号とを合成して第２の信号を得る
加算手段と、第２の信号に変数（２ｎ）の逆数を乗する
第２の係数手段と、前記差信号の絶対値の大きさに応じ
て変数（２ｎ）を増減する動き検出手段とを備え、画像
の動きに応じて変数（２ｎ）を制御し得ることを特徴と
する雑音抑制装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1167793A JPH0332171A (ja) | 1989-06-28 | 1989-06-28 | 雑音抑制装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1167793A JPH0332171A (ja) | 1989-06-28 | 1989-06-28 | 雑音抑制装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0332171A true JPH0332171A (ja) | 1991-02-12 |
Family
ID=15856213
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1167793A Pending JPH0332171A (ja) | 1989-06-28 | 1989-06-28 | 雑音抑制装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0332171A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008190532A (ja) * | 2007-02-06 | 2008-08-21 | Denso Corp | 燃料ポンプモジュール |
-
1989
- 1989-06-28 JP JP1167793A patent/JPH0332171A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008190532A (ja) * | 2007-02-06 | 2008-08-21 | Denso Corp | 燃料ポンプモジュール |
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