JPH033409A - ディジタル自動利得制御方式 - Google Patents
ディジタル自動利得制御方式Info
- Publication number
- JPH033409A JPH033409A JP13595889A JP13595889A JPH033409A JP H033409 A JPH033409 A JP H033409A JP 13595889 A JP13595889 A JP 13595889A JP 13595889 A JP13595889 A JP 13595889A JP H033409 A JPH033409 A JP H033409A
- Authority
- JP
- Japan
- Prior art keywords
- value
- input signal
- gain control
- automatic gain
- digital automatic
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Control Of Amplification And Gain Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(産業上の利用分野)
本発明は各種のディジタル信号処理装首に使用されるデ
ィジタル自動利得制御方式に関する。
ィジタル自動利得制御方式に関する。
従来のディジタル自動利得制御方式の回路構成例を第2
図に示し、その回路の動作を以下に説明する。まず、入
力信号は、乗算器101により、加′IA器107の出
力値を乗ぜられて出力信号となり、外部に出力される。
図に示し、その回路の動作を以下に説明する。まず、入
力信号は、乗算器101により、加′IA器107の出
力値を乗ぜられて出力信号となり、外部に出力される。
同時に、この出力信号は自乗器102と平均化器103
とにより、自乗平均値が計算される。次いで、この自乗
平均値を減算器105においてあらかじめ定めた設定値
から減じることにより、その設定値との誤差を求める。
とにより、自乗平均値が計算される。次いで、この自乗
平均値を減算器105においてあらかじめ定めた設定値
から減じることにより、その設定値との誤差を求める。
さらに、この誤差に乗算器106においである任意の係
数αを乗じる。この乗算器106の出力値と、加算器1
07の出力値を入力とするレジスタ108の出力値とを
加算器107で加算し、その結果を乗算器101に供給
することにより次の入力信号に対する利得を誤差が平に
なるように修正し、結果的に出カイ3号を一方レベルに
保っていた。
数αを乗じる。この乗算器106の出力値と、加算器1
07の出力値を入力とするレジスタ108の出力値とを
加算器107で加算し、その結果を乗算器101に供給
することにより次の入力信号に対する利得を誤差が平に
なるように修正し、結果的に出カイ3号を一方レベルに
保っていた。
(発明が解決しようとする課題)
しかしながら上記のような従来例のディジタル自動利得
制御方式では、入力信号レベルと所望の出力信号レベル
との差が大きくなるにつれて、出力信号をその所望のレ
ベルに収束させるまでの時間が長くなる。
制御方式では、入力信号レベルと所望の出力信号レベル
との差が大きくなるにつれて、出力信号をその所望のレ
ベルに収束させるまでの時間が長くなる。
この収束時間は、第2図に示す係数αの値を大きくすれ
ば、その値にほぼ反比例して短くなるが、ある程度以上
に係数αの値を大きくすると、入力信号レベルと所望の
出力信号レベルとの差が小さい時に、過剰制御となり、
そのため出力信号レベルの変動が大きくなってしまフた
り、さらには出力信号の発振につながる場合もある。
ば、その値にほぼ反比例して短くなるが、ある程度以上
に係数αの値を大きくすると、入力信号レベルと所望の
出力信号レベルとの差が小さい時に、過剰制御となり、
そのため出力信号レベルの変動が大きくなってしまフた
り、さらには出力信号の発振につながる場合もある。
すなわち、従来方式では出力信号の収束時間をすべての
入力信号レベルにおいて一定時間以内におさえようとす
ると、入力信号レベルのダイナミックレンジが制限され
てしまうという欠点があった。
入力信号レベルにおいて一定時間以内におさえようとす
ると、入力信号レベルのダイナミックレンジが制限され
てしまうという欠点があった。
そこで、本発明は、上述のような欠点を除去し、入力信
号が変動してから出力信号が所定のレベルに安定するま
での時間を大幅に短縮することが可能となり、実用上の
入力信号レベルの許、容ダイナミックレンジを大きく広
げることができるディジタル自動利得制御方式を提供す
ることを目的とする。
号が変動してから出力信号が所定のレベルに安定するま
での時間を大幅に短縮することが可能となり、実用上の
入力信号レベルの許、容ダイナミックレンジを大きく広
げることができるディジタル自動利得制御方式を提供す
ることを目的とする。
(課題を解決するための手段〕
かかる目的を達成するため、本発明は、振幅の平均値が
変動する入力信号に対して指定の利得を乗じて出力信号
となし、出力信号の振幅の平均値を所定の値に保つよう
に利得を制御するディジタル自動利得制御方式であって
、入力信号の振幅値の絶対値の平均値を算出する第1の
演算手段と、所定の設定値を第1の演算手段から得られ
る絶対値の平均値で除する第2の演算手段と、第2の演
算手段の出力値を利得として入力信号に乗じる第3の演
算手段とを具備したことを特徴とする。
変動する入力信号に対して指定の利得を乗じて出力信号
となし、出力信号の振幅の平均値を所定の値に保つよう
に利得を制御するディジタル自動利得制御方式であって
、入力信号の振幅値の絶対値の平均値を算出する第1の
演算手段と、所定の設定値を第1の演算手段から得られ
る絶対値の平均値で除する第2の演算手段と、第2の演
算手段の出力値を利得として入力信号に乗じる第3の演
算手段とを具備したことを特徴とする。
(作 用)
木発明では、上記構成のように、従来技術のようなフィ
ードバック制御は行なわずに、入力信号の振幅値の絶対
値の平均値を求め、その平均値で所定の設定値を除算し
、その商を入力信号の振幅値に乗する利得とするように
したので、従来のフィードバック制御で数サイクル以上
かけて求めていた適正利得を1サイクルで求めることが
できる。従って、木発明によれば、入力信号が変動して
から出力信号が所定のレベルに安定するまでの時間を大
幅に短縮することが可能となり、またその結果実用上の
入力信号レベルの許容ダイナミックレンジを大きく広げ
ることができる。
ードバック制御は行なわずに、入力信号の振幅値の絶対
値の平均値を求め、その平均値で所定の設定値を除算し
、その商を入力信号の振幅値に乗する利得とするように
したので、従来のフィードバック制御で数サイクル以上
かけて求めていた適正利得を1サイクルで求めることが
できる。従って、木発明によれば、入力信号が変動して
から出力信号が所定のレベルに安定するまでの時間を大
幅に短縮することが可能となり、またその結果実用上の
入力信号レベルの許容ダイナミックレンジを大きく広げ
ることができる。
(実施例)
以下、図面を参照して本発明の実施例を詳細に説明する
。
。
第1図は本発明の特徴を最もよく表わすディジタル自動
利得制御方式を実施する回路の構成例を示す。同図にお
いて乗算器201の一方の入力端子には外部から振幅の
平均値が変動する入力信号S1が人力され、他の入力端
子には除算器204の圧力値が入力される。この乗算器
201の演算値は出力信号S2どなってそのまま外部へ
出力される。
利得制御方式を実施する回路の構成例を示す。同図にお
いて乗算器201の一方の入力端子には外部から振幅の
平均値が変動する入力信号S1が人力され、他の入力端
子には除算器204の圧力値が入力される。この乗算器
201の演算値は出力信号S2どなってそのまま外部へ
出力される。
同時に、上述の入力信号51は絶対値化器202の入力
端子にも人力され、絶対値化器202の出力値は平均化
器203の入力端子に人力される。従って、平均化器2
03の出力端子には入力信号Slの振幅値の絶対値を平
均化した平均値が出力され、その平均値は、除算器20
4の一方の入力端子に人力される。除算器204の他の
入力端子には外部から所定の設定値が人力される。
端子にも人力され、絶対値化器202の出力値は平均化
器203の入力端子に人力される。従って、平均化器2
03の出力端子には入力信号Slの振幅値の絶対値を平
均化した平均値が出力され、その平均値は、除算器20
4の一方の入力端子に人力される。除算器204の他の
入力端子には外部から所定の設定値が人力される。
除算器204の出力端子には、上記の所定の設定値を入
力信号S1の絶対値の平均値で除した結果(商の値)が
出力される。
力信号S1の絶対値の平均値で除した結果(商の値)が
出力される。
この除算器204の出力を入力信号Stに乗ずべき利得
として乗算器201の一方の入力端子に人力しているの
で、入力信号S1の絶対値の平均値が求められた時点で
、即時に適正な利得を算出することが可能となる。
として乗算器201の一方の入力端子に人力しているの
で、入力信号S1の絶対値の平均値が求められた時点で
、即時に適正な利得を算出することが可能となる。
そのため、最初の入力信号Slが人力されてから出力信
号の52のレベルが、所定の値に安定するまでの時間は
上述した従来方式に比べて大幅に短縮することができ、
入力信号レベルの変動に対する出力信号レベルの変動も
十分に小さくすることができる。
号の52のレベルが、所定の値に安定するまでの時間は
上述した従来方式に比べて大幅に短縮することができ、
入力信号レベルの変動に対する出力信号レベルの変動も
十分に小さくすることができる。
第1図は本発明のディジタル自動利得制御方式を実施す
る回路の構成例を示すブロック構成図、 第2図は従来のディジタル自動利得制御・方式の回路の
構成を示すブロック構成図である。 (発明の効果〕 以上説明したように、本発明によれば、入力信号の振幅
値の絶対値の平均値で所定の設定値を除し、その除算結
果を入力信号に対する利得とするようにしたので、従来
方式のフィードバック制御で数サイクル以上かけて求め
ていた適正利得を1サイクルで求められる。従って、本
発明によれば、入力信号が変動してから出力信号が所定
のレベルに安定するまでの時間を大幅に短縮することが
可能になり、その結果実用上の入力信号レベルの許容ダ
イナミックレンジを大きく広げることができるという優
れた効果が得られる。 201・・・ 乗算器、 202・・・ 絶対値化器、 203・・・ 平均化器、 204・・・ 除算器。 第1図 第2図
る回路の構成例を示すブロック構成図、 第2図は従来のディジタル自動利得制御・方式の回路の
構成を示すブロック構成図である。 (発明の効果〕 以上説明したように、本発明によれば、入力信号の振幅
値の絶対値の平均値で所定の設定値を除し、その除算結
果を入力信号に対する利得とするようにしたので、従来
方式のフィードバック制御で数サイクル以上かけて求め
ていた適正利得を1サイクルで求められる。従って、本
発明によれば、入力信号が変動してから出力信号が所定
のレベルに安定するまでの時間を大幅に短縮することが
可能になり、その結果実用上の入力信号レベルの許容ダ
イナミックレンジを大きく広げることができるという優
れた効果が得られる。 201・・・ 乗算器、 202・・・ 絶対値化器、 203・・・ 平均化器、 204・・・ 除算器。 第1図 第2図
Claims (1)
- 【特許請求の範囲】 1)振幅の平均値が変動する入力信号に対して指定の利
得を乗じて出力信号となし、該出力信号の振幅の平均値
を所定の値に保つように前記利得を制御するディジタル
自動利得制御方式であって、 前記入力信号の振幅値の絶対値の平均値を算出する第1
の演算手段と、 所定の設定値を前記第1の演算手段から得られる前記絶
対値の平均値で除する第2の演算手段と、 該第2の演算手段の出力値を前記利得として前記入力信
号に乗じる第3の演算手段と を具備したことを特徴とするディジタル自動利得制御方
式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13595889A JPH033409A (ja) | 1989-05-31 | 1989-05-31 | ディジタル自動利得制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13595889A JPH033409A (ja) | 1989-05-31 | 1989-05-31 | ディジタル自動利得制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH033409A true JPH033409A (ja) | 1991-01-09 |
Family
ID=15163820
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13595889A Pending JPH033409A (ja) | 1989-05-31 | 1989-05-31 | ディジタル自動利得制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH033409A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100664017B1 (ko) * | 2001-05-24 | 2007-01-03 | 엘지전자 주식회사 | 자동 이득 제어 장치 |
| KR100761421B1 (ko) * | 2003-12-26 | 2007-10-04 | 실트로닉 아게 | 실리콘 결정 육성용 도가니 및 실리콘 결정의 육성 방법 |
-
1989
- 1989-05-31 JP JP13595889A patent/JPH033409A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100664017B1 (ko) * | 2001-05-24 | 2007-01-03 | 엘지전자 주식회사 | 자동 이득 제어 장치 |
| KR100761421B1 (ko) * | 2003-12-26 | 2007-10-04 | 실트로닉 아게 | 실리콘 결정 육성용 도가니 및 실리콘 결정의 육성 방법 |
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