JPH0336520A - 強誘電性液晶素子 - Google Patents
強誘電性液晶素子Info
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- JPH0336520A JPH0336520A JP17115589A JP17115589A JPH0336520A JP H0336520 A JPH0336520 A JP H0336520A JP 17115589 A JP17115589 A JP 17115589A JP 17115589 A JP17115589 A JP 17115589A JP H0336520 A JPH0336520 A JP H0336520A
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- Japan
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- electrode
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- pixel
- liquid crystal
- electrodes
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[産業上の利用分野]
本発明は、例えばプリンターヘッドやデイスプレィに応
用される、強誘電性液晶素子に関する。
用される、強誘電性液晶素子に関する。
[従来の技術]
従来、プリンタヘッドやデイスプレィに用いられる強誘
電性液晶素子は、走査側電極群とこれに交差して対向す
る情報側電極群からなるマトリクス電極、および画電極
群間に保持された強誘電性液晶を備え、対向する各電極
の各交差部分に1画素を形成し、各電極に印加するパル
ス電圧によって各交差部分の液晶に印加する電界を制御
することにより画像を形成するようになっている。そし
て、近年、強誘電性液晶の高速応答性とメモリー性に着
目し、強誘電性液晶素子を利用した大画面フラットパネ
ルデイスプレィの開発が期待されている。
電性液晶素子は、走査側電極群とこれに交差して対向す
る情報側電極群からなるマトリクス電極、および画電極
群間に保持された強誘電性液晶を備え、対向する各電極
の各交差部分に1画素を形成し、各電極に印加するパル
ス電圧によって各交差部分の液晶に印加する電界を制御
することにより画像を形成するようになっている。そし
て、近年、強誘電性液晶の高速応答性とメモリー性に着
目し、強誘電性液晶素子を利用した大画面フラットパネ
ルデイスプレィの開発が期待されている。
[発明が解決しようとしている課題]
しかしながら、このような強誘電性液晶(FLC)デイ
スプレィは、本来薄セルにつめたFLCの白状態と黒状
態の双安定を利用した2値の画素によるデイスプレィで
あることから、階調表示を行なうのが難しいという問題
がある。
スプレィは、本来薄セルにつめたFLCの白状態と黒状
態の双安定を利用した2値の画素によるデイスプレィで
あることから、階調表示を行なうのが難しいという問題
がある。
そこで、複数の画素で見かけ上の1画素を構成するザイ
デ方式が考えられたが、この方式では階調数の増加にと
もなってマトリクス電極数及び駆動用IC等が増加し、
コスト高となってしまうという問題がある。
デ方式が考えられたが、この方式では階調数の増加にと
もなってマトリクス電極数及び駆動用IC等が増加し、
コスト高となってしまうという問題がある。
本発明の目的は、このような従来技術の問題点に鑑み、
強誘電性液晶素子において、簡単で安価な構成により階
調制御が行なえるようにすることにある。
強誘電性液晶素子において、簡単で安価な構成により階
調制御が行なえるようにすることにある。
[課題を解決するための手段]
上記目的を達成するため本発明では、情報電極群および
これに交差して対向する走査電極群を有するマトリクス
電極、ならびに画電極群間に保持された強誘電性液晶を
備え、周電極群に電圧を印加して強誘電性液晶を駆動す
ることにより画像を形成する強誘電性液晶素子において
、各情報電極は、1の画素につき、相互に反転閾値が異
なる画素部分に対応した2以上の電極部分を備え、1の
画素に係る情報電極は2以上であり、そのそれぞれの情
報電極が備える電極部分は1の画素につきすべて面積が
異なり、各画素は、その画素に係る走査電極と、その画
素に係る情報電極の電極部分とによって階調制御するよ
うにしている。
これに交差して対向する走査電極群を有するマトリクス
電極、ならびに画電極群間に保持された強誘電性液晶を
備え、周電極群に電圧を印加して強誘電性液晶を駆動す
ることにより画像を形成する強誘電性液晶素子において
、各情報電極は、1の画素につき、相互に反転閾値が異
なる画素部分に対応した2以上の電極部分を備え、1の
画素に係る情報電極は2以上であり、そのそれぞれの情
報電極が備える電極部分は1の画素につきすべて面積が
異なり、各画素は、その画素に係る走査電極と、その画
素に係る情報電極の電極部分とによって階調制御するよ
うにしている。
前記2以上の電極部分は、例えば、対向する走査電極と
の間隙が互いに異なり、これによって相互に反転閾値が
異なるものである。
の間隙が互いに異なり、これによって相互に反転閾値が
異なるものである。
あるいは、各情報電極は、情報電極本体と、これに対し
前記2以上の電極部分をそれぞれ接続している、導電体
、絶縁体、および導電体をこの順序で積層した非線形抵
抗とを備え、前記2以上の電極部分はこれにより相互に
反転閾値が異なるものである。
前記2以上の電極部分をそれぞれ接続している、導電体
、絶縁体、および導電体をこの順序で積層した非線形抵
抗とを備え、前記2以上の電極部分はこれにより相互に
反転閾値が異なるものである。
[作用]
この構成において、各画素は、その画素に係る走査電極
と、その画素に係る情報電極が有する電極部分との間の
電界によってオン・オフ制御されるが、1の画素につき
1の情報電極が有する各電極部分は相互に反転閾値が異
なるので情報電極毎に電界強度をコントロールすること
によって任意の画素部分の組合せでオン・オフ制御する
ことができ、かつ1画素のすべての画素部分の面積が異
なり、したがって例えば1画素に係る情報電極が2本で
あり、それぞれ1画素につき2つの電極部分を有すると
すれば、2’ (=18)階調で階調制御が行なわれ
る。
と、その画素に係る情報電極が有する電極部分との間の
電界によってオン・オフ制御されるが、1の画素につき
1の情報電極が有する各電極部分は相互に反転閾値が異
なるので情報電極毎に電界強度をコントロールすること
によって任意の画素部分の組合せでオン・オフ制御する
ことができ、かつ1画素のすべての画素部分の面積が異
なり、したがって例えば1画素に係る情報電極が2本で
あり、それぞれ1画素につき2つの電極部分を有すると
すれば、2’ (=18)階調で階調制御が行なわれ
る。
[実施例]
以下、図面を用いて本発明の詳細な説明する。
第1図は、本発明の一実施例に係る液晶素子の一部を示
す断面図である。図中、6はガラス基板、7は強誘電性
液晶(FLC)、5はある4番目の走査電極であるとこ
ろの上側透明電極、1および2は上側透明電極5と直交
する第1の情報電極に接続されそして互いに面積及び反
転閾値の異なる2つの電極部分からなる第1の分割画素
を構成する下側透明電極、3および4は、同じく上側透
明電極5と直交し、かつ第1の情報電極と互いに隣り合
う第2の情報電極に接続され、そして互いに面積及び反
転閾値が異なる2つの電極部分からなり、かつ第1の分
割画素に対しても互いに面積の異なる第2の分割画素を
構成する下側電極である。さらに、各電極上には配向膜
層と絶縁層が設けられているが、図示は省略しである。
す断面図である。図中、6はガラス基板、7は強誘電性
液晶(FLC)、5はある4番目の走査電極であるとこ
ろの上側透明電極、1および2は上側透明電極5と直交
する第1の情報電極に接続されそして互いに面積及び反
転閾値の異なる2つの電極部分からなる第1の分割画素
を構成する下側透明電極、3および4は、同じく上側透
明電極5と直交し、かつ第1の情報電極と互いに隣り合
う第2の情報電極に接続され、そして互いに面積及び反
転閾値が異なる2つの電極部分からなり、かつ第1の分
割画素に対しても互いに面積の異なる第2の分割画素を
構成する下側電極である。さらに、各電極上には配向膜
層と絶縁層が設けられているが、図示は省略しである。
また、上下の透明電極5と1〜4間の間隙dlとd2は
互いに異なっており、それゆえに第1の分割画素lと2
、あるいは第2の分割画素3と4とでは反転閾値が互い
に異なる。また、分割画素の面積比は、それぞれ電極5
と1.5と2.5と3.5と4で構成される各分割画素
の面積をそれぞれS 81% S 52% S 63%
S 54% とするとSs’: SS2: Ss3:
5S4=4 : 1 : 2 : 3である。
互いに異なっており、それゆえに第1の分割画素lと2
、あるいは第2の分割画素3と4とでは反転閾値が互い
に異なる。また、分割画素の面積比は、それぞれ電極5
と1.5と2.5と3.5と4で構成される各分割画素
の面積をそれぞれS 81% S 52% S 63%
S 54% とするとSs’: SS2: Ss3:
5S4=4 : 1 : 2 : 3である。
第2図はこれら各分割画素のオン・オフ状態を組み合わ
せて得られる各階調を示す説明図である。同図に示すよ
うに10階調が得られることがわかる。ただし、第2図
は、第1の分割画素と第2の分割画素とで1画素を構成
する場合について示しており、図中、斜線部は黒状態、
非斜線部は白状態を示し、Tは階調レベルを示す、
これによれば、例えば第2図(C)の如く、左側の第1
の分割画素を完全に黒状態にして右側の第2の分割画素
の面積の広い方を黒状態にしたものと、第2図(b)の
如く、第2の分割画素を完全に黒状態にして第1の分割
画素の面積の狭い方を黒状態にしたものとでは階調レベ
ルが異なるので、階調数を従来より増加させることが可
能となる。
せて得られる各階調を示す説明図である。同図に示すよ
うに10階調が得られることがわかる。ただし、第2図
は、第1の分割画素と第2の分割画素とで1画素を構成
する場合について示しており、図中、斜線部は黒状態、
非斜線部は白状態を示し、Tは階調レベルを示す、
これによれば、例えば第2図(C)の如く、左側の第1
の分割画素を完全に黒状態にして右側の第2の分割画素
の面積の広い方を黒状態にしたものと、第2図(b)の
如く、第2の分割画素を完全に黒状態にして第1の分割
画素の面積の狭い方を黒状態にしたものとでは階調レベ
ルが異なるので、階調数を従来より増加させることが可
能となる。
[他の実施例]
第3図は、本発明の他の実施例に係る液晶素子の一部を
示す平面図である。図中、31aは第1の情報電極本体
、31bは第2の情報電極本体、33aおよび33bは
第1の分割画素、33cおよび33dは第2の分割画素
、34は第1の分割画素33 a、 33 bと第2の
分割画素33c、33dを含む1画素、32a〜32d
は導電体−絶縁体一導電体の3層よりなる非線形抵抗部
分を示す。分割画素33a、33bに対応する下側電極
は非線型抵抗部分32a、32bを介して第1の情報電
極本体31aに接続し、分割画素33c。
示す平面図である。図中、31aは第1の情報電極本体
、31bは第2の情報電極本体、33aおよび33bは
第1の分割画素、33cおよび33dは第2の分割画素
、34は第1の分割画素33 a、 33 bと第2の
分割画素33c、33dを含む1画素、32a〜32d
は導電体−絶縁体一導電体の3層よりなる非線形抵抗部
分を示す。分割画素33a、33bに対応する下側電極
は非線型抵抗部分32a、32bを介して第1の情報電
極本体31aに接続し、分割画素33c。
33dに対応する下側電極は非線形抵抗部分32c、3
2dを介して第2の情報電極本体31b&:接続してい
る。分割画素33a〜33dの面積比は4:2:8:1
となっている。
2dを介して第2の情報電極本体31b&:接続してい
る。分割画素33a〜33dの面積比は4:2:8:1
となっている。
特に、この実施例は、非線形抵抗32a〜32dを介し
て各分割画素33a〜33dに電圧が印加されることを
特徴とする。
て各分割画素33a〜33dに電圧が印加されることを
特徴とする。
ここで、分割画素33a〜33dは面積が互いに異なる
ため容量も互いに異なり、特に、非線形抵抗部分32a
〜32dの容量及びブレークダウン電圧を同一にした場
合には、互いに反転閾値の異なる分割画素となる。もち
ろん、分割画素33a〜33dの容量と非線形抵抗部分
32a〜32dの容量及びブレークダウン電圧を適当に
設定すれば、分割画素の反転閾値を所望の値に設定でき
る。
ため容量も互いに異なり、特に、非線形抵抗部分32a
〜32dの容量及びブレークダウン電圧を同一にした場
合には、互いに反転閾値の異なる分割画素となる。もち
ろん、分割画素33a〜33dの容量と非線形抵抗部分
32a〜32dの容量及びブレークダウン電圧を適当に
設定すれば、分割画素の反転閾値を所望の値に設定でき
る。
したがって、第3図の如く構成すると、第2図で示した
と同様にして2’−16なる階調数の画素を有する強誘
電性液晶デイスプレィとすることができる。
と同様にして2’−16なる階調数の画素を有する強誘
電性液晶デイスプレィとすることができる。
[発明の効果]
以上説明したように本発明によれば、1画素につき、相
互に閾値が異なる複数電極部分を有する複数の情報電極
を備え、かつこれらの電極部分は相互に面積が異なるよ
うにしたためマトリクス電極数及び駆動用ICの数を増
やすことなく、階調数を増やした、強誘電性液晶素子を
提供することができる。
互に閾値が異なる複数電極部分を有する複数の情報電極
を備え、かつこれらの電極部分は相互に面積が異なるよ
うにしたためマトリクス電極数及び駆動用ICの数を増
やすことなく、階調数を増やした、強誘電性液晶素子を
提供することができる。
第1図は、本発明の一実施例に係る液晶素子の一部を示
す断面図、 第2図は、各分割画素のオン・オフ状態を組み合わせて
得られる各階調を示す説明図、そして第3図は、本発明
の他の実施例に係る液晶素子の一部を示す平面図である
。 1〜4:下側透明電極、5:上側透明電極6:ガラス基
板、7:強誘電性液晶、 31a、31b:情報電極本体、 32a〜32d:非線型抵抗部分、 33a 〜33d:分割画素、 34 : 1画素。 特 許 出 願 人 キャノン株式会社
す断面図、 第2図は、各分割画素のオン・オフ状態を組み合わせて
得られる各階調を示す説明図、そして第3図は、本発明
の他の実施例に係る液晶素子の一部を示す平面図である
。 1〜4:下側透明電極、5:上側透明電極6:ガラス基
板、7:強誘電性液晶、 31a、31b:情報電極本体、 32a〜32d:非線型抵抗部分、 33a 〜33d:分割画素、 34 : 1画素。 特 許 出 願 人 キャノン株式会社
Claims (3)
- (1)情報電極群およびこれに交差して対向する走査電
極群を有するマトリクス電極、ならびに両電極群間に保
持された強誘電性液晶を備え、両電極群に電圧を印加し
て強誘電性液晶を駆動することにより画像を形成する強
誘電性液晶素子において、各情報電極は、1の画素につ
き、相互に反転閾値が異なる画素部分に対応した2以上
の電極部分を備え、1の画素に係る情報電極は2以上で
あり、そのそれぞれの情報電極が備える電極部分は1の
画素につきすべて面積が異なり、各画素は、その画素に
係る走査電極と、その画素に係る情報電極の電極部分と
によって階調制御されることを特徴とする強誘電性液晶
素子。 - (2)前記2以上の電極部分は対向する走査電極との間
隙が互いに異なり、これによって相互に反転閾値が異な
るものである、請求項1記載の強誘電性液晶素子。 - (3)各情報電極は、情報電極本体と、これに対し前記
2以上の電極部分をそれぞれ接続している、導電体、絶
縁体、および導電体をこの順序で積層した非線形抵抗と
を備え、前記2以上の電極部分はこれにより相互に反転
閾値が異なるものである、請求項1記載の強誘電性液晶
素子。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1171155A JP2737002B2 (ja) | 1989-07-04 | 1989-07-04 | 強誘電性液晶素子 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1171155A JP2737002B2 (ja) | 1989-07-04 | 1989-07-04 | 強誘電性液晶素子 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0336520A true JPH0336520A (ja) | 1991-02-18 |
| JP2737002B2 JP2737002B2 (ja) | 1998-04-08 |
Family
ID=15918013
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1171155A Expired - Fee Related JP2737002B2 (ja) | 1989-07-04 | 1989-07-04 | 強誘電性液晶素子 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2737002B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5581381A (en) * | 1993-06-04 | 1996-12-03 | Canon Kabushiki Kaisha | LCD electrode projections of variable widths and spacings |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62145216A (ja) * | 1985-12-20 | 1987-06-29 | Canon Inc | 液晶素子及びその駆動法 |
| JPS63229430A (ja) * | 1987-03-18 | 1988-09-26 | Nec Corp | 液晶デイスプレイ |
-
1989
- 1989-07-04 JP JP1171155A patent/JP2737002B2/ja not_active Expired - Fee Related
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62145216A (ja) * | 1985-12-20 | 1987-06-29 | Canon Inc | 液晶素子及びその駆動法 |
| JPS63229430A (ja) * | 1987-03-18 | 1988-09-26 | Nec Corp | 液晶デイスプレイ |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5581381A (en) * | 1993-06-04 | 1996-12-03 | Canon Kabushiki Kaisha | LCD electrode projections of variable widths and spacings |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2737002B2 (ja) | 1998-04-08 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |