JPH0337529U - - Google Patents

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JPH0337529U
JPH0337529U JP1989096748U JP9674889U JPH0337529U JP H0337529 U JPH0337529 U JP H0337529U JP 1989096748 U JP1989096748 U JP 1989096748U JP 9674889 U JP9674889 U JP 9674889U JP H0337529 U JPH0337529 U JP H0337529U
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data
cpu
protection circuit
command
floppy disk
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JP1989096748U
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  • Signal Processing For Digital Recording And Reproducing (AREA)
  • Storage Device Security (AREA)

Description

【図面の簡単な説明】
第１図は本考案の一実施例についてａはフロツ
ピーデイスク装置に組込んだ概略構成図、ｂは実
施例の配線図、第２図はデータビツト列の変換の
１例を示す図である。 １…ＣＰＵ、２…メモリ、３…ＦＤＣ（フロツ
ピーデイスクコントローラ）、４…フロツピーデ
イスク装置、１０…データ保護回路、１１…コマ
ンド／ステータス用バツフア、１２…データ用バ
ツフア、１３…ＮＯＴ回路、１４…制御信号。

Claims (1)

  1. 【実用新案登録請求の範囲】 フロツピーデイスクコントローラのＣＰＵ側へ
    のデータバスに、ＣＰＵからの制御信号により導
    通・不導通状態が互いに相反的に定められるコマ
    ンド／ステータス用バツフアおよびデータ用バツ
    フアを並列に介在してなるデータ保護回路であつ
    て、 前記データ用バツフアは、ライトコマンドおよ
    びリードコマンドの実行時にのみ導通状態となさ
    れ、結線手段によりライトコマンドではＣＰＵか
    らの信号データビツト列を変換して書込みデータ
    となし、リードコマンドでは前記書込みデータを
    信号データに復原してＣＰＵへ送出する ことを特徴とするフロツピーデイスク装置のデ
    ータ保護回路。
JP1989096748U 1989-08-21 1989-08-21 Pending JPH0337529U (ja)

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JPH0337529U true JPH0337529U (ja) 1991-04-11

Family

ID=31645931

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JP1989096748U Pending JPH0337529U (ja) 1989-08-21 1989-08-21

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