JPH0341914B2 - - Google Patents
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- JPH0341914B2 JPH0341914B2 JP55132876A JP13287680A JPH0341914B2 JP H0341914 B2 JPH0341914 B2 JP H0341914B2 JP 55132876 A JP55132876 A JP 55132876A JP 13287680 A JP13287680 A JP 13287680A JP H0341914 B2 JPH0341914 B2 JP H0341914B2
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- JP
- Japan
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- circuit
- signal
- output
- supplementary
- replenishment
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- 238000001514 detection method Methods 0.000 claims description 18
- 230000001360 synchronised effect Effects 0.000 claims description 2
- 238000010586 diagram Methods 0.000 description 7
- 230000007257 malfunction Effects 0.000 description 4
- 238000000034 method Methods 0.000 description 4
- 238000006243 chemical reaction Methods 0.000 description 3
- 239000013589 supplement Substances 0.000 description 2
- 230000005540 biological transmission Effects 0.000 description 1
- 239000002131 composite material Substances 0.000 description 1
- 230000006835 compression Effects 0.000 description 1
- 238000007906 compression Methods 0.000 description 1
- 238000013139 quantization Methods 0.000 description 1
- 230000004044 response Effects 0.000 description 1
- 238000005070 sampling Methods 0.000 description 1
Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/10527—Audio or video recording; Data buffering arrangements
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
- H03K5/19—Monitoring patterns of pulse trains
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- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Physics & Mathematics (AREA)
- Nonlinear Science (AREA)
- Optical Recording Or Reproduction (AREA)
- Synchronisation In Digital Transmission Systems (AREA)
- Signal Processing For Digital Recording And Reproducing (AREA)
Description
【発明の詳細な説明】
本発明はPCM方式記録再生装置における同期
信号保護回路に関するものである。
信号保護回路に関するものである。
アナグロ信号の記録・再生には、従来、アナロ
グ信号をそのまま磁気テープや磁気デイスクに記
録し、かつ再生する方式が用いられている。しか
し上記従来方式では、記録媒体や変換系の特性か
ら、周波数特性及びダイナミツクレンジに限界が
あつた。これに対処して、記録媒体や変換系の性
質にとらわれることなく高品位の記録・再生また
は伝送を行なうための一方式としてPCM方式が
採用されている。このPCM方式によれば、周波
数帯域は標本化周期に、ダイナミツクレンジは量
子化ビツト数に依存するので、記録媒体や変換系
の帯域が許される限り周波数帯域あるいはダイナ
ミツクレンジを拡大することができる。しかし、
この場合には、広帯域の記録再生装置が必要とさ
れる。一般に広帯域の記録再生装置としてはビデ
オテープレコーダ（以下VTRと記す）があり、
２ヘツドヘリカルスキヤン形VTRを記録媒体と
して利用したPCM方式記録再生装置のブロツク
構成図を第１図に示し、以下その動作を概説す
る。
グ信号をそのまま磁気テープや磁気デイスクに記
録し、かつ再生する方式が用いられている。しか
し上記従来方式では、記録媒体や変換系の特性か
ら、周波数特性及びダイナミツクレンジに限界が
あつた。これに対処して、記録媒体や変換系の性
質にとらわれることなく高品位の記録・再生また
は伝送を行なうための一方式としてPCM方式が
採用されている。このPCM方式によれば、周波
数帯域は標本化周期に、ダイナミツクレンジは量
子化ビツト数に依存するので、記録媒体や変換系
の帯域が許される限り周波数帯域あるいはダイナ
ミツクレンジを拡大することができる。しかし、
この場合には、広帯域の記録再生装置が必要とさ
れる。一般に広帯域の記録再生装置としてはビデ
オテープレコーダ（以下VTRと記す）があり、
２ヘツドヘリカルスキヤン形VTRを記録媒体と
して利用したPCM方式記録再生装置のブロツク
構成図を第１図に示し、以下その動作を概説す
る。
第１図において、アナグロ入力信号１はＡ／Ｄ
（アナログデイジタル）変換部２によりデイジタ
ル信号３に変換される。デイジタル信号３は記録
系メモリ４に順次記録され、そしてここからデイ
ジタル信号が読出される。ここで、読出し周期を
記録周期より短くすることにより時間圧縮が行な
われる。時間圧縮されたデータ５はデータ生成回
路６に入力され、誤り訂正用データと誤り検出用
データが付加されて記録用デイジタルデータ７と
して出力される。この記録用デイジタルデータ７
に、さらに水平・垂直同期信号が映像波形生成回
路８において付加され、映像信号９としてVTR
１０に記録される。VTR１０から再生された再
生映像信号１１は誤りチエツク回路１２において
誤りデータのチエツクが行なわれ、デイジタルデ
ータに誤りチエツク信号を加えた誤りチエツク回
路出力信号１３として出力される。誤りチエツク
回路出力信号１３は再生系メモリ１４に順次記録
される。再生系メモリ１４に記録された信号１５
を読出す時の読出し周期を記録周期より長く設定
することにより時間伸長が行なわれる。時間伸長
されたデータから誤りチエツク信号により誤りの
あるデータの訂正を誤り処理回路１６により行な
い、訂正処理された信号１７を得る。訂正処理さ
れた信号１７をＤ／Ａ（デイジタルアナログ）変
換部１８によりアナログ信号１９に変換して出力
する。
（アナログデイジタル）変換部２によりデイジタ
ル信号３に変換される。デイジタル信号３は記録
系メモリ４に順次記録され、そしてここからデイ
ジタル信号が読出される。ここで、読出し周期を
記録周期より短くすることにより時間圧縮が行な
われる。時間圧縮されたデータ５はデータ生成回
路６に入力され、誤り訂正用データと誤り検出用
データが付加されて記録用デイジタルデータ７と
して出力される。この記録用デイジタルデータ７
に、さらに水平・垂直同期信号が映像波形生成回
路８において付加され、映像信号９としてVTR
１０に記録される。VTR１０から再生された再
生映像信号１１は誤りチエツク回路１２において
誤りデータのチエツクが行なわれ、デイジタルデ
ータに誤りチエツク信号を加えた誤りチエツク回
路出力信号１３として出力される。誤りチエツク
回路出力信号１３は再生系メモリ１４に順次記録
される。再生系メモリ１４に記録された信号１５
を読出す時の読出し周期を記録周期より長く設定
することにより時間伸長が行なわれる。時間伸長
されたデータから誤りチエツク信号により誤りの
あるデータの訂正を誤り処理回路１６により行な
い、訂正処理された信号１７を得る。訂正処理さ
れた信号１７をＤ／Ａ（デイジタルアナログ）変
換部１８によりアナログ信号１９に変換して出力
する。
このようなPCM方式記録再生装置においては、
水平垂直同期信号がタイミングの原点となるか
ら、同期信号が欠落すると誤動作を起こす。この
誤動作を防ぐために同期信号保護回路は必要不可
欠なものである。特に水平同期信号に関してはス
キユーという問題があり、保護回路には工夫を要
する。
水平垂直同期信号がタイミングの原点となるか
ら、同期信号が欠落すると誤動作を起こす。この
誤動作を防ぐために同期信号保護回路は必要不可
欠なものである。特に水平同期信号に関してはス
キユーという問題があり、保護回路には工夫を要
する。
第２図に従来の保護回路即ち水平同期信号が欠
落した場合それを補充する補充回路を示し、第３
図に水平同期信号の検出から出力に至る波形図を
示す。第２図において２０は水平同期信号検出回
路、２１は補充回路である。水平同期信号回路２
０は、コンポジツト信号Scから第３図１に示す
ように水平同期信号H1を検出した後適当な時間
（たとえば62μs）ゲートを閉じ、水平同期信号間
1H（63.5μs、26MHzクロツク単位で168クロツク
に相当）のノイズを同期信号としてとりこまない
ようにする。次にゲートを開けて水平同期信号が
入力するのを10数クロツク間待ち、入力信号があ
ればそれを出力するとともに上記の動作をくり返
す。ここで水平同期信号が入力しなかつた場合は
補充回路２１を動作させ、第３図２に示すように
水平同期信号H2′を補充するようになしている。
第３図４は出力信号を示し、上述の場合正しい水
平同期信号出力H1″の後に補充出力H2″が得られ
ている。
落した場合それを補充する補充回路を示し、第３
図に水平同期信号の検出から出力に至る波形図を
示す。第２図において２０は水平同期信号検出回
路、２１は補充回路である。水平同期信号回路２
０は、コンポジツト信号Scから第３図１に示す
ように水平同期信号H1を検出した後適当な時間
（たとえば62μs）ゲートを閉じ、水平同期信号間
1H（63.5μs、26MHzクロツク単位で168クロツク
に相当）のノイズを同期信号としてとりこまない
ようにする。次にゲートを開けて水平同期信号が
入力するのを10数クロツク間待ち、入力信号があ
ればそれを出力するとともに上記の動作をくり返
す。ここで水平同期信号が入力しなかつた場合は
補充回路２１を動作させ、第３図２に示すように
水平同期信号H2′を補充するようになしている。
第３図４は出力信号を示し、上述の場合正しい水
平同期信号出力H1″の後に補充出力H2″が得られ
ている。
しかし、この回路構成のままではVTRのスキ
ユー部分で誤動作をする虞れがある。ヘリカルス
キヤン形VTRの場合、ヘツド切換時に水平同期
信号時間幅が極端に短くなつたり長くなつたりす
る（これをスキユーといい、最大±20μs前後であ
る）。今水平同期信号間が通常よりも短くなつた
場合は、上記の回路で動作するが、第３図１の
H2に示すようにスキユーにより長くなつた場合
には、正しい水平同期信号H2を検出する前に補
充の信号H2′が出てしまい、その後正しい水平同
期信号H2が検出されるため結果的に同期信号の
数が１つ増すことになる。これを防ぐために補充
の信号H2′を出した後に第３図３に示すように適
当な時間（たとえば40μs程度）のゲートＧをか
け、同期信号の増加を防がなければならない。
ユー部分で誤動作をする虞れがある。ヘリカルス
キヤン形VTRの場合、ヘツド切換時に水平同期
信号時間幅が極端に短くなつたり長くなつたりす
る（これをスキユーといい、最大±20μs前後であ
る）。今水平同期信号間が通常よりも短くなつた
場合は、上記の回路で動作するが、第３図１の
H2に示すようにスキユーにより長くなつた場合
には、正しい水平同期信号H2を検出する前に補
充の信号H2′が出てしまい、その後正しい水平同
期信号H2が検出されるため結果的に同期信号の
数が１つ増すことになる。これを防ぐために補充
の信号H2′を出した後に第３図３に示すように適
当な時間（たとえば40μs程度）のゲートＧをか
け、同期信号の増加を防がなければならない。
上記の回数を用いることによつてほとんど正常
に装置を動作させることは可能であるが、この回
路は水平同期信号H2′を１つ補充すると、次に水
平同期信号が検出されるまでは待ち状態となるた
めに、２つ連続して欠落した場合あるいはドロツ
プアウトによつて数10H区間にわたつて水平同期
信号が欠落したしまつた場合、誤動作をしてしま
う可能性があつた。第３図１においてH3はドロ
ツプアウトによい欠落した水平同期信号であり、
この場合補充回路２１は再補充の信号を出さな
い。
に装置を動作させることは可能であるが、この回
路は水平同期信号H2′を１つ補充すると、次に水
平同期信号が検出されるまでは待ち状態となるた
めに、２つ連続して欠落した場合あるいはドロツ
プアウトによつて数10H区間にわたつて水平同期
信号が欠落したしまつた場合、誤動作をしてしま
う可能性があつた。第３図１においてH3はドロ
ツプアウトによい欠落した水平同期信号であり、
この場合補充回路２１は再補充の信号を出さな
い。
本発明の目的は、上記した従来技術の欠点を無
くし長時間にわたつて同期信号が欠落しても正常
位置に同期信号を補充する同期信号補充回路を提
供するにある。
くし長時間にわたつて同期信号が欠落しても正常
位置に同期信号を補充する同期信号補充回路を提
供するにある。
本発明では、同期信号が１つ欠落した場合ある
いはスキユーによつて正規の位置に無かつた場合
には、従来通りの補充回路で補充し、次に正しい
水平同期信号がこない場合には、自走している第
２の補充回路にて同期信号を補充させるようにし
たことを特徴とする。
いはスキユーによつて正規の位置に無かつた場合
には、従来通りの補充回路で補充し、次に正しい
水平同期信号がこない場合には、自走している第
２の補充回路にて同期信号を補充させるようにし
たことを特徴とする。
以下、本発明を図面に示した一実施例によつて
説明する。第４図は本発明の一実施例を示すブロ
ツク図である。第４図において２０は水平同期信
号検出回路、２１は補充回路（以下第１補充回路
という）、２２は第２補充回路、２３は出力切換
回路である。
説明する。第４図は本発明の一実施例を示すブロ
ツク図である。第４図において２０は水平同期信
号検出回路、２１は補充回路（以下第１補充回路
という）、２２は第２補充回路、２３は出力切換
回路である。
水平同期信号検出回路２０と第１補充回路２１
の動作については従来例で述べたのと同様であ
る。即ち、水平同期信号が１つ欠落あるいはスキ
ユーによつて定常位置からずれた場合に第１補充
回路２１より水平同期信号を１コ補充する。本発
明では、その後正しい水平同期信号が検出できな
い場合に、出力切換回路２３を切換えて第２補充
回路２２から同期信号を補充し、正しい同期信号
を検出した時点で定常状態に復帰する。
の動作については従来例で述べたのと同様であ
る。即ち、水平同期信号が１つ欠落あるいはスキ
ユーによつて定常位置からずれた場合に第１補充
回路２１より水平同期信号を１コ補充する。本発
明では、その後正しい水平同期信号が検出できな
い場合に、出力切換回路２３を切換えて第２補充
回路２２から同期信号を補充し、正しい同期信号
を検出した時点で定常状態に復帰する。
ここで第２補充回路２２について説明すると、
一般に水平同期信号は、１サイクル168クロツク、
幅13クロツクの信号であるから、168進のカウン
タを常に動作状態にして使用することによつて常
時この水平同期信号を出力し、これを第２補充回
路２２の出力パルスとして用いればよい。そして
正しい水平同期信号を検出するたびにこのカウン
タをリセツトすれば、ほとんど正常位置に同期信
号を補充することが可能となる。第５図に第２補
充回路の一実施例を示した。第５図において２４
は８ビツトのカウンタ、２５は13、168デコーダ、
２６はリセツト回路、Hdは検出水平同期信号で
ある。
一般に水平同期信号は、１サイクル168クロツク、
幅13クロツクの信号であるから、168進のカウン
タを常に動作状態にして使用することによつて常
時この水平同期信号を出力し、これを第２補充回
路２２の出力パルスとして用いればよい。そして
正しい水平同期信号を検出するたびにこのカウン
タをリセツトすれば、ほとんど正常位置に同期信
号を補充することが可能となる。第５図に第２補
充回路の一実施例を示した。第５図において２４
は８ビツトのカウンタ、２５は13、168デコーダ、
２６はリセツト回路、Hdは検出水平同期信号で
ある。
次に出力切換回路２３について説明する。出力
切換回路２３は、検出信号および補充信号を切換
えるもので、ゲートで簡単に構成できる。第６図
に本発明の水平同期信号補充回路のタイミングチ
ヤートを示している。同図において、１は水平同
期信号検出回路２０の検出信号、２は第１補充回
路２１の出力信号、３は第１補充回路出力ゲー
ト、４は第２補充回路２２の出力信号、５は第２
補充回路出力ゲート、６は出力信号である。同図
４における第２補充回路出力a″(a)，b″(a)，C″(a)
……のうち（ ）内の記号は、それと同記号の水
平同期検出信号１によつて168進カウンタ（８ビ
ツトカウンタ２４）がリセツトされ、第２補充回
路２２の出力となつていることを示している。こ
のリセツトは、出力e″(e)に示すように検出信号１
が２回連続して入力した場合（ｄ、ｅ）のみ正し
い検出信号とみなしリセツトを行なつている。ま
た第１補充回路２１の出力２と第２補充回路２２
の出力４の切り換えは、同図３，５に示すように
出力２が出た所定時間後に第１補充回路２１のゲ
ートを開き、同時に第２補充回路２２のゲートを
閉じるようにすればよい。これにより同図６に示
した出力信号を得ることができる。
切換回路２３は、検出信号および補充信号を切換
えるもので、ゲートで簡単に構成できる。第６図
に本発明の水平同期信号補充回路のタイミングチ
ヤートを示している。同図において、１は水平同
期信号検出回路２０の検出信号、２は第１補充回
路２１の出力信号、３は第１補充回路出力ゲー
ト、４は第２補充回路２２の出力信号、５は第２
補充回路出力ゲート、６は出力信号である。同図
４における第２補充回路出力a″(a)，b″(a)，C″(a)
……のうち（ ）内の記号は、それと同記号の水
平同期検出信号１によつて168進カウンタ（８ビ
ツトカウンタ２４）がリセツトされ、第２補充回
路２２の出力となつていることを示している。こ
のリセツトは、出力e″(e)に示すように検出信号１
が２回連続して入力した場合（ｄ、ｅ）のみ正し
い検出信号とみなしリセツトを行なつている。ま
た第１補充回路２１の出力２と第２補充回路２２
の出力４の切り換えは、同図３，５に示すように
出力２が出た所定時間後に第１補充回路２１のゲ
ートを開き、同時に第２補充回路２２のゲートを
閉じるようにすればよい。これにより同図６に示
した出力信号を得ることができる。
ここで、従来技術にて述べたように、スキユー
によつて水平同期信号の時間々隔が長くなつた時
の対策としては、第７図５に示すように第２補充
回路２２のゲート幅を第６図のものより短く設定
し、このゲート信号５により第２補充回路２２の
出力d″(a)を出力させないようになしている。また
他の防止法としては、168進カウンタ（８ビツト
カウンタ２４）とは別にパルス幅生成回路を設け
てこれが第２補充回路出力によつて動作するよう
にしておき、第７図４に示すように第２補充回路
の出力が出て一度パルス幅生成回路が動作した後
は、第７図６に示すように所定時間（たとえば
20μs）第２補充回路の出力を発生させないように
してもよい。なお第７図の波形１，２，３，４及
び７は、それぞれ第６図の１，２，３，４及び６
と同種のものである。
によつて水平同期信号の時間々隔が長くなつた時
の対策としては、第７図５に示すように第２補充
回路２２のゲート幅を第６図のものより短く設定
し、このゲート信号５により第２補充回路２２の
出力d″(a)を出力させないようになしている。また
他の防止法としては、168進カウンタ（８ビツト
カウンタ２４）とは別にパルス幅生成回路を設け
てこれが第２補充回路出力によつて動作するよう
にしておき、第７図４に示すように第２補充回路
の出力が出て一度パルス幅生成回路が動作した後
は、第７図６に示すように所定時間（たとえば
20μs）第２補充回路の出力を発生させないように
してもよい。なお第７図の波形１，２，３，４及
び７は、それぞれ第６図の１，２，３，４及び６
と同種のものである。
以上説明したように、本発明によれば、VTR
のドロツプアウトなどによつて水平同期信号が長
時間にわたつて欠落した場合、あるいはスキユー
によつて水平同期信号がずれた場合に、常にほと
んど正しい位置に水平同期信号を補充することが
でき、PCM方式記録再生装置の動作をさらに安
定なものにすることができるものである。
のドロツプアウトなどによつて水平同期信号が長
時間にわたつて欠落した場合、あるいはスキユー
によつて水平同期信号がずれた場合に、常にほと
んど正しい位置に水平同期信号を補充することが
でき、PCM方式記録再生装置の動作をさらに安
定なものにすることができるものである。
第１図はPCM方式記録再生装置のブロツク図、
第２図は従来の水平同期信号保護回路のブロツク
図、第３図は第２図に示した従来回路の動作を示
すタイムチヤート、第４図は本発明の一実施例を
示すブロツク図、第５図は本発明に用いるカウン
タの一実施例ブロツク図、第６図及び第７図は本
発明の回路動作を示すタイムチヤートである。 ２０：水平同期信号検出回路、２１：第１補充
回路、２２：第２補充回路、２３：出力切換回
路。
第２図は従来の水平同期信号保護回路のブロツク
図、第３図は第２図に示した従来回路の動作を示
すタイムチヤート、第４図は本発明の一実施例を
示すブロツク図、第５図は本発明に用いるカウン
タの一実施例ブロツク図、第６図及び第７図は本
発明の回路動作を示すタイムチヤートである。 ２０：水平同期信号検出回路、２１：第１補充
回路、２２：第２補充回路、２３：出力切換回
路。
Claims (1)
- １ 再生信号から同期信号を検出する同期信号検
出回路と、該検出回路の出力によつて制御され検
出回路の出力がない時に補充信号を導出する第１
の補充回路と、自走するカウンタにより構成され
上記検出回路の出力時期に関連して補充信号を導
出する第２の補充回路と、上記第１と第２の補充
回路の出力を選択する出力切換回路であつて、上
記検出回路の検出結果に基づく同期信号の欠落が
１つの場合は上記第１の補充回路の出力を導出
し、欠落が連続した場合には上記第２の補充回路
の出力を導出する出力切換回路とを少なくとも備
えてなることを特徴とする同期信号保護回路。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55132876A JPS5760513A (en) | 1980-09-26 | 1980-09-26 | Synchronizing signal protecting circuit |
| GB8128994A GB2086177B (en) | 1980-09-26 | 1981-09-25 | Circuit and method for monitoring and correcting a faulty horizontal synchronous signal |
| US06/305,779 US4420775A (en) | 1980-09-26 | 1981-09-25 | Circuit and method for protecting a horizontal synchronous signal |
| DE3138310A DE3138310C2 (de) | 1980-09-26 | 1981-09-25 | Schaltungsanordnung zur Steuerung der Horizontal-Synchronsignale für ein PCM-Signal-Wiedergabegerät |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55132876A JPS5760513A (en) | 1980-09-26 | 1980-09-26 | Synchronizing signal protecting circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5760513A JPS5760513A (en) | 1982-04-12 |
| JPH0341914B2 true JPH0341914B2 (ja) | 1991-06-25 |
Family
ID=15091615
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP55132876A Granted JPS5760513A (en) | 1980-09-26 | 1980-09-26 | Synchronizing signal protecting circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5760513A (ja) |
-
1980
- 1980-09-26 JP JP55132876A patent/JPS5760513A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5760513A (en) | 1982-04-12 |
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