JPH0357342A - 通信制御装置 - Google Patents
通信制御装置Info
- Publication number
- JPH0357342A JPH0357342A JP1193052A JP19305289A JPH0357342A JP H0357342 A JPH0357342 A JP H0357342A JP 1193052 A JP1193052 A JP 1193052A JP 19305289 A JP19305289 A JP 19305289A JP H0357342 A JPH0357342 A JP H0357342A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、パケット通信制御装置に関し、特にＬＡＮ網
上のホストＣＰＵ側通信制御装置に関する。
上のホストＣＰＵ側通信制御装置に関する。
従来、ＬＡＮ （ローカル・エリア・ネットワーク）等
のパケット網での通信は、○ＳＩ（○ＰＥＮ ＳＹＳ
ＴＥＭＳ ＩＮＴＥＲＣＯＮＥＣＴＩ○Ｎ〉の各層毎
に応答手順が有りこれらの応答手順によってデータの保
証を行っている。この為通信制御装置は，これらの手順
処理が、かなりの負荷になっていた、 特に、ホストＣＰＵの通信制御装置は、同一回線上に複
数の端末が接続され、全ての端末が、ホストに対して送
受信を行い通信を行うため、ホスト側の通信制御装置は
、端末が、増加すると、装置自身の処理能力が不足し、
端末の処理要求に追い付かず、通信制御装置を追加して
対応していた６ 〔発明が解決しようとする課題〕 この様な従来の方法では、端末数が増える度に通信制御
装置を追加する為ＬＡＮ網との接続部、ＬＡＮデータの
変換部等が、各通信制御部毎に必要となり８装置全体の
Ｈ／Ｗに無駄があった。
のパケット網での通信は、○ＳＩ（○ＰＥＮ ＳＹＳ
ＴＥＭＳ ＩＮＴＥＲＣＯＮＥＣＴＩ○Ｎ〉の各層毎
に応答手順が有りこれらの応答手順によってデータの保
証を行っている。この為通信制御装置は，これらの手順
処理が、かなりの負荷になっていた、 特に、ホストＣＰＵの通信制御装置は、同一回線上に複
数の端末が接続され、全ての端末が、ホストに対して送
受信を行い通信を行うため、ホスト側の通信制御装置は
、端末が、増加すると、装置自身の処理能力が不足し、
端末の処理要求に追い付かず、通信制御装置を追加して
対応していた６ 〔発明が解決しようとする課題〕 この様な従来の方法では、端末数が増える度に通信制御
装置を追加する為ＬＡＮ網との接続部、ＬＡＮデータの
変換部等が、各通信制御部毎に必要となり８装置全体の
Ｈ／Ｗに無駄があった。
本発明の通信制御装置の構成は、データ通信網に接続さ
れた送付先アドレス及び発信元アドレスを持つパケット
データ通信を行う通信制御装置において、通信網からの
受信バゲットの送信先アドレスを判断して自局宛のパケ
ットのみを受信する手段と、発信元アドレスが、指定さ
れた発信元アドレスと一致した時パケットを受信する手
段と、その受信したパゲットに対して発信元アドレスに
対応したＣＰＵ番号を保持する手段と、そのＣＰＵ番号
に対応した処理プロセッサに処理要求を出力する手段と
、その要求を受付け、受信パケットに対する手順処理を
行う処理プロセッサを複数個持ち、発信元毎または、複
数の発信元毎に複数の処理プロセッサに手順処理を行わ
せたことを特徴とする。
れた送付先アドレス及び発信元アドレスを持つパケット
データ通信を行う通信制御装置において、通信網からの
受信バゲットの送信先アドレスを判断して自局宛のパケ
ットのみを受信する手段と、発信元アドレスが、指定さ
れた発信元アドレスと一致した時パケットを受信する手
段と、その受信したパゲットに対して発信元アドレスに
対応したＣＰＵ番号を保持する手段と、そのＣＰＵ番号
に対応した処理プロセッサに処理要求を出力する手段と
、その要求を受付け、受信パケットに対する手順処理を
行う処理プロセッサを複数個持ち、発信元毎または、複
数の発信元毎に複数の処理プロセッサに手順処理を行わ
せたことを特徴とする。
次に、本発明について図面を参照して説明する。
第１図に本発明を実施した通信制御装Ｗ（ＢＮＡ〉の一
例を示す。
例を示す。
ＬＡＮ網との物理層の接続を行うＰＨＹ部ＭＡＣ層の制
御を行い、制御部内のＭＥＭにデータを転送し、さらに
受信パケットの発信元アドレスをＣＰＵ ＴＢＬに出
力するＭＡＣ部、送受信データを蓄積するメモリ部＜Ｍ
ＥＭ） 、ＭＡＣからの発信元アドレス出力を元に、Ｃ
ＰＵ番号を蓄積したテーブルを参照し、そのＣＰＵ番号
に対応したＣＰＵに割り込みを発生するＣＰｔＪテーブ
ル部（ＣＰＵ ＴＢＬ）、受信パケットの手順処理を
行い、上位装置とのデータ転送制御を行う処理プロセッ
サ部（ＣＰＵ＃ｎ〉、上位装置とのデータ転送を行うＤ
ＭＡＣ部から構成される。
御を行い、制御部内のＭＥＭにデータを転送し、さらに
受信パケットの発信元アドレスをＣＰＵ ＴＢＬに出
力するＭＡＣ部、送受信データを蓄積するメモリ部＜Ｍ
ＥＭ） 、ＭＡＣからの発信元アドレス出力を元に、Ｃ
ＰＵ番号を蓄積したテーブルを参照し、そのＣＰＵ番号
に対応したＣＰＵに割り込みを発生するＣＰｔＪテーブ
ル部（ＣＰＵ ＴＢＬ）、受信パケットの手順処理を
行い、上位装置とのデータ転送制御を行う処理プロセッ
サ部（ＣＰＵ＃ｎ〉、上位装置とのデータ転送を行うＤ
ＭＡＣ部から構成される。
第２図は、本発明を実施したＬＡＮ網の構成図である．
ホストＣＰＵ下の通信制御装ｆ （ＢＮＡ）は、ＬＡＮ
＊を介して、各端末装置（ＴＭＯｍ）に接続している，
ＬＡＮ網上の各装置には、網アドレスが定義され、各々
、ＰＮＰは、“Ｏ”、各端末装置は、” １ ”
” ２”゛ｊ゛゜が割り当てられている． ＢＮＡ内のＣＰＵ ＴＢＬには、第３図に示す様に各
端末装置の網アドレスに対応して、その端末装置との手
順処理を担当する処理プロセッサ部の番号が格納されて
いる。
ホストＣＰＵ下の通信制御装ｆ （ＢＮＡ）は、ＬＡＮ
＊を介して、各端末装置（ＴＭＯｍ）に接続している，
ＬＡＮ網上の各装置には、網アドレスが定義され、各々
、ＰＮＰは、“Ｏ”、各端末装置は、” １ ”
” ２”゛ｊ゛゜が割り当てられている． ＢＮＡ内のＣＰＵ ＴＢＬには、第３図に示す様に各
端末装置の網アドレスに対応して、その端末装置との手
順処理を担当する処理プロセッサ部の番号が格納されて
いる。
この様なＬＡＮ網で、ＴＭＩがホストに対し送信すると
、第４図に示す様な送信先アドレス＝０、発信元アドレ
ス−２のデータパケットが、ＬＡＮ網上を流れる，ＬＡ
Ｎ網上のパケットは、ＬＡＮ網上の各装置が受信するが
、送信先アドレスが一致したＢＮＡのみが受信し、他の
装置は、パケットを廃棄する． ＢＮＡ内では、ＰＨＹ部が、ＬＡＮ網の信号をＢＮＡ内
の信号レベルに変換し、ＭＡＣ部で、この信号を並列信
号に変換し、ＭＥＭ部へ、データを転送する。この時、
Ｍ Ａ． Ｃ部は、送信先アドレスが゜゛Ｏ”であるこ
とを確認しさらに、発信元アドレス゛゜２″をＣＰＵ
ＴＢＬ部へ出力する。
、第４図に示す様な送信先アドレス＝０、発信元アドレ
ス−２のデータパケットが、ＬＡＮ網上を流れる，ＬＡ
Ｎ網上のパケットは、ＬＡＮ網上の各装置が受信するが
、送信先アドレスが一致したＢＮＡのみが受信し、他の
装置は、パケットを廃棄する． ＢＮＡ内では、ＰＨＹ部が、ＬＡＮ網の信号をＢＮＡ内
の信号レベルに変換し、ＭＡＣ部で、この信号を並列信
号に変換し、ＭＥＭ部へ、データを転送する。この時、
Ｍ Ａ． Ｃ部は、送信先アドレスが゜゛Ｏ”であるこ
とを確認しさらに、発信元アドレス゛゜２″をＣＰＵ
ＴＢＬ部へ出力する。
ＣＰＵ ＴＢＬは、ＭＡＣ部からの出力” ２ ”を
元に、テーブルを参照し、対応するＣＰＵ番号１１ ０
＋＋に割り込みを発生する。ＣＰＵ＃Ｏは、ＣＰＵ
ＴＢＬからの割り込みにより、ＭＡＣ部がＭＥＭ部へ
転送したパケットデータを認識し、手順に応じた処理を
おこなう。ＣＰＵ＃Ｏは、手順処理が終了した時、上位
装置へのデータ転送をおこなうため、ＤＭＡＣ部に、転
送を指示し、さらに、上位装置に受信完了を報告する。
元に、テーブルを参照し、対応するＣＰＵ番号１１ ０
＋＋に割り込みを発生する。ＣＰＵ＃Ｏは、ＣＰＵ
ＴＢＬからの割り込みにより、ＭＡＣ部がＭＥＭ部へ
転送したパケットデータを認識し、手順に応じた処理を
おこなう。ＣＰＵ＃Ｏは、手順処理が終了した時、上位
装置へのデータ転送をおこなうため、ＤＭＡＣ部に、転
送を指示し、さらに、上位装置に受信完了を報告する。
ＤＭＡＣ部は、ＣＰＵ＃Ｏからの指示に従い上位装置に
、ＭＥＭ部のデータを転送する。
、ＭＥＭ部のデータを転送する。
端末装置ＴＭ３からホストへのパケットは、ＭＡＣ部か
らの発信元アドレス出力をもとに、ＣＰＵ ＴＢＬ部
が、ｃｐｕ番号゛１゛′を参照し、ＣＰＵ＃１に端末装
置３からのパケット処理を要求する。
らの発信元アドレス出力をもとに、ＣＰＵ ＴＢＬ部
が、ｃｐｕ番号゛１゛′を参照し、ＣＰＵ＃１に端末装
置３からのパケット処理を要求する。
同様に端末装置ｍからホストへのパケットは、ＣＰＵ＃
１が、発信元アドレスから割当られパケット処理を行う
。
１が、発信元アドレスから割当られパケット処理を行う
。
端末のアドレスを識別し、処理を行うＣＰＵを決定する
ことにより端末装置を追加した時は、追加した端末装置
を担当するＣＰＵを追加するだけで、ＬＡＮ網上のＢＮ
Ａの台数を増加せず端末の追加に対応できる効果がある
．
ことにより端末装置を追加した時は、追加した端末装置
を担当するＣＰＵを追加するだけで、ＬＡＮ網上のＢＮ
Ａの台数を増加せず端末の追加に対応できる効果がある
．
第１図は本発明の一実施例のブロック図、第２図は本発
明を実施したＬＡＮ＃！ｌの構成図、第３図はＣＰＵ
ＴＢＬ部のｃｐｕ番号参照テーブル詳細図、第４図は
パケットの形式を示す図である。 ＢＮＡ・・・ホストＣＰＵに接続された通信制御装置、
ＣＰＵ＃０．１・・・処理プロセッサ、ＣＰＵＴＢＬ・
・・ＣＰＵテーブル部、ＬＡＮ・・・ローカルエリアネ
ットワーク、ＭＡＣ・・・ＭＡＣ部、ＭＥＭ・・・ＢＮ
Ａ内メモリ部、Ｐ Ｈ Ｙ ・Ｐ Ｈ Ｙ部、ＴＭ○−
ｍ・・・端末装置。
明を実施したＬＡＮ＃！ｌの構成図、第３図はＣＰＵ
ＴＢＬ部のｃｐｕ番号参照テーブル詳細図、第４図は
パケットの形式を示す図である。 ＢＮＡ・・・ホストＣＰＵに接続された通信制御装置、
ＣＰＵ＃０．１・・・処理プロセッサ、ＣＰＵＴＢＬ・
・・ＣＰＵテーブル部、ＬＡＮ・・・ローカルエリアネ
ットワーク、ＭＡＣ・・・ＭＡＣ部、ＭＥＭ・・・ＢＮ
Ａ内メモリ部、Ｐ Ｈ Ｙ ・Ｐ Ｈ Ｙ部、ＴＭ○−
ｍ・・・端末装置。
Claims (1)
- データ通信網に接続された送付先アドレス及び発信元ア
ドレスを持つパケットデータ通信を行う通信制御装置に
おいて、通信網からの受信パケットの送信先アドレスを
判断して自局宛のパケットのみを受信する手段と、発信
元アドレスが、指定された発信元アドレスと一致した時
パケットを受信する手段と、その受信したパケットに対
して発信元アドレスに対応したＣＰＵ番号を保持する手
段と、そのＣＰＵ番号に対応した処理プロセッサに処理
要求を出力する手段と、その要求を受付け、受信パケッ
トに対する手順処理を行う処理プロセッサを複数個持ち
、発信元毎または、複数の発信元毎に複数の処理プロセ
ッサに手順処理を行わせたことを特徴とする通信制御装
置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1193052A JPH0357342A (ja) | 1989-07-25 | 1989-07-25 | 通信制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1193052A JPH0357342A (ja) | 1989-07-25 | 1989-07-25 | 通信制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0357342A true JPH0357342A (ja) | 1991-03-12 |
Family
ID=16301382
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1193052A Pending JPH0357342A (ja) | 1989-07-25 | 1989-07-25 | 通信制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0357342A (ja) |
-
1989
- 1989-07-25 JP JP1193052A patent/JPH0357342A/ja active Pending
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