JPH0361202B2 - - Google Patents

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Publication number
JPH0361202B2
JPH0361202B2 JP56100871A JP10087181A JPH0361202B2 JP H0361202 B2 JPH0361202 B2 JP H0361202B2 JP 56100871 A JP56100871 A JP 56100871A JP 10087181 A JP10087181 A JP 10087181A JP H0361202 B2 JPH0361202 B2 JP H0361202B2
Authority
JP
Japan
Prior art keywords
setting
switch
mode
group
error
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired - Lifetime
Application number
JP56100871A
Other languages
English (en)
Other versions
JPS582909A (ja
Inventor
Hiroya Tanaka
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP56100871A priority Critical patent/JPS582909A/ja
Publication of JPS582909A publication Critical patent/JPS582909A/ja
Publication of JPH0361202B2 publication Critical patent/JPH0361202B2/ja
Granted legal-status Critical Current

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Classifications

    • GPHYSICS
    • G05CONTROLLING; REGULATING
    • G05BCONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
    • G05B23/00Testing or monitoring of control systems or parts thereof
    • G05B23/02Electric testing or monitoring
    • G05B23/0205Electric testing or monitoring by means of a monitoring system capable of detecting and responding to faults
    • G05B23/0259Electric testing or monitoring by means of a monitoring system capable of detecting and responding to faults characterized by the response to fault detection
    • G05B23/0267Fault communication, e.g. human machine interface [HMI]
    • G05B23/0272Presentation of monitored results, e.g. selection of status reports to be displayed; Filtering information to the user

Landscapes

  • Engineering & Computer Science (AREA)
  • Human Computer Interaction (AREA)
  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Automation & Control Theory (AREA)
  • Testing And Monitoring For Control Systems (AREA)

Description

【発明の詳細な説明】
本発明はスイツチのような設定部により誤設定
の操作があつたとき表示する誤設定表示方式に関
する。 動作システムを制御するときスイツチのような
設定部を閉または開のように制御する。第1図の
例においてスイツチSW1乃至SW4を組合せ設
定したときその動作モードは第1表のように16種
類ある。このとき各スイツチの設定を検出・復号
するなど検出制御部DCTにおいて適宜な制御信
号を作り、動作制御部CTLを制御している。動
作制御部CTLは所定動作回路の動作を適宜制御
する。設定者は16種類のモードについて何回も制
御することにより熟練しない限り第1表を見なが
ら制御する必要がある。
【表】
【表】 検出制御部DCTも第1表のとおり翻訳制御し
ている。この場合は予定外のモードを設定し異常
状態を発生することはない。しかしこの設定スイ
ツチが4個よりもはるかに数が多くなると設定可
能なモード数が増加し、表を探すことも長時間を
要することになる。 本発明の目的は前述の欠点を改善し条件設定の
ときテーブルを探すことなく簡便にでき、若し誤
設定を行なつたときはそれを表示できる方式を提
供することにある。そのため本発明の要旨は設定
部を複数グループに分けておき誤設定のあつた場
合はエラー表示のできる装置を設けることであ
る。 以下図面に示す本発明の実施例について説明す
る。第2図は本発明の実施例を示す構成図で、10
個の設定スイツチは3個のグループG1乃至G3
に分割し、各グループ内のスイツチは3個、4
個、3個となつている。第1グルーブG1はスイ
ツチに、第2グループG2はスイツチに
、第3グループは○ア○イ○ウと符号をつける。
各スイツチを操作して得られる設定モードは第2
表に示す16通りに限られ、他はないものとする。
【表】
【表】 そのとき各スイツチについてアルフアベツト・
数字などのそれぞれに簡単な約束をして、それの
み覚えれば設定モードについてその都度テーブル
を持出して調べる必要はなく、所定のモードを容
易に設定できる。そのためスイツチ操作が円滑に
できる。しかし若し誤設定をしたときは、論理演
算回路を組合せる等の簡易な装置でエラー検出と
表示ERDを行なうことができる。第2図の実施
例における検出制御部は演算処理装置を具備し、
第3図に示すフローチヤートに従いスイツチ操作
のエラー検出を行う。第3図において「異常状態
表示」エラー1などは、スイツチ操作を行つた状
態モードが第2表に無く、エラーを表示させるこ
とを意味する。例えばスイツチ第1グループG1
において、、を共に設定してないとき(オ
ンでないとき)は「異常状態表示」エラー1とな
る。なおエラーを検出して表示することは後述す
る。 第3図のフローチヤートにおいて「異常状態表
示」エラー1の処理の後に、矢印が上方へ向かつ
てスイツチAを設定した場合に合流している。こ
のことはスイツチ、、について何れも設定
していないとき、を設定することを自動的に行
えば良いことを意味する。自動設定についてはエ
ラー検出についての説明のとき詳述する。ここで
Aを設定することはについての設定モード数が
多いこと、換言すればを他のスイツチに対して
優先順位を高くしていることである。 設定モード数が多いことは、第2グループG2
と第3グループG3についても同様に考えて、第
2グループG2についての「異常状態表示」エラ
ー2では、スイツチ〜の何れも設定されてい
ないときにスイツチを設定することも動作させ
る。また第3グループG3についての「異常状態
表示」エラー3ではスイツチ○ア〜○ウの何れも設定
されていないとき、スイツチ○アを設定することを
動作させる。また「異常状態表示」エラー5では
第1グループG1がCのスイツチを設定し、その
とき第2表を見ると第2グループG2がまたは
となることが必要で、それ以外のときは異常で
ある。そのときもスイツチを設定させる。 以上のようにスイツチの設定状態により「異常
状態表示」の必要があるときはエラー表示を行
い、且つ最もモード数が多い状態に自動修正を行
う。そしてスイツチが正常に設定されたときはモ
ードXと記述してある状態に設定されることがフ
ローチヤートに示される。モードXのXとは第2
表について1〜16の値を採り、この場合各スイツ
チの設定が正常のとき必ず1つのモードのみが選
択される。 次に第3図に示す動作を行うための論理演算回
路を第4図に示す。第4図の当初の図は「異常状
態表示」エラー1の信号を得るための回路を示
す。上述したとおりスイツチ〜の何れも設定
がないとき、そのことをナンド回路で演算してエ
ラー1を得る。そしてエラー1の信号を検出した
とき、その信号と、スイツチを設定してない信
号とについて、更にナンド回路で演算して「選択
A」を得る。選択Aはスイツチを動作させるべ
き信号であるから、例えば電子スイツチで形成し
たスイツチAを駆動すれば良い。そして「異常状
態表示」エラー1のときは、スイツチを設定し
オン状態とするから、エラー1の状態が解除され
る。第4図の他の図は、同様にエラー検出信号と
スイツチを選択すべき信号とについて演算する回
路を示す。即ち、第2図に示すスイツチ〜、
……ア〜○ウの回路から多数の接続線により演算回
路を形成することであり、これら回路を全て含み
検出制御部DCTが構成される。 なおエラー検出・表示ERDは発光ダイオード
による発光表示、あるいは音声表示を利用する。 このようにして本発明によると条件設定のとき
グループ分けしてあるため意味付けした表現もで
きるので、テーブルを探すことなく簡便な設定が
できる。更に誤設定を行なつたときは簡易な回路
で検出・表示させることができる。更に論理演算
回路を組合せて検出制御部を構成したため、誤設
定を行つたときには容易に自動修正することが出
来る。
【図面の簡単な説明】
第1図は従来の動作システムの条件設定を説明
する図、第2図は本発明の実施例の構成を示す
図、第3図は第2図の動作フローチヤート、第4
図は第3図の動作を行う論理演算回路の例を示す
図である。 SW1〜SW4〜,〜,○ア〜○ウ…設定
スイツチ、DCT…検出制御部、CTL…動作制御
部、ERD…エラー検出・表示。

Claims (1)

  1. 【特許請求の範囲】 1 設定部の設定操作により動作制御部を介して
    所定の動作回路の動作制御を行わせる動作システ
    ムにおいて、 それぞれ複数の設定スイツチを有する複数のグ
    ループに分けられ、各グループについてそれぞれ
    何れかの設定スイツチがセツト状態に操作される
    ことにより、対応する予定のモードを設定する設
    定部と、 該設定部の設定スイツチの状態を各グループ毎
    に順次調べて、対応する設定モードを検出すると
    共に、前記予定のモードに対応するセツト状態に
    ないときは、設定スイツチの誤設定と判断して、
    各グループで前記予定のモードを最も多く設定す
    る設定スイツチがセツト状態にあるものとして対
    応するモードに自動修正し、検出されたモードま
    たは自動修正されたモードに対応した制御信号に
    より動作制御部を制御する検出制御部と、 該検出制御部が前記設定スイツチの誤設定を判
    断したときエラー表示を行うことエラー表示装置
    と、 で構成することを特徴とする動作システムの誤設
    定表示装置。
JP56100871A 1981-06-29 1981-06-29 動作システムの誤設定表示方式 Granted JPS582909A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP56100871A JPS582909A (ja) 1981-06-29 1981-06-29 動作システムの誤設定表示方式

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JP56100871A JPS582909A (ja) 1981-06-29 1981-06-29 動作システムの誤設定表示方式

Publications (2)

Publication Number Publication Date
JPS582909A JPS582909A (ja) 1983-01-08
JPH0361202B2 true JPH0361202B2 (ja) 1991-09-19

Family

ID=14285373

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JP56100871A Granted JPS582909A (ja) 1981-06-29 1981-06-29 動作システムの誤設定表示方式

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Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH07120191B2 (ja) * 1986-01-13 1995-12-20 オムロン株式会社 制御装置

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5582303A (en) * 1978-12-18 1980-06-21 Omron Tateisi Electronics Co Sequence controller

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JPS582909A (ja) 1983-01-08

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