JPH0362357B2 - - Google Patents
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- JPH0362357B2 JPH0362357B2 JP59113744A JP11374484A JPH0362357B2 JP H0362357 B2 JPH0362357 B2 JP H0362357B2 JP 59113744 A JP59113744 A JP 59113744A JP 11374484 A JP11374484 A JP 11374484A JP H0362357 B2 JPH0362357 B2 JP H0362357B2
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- capacitor
- signal
- circuit
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- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
- G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
- G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
- G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
- G09G3/3611—Control of matrices with row and column drivers
- G09G3/3685—Details of drivers for data electrodes
- G09G3/3688—Details of drivers for data electrodes suitable for active matrices only
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- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N3/00—Scanning details of television systems; Combination thereof with generation of supply voltages
- H04N3/10—Scanning details of television systems; Combination thereof with generation of supply voltages by means not exclusively optical-mechanical
- H04N3/12—Scanning details of television systems; Combination thereof with generation of supply voltages by means not exclusively optical-mechanical by switched stationary formation of lamps, photocells or light relays
- H04N3/127—Scanning details of television systems; Combination thereof with generation of supply voltages by means not exclusively optical-mechanical by switched stationary formation of lamps, photocells or light relays using liquid crystals
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- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
- G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
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- Liquid Crystal Display Device Control (AREA)
- Transforming Electric Information Into Light Information (AREA)
Description
【発明の詳細な説明】
〈技術分野〉
本発明は、マトリツクス型液晶表示装置に関す
るもので、特にスイツチングトランジスタを表示
の各絵素に付加したマトリツクス型液晶表示を用
いたテレビ画像表示装置の駆動回路に関するもの
である。
るもので、特にスイツチングトランジスタを表示
の各絵素に付加したマトリツクス型液晶表示を用
いたテレビ画像表示装置の駆動回路に関するもの
である。
〈従来技術〉
スイツチングトランジスタを表示の各絵素に付
加したマトリツクス型液晶表示装置は、デユーテ
イ比の小さい即ち多ラインのマルチプレツクス駆
動を行つた場合でもスタテイツク駆動と同等の高
コントラストが得られるので、一般的に第１図に
示したような回路構成および信号波形になつてい
る。第１図において１１は液晶表示パネルで行電
極１１−ａと列電極１１−ｂの各交点にスイツチ
ングトランジスタ１１−ｃが図の様に接続されて
いる。１１−ｄは絵素と対向電極の間の液晶層で
ある。１２は各電極に走査パルス（Y1〜Yn）を
出力する行電極ドライバで主にシフトレジスタか
ら成り、信号制御回路１３から送られた走査開始
パルスＰをクロツクφ1により順次シフトさせ各
行電極に出力する。１４は各列電極に表示の濃淡
に対応した振幅をもつデータ信号（X1〜Xm）を
出力する列電極ドライバで主にシフトレジスタ、
サンプルホールド回路、出力バツフア回路から成
つている。そしてデータ制御回路１５から直列に
送られてくる表示データのうちの該当する列の絵
素に対応する期間のデータ電圧をサンプリング
し、その値を一定期間ホールドしてクロツクφ1
に同期して１走査期間（1H）列電極に出力する。
データ制御回路１５は、テレビ画像表示の場合、
映像の受信回路、信号処理回路等である。
加したマトリツクス型液晶表示装置は、デユーテ
イ比の小さい即ち多ラインのマルチプレツクス駆
動を行つた場合でもスタテイツク駆動と同等の高
コントラストが得られるので、一般的に第１図に
示したような回路構成および信号波形になつてい
る。第１図において１１は液晶表示パネルで行電
極１１−ａと列電極１１−ｂの各交点にスイツチ
ングトランジスタ１１−ｃが図の様に接続されて
いる。１１−ｄは絵素と対向電極の間の液晶層で
ある。１２は各電極に走査パルス（Y1〜Yn）を
出力する行電極ドライバで主にシフトレジスタか
ら成り、信号制御回路１３から送られた走査開始
パルスＰをクロツクφ1により順次シフトさせ各
行電極に出力する。１４は各列電極に表示の濃淡
に対応した振幅をもつデータ信号（X1〜Xm）を
出力する列電極ドライバで主にシフトレジスタ、
サンプルホールド回路、出力バツフア回路から成
つている。そしてデータ制御回路１５から直列に
送られてくる表示データのうちの該当する列の絵
素に対応する期間のデータ電圧をサンプリング
し、その値を一定期間ホールドしてクロツクφ1
に同期して１走査期間（1H）列電極に出力する。
データ制御回路１５は、テレビ画像表示の場合、
映像の受信回路、信号処理回路等である。
第２図は上記列電極ドライバのうちの１本分
（Xi）の回路の一実施例および信号波形を示した
ものでああり、制御信号Ｔ、CLはすべての列に
ついて共通に加えられる。図の中で２１〜２４は
アナログスイツチで、例えば制御信号（Si、Ｔ、
CL）がハイレベルの時にスイツチオン状態とな
る。まずSiにより、1Hのうちの該当する瞬間だ
けスイツチ２１がオン状態になると、その瞬間の
表示データＤの電圧がコンデンサ２５にサンプリ
ングされる。そして各列について順次サンプリン
グが行われ、すべての列についてサンプリングが
完了してから再び第１列目のサンプリングが始ま
るまでの間のある期間Ｔによりスイツチ２２がオ
ン状態となり、コンデンサ２５の電圧はコンデン
サ２６に転送され、次のサンプリングが行なわれ
ている間そこにホールドされる。さらにコンデン
サ２６にホールドされた電圧は絶縁ゲート型トラ
ンジスタ２７による出力バツフア回路を経て負荷
である列電極に出力される。この場合の負荷な１
本の列電極に浮遊する容量をすべて合成した１つ
のコンデンサ２８であるとみなせる。スイツチ２
３および２４はコンデンサ２６および２８に充電
されている電圧が次にそれらに充電される電圧に
対して影響を与えないように、スイツチ２２をオ
ン状態にする前にコンデンサ２６および２８を放
電させるためのものである。
（Xi）の回路の一実施例および信号波形を示した
ものでああり、制御信号Ｔ、CLはすべての列に
ついて共通に加えられる。図の中で２１〜２４は
アナログスイツチで、例えば制御信号（Si、Ｔ、
CL）がハイレベルの時にスイツチオン状態とな
る。まずSiにより、1Hのうちの該当する瞬間だ
けスイツチ２１がオン状態になると、その瞬間の
表示データＤの電圧がコンデンサ２５にサンプリ
ングされる。そして各列について順次サンプリン
グが行われ、すべての列についてサンプリングが
完了してから再び第１列目のサンプリングが始ま
るまでの間のある期間Ｔによりスイツチ２２がオ
ン状態となり、コンデンサ２５の電圧はコンデン
サ２６に転送され、次のサンプリングが行なわれ
ている間そこにホールドされる。さらにコンデン
サ２６にホールドされた電圧は絶縁ゲート型トラ
ンジスタ２７による出力バツフア回路を経て負荷
である列電極に出力される。この場合の負荷な１
本の列電極に浮遊する容量をすべて合成した１つ
のコンデンサ２８であるとみなせる。スイツチ２
３および２４はコンデンサ２６および２８に充電
されている電圧が次にそれらに充電される電圧に
対して影響を与えないように、スイツチ２２をオ
ン状態にする前にコンデンサ２６および２８を放
電させるためのものである。
以上の様な液晶表示装置により表示を行う場
合、液晶を交流駆動するために、通常２回の走査
を１組とし、各走査毎に列電極に加えるデータ信
号の極性を反転させて液晶に交流がかるようにす
る。従つてテレビ画像を表示する場合、通常のテ
レビと同一の走査線数（525本）の表示を行おう
とすると、テレビ画像のフレーム周波数は30Hzで
あるから液晶にかかる電厚のフレーム周波数はそ
の1/2の15Hzとなり表示にちらつきが生じてしま
う。そこで通常のテレビは飛び越し走査が行われ
ていることを利用してデータ信号の極性の反転を
フイールド毎に行い液晶には30Hzの交流がかかる
ようにすることが行なわれている。しかしこの場
合、通常のテレビと同一の走査線数の表示を行う
と、各フイールドでは奇数番目または偶数番目の
どちらかの走査線に対する映像信号しか送られて
こないため、例えばフレームメモリを設けて、残
りの半数の走査に対する画像信号はそのメモリか
ら読み出して列電極ドライバに加えるということ
が行われる。
合、液晶を交流駆動するために、通常２回の走査
を１組とし、各走査毎に列電極に加えるデータ信
号の極性を反転させて液晶に交流がかるようにす
る。従つてテレビ画像を表示する場合、通常のテ
レビと同一の走査線数（525本）の表示を行おう
とすると、テレビ画像のフレーム周波数は30Hzで
あるから液晶にかかる電厚のフレーム周波数はそ
の1/2の15Hzとなり表示にちらつきが生じてしま
う。そこで通常のテレビは飛び越し走査が行われ
ていることを利用してデータ信号の極性の反転を
フイールド毎に行い液晶には30Hzの交流がかかる
ようにすることが行なわれている。しかしこの場
合、通常のテレビと同一の走査線数の表示を行う
と、各フイールドでは奇数番目または偶数番目の
どちらかの走査線に対する映像信号しか送られて
こないため、例えばフレームメモリを設けて、残
りの半数の走査に対する画像信号はそのメモリか
ら読み出して列電極ドライバに加えるということ
が行われる。
以上の様に、マトリツクス型液晶表示を用いた
テレビ画像表示装置において、通常のテレビと同
一の走査線数（525本）の表示を行う場合、フレ
ームメモリが必要となるが、フレームメモリを設
けることは、消費電力の増加、コストの増加を招
き、非常に大きな問題となる。
テレビ画像表示装置において、通常のテレビと同
一の走査線数（525本）の表示を行う場合、フレ
ームメモリが必要となるが、フレームメモリを設
けることは、消費電力の増加、コストの増加を招
き、非常に大きな問題となる。
〈発明の目的〉
本発明は、マトリツクス型液晶表示装置を用い
たテレビ画像表示装置の駆動回路における上記問
題点に鑑みてなされたものであり、フレームメモ
リを用いることなく、通常のテレビと同一の走査
線数の表示を行うことが可能な、新規有用な液晶
表示装置の駆動回路を提供することを目的とする
ものである。
たテレビ画像表示装置の駆動回路における上記問
題点に鑑みてなされたものであり、フレームメモ
リを用いることなく、通常のテレビと同一の走査
線数の表示を行うことが可能な、新規有用な液晶
表示装置の駆動回路を提供することを目的とする
ものである。
〈発明の基本原理〉
本発明の駆動回路の特徴は、第３図に示したよ
うに奇数（偶数）フイールドにおいては偶数（奇
数）番目の走査に対応する映像信号として、その
１走査前と後の奇数（偶数）番目の走査に対応す
る２つの映像信号の平均値を液晶パネルに加える
ことにより、フレームメモリを用いることなく、
通常のテレビと同一の走査線数の表示を行うもの
である。図においてａ，ｂは送られてくるテレビ
信号の水平同期信号および映像信号であり、奇数
フイールドの場合を例に示している。したがつて
映像信号ｂには奇数番目の走査に対応する信号だ
けが含まれている。ｃは走査パルスを作るための
クロツクφ1である。この場合、繰り返し周波数
60Hzで全走査線を走査するために、クロツクφ1
の周期は水平同期信号ａの半分になる。ｄは列電
極に印加されるデータ信号の１つを示したもの
で、奇数番目（…、2n−１、2n＋１、2n＋３、
…）の走査期間には、映像信号ｂから得られた信
号電圧（…、V2o-1、V2o+1、V2o+3、…）が、偶
数番目（…、2n、2n＋２、2n＋４、…）の走査
期間には対応する映像記号がないので、そのかわ
りに前後の信号電圧の平均値（…、V2o＝（V2o-1
＋V2o+1）／２、V2o+2＝（V2o+1＋V2o+3）／２、
…）がそれぞれ出力された波形となつている。ま
た偶数フイールドにおいては偶数番目の走査期間
には映像信号から得られる信号電圧が奇数番目の
期間には平均化によつて得られる信号電圧が出力
される。そしてフイールド毎に映像信号の極性を
反転することにより、映像信号から得られる信号
電圧と平均化によつて得られる信号電圧を１つの
組とし、液晶に30Hzの交流が印加される。
うに奇数（偶数）フイールドにおいては偶数（奇
数）番目の走査に対応する映像信号として、その
１走査前と後の奇数（偶数）番目の走査に対応す
る２つの映像信号の平均値を液晶パネルに加える
ことにより、フレームメモリを用いることなく、
通常のテレビと同一の走査線数の表示を行うもの
である。図においてａ，ｂは送られてくるテレビ
信号の水平同期信号および映像信号であり、奇数
フイールドの場合を例に示している。したがつて
映像信号ｂには奇数番目の走査に対応する信号だ
けが含まれている。ｃは走査パルスを作るための
クロツクφ1である。この場合、繰り返し周波数
60Hzで全走査線を走査するために、クロツクφ1
の周期は水平同期信号ａの半分になる。ｄは列電
極に印加されるデータ信号の１つを示したもの
で、奇数番目（…、2n−１、2n＋１、2n＋３、
…）の走査期間には、映像信号ｂから得られた信
号電圧（…、V2o-1、V2o+1、V2o+3、…）が、偶
数番目（…、2n、2n＋２、2n＋４、…）の走査
期間には対応する映像記号がないので、そのかわ
りに前後の信号電圧の平均値（…、V2o＝（V2o-1
＋V2o+1）／２、V2o+2＝（V2o+1＋V2o+3）／２、
…）がそれぞれ出力された波形となつている。ま
た偶数フイールドにおいては偶数番目の走査期間
には映像信号から得られる信号電圧が奇数番目の
期間には平均化によつて得られる信号電圧が出力
される。そしてフイールド毎に映像信号の極性を
反転することにより、映像信号から得られる信号
電圧と平均化によつて得られる信号電圧を１つの
組とし、液晶に30Hzの交流が印加される。
第４図は上記の駆動波形を実現するための列電
極ドライバの構成を示す概念図である。図におい
て、４１，４２，４３は映像信号のある瞬間の電
圧をサンプリングしホールドするためのサンプル
ホールド回路であり、４１〜４３の３つに同じ電
圧がサンプリングされ、４１では１走査前の映像
信号と平均化を行うために、４３では１走査後の
映像信号と平均化を行うために用いられる。４２
ではサンプリングされた電圧がそのまま出力され
る。またサンプルホールド回路が２組（ａとｂ）
になつているのは、一方では平均化出力を行つて
いる間に他方で次の映像信号のサンプリングを行
うためである。
極ドライバの構成を示す概念図である。図におい
て、４１，４２，４３は映像信号のある瞬間の電
圧をサンプリングしホールドするためのサンプル
ホールド回路であり、４１〜４３の３つに同じ電
圧がサンプリングされ、４１では１走査前の映像
信号と平均化を行うために、４３では１走査後の
映像信号と平均化を行うために用いられる。４２
ではサンプリングされた電圧がそのまま出力され
る。またサンプルホールド回路が２組（ａとｂ）
になつているのは、一方では平均化出力を行つて
いる間に他方で次の映像信号のサンプリングを行
うためである。
図において４４は２つの電圧の平均値を得るた
めの回路である。信号がアナログで処理される回
路構成の場合には、例えば後述するようなコンデ
ンサによる分圧回路を用いて平均値を得ることが
できる。またデジタル信号の場合には４４はデジ
タル演算回路となるが、この場合、平均化を行つ
てもサンプリングされた電圧が変化することがな
いため、３つのサンプルホールド回路を１つの回
路で共用することが可能となる。
めの回路である。信号がアナログで処理される回
路構成の場合には、例えば後述するようなコンデ
ンサによる分圧回路を用いて平均値を得ることが
できる。またデジタル信号の場合には４４はデジ
タル演算回路となるが、この場合、平均化を行つ
てもサンプリングされた電圧が変化することがな
いため、３つのサンプルホールド回路を１つの回
路で共用することが可能となる。
〈実施例〉
本発明の駆動回路の構成は従来の場合（第１
図）と同一であるが、列電極ドライバおよび信号
制御回路の内部構造が異なる。まず、列電極ドラ
イバのうちの１本分（Xi）の回路の１実施例を
第５図に示す。本駆動回路は、従来例（第２図）
に前述の基本原理（第４図）をそのまま適用した
もので、したがつてサンプリング部のアナログク
イツチ５１，５２およびコンデンサ５５の数が従
来例に比較して６倍になつている。また図におい
て、制御信号T1〜T6、CLは各列に共通に設けら
れており、第２図にて説明した如く第１図に示す
信号制御回路及びデータ制御回路より全ての列電
極に対して各制御信号毎に一斉に印加される。制
御信号T1〜T6はホールドコンデンサ５６への充
電を制御する制御信号であり、第４図で説明した
原理に即してアナログスイツチ５２−１〜５２−
６を順次開閉するために水平同期信号及びクロツ
ク信号φ1を基準として形成される。また制御信
号CLは各絵素５８に充電された充電々荷をホー
ルドコンデンサ５６に蓄積されている次の映像信
号の印加直前に各絵素５８から除去するために制
御信号T1〜T6の直前でスイツチ５４を開閉制御
する。制御信号CLが印加されると第２図ｂに示
す如く列電極xiの電位は零となり、次の制御信号
T1〜T6の印加によつて列電極xiは映像信号に対
応した電位に再充電される。この点は充来と同様
の基本動作に基いている。尚、S1i、S2iは第２図
にて説明した如く映像信号を表示するために1H
のうちの該当する瞬間だけスイツチ５１−１〜５
１−６をオンにするサンプリング信号であり、信
号制御回路及びデータ制御回路のクロツク信号及
び水平同期信号に基いて形成される。
図）と同一であるが、列電極ドライバおよび信号
制御回路の内部構造が異なる。まず、列電極ドラ
イバのうちの１本分（Xi）の回路の１実施例を
第５図に示す。本駆動回路は、従来例（第２図）
に前述の基本原理（第４図）をそのまま適用した
もので、したがつてサンプリング部のアナログク
イツチ５１，５２およびコンデンサ５５の数が従
来例に比較して６倍になつている。また図におい
て、制御信号T1〜T6、CLは各列に共通に設けら
れており、第２図にて説明した如く第１図に示す
信号制御回路及びデータ制御回路より全ての列電
極に対して各制御信号毎に一斉に印加される。制
御信号T1〜T6はホールドコンデンサ５６への充
電を制御する制御信号であり、第４図で説明した
原理に即してアナログスイツチ５２−１〜５２−
６を順次開閉するために水平同期信号及びクロツ
ク信号φ1を基準として形成される。また制御信
号CLは各絵素５８に充電された充電々荷をホー
ルドコンデンサ５６に蓄積されている次の映像信
号の印加直前に各絵素５８から除去するために制
御信号T1〜T6の直前でスイツチ５４を開閉制御
する。制御信号CLが印加されると第２図ｂに示
す如く列電極xiの電位は零となり、次の制御信号
T1〜T6の印加によつて列電極xiは映像信号に対
応した電位に再充電される。この点は充来と同様
の基本動作に基いている。尚、S1i、S2iは第２図
にて説明した如く映像信号を表示するために1H
のうちの該当する瞬間だけスイツチ５１−１〜５
１−６をオンにするサンプリング信号であり、信
号制御回路及びデータ制御回路のクロツク信号及
び水平同期信号に基いて形成される。
まず図において第７番目の走査に対応する映像
信号を受信している期間を考える。制御信号S1i
によりａの瞬間アナログスイツチ５１−１，５１
−２，５１−３がオンするとその瞬間の映像信号
電圧V7iがコンデンサ５５−１，５５−２，５５
−３にサンプリングされる。この時点ではコンデ
ンサ５５−４，５５−５，５５−６には第５番目
の走査に対応する映像信号電圧V5iがサンプリン
グされホールドされている。次にｂの時点で制御
信号T1、T6によりアナログスイツチ５２−１，
５１−６がオンすると、コンデンサ５５−１と５
５−６が並列に接続され（V5i＋V7i）／２の電圧
がコンデンサ５６に転送され、第６番目の走査に
対応する映像信号電圧としてバツフア用の絶縁ゲ
ート型トランジスタ５７を通して負荷絵素５８に
出力される。次にｃの時点になると、制御信号
T2によりアナログスイツチ５５−２がオンし、
コンデンサ５５−２の電圧V7iがコンデンサ５６
に転送されバツフア５７を通して出力される。次
にｄの瞬間、制御信号S2iによりアナログスイツ
チ５１−４，５１−５，５１−６がオンすると、
第９番目の走査に対応する映像信号電圧V9iがコ
ンデンサ５５−４，５５−５，５５−６にサンプ
リングされる。そしてｅの時点で制御信号T3、
T4によりアナログスイツチ５２−３，５２−４
がオンすると、コンデンサ５５−３と５５−４が
並列に接続され（V7i＋V9i）／２の電圧がコンデ
ンサ５６に転送され、第８番目の走査に対応する
映像信号電圧として負荷５８に出力される。次に
ｆ瞬間、制御信号S1iによりアナログスイツチ５
１−１，５１−２，５１−３が再びオンすると、
第11番目の走査に対応する映像信号電圧V11iがコ
ンデンサ５１−１，５１−２，５１−３にサンプ
リングされる。そして上記動作を繰り返すことに
より、負荷５８に出力される電圧Xiは図に示し
た様な順序になる。図において３は３番目の走査
に対応する映像信号が出力され、３＊５は３番目
と５番目の映像信号の平均値が４番目の走査に対
応する映像信号として出力されるということを示
している。
信号を受信している期間を考える。制御信号S1i
によりａの瞬間アナログスイツチ５１−１，５１
−２，５１−３がオンするとその瞬間の映像信号
電圧V7iがコンデンサ５５−１，５５−２，５５
−３にサンプリングされる。この時点ではコンデ
ンサ５５−４，５５−５，５５−６には第５番目
の走査に対応する映像信号電圧V5iがサンプリン
グされホールドされている。次にｂの時点で制御
信号T1、T6によりアナログスイツチ５２−１，
５１−６がオンすると、コンデンサ５５−１と５
５−６が並列に接続され（V5i＋V7i）／２の電圧
がコンデンサ５６に転送され、第６番目の走査に
対応する映像信号電圧としてバツフア用の絶縁ゲ
ート型トランジスタ５７を通して負荷絵素５８に
出力される。次にｃの時点になると、制御信号
T2によりアナログスイツチ５５−２がオンし、
コンデンサ５５−２の電圧V7iがコンデンサ５６
に転送されバツフア５７を通して出力される。次
にｄの瞬間、制御信号S2iによりアナログスイツ
チ５１−４，５１−５，５１−６がオンすると、
第９番目の走査に対応する映像信号電圧V9iがコ
ンデンサ５５−４，５５−５，５５−６にサンプ
リングされる。そしてｅの時点で制御信号T3、
T4によりアナログスイツチ５２−３，５２−４
がオンすると、コンデンサ５５−３と５５−４が
並列に接続され（V7i＋V9i）／２の電圧がコンデ
ンサ５６に転送され、第８番目の走査に対応する
映像信号電圧として負荷５８に出力される。次に
ｆ瞬間、制御信号S1iによりアナログスイツチ５
１−１，５１−２，５１−３が再びオンすると、
第11番目の走査に対応する映像信号電圧V11iがコ
ンデンサ５１−１，５１−２，５１−３にサンプ
リングされる。そして上記動作を繰り返すことに
より、負荷５８に出力される電圧Xiは図に示し
た様な順序になる。図において３は３番目の走査
に対応する映像信号が出力され、３＊５は３番目
と５番目の映像信号の平均値が４番目の走査に対
応する映像信号として出力されるということを示
している。
第５図ａに示す回路において、コンデンサ５６
の容量C0がコンデンサ５５−２，５５−５の容
量C1に比べて無視できない大きさである場合、
コンデンサ５５−２，５５−５からコンデンサ５
６に電圧が転送される時に電圧C1／（C1＋C0）
に減少する。したがつて、２つのコンデンサの電
圧が同時にコンデンサ５６に転送される場合でも
その減少率が等しくなるように、コンデンサ５１
−１，３，４，６の容量はC1／２になつている。
の容量C0がコンデンサ５５−２，５５−５の容
量C1に比べて無視できない大きさである場合、
コンデンサ５５−２，５５−５からコンデンサ５
６に電圧が転送される時に電圧C1／（C1＋C0）
に減少する。したがつて、２つのコンデンサの電
圧が同時にコンデンサ５６に転送される場合でも
その減少率が等しくなるように、コンデンサ５１
−１，３，４，６の容量はC1／２になつている。
第６図は本発明の列電極ドライバの他の実施例
である。本回路は第５図と同様１列分の駆動回路
について描いたものであり、前列における６組の
サンプリング回路のうち、時間的に見て共通使用
が可能なものについて共用できる様に結線し、サ
ンプリング回路を４組に減らしたものである。ア
ナログスイツチ６１−１，６１−２は制御信号
S1iによつて開閉され、アナログスイツチ６１−
３は制御信号S1iとS2iのアンドゲートを介してま
たアナログスイツチ61−４は制御信号S1iとS3iの
アンドゲートを介してそれぞれ開閉される。制御
信号S1i，S2i，S3iはそれぞれ映像信号を1Hの該当
期間でサンプリングして所定のサンプリングコン
デンサ６５−１〜６５−４に蓄積させるサンプリ
ング信号であり、この蓄積された各サンプリング
コンデンサ６５−１〜６５−４のサンプリングデ
ータは制御信号T1〜T4によつて選択的に開閉さ
れるアナログスイツチ６２−１〜６２−４を介し
てホールドコンデンサ６６へ出力される。本回路
のその他動作過程は前例で述べたものと同一であ
り、前例に比べて少ない回路素子数で全く同一の
出力波形が得られるため、回路構成上有利であ
る。
である。本回路は第５図と同様１列分の駆動回路
について描いたものであり、前列における６組の
サンプリング回路のうち、時間的に見て共通使用
が可能なものについて共用できる様に結線し、サ
ンプリング回路を４組に減らしたものである。ア
ナログスイツチ６１−１，６１−２は制御信号
S1iによつて開閉され、アナログスイツチ６１−
３は制御信号S1iとS2iのアンドゲートを介してま
たアナログスイツチ61−４は制御信号S1iとS3iの
アンドゲートを介してそれぞれ開閉される。制御
信号S1i，S2i，S3iはそれぞれ映像信号を1Hの該当
期間でサンプリングして所定のサンプリングコン
デンサ６５−１〜６５−４に蓄積させるサンプリ
ング信号であり、この蓄積された各サンプリング
コンデンサ６５−１〜６５−４のサンプリングデ
ータは制御信号T1〜T4によつて選択的に開閉さ
れるアナログスイツチ６２−１〜６２−４を介し
てホールドコンデンサ６６へ出力される。本回路
のその他動作過程は前例で述べたものと同一であ
り、前例に比べて少ない回路素子数で全く同一の
出力波形が得られるため、回路構成上有利であ
る。
また、本発明の列電極ドライバでは、第５図
ｂ、第６図ｂに示した様に出力Xiのタイミング
が水平同期信号を基準に見た場合に奇数フイール
ドと偶数フイールドで１走査分ずれる。したがつ
て走査パルスのタイミングもフイールド毎に１走
査分ずれるように制御する必要がある。これは例
えば第７図に示したような回路構成により、行電
極ドライバ１２に加える走査開始パルスＰのタイ
ミングをフイールド毎に変えることにより容易に
達成することができる。即ち、走査開始パルスＰ
を第１図で説明した如くクロツクφ1で順次シフ
トさせることにより走査パルス信号が形成される
が、この際奇数フイールドと偶数フイールドを区
別するフイールド弁別信号ｏ／ｅによつて走査開
始パルスＰをフイールド毎にフリツプフロツプ７
３等を介して一走査分ずらせる。図において７
１，７２，７３はフリツプフロツプである。
ｂ、第６図ｂに示した様に出力Xiのタイミング
が水平同期信号を基準に見た場合に奇数フイール
ドと偶数フイールドで１走査分ずれる。したがつ
て走査パルスのタイミングもフイールド毎に１走
査分ずれるように制御する必要がある。これは例
えば第７図に示したような回路構成により、行電
極ドライバ１２に加える走査開始パルスＰのタイ
ミングをフイールド毎に変えることにより容易に
達成することができる。即ち、走査開始パルスＰ
を第１図で説明した如くクロツクφ1で順次シフ
トさせることにより走査パルス信号が形成される
が、この際奇数フイールドと偶数フイールドを区
別するフイールド弁別信号ｏ／ｅによつて走査開
始パルスＰをフイールド毎にフリツプフロツプ７
３等を介して一走査分ずらせる。図において７
１，７２，７３はフリツプフロツプである。
〈発明の効果〉
以上の如く本発明は、通常のテレビと同一の走
査線数の画像表示をフレームメモリを用いること
なく、マトリツクス型液晶表示により行なうこと
ができる有効な駆動回路であり、液晶表示を用い
たテレビ画像表示装置を駆動する上で極めて有益
である。
査線数の画像表示をフレームメモリを用いること
なく、マトリツクス型液晶表示により行なうこと
ができる有効な駆動回路であり、液晶表示を用い
たテレビ画像表示装置を駆動する上で極めて有益
である。
第１図はスイツチングトランジスタを付加した
マトリツクス型液晶表示装置の駆動回路のブロツ
ク図および主な信号の波形図である。第２図は従
来の列電極ドライバの１列分の駆動回路の１例お
よび波形図である。第３図は本発明の基本原理を
示す波形図であり、第４図は本発明の駆動回路の
列電極ドライバの回路構成を示す概念図である。
第５図ａおよび第６図ａは本発明の駆動回路の列
電極ドライバの１列分の回路図、第５図ｂおよび
第６図ｂは同じく波形図である。第７図ａは本発
明の信号制御回路のうちの走査開始パルス発生部
の１例を示す回路図、第７図ｂは同じく波形図で
ある。 １１……マトリツクス型液晶パネル、１２……
行電極ドライバ、１３……信号制御回路、１４…
…列電極ドライバ、２１〜２４，５１〜５４，６
１〜６４……アナログスイツチ、２５，２６，５
５，５６，６５，６６……コンデンサ、２７，５
７，６７……絶縁ゲート型トランジスタ。
マトリツクス型液晶表示装置の駆動回路のブロツ
ク図および主な信号の波形図である。第２図は従
来の列電極ドライバの１列分の駆動回路の１例お
よび波形図である。第３図は本発明の基本原理を
示す波形図であり、第４図は本発明の駆動回路の
列電極ドライバの回路構成を示す概念図である。
第５図ａおよび第６図ａは本発明の駆動回路の列
電極ドライバの１列分の回路図、第５図ｂおよび
第６図ｂは同じく波形図である。第７図ａは本発
明の信号制御回路のうちの走査開始パルス発生部
の１例を示す回路図、第７図ｂは同じく波形図で
ある。 １１……マトリツクス型液晶パネル、１２……
行電極ドライバ、１３……信号制御回路、１４…
…列電極ドライバ、２１〜２４，５１〜５４，６
１〜６４……アナログスイツチ、２５，２６，５
５，５６，６５，６６……コンデンサ、２７，５
７，６７……絶縁ゲート型トランジスタ。
Claims (1)
- １ スイツチング素子をマトリツクス状に配列さ
れた絵素の各々に付加して成り、走査線を順次飛
び越し走査しながらデータ線に映像信号を供給し
て線順次方式の表示を実行する液晶表示装置の駆
動回路において、前記データ線には少なくとも２
本の走査線の走査期間で供給される映像信号を各
走査期間で複数のコンデンサに蓄積する２組のコ
ンデンサ群が付加され、奇数（偶数）番目の走査
線を走査する奇数（偶数）フイールドでは奇数
（偶数）番目の各走査線の走査期間でその走査線
の映像信号が蓄積されている前記コンデンサ群の
中の一方の組の一方のコンデンサを選定して該コ
ンデンサの映像信号を前記データ線に供給しかつ
偶数（奇数）番目の各走査線の走査飛び越し期間
ではその走査線の一本前の走査線の映像信号が蓄
積されている前記コンデンサ群の中の一方の組の
他方のコンデンサと一本後の走査線の映像信号が
蓄積されている前記コンデンサ群の中の他方の組
の一方のコンデンサとを並列接続して得られる２
つの映像信号の平均値を前記データ線に供給する
ことを特徴とする液晶表示装置の駆動回路。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59113744A JPS60257683A (ja) | 1984-06-01 | 1984-06-01 | 液晶表示装置の駆動回路 |
| US06/739,849 US4694349A (en) | 1984-06-01 | 1985-05-31 | Liquid crystal matrix display panel driver circuit |
| GB08513780A GB2159657B (en) | 1984-06-01 | 1985-05-31 | Liquid crystal displays |
| DE3519793A DE3519793C2 (de) | 1984-06-01 | 1985-06-03 | Treiberschaltung für matrixförmige Flüssigkristall-Anzeigen |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59113744A JPS60257683A (ja) | 1984-06-01 | 1984-06-01 | 液晶表示装置の駆動回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60257683A JPS60257683A (ja) | 1985-12-19 |
| JPH0362357B2 true JPH0362357B2 (ja) | 1991-09-25 |
Family
ID=14620022
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59113744A Granted JPS60257683A (ja) | 1984-06-01 | 1984-06-01 | 液晶表示装置の駆動回路 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US4694349A (ja) |
| JP (1) | JPS60257683A (ja) |
| DE (1) | DE3519793C2 (ja) |
| GB (1) | GB2159657B (ja) |
Families Citing this family (25)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE3720353A1 (de) * | 1987-06-19 | 1989-01-05 | Online Tech Datenuebertragungs | Verfahren und schaltungsanordnung zur ansteuerung einer bildwiedergabeeinrichtung |
| US4870396A (en) * | 1987-08-27 | 1989-09-26 | Hughes Aircraft Company | AC activated liquid crystal display cell employing dual switching devices |
| ATE201788T1 (de) * | 1987-11-12 | 2001-06-15 | Canon Kk | Flüssigkristallgerät |
| DE3856497T2 (de) * | 1987-12-29 | 2002-05-23 | Sharp K.K., Osaka | Halbbild-Diskriminierschaltung für Fernsehsignal, z.B. für Flüssigkristallanzeige |
| EP0355693B1 (en) * | 1988-08-17 | 1995-04-12 | Canon Kabushiki Kaisha | Display apparatus |
| JPH02157813A (ja) * | 1988-12-12 | 1990-06-18 | Sharp Corp | 液晶表示パネル |
| US5111195A (en) * | 1989-01-31 | 1992-05-05 | Sharp Kabushiki Kaisha | Driving circuit for a matrix type display device |
| EP0382567B1 (en) * | 1989-02-10 | 1996-05-29 | Sharp Kabushiki Kaisha | Liquid crystal display device and driving method therefor |
| EP0441661B1 (en) * | 1990-02-09 | 1996-01-10 | Sharp Kabushiki Kaisha | A driving method and a driving device for a display device |
| FR2667188A1 (fr) * | 1990-09-21 | 1992-03-27 | Senn Patrice | Circuit echantillonneur-bloqueur pour ecran d'affichage a cristal liquide. |
| FR2667187A1 (fr) * | 1990-09-21 | 1992-03-27 | Senn Patrice | Circuit de commande, notamment pour ecran d'affichage a cristal liquide, a sortie protegee. |
| JP2719224B2 (ja) * | 1990-09-28 | 1998-02-25 | シャープ株式会社 | 表示装置の駆動回路 |
| EP0515191B1 (en) * | 1991-05-21 | 1998-08-26 | Sharp Kabushiki Kaisha | A display apparatus, a drive circuit for a display apparatus, and a method of driving a display apparatus |
| DE4129459A1 (de) * | 1991-09-05 | 1993-03-11 | Thomson Brandt Gmbh | Verfahren und vorrichtung zur ansteuerung von matrixdisplays |
| JP2639763B2 (ja) * | 1991-10-08 | 1997-08-13 | 株式会社半導体エネルギー研究所 | 電気光学装置およびその表示方法 |
| CA2075441A1 (en) * | 1991-12-10 | 1993-06-11 | David D. Lee | Am tft lcd universal controller |
| US5257103A (en) * | 1992-02-05 | 1993-10-26 | Nview Corporation | Method and apparatus for deinterlacing video inputs |
| JP2618156B2 (ja) * | 1992-06-08 | 1997-06-11 | インターナショナル・ビジネス・マシーンズ・コーポレイション | ドット・マトリックス表示パネルの駆動方法、ドット・マトリックス表示パネル用駆動回路、ドット・マトリックス表示装置、及び、ドット・マトリックス表示装置を備えた情報処理システム |
| JPH06274133A (ja) * | 1993-03-24 | 1994-09-30 | Sharp Corp | 表示装置の駆動回路及び表示装置 |
| US5381182A (en) * | 1993-09-28 | 1995-01-10 | Honeywell Inc. | Flat panel image reconstruction interface for producing a non-interlaced video signal |
| JPH07210116A (ja) * | 1993-12-28 | 1995-08-11 | Internatl Business Mach Corp <Ibm> | 液晶駆動装置及び液晶駆動方法 |
| JP3275991B2 (ja) * | 1994-07-27 | 2002-04-22 | シャープ株式会社 | アクティブマトリクス型表示装置及びその駆動方法 |
| JPH08115060A (ja) * | 1994-10-14 | 1996-05-07 | Sharp Corp | 表示装置の駆動回路及び液晶表示装置 |
| JPH09101763A (ja) * | 1995-10-05 | 1997-04-15 | Sharp Corp | 画像表示装置の駆動回路 |
| JP3349638B2 (ja) * | 1996-11-15 | 2002-11-25 | シャープ株式会社 | 表示装置を駆動する方法および回路 |
Family Cites Families (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5368514A (en) * | 1976-11-30 | 1978-06-19 | Matsushita Electric Ind Co Ltd | Driving system for matrix panel |
| JPS558157A (en) * | 1978-07-04 | 1980-01-21 | Seiko Epson Corp | Display unit |
| JPS57201295A (en) * | 1981-06-04 | 1982-12-09 | Sony Corp | Two-dimensional address device |
| JPS57204592A (en) * | 1981-06-11 | 1982-12-15 | Sony Corp | Two-dimensional address device |
| US4400719A (en) * | 1981-09-08 | 1983-08-23 | Rca Corporation | Television display system with reduced line-scan artifacts |
| JPS5879378A (ja) * | 1981-11-05 | 1983-05-13 | Sony Corp | テレビジヨン受像機 |
| FR2524679B1 (fr) * | 1982-04-01 | 1990-07-06 | Suwa Seikosha Kk | Procede d'attaque d'un panneau d'affichage a cristaux liquides a matrice active |
| GB2118346B (en) * | 1982-04-01 | 1985-07-24 | Standard Telephones Cables Ltd | Scanning liquid crystal display cells |
| JPS5937775A (ja) * | 1982-08-25 | 1984-03-01 | Sony Corp | 倍走査テレビジヨン受像機 |
-
1984
- 1984-06-01 JP JP59113744A patent/JPS60257683A/ja active Granted
-
1985
- 1985-05-31 US US06/739,849 patent/US4694349A/en not_active Expired - Lifetime
- 1985-05-31 GB GB08513780A patent/GB2159657B/en not_active Expired
- 1985-06-03 DE DE3519793A patent/DE3519793C2/de not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| DE3519793C2 (de) | 1987-05-07 |
| US4694349A (en) | 1987-09-15 |
| GB8513780D0 (en) | 1985-07-03 |
| JPS60257683A (ja) | 1985-12-19 |
| DE3519793A1 (de) | 1985-12-05 |
| GB2159657A (en) | 1985-12-04 |
| GB2159657B (en) | 1987-12-31 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |