JPH0370935B2 - - Google Patents
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- JPH0370935B2 JPH0370935B2 JP58196774A JP19677483A JPH0370935B2 JP H0370935 B2 JPH0370935 B2 JP H0370935B2 JP 58196774 A JP58196774 A JP 58196774A JP 19677483 A JP19677483 A JP 19677483A JP H0370935 B2 JPH0370935 B2 JP H0370935B2
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- Japan
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- transistor
- transistors
- collector
- output
- base
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-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K3/00—Circuits for generating electric pulses; Monostable, bistable or multistable circuits
- H03K3/02—Generators characterised by the type of circuit or by the means used for producing pulses
- H03K3/26—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback
- H03K3/28—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback using means other than a transformer for feedback
- H03K3/281—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback using means other than a transformer for feedback using at least two transistors so coupled that the input of one is derived from the output of another, e.g. multivibrator
- H03K3/286—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback using means other than a transformer for feedback using at least two transistors so coupled that the input of one is derived from the output of another, e.g. multivibrator bistable
- H03K3/288—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback using means other than a transformer for feedback using at least two transistors so coupled that the input of one is derived from the output of another, e.g. multivibrator bistable using additional transistors in the input circuit
- H03K3/2885—Generators characterised by the type of circuit or by the means used for producing pulses by the use, as active elements, of bipolar transistors with internal or external positive feedback using means other than a transformer for feedback using at least two transistors so coupled that the input of one is derived from the output of another, e.g. multivibrator bistable using additional transistors in the input circuit the input circuit having a differential configuration
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
Description
【発明の詳細な説明】
本発明は、入力信号の周波数を1/2倍の周波数
の信号に変換する分周回路に関する。
の信号に変換する分周回路に関する。
この種の分周回路の内、ECL（エミツタ・カツ
プルド・ロジツク）マスター・スレーブ型の分周
回路は、第１図に示す回路構成であつた。
プルド・ロジツク）マスター・スレーブ型の分周
回路は、第１図に示す回路構成であつた。
この回路は、正相入力端子１と逆相入力端子２
に印加する２相クロツク信号に応じて、トランジ
スタ３と４、トランジスタ５と６を差動的にオ
ン・オフさせるものである。そして、トランジス
タ３と４がオフでトランジスタ５と６がオンの時
に、トランジスタ９〜１２をオフさせて不動作に
すると共に、トランジスタ７，８，１３，１４を
オン或いはオフにさせ、またトランジスタ５と６
がオフでトランジスタ３と４がオンの時に、トラ
ンジスタ７，８，１３，１４をオフさせて不動作
にすると共に、トランジスタ９〜１２をオン或い
はオフにさせる。そして、トランジスタ１３と１
４はトランジスタ７と８に制御され、トランジス
タ９と１０はトランジスタ１１と１２に制御され
るようにしている。また、トランジスタ９と１０
はトランジスタ７と８にそのオン・オフ状態を１
クロツク遅れて伝達し、トランジスタ１３と１４
はそのオン・オフ状態をトランジスタ１１と１２
に１クロツク遅れて伝達する。このようにして、
出力端子１５，１６に入力端子１，２に印加する
信号の1/2の周波数の信号を出力させるにしたも
のである。
に印加する２相クロツク信号に応じて、トランジ
スタ３と４、トランジスタ５と６を差動的にオ
ン・オフさせるものである。そして、トランジス
タ３と４がオフでトランジスタ５と６がオンの時
に、トランジスタ９〜１２をオフさせて不動作に
すると共に、トランジスタ７，８，１３，１４を
オン或いはオフにさせ、またトランジスタ５と６
がオフでトランジスタ３と４がオンの時に、トラ
ンジスタ７，８，１３，１４をオフさせて不動作
にすると共に、トランジスタ９〜１２をオン或い
はオフにさせる。そして、トランジスタ１３と１
４はトランジスタ７と８に制御され、トランジス
タ９と１０はトランジスタ１１と１２に制御され
るようにしている。また、トランジスタ９と１０
はトランジスタ７と８にそのオン・オフ状態を１
クロツク遅れて伝達し、トランジスタ１３と１４
はそのオン・オフ状態をトランジスタ１１と１２
に１クロツク遅れて伝達する。このようにして、
出力端子１５，１６に入力端子１，２に印加する
信号の1/2の周波数の信号を出力させるにしたも
のである。
ところが、この回路は、４個の負荷抵抗１７〜
２０が必要であり、トランジスタも合計で12個も
必要で、非常に素子数が多く、また定電流源を符
号２１，２２で示すように２個必要としている。
更に、この回路は電源端子２３と接地間に、負荷
抵抗に直列接続される素子はトランジスタ２個と
定電流源であり、その定電流源が１個のトランジ
スタで成るとしても、最低３個のトランジスタが
直列に接続されることになり、出力振幅を大きく
とることができない。
２０が必要であり、トランジスタも合計で12個も
必要で、非常に素子数が多く、また定電流源を符
号２１，２２で示すように２個必要としている。
更に、この回路は電源端子２３と接地間に、負荷
抵抗に直列接続される素子はトランジスタ２個と
定電流源であり、その定電流源が１個のトランジ
スタで成るとしても、最低３個のトランジスタが
直列に接続されることになり、出力振幅を大きく
とることができない。
本発明は斯かる点に鑑みて成されたもので、そ
の目的は、素子数を少なくし、定電流源も１個で
済み、出力振幅も大きくすることができるように
した分周回路を提供することである。
の目的は、素子数を少なくし、定電流源も１個で
済み、出力振幅も大きくすることができるように
した分周回路を提供することである。
以下、本発明の実施例について説明する。第２
図はその一実施例の分周回路を示すもので、３１
は２個のコレクタＣ１，Ｃ２を有し、正相入力端
子１からの信号をベースに入力するPNP型のト
ランジスタ、３２も２個のコレクタＣ１，Ｃ２を
有し、逆相入力端子２からの信号をベースに入力
するPNP型のトランジスタで、これらトランジ
スタ３１と３２はそのエミツタが定電流源３３に
共通接続されている。
図はその一実施例の分周回路を示すもので、３１
は２個のコレクタＣ１，Ｃ２を有し、正相入力端
子１からの信号をベースに入力するPNP型のト
ランジスタ、３２も２個のコレクタＣ１，Ｃ２を
有し、逆相入力端子２からの信号をベースに入力
するPNP型のトランジスタで、これらトランジ
スタ３１と３２はそのエミツタが定電流源３３に
共通接続されている。
３４，３５は３個のコレクタＣ１〜Ｃ３を各々
有するNPN型のトランジスタで、上記トランジ
スタ３１のコレクタからの出力をベースに受けて
フリツプ・フロツプ動作するよう接続されてい
る。即ちこのトランジスタ３４，３５はトランジ
スタ３１がオフの時にはオフとなり、トランジス
タ３１がオンすると、いずれか一方のみがオンす
るようにコレクタＣ１と相手トランジスタのベー
スがクロス接続されたフリツプ・フロツプ構成と
なつている。
有するNPN型のトランジスタで、上記トランジ
スタ３１のコレクタからの出力をベースに受けて
フリツプ・フロツプ動作するよう接続されてい
る。即ちこのトランジスタ３４，３５はトランジ
スタ３１がオフの時にはオフとなり、トランジス
タ３１がオンすると、いずれか一方のみがオンす
るようにコレクタＣ１と相手トランジスタのベー
スがクロス接続されたフリツプ・フロツプ構成と
なつている。
３６，３７も３個のコレクタＣ１〜Ｃ３を各々
有するNPN型のトランジスタで、上記トランジ
スタ３２のコレクタからの出力をベースに受けて
フリツプ・フロツプ動作するよう接続されてい
る。即ちこのトランジスタ３６，３７はトランジ
スタ３２がオフの時にはオフとなり、トランジス
タ３２がオンすると、いずれか一方のみがオンす
るようにコレクタＣ１と相手トランジスタのベー
スがクロス接続されたフリツプ・フロツプ構成と
なつている。
有するNPN型のトランジスタで、上記トランジ
スタ３２のコレクタからの出力をベースに受けて
フリツプ・フロツプ動作するよう接続されてい
る。即ちこのトランジスタ３６，３７はトランジ
スタ３２がオフの時にはオフとなり、トランジス
タ３２がオンすると、いずれか一方のみがオンす
るようにコレクタＣ１と相手トランジスタのベー
スがクロス接続されたフリツプ・フロツプ構成と
なつている。
そして、トランジスタ３４はそのオン・オフ状
態を次のクロツク到来時にそのコレクタＣ３から
トランジスタ３７に反転して伝達し、このトラン
ジスタ３７はそのオン・オフ状態を次のクロツク
到来時にそのコレクタＣ３からトランジスタ３５
に反転して伝達し、このトランジスタ３５はその
オン・オフ状態を次のクロツク到来時にそのコレ
クタＣ３からトランジスタ３６に反転して伝達
し、このトランジスタ３６はそのオン・オフ状態
を次のクロツク到来時に反転してそのコレクタＣ
３からトランジスタ３４に伝達するように、各々
のコレクタＣ３からベースに接続されている。
態を次のクロツク到来時にそのコレクタＣ３から
トランジスタ３７に反転して伝達し、このトラン
ジスタ３７はそのオン・オフ状態を次のクロツク
到来時にそのコレクタＣ３からトランジスタ３５
に反転して伝達し、このトランジスタ３５はその
オン・オフ状態を次のクロツク到来時にそのコレ
クタＣ３からトランジスタ３６に反転して伝達
し、このトランジスタ３６はそのオン・オフ状態
を次のクロツク到来時に反転してそのコレクタＣ
３からトランジスタ３４に伝達するように、各々
のコレクタＣ３からベースに接続されている。
各トランジスタ３４〜３７のコレクタＣ２は出
力用で、トランジスタ３５と３６のコレクタＣ２
が正相出力端子１５に接続され、またトランジス
タ３４と３７のコレクタＣ２が逆相出力端子１６
に接続されている。
力用で、トランジスタ３５と３６のコレクタＣ２
が正相出力端子１５に接続され、またトランジス
タ３４と３７のコレクタＣ２が逆相出力端子１６
に接続されている。
即ち、正相出力端子１５は、トランジスタ３５
と３６の両コレクタＣ２のアンド出力を受け、ま
た逆相出力端子１６はトランジスタ３４と３７の
両コレクタＣ２のアンド出力を受けるよう接続さ
れている。３８，３９は負荷抵抗である。
と３６の両コレクタＣ２のアンド出力を受け、ま
た逆相出力端子１６はトランジスタ３４と３７の
両コレクタＣ２のアンド出力を受けるよう接続さ
れている。３８，３９は負荷抵抗である。
以上において、正相入力端子１がＬレベル、逆
相入力端子２がＨレベルとなると、トランジスタ
３１がオン、トランジスタ３２がオフする。この
時、トランジスタ３６，３７はオフする。また、
ここで、トランジスタ３１のコレクタ出力を受け
て、トランジスタ３４がオン、トランジスタ３５
がオフしたとする。（第３図） 次に正相入力端子１がＨレベル、逆相入力端子
２がＬベレルに変わると、トランジスタ３１がオ
フ、トランジスタ３２がオンするので、トランジ
スタ３４，３５はオフする。また、トランジスタ
３５がオフ→オフと変わらないので、切り替わり
時点でもそのトランジスタ３５のコレクタＣ３に
はトランジスタ３２のコレクタＣ２からの電流は
流れず、トランジスタ３６のベースに流れる。一
方、トランジスタ３４はオン→オフと変化するの
で、その変化完了前に、そのトランジスタ３４の
コレクタＣ３にはトランジスタ３２のコレクタＣ
１からの電流が瞬時流れ、よつてトランジスタ３
７のベースに流れる電流はトランジスタ３６のベ
ースに流れる電流より少ない。よつてトランジス
タ３６と３７のベース電流に差が生じ、トランジ
スタ３６が最初にオンし始め、次にトランジスタ
３７がオンし始める。しかし、トランジスタ３６
がより深くオンすると、そのコレクタＣ１の電位
が下がるので、トランジスタ３２のコレクタＣ１
からの電流がトランジスタ３６のコレクタＣ１に
流れ、トランジスタ３７のベースには流れなくな
る。従つて、そのトランジスタ３７はオフする。
即ち、トランジスタ３６がオン、トランジスタ３
７がオフの状態となる。（第３図） 次に正相入力端子１がＬレベル、逆相入力端子
２がＨレベルに変わると、トランジスタ３２がオ
フ、トランジスタ３１がオンとなる。よつてトラ
ンジスタ３６，３７はオフとなる。この時、トラ
ンジスタ３７はオフ→オフと変わらないので、そ
のコレクタＣ３の出力を受けるトランジスタ３５
がオン、またトランジスタ３６はオン→オフと変
わるので、そのコレクタＣ３の出力を受けるトラ
ンジスタ３４はオフとなる。（第３図） 次に正相入力端子１がＨレベル、逆相入力端子
２がＬレベルに変わると、トランジスタ３１がオ
フ、トランジスタ３２がオンとなる。よつてトラ
ンジスタ３４，３５はオフとなる。この時、トラ
ンジスタ３４はオフ→オフと変わらないので、そ
のコレクタＣ３の出力を受けるトランジスタ３７
がオン、またトランジスタ３６はオン→オフと変
わるので、そのコレクタＣ３の出力を受けるトラ
ンジスタ３６はオフとなる。（第３図） 次に正相入力端子１がＬレベル、逆相入力端子
２がＨレベルに変わると、トランジスタ３２がオ
フ、トランジスタ３１がオンとなる。よつてトラ
ンジスタ３６，３７はオフとなる。この時、トラ
ンジスタ３６はオフ→オフと変わらないので、そ
のコレクタＣ３の出力を受けるトランジスタ３４
がオン、またトランジスタ３７はオン→オフと変
わるので、そのコレクタＣ３の出力を受けるトラ
ンジスタ３５はオフとなる。（第３図） 以下、同様に各トランジスタがオン・オフを繰
り返し、第３図，，，…のように進む。
相入力端子２がＨレベルとなると、トランジスタ
３１がオン、トランジスタ３２がオフする。この
時、トランジスタ３６，３７はオフする。また、
ここで、トランジスタ３１のコレクタ出力を受け
て、トランジスタ３４がオン、トランジスタ３５
がオフしたとする。（第３図） 次に正相入力端子１がＨレベル、逆相入力端子
２がＬベレルに変わると、トランジスタ３１がオ
フ、トランジスタ３２がオンするので、トランジ
スタ３４，３５はオフする。また、トランジスタ
３５がオフ→オフと変わらないので、切り替わり
時点でもそのトランジスタ３５のコレクタＣ３に
はトランジスタ３２のコレクタＣ２からの電流は
流れず、トランジスタ３６のベースに流れる。一
方、トランジスタ３４はオン→オフと変化するの
で、その変化完了前に、そのトランジスタ３４の
コレクタＣ３にはトランジスタ３２のコレクタＣ
１からの電流が瞬時流れ、よつてトランジスタ３
７のベースに流れる電流はトランジスタ３６のベ
ースに流れる電流より少ない。よつてトランジス
タ３６と３７のベース電流に差が生じ、トランジ
スタ３６が最初にオンし始め、次にトランジスタ
３７がオンし始める。しかし、トランジスタ３６
がより深くオンすると、そのコレクタＣ１の電位
が下がるので、トランジスタ３２のコレクタＣ１
からの電流がトランジスタ３６のコレクタＣ１に
流れ、トランジスタ３７のベースには流れなくな
る。従つて、そのトランジスタ３７はオフする。
即ち、トランジスタ３６がオン、トランジスタ３
７がオフの状態となる。（第３図） 次に正相入力端子１がＬレベル、逆相入力端子
２がＨレベルに変わると、トランジスタ３２がオ
フ、トランジスタ３１がオンとなる。よつてトラ
ンジスタ３６，３７はオフとなる。この時、トラ
ンジスタ３７はオフ→オフと変わらないので、そ
のコレクタＣ３の出力を受けるトランジスタ３５
がオン、またトランジスタ３６はオン→オフと変
わるので、そのコレクタＣ３の出力を受けるトラ
ンジスタ３４はオフとなる。（第３図） 次に正相入力端子１がＨレベル、逆相入力端子
２がＬレベルに変わると、トランジスタ３１がオ
フ、トランジスタ３２がオンとなる。よつてトラ
ンジスタ３４，３５はオフとなる。この時、トラ
ンジスタ３４はオフ→オフと変わらないので、そ
のコレクタＣ３の出力を受けるトランジスタ３７
がオン、またトランジスタ３６はオン→オフと変
わるので、そのコレクタＣ３の出力を受けるトラ
ンジスタ３６はオフとなる。（第３図） 次に正相入力端子１がＬレベル、逆相入力端子
２がＨレベルに変わると、トランジスタ３２がオ
フ、トランジスタ３１がオンとなる。よつてトラ
ンジスタ３６，３７はオフとなる。この時、トラ
ンジスタ３６はオフ→オフと変わらないので、そ
のコレクタＣ３の出力を受けるトランジスタ３４
がオン、またトランジスタ３７はオン→オフと変
わるので、そのコレクタＣ３の出力を受けるトラ
ンジスタ３５はオフとなる。（第３図） 以下、同様に各トランジスタがオン・オフを繰
り返し、第３図，，，…のように進む。
正相出力端子１５はトランジスタ３５，３６の
コレクタＣ２の電位をアンド・ゲート的に受けて
いるので、その両トランジスタ３５，３６がオフ
の時Ｈレベル、いずれもオン或いはいずれかオン
の時にはＬレベルとなる。また、逆相出力端子１
６はトランジスタ３４，３７のコレクタＣ３の電
位をアンド・ゲート的に受けているので、その両
トランジスタ３４，３７がオフの時にＨレベル、
いずれもオン或いはいずれかオンの時にはＬレベ
ルとなる。
コレクタＣ２の電位をアンド・ゲート的に受けて
いるので、その両トランジスタ３５，３６がオフ
の時Ｈレベル、いずれもオン或いはいずれかオン
の時にはＬレベルとなる。また、逆相出力端子１
６はトランジスタ３４，３７のコレクタＣ３の電
位をアンド・ゲート的に受けているので、その両
トランジスタ３４，３７がオフの時にＨレベル、
いずれもオン或いはいずれかオンの時にはＬレベ
ルとなる。
従つて、正相出力端子１５及び逆相出力端子１
６には、正相入力端子１及び逆相入力端子２に入
力するコロツクと同一の１／２デユーテイ比で２
倍のパルス幅を持つクロツク、即ち1/2の周波数
のクロツクが出力する。
６には、正相入力端子１及び逆相入力端子２に入
力するコロツクと同一の１／２デユーテイ比で２
倍のパルス幅を持つクロツク、即ち1/2の周波数
のクロツクが出力する。
また、この回路は、電源端子２３と接地間に
は、負荷抵抗に直列接続されるトランジスタは１
個であるので、出力振幅を大きくとることができ
る。
は、負荷抵抗に直列接続されるトランジスタは１
個であるので、出力振幅を大きくとることができ
る。
なお、上記した実施例において、２個のコレク
タを有するトランジスタ３１，３２は１個のコレ
クタのものを使用し、このコレクタにダイオード
を接続してコレクタ出力を分けることができる。
また３個のコレクタを有するトランジスタについ
ても同様である。
タを有するトランジスタ３１，３２は１個のコレ
クタのものを使用し、このコレクタにダイオード
を接続してコレクタ出力を分けることができる。
また３個のコレクタを有するトランジスタについ
ても同様である。
以上のように、本発明の分周回路によれば、最
低限必要な素子として、トランジスタは６個、定
電流源は１個、負荷抵抗は２個と極めて少ない素
子で済ませることができる。また、出力振幅を大
きくすることもできる。
低限必要な素子として、トランジスタは６個、定
電流源は１個、負荷抵抗は２個と極めて少ない素
子で済ませることができる。また、出力振幅を大
きくすることもできる。
第１図は従来の分周回路の回路図、第２図は本
発明の一実施例の分周回路の回路図、第３図は第
２図の回路のタイミング・チヤートである。 １……正相入力端子、２……逆相入力端子、１
５……正相出力端子、１６……逆相出力端子、３
１，３２，３４〜３７……トランジスタ、３３…
…定電流源、３８，３９……負荷抵抗。
発明の一実施例の分周回路の回路図、第３図は第
２図の回路のタイミング・チヤートである。 １……正相入力端子、２……逆相入力端子、１
５……正相出力端子、１６……逆相出力端子、３
１，３２，３４〜３７……トランジスタ、３３…
…定電流源、３８，３９……負荷抵抗。
Claims (1)
- 【特許請求の範囲】 １ 各々３個のコレクタ出力部を有し、その第１
のコレクタ出力部が相手のトランジスタのベース
にクロス接続され、エミツタが共通接地された第
１及び第２のトランジスタと、 各々３個のコレクタ出力部を有し、その第１の
コレクタ出力部が相手のトランジスタのベースに
クロス接続され、エミツタが共通接地された第３
及び第４のトランジスタと、 ２個のコレクタ出力部を有し、ベースに正相入
力端子が接続され、該各コレクタ出力部の出力を
上記第１及び第２のトランジスタのベースに各別
に供給する第５のトランジスタと、 ２個のコレクタ出力部を有し、ベースに逆相入
力端子が接続され、該各コレクタ出力部の出力を
上記第３及び第４のトランジスタのベースに各別
に供給し、エミツタが上記第５のトランジスタの
エミツタと共通に定電流源に接続された第６のト
ランジスタとを具備し、 上記第１及び第４のトランジスタの第２のコレ
クタ出力部が共通に正相出力端子及び第１の負荷
抵抗に接続され、 上記第２及び第３のトランジスタの第２のコレ
クタ出力部が共通に逆相出力端子及び第２の負荷
抵抗に接続され、 上記第１のトランジスタの第３のコレクタ出力
部が上記第４のトランジスタのベースに接続さ
れ、上記第２のトランジスタの第３のコレクタ出
力部が上記第３のトランジスタのベースに接続さ
れ、上記第３のトランジスタの第３のコレクタ出
力部が上記第１のトランジスタのベースに接続さ
れ、上記第４のトランジスタの第３のコレクタ出
力部が上記第２のトランジスタのベースに接続さ
れて成ることを特徴とする分周回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58196774A JPS6089128A (ja) | 1983-10-20 | 1983-10-20 | 分周回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58196774A JPS6089128A (ja) | 1983-10-20 | 1983-10-20 | 分周回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6089128A JPS6089128A (ja) | 1985-05-20 |
| JPH0370935B2 true JPH0370935B2 (ja) | 1991-11-11 |
Family
ID=16363403
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58196774A Granted JPS6089128A (ja) | 1983-10-20 | 1983-10-20 | 分周回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6089128A (ja) |
-
1983
- 1983-10-20 JP JP58196774A patent/JPS6089128A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6089128A (ja) | 1985-05-20 |
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