JPH0371626A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPH0371626A JPH0371626A JP20813989A JP20813989A JPH0371626A JP H0371626 A JPH0371626 A JP H0371626A JP 20813989 A JP20813989 A JP 20813989A JP 20813989 A JP20813989 A JP 20813989A JP H0371626 A JPH0371626 A JP H0371626A
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Landscapes
- Electrodes Of Semiconductors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(イ)産業上の利用分野
本発明は半導体装置の製造方法に関し、特に小口径、高
段差のコンタクトの電気的特性の改善を図った半導体装
置の製造方法に関する。
段差のコンタクトの電気的特性の改善を図った半導体装
置の製造方法に関する。
(0)従来の技術
半導体装置の集積度の向上に伴って、その内部の素子を
接続するコンタクト孔は小口径、高段差となってきてお
り、AIスパッタによる単純なコンタクト方式ではその
段差部におけるAl膜厚の低下に起因するコンタクト抵
抗の上昇、さらには段差部におけるAI配線の断線が避
けられなくなっている。このため、AI配線に先だって
コンタクト孔にポリシリコンを埋め込んでステップカバ
レッジを改善するコンタクト方式が提案されている。
接続するコンタクト孔は小口径、高段差となってきてお
り、AIスパッタによる単純なコンタクト方式ではその
段差部におけるAl膜厚の低下に起因するコンタクト抵
抗の上昇、さらには段差部におけるAI配線の断線が避
けられなくなっている。このため、AI配線に先だって
コンタクト孔にポリシリコンを埋め込んでステップカバ
レッジを改善するコンタクト方式が提案されている。
以下、第2図を参照して従来のポリシリコン埋め込みコ
ンタクトの製造工程を説明する。
ンタクトの製造工程を説明する。
今日、最も一般的な絶縁膜構造は第2図(1)に示され
るような、減圧気相成長装置により3000人厚のSi
n、膜(23)、この上面に常圧気相成長装置により形
成される8 000A厚のBPSG(ボロン・ホスホラ
ス・シリケート・グラス以下、BPSGと称する) (
24)の2層構造であって、このような2層構造の絶縁
膜に形成されるポリシリコン埋め込みコンタクトの製造
工程は概略以下のようなものである。なお、工程番号と
図面番号は対応している。
るような、減圧気相成長装置により3000人厚のSi
n、膜(23)、この上面に常圧気相成長装置により形
成される8 000A厚のBPSG(ボロン・ホスホラ
ス・シリケート・グラス以下、BPSGと称する) (
24)の2層構造であって、このような2層構造の絶縁
膜に形成されるポリシリコン埋め込みコンタクトの製造
工程は概略以下のようなものである。なお、工程番号と
図面番号は対応している。
1、コンタクトエッチ
ホトリソグラフィと酸化膜エツチングにより、ウェハ(
21)に予め形成されたコンタクト領域(22)の上面
に0.8μmX0.8μm、深さ1.ll1mのコンタ
クト孔(26)をあける。
21)に予め形成されたコンタクト領域(22)の上面
に0.8μmX0.8μm、深さ1.ll1mのコンタ
クト孔(26)をあける。
2、ポリシリコンデポジション
減圧気相成長装置により12000A厚のポリシリコン
層(27)を成長させる。
層(27)を成長させる。
3、ポリシリコンエッチバック
ケミカルドライエツチングによりポリシリコン層(27
)の等方性エツチングを行い、コンタクト孔(26)内
部のポリシリコン層(27)のみを残すようにポリシリ
コン(27)は図示するようにエッチバックされる。
)の等方性エツチングを行い、コンタクト孔(26)内
部のポリシリコン層(27)のみを残すようにポリシリ
コン(27)は図示するようにエッチバックされる。
ポリシリコン層(27〉に”りん”イオンのイオン注入
を行った後、窒素ガス雰囲気中において9゜0℃、30
m i n、 )7=−ルを行い、コンタクト領域(
22)と同一導電型、がっ高導電率とする。
を行った後、窒素ガス雰囲気中において9゜0℃、30
m i n、 )7=−ルを行い、コンタクト領域(
22)と同一導電型、がっ高導電率とする。
5、AIスパッタ
AIスパッタ装置により、0.8μm厚のAI(アルミ
ニウム)Ill(28)を形成する。
ニウム)Ill(28)を形成する。
6、Alエッチ
ホトリソグラフィとAIエツチングにより、アルミ配線
領域(28)を残す。この後、低温熱処理を行い、アル
ミニウムとシリコンとの接触性を良好なものとする。
領域(28)を残す。この後、低温熱処理を行い、アル
ミニウムとシリコンとの接触性を良好なものとする。
上記したポリシリコン埋め込みコンタクトはステノブカ
バレッジが良好であるため、イオン注入およびアニール
が適正に行われれば電気的特性が極めて良好なコンタク
トが得られる筈である。然るに、これまで設5fされた
コンタクト性能、即ちコンタクト抵抗およびオーム性が
得られることは少なく、その原因も不明であった。
バレッジが良好であるため、イオン注入およびアニール
が適正に行われれば電気的特性が極めて良好なコンタク
トが得られる筈である。然るに、これまで設5fされた
コンタクト性能、即ちコンタクト抵抗およびオーム性が
得られることは少なく、その原因も不明であった。
発明者等がこの点につき研究を行った結果、前記プロセ
ス4のアニール時にBPSG(24)からポリシリコン
層(27)に逆導電型の不純物、ボロンが拡敵すること
によりコンペンセートされてポリシリコン層(27)の
導電率が低下すること、また第3図に図示するように、
工程4によりイオン注入されたイオンがその後の熱処理
によりアウトディフュージョンしてアルミ配線領域(2
8)とポリシリコン層(27)の界面の不純物濃度が低
下するここにより、異種導体接触によるバリアが形成さ
れること等が解明された。
ス4のアニール時にBPSG(24)からポリシリコン
層(27)に逆導電型の不純物、ボロンが拡敵すること
によりコンペンセートされてポリシリコン層(27)の
導電率が低下すること、また第3図に図示するように、
工程4によりイオン注入されたイオンがその後の熱処理
によりアウトディフュージョンしてアルミ配線領域(2
8)とポリシリコン層(27)の界面の不純物濃度が低
下するここにより、異種導体接触によるバリアが形成さ
れること等が解明された。
(・・)発明が解決しようとする課題
本発明は従来技術に存する課題の上記した原因の解明に
基づくものであって、小口径、高段差のコンタクトの電
気的特性、即ち電気抵抗、安定性およびオーム性の改善
を図った半導体装置の製造方法を提供することを目的と
する。
基づくものであって、小口径、高段差のコンタクトの電
気的特性、即ち電気抵抗、安定性およびオーム性の改善
を図った半導体装置の製造方法を提供することを目的と
する。
(ニ)課題を解決するための手段
本発明は、コンタクト孔側壁部を含むウェハの一面に5
13N 4膜を成長させる工程、コンタクト孔側壁部の
Si、N1膜のみを残す異方性エツチングする工程、ウ
ェハの一面にポリシリコン層を形成し、このポリシリコ
ンによりコンタクト孔を埋める工程、コンタクト孔内の
ポリシリコンのみを残すポリシリコン層の等方性エツチ
ングする工程、コンタクト孔内のポリシリコンに不純物
をイオン注入する工程、アウトディフュージョン防止膜
形成後イオン注入領域のアニールを行う工程、アウトデ
ィフュージョン防止膜除去後AI膜を形成する工程、A
I膜およびバリアメタル膜エッチにより、アルミ配線領
域を残す、一連の工程からなる。
13N 4膜を成長させる工程、コンタクト孔側壁部の
Si、N1膜のみを残す異方性エツチングする工程、ウ
ェハの一面にポリシリコン層を形成し、このポリシリコ
ンによりコンタクト孔を埋める工程、コンタクト孔内の
ポリシリコンのみを残すポリシリコン層の等方性エツチ
ングする工程、コンタクト孔内のポリシリコンに不純物
をイオン注入する工程、アウトディフュージョン防止膜
形成後イオン注入領域のアニールを行う工程、アウトデ
ィフュージョン防止膜除去後AI膜を形成する工程、A
I膜およびバリアメタル膜エッチにより、アルミ配線領
域を残す、一連の工程からなる。
(0作用
コンタクトホール側壁部をSi、N、膜で被覆するプロ
セスは、BPSGから埋め込みポリシリコン層への逆導
電型の不純物の拡故によるポリシリコン層の不純物コン
ベンセーションを防止する。
セスは、BPSGから埋め込みポリシリコン層への逆導
電型の不純物の拡故によるポリシリコン層の不純物コン
ベンセーションを防止する。
また、アウトディフュージョン防止膜形成後イオン注入
領域のアニールを行うプロセスは、注入されたイオンの
アウトディフュージョンを防止し、埋め込みポリシリコ
ン層の導電率の低下およびその界面のバリアの形成を防
止する。
領域のアニールを行うプロセスは、注入されたイオンの
アウトディフュージョンを防止し、埋め込みポリシリコ
ン層の導電率の低下およびその界面のバリアの形成を防
止する。
(へ)実施例
以下、製造工程を説明する第1図を参照して本発明の詳
細な説明する。なお、工程番号と図面番号は対応してい
る。
細な説明する。なお、工程番号と図面番号は対応してい
る。
本実施例は以下のIOのプロセスよりなる。ただし、以
下の説明で使用する数値は何れも代表的な値であって、
本発明の技術範囲を限定するものではない。
下の説明で使用する数値は何れも代表的な値であって、
本発明の技術範囲を限定するものではない。
1、コンタクト孔エッチ
ウェハ(1)全面に減圧気相成長装置により形成した3
000000A厚n、膜(3)、このSin。
000000A厚n、膜(3)、このSin。
膜(3)上面に常圧気相成長装置により形成した800
0000A厚P S G (4)からなる絶縁膜にホト
リソグラフィと酸化膜エツチングを使用して0゜8μm
X0.8μm、深さ1.1μmのコンタクト孔(6)を
あける。なお、領域(2)はコンタクトのために格別に
形成された高濃度のコンタクト領域である。
0000A厚P S G (4)からなる絶縁膜にホト
リソグラフィと酸化膜エツチングを使用して0゜8μm
X0.8μm、深さ1.1μmのコンタクト孔(6)を
あける。なお、領域(2)はコンタクトのために格別に
形成された高濃度のコンタクト領域である。
2.SisN4膜デポジシヨン
減圧気相成長装置によりコンタクト孔(6)の側壁部を
含むウェハ(1)の全面に500A厚のSilN、膜(
7)を成長させる。
含むウェハ(1)の全面に500A厚のSilN、膜(
7)を成長させる。
3、 S l 3N(膜エッチ
リアクティブイオンエッチ等のドライエツチングにより
異方性エツチングを行い、コンタクト孔(6)の側壁部
のSi、N、膜のみを残す。
異方性エツチングを行い、コンタクト孔(6)の側壁部
のSi、N、膜のみを残す。
4、ポリシリコンデポジション
減圧気相成長装置により12000人厚のポリンリコン
層(8)を成長させる。
層(8)を成長させる。
5、ポリシリコンエッチバック
ケミカルドライエツチングによりポリシリコン層(8)
の等方性エツチングを行い、コンタクト孔(6)内のポ
リシリコン(8)のみを残す。このとき、Si O!膜
(5)が表面に現れるようにポリシリコン(8)はエッ
チバックされる。
の等方性エツチングを行い、コンタクト孔(6)内のポ
リシリコン(8)のみを残す。このとき、Si O!膜
(5)が表面に現れるようにポリシリコン(8)はエッ
チバックされる。
6、イオン注入
加速電界80keV、ドーズ量lXl0”イオン/ c
m ”の条件にて、ポリシリコン層(8)に”りん1
イオンを打ち込む。
m ”の条件にて、ポリシリコン層(8)に”りん1
イオンを打ち込む。
7、アウトディフュージョン防止膜形戊減圧気相成長成
長装置によって、500A厚のSi、N、膜(9)を成
長させる。この後、窒素ガス雰囲気中において、900
℃、30m1n、のアニールを行って、イオン注入され
たポリシリコン層(8)をコンタクト領域(2)と同一
導電型かつ高導電率とする。さらに、アニール後Si、
N、膜(9)を除去する。
長装置によって、500A厚のSi、N、膜(9)を成
長させる。この後、窒素ガス雰囲気中において、900
℃、30m1n、のアニールを行って、イオン注入され
たポリシリコン層(8)をコンタクト領域(2)と同一
導電型かつ高導電率とする。さらに、アニール後Si、
N、膜(9)を除去する。
8、AIスパッタ
AIスパッタ装置により、0.8μm厚のAI(アルミ
ニウム)膜(11)を形成する。
ニウム)膜(11)を形成する。
9、AIエッチ
ホトリソグラフィとAIエツチングにより、アルミ配線
領域(11)を残す。この後、低温熱処理を行ってアル
ミニウムとシリコンとの接触性を良好なものとする。
領域(11)を残す。この後、低温熱処理を行ってアル
ミニウムとシリコンとの接触性を良好なものとする。
(ト)発明の効果
以上述べたように本発明によれば、コンタクト几側壁の
SilN、膜により、BPSGからの不純物拡散および
アニール時の横方向拡散が防止されてポリシリコン埋め
込み層の導電率の低下が防止される。
SilN、膜により、BPSGからの不純物拡散および
アニール時の横方向拡散が防止されてポリシリコン埋め
込み層の導電率の低下が防止される。
また、アウトディフュージョン防止膜によりアニール時
の不純物のアウトディフュージョンが防止されて、アル
ミ配線領域と埋め込みポリシリコン層の界面のショット
キーバリアの形成および導電率の低下が防止される。
の不純物のアウトディフュージョンが防止されて、アル
ミ配線領域と埋め込みポリシリコン層の界面のショット
キーバリアの形成および導電率の低下が防止される。
第1図は本発明の詳細な説明する製造工程フローを示す
断面図、 第2図は従来技術を説明する製造工程フローを示す断面
図、 第3図はアニールによる界面不純物濃度の低下を説明す
る図である。 1・・・ウェハ 2・・・コンタク ト領域、 3・・・S O2膜、 ・・・ B SG、 6・・・コンタク ト 孔、 7. 9・・・S 3 N (膜、 1 ・・・A (アルミ ニウム)
断面図、 第2図は従来技術を説明する製造工程フローを示す断面
図、 第3図はアニールによる界面不純物濃度の低下を説明す
る図である。 1・・・ウェハ 2・・・コンタク ト領域、 3・・・S O2膜、 ・・・ B SG、 6・・・コンタク ト 孔、 7. 9・・・S 3 N (膜、 1 ・・・A (アルミ ニウム)
Claims (2)
- (1)コンタクト孔内面を含むウェハの一面にSi_3
N_4膜を成長させる工程、 コンタクト孔側壁部のSi_3N_4膜のみを残す異方
性エッチングする工程、 ウェハの一面にポリシリコン層を形成し、このポリシリ
コンによりコンタクト孔を埋める工程、コンタクト孔内
のポリシリコン層のみを残すポリシリコン層の等方性エ
ッチングする工程、コンタクト孔内のポリシリコン層に
不純物をイオン注入する工程、 アウトディフュージョン防止膜形成後、イオン注入領域
のアニールを行う工程、 前記アウトディフュージョン防止膜除去後、Al膜を形
成する工程、 Al膜エッチにより、アルミ配線領域を残す工程とを具
備することを特徴とする半導体装置の製造方法。 - (2)前記アウトディフュージョン防止膜がSi_3N
_4により形成されることを特徴とする請求項1記載の
半導体装置の製造方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1208139A JPH0722140B2 (ja) | 1989-08-10 | 1989-08-10 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1208139A JPH0722140B2 (ja) | 1989-08-10 | 1989-08-10 | 半導体装置の製造方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0371626A true JPH0371626A (ja) | 1991-03-27 |
| JPH0722140B2 JPH0722140B2 (ja) | 1995-03-08 |
Family
ID=16551284
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1208139A Expired - Fee Related JPH0722140B2 (ja) | 1989-08-10 | 1989-08-10 | 半導体装置の製造方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0722140B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
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| CN115172265A (zh) * | 2022-06-23 | 2022-10-11 | 上海华虹宏力半导体制造有限公司 | 改善bpsg对接触电阻影响的方法 |
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-
1989
- 1989-08-10 JP JP1208139A patent/JPH0722140B2/ja not_active Expired - Fee Related
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Also Published As
| Publication number | Publication date |
|---|---|
| JPH0722140B2 (ja) | 1995-03-08 |
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