JPH04196760A - 画像読み取り処理装置 - Google Patents
画像読み取り処理装置Info
- Publication number
- JPH04196760A JPH04196760A JP2328719A JP32871990A JPH04196760A JP H04196760 A JPH04196760 A JP H04196760A JP 2328719 A JP2328719 A JP 2328719A JP 32871990 A JP32871990 A JP 32871990A JP H04196760 A JPH04196760 A JP H04196760A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は光電変換素子に画像を投影し その光電変換素
子からの画像情報をデジタル信号に変換して２値化もし
くは多値化する画像読み取り処理装置に関するものであ
る。
子からの画像情報をデジタル信号に変換して２値化もし
くは多値化する画像読み取り処理装置に関するものであ
る。
従来の技術
近蝦 画像読み取り処理装置は原稿の画像情報を忠実に
すなわち高精度、高階調な読み取りが可能な処理技術が
要求されている。
すなわち高精度、高階調な読み取りが可能な処理技術が
要求されている。
以下図面を参照しなか教 上記した従来の画像読み取り
処理装置の一例について説明する。
処理装置の一例について説明する。
第３図は従来の画像読み取り処理装置のブロック図を示
すものであも 第３図において、 １００は光電変換素
子からのアナログ画像信号入力端子で、 １０１はアナ
ログデジタル変換器（Ａ／Ｄ変換器）で、 １０２はデ
ータセレクタで、 １０３．１０４はメモリである。
１０５、１０６はデジタルアナログ変換器（Ｄ／Ａ変換
器）、 １０７はＡ／Ｄ変換器で、 １０８はデジタル
画像信号出力端子である。以上のように構成された画像
読み取り処理装置について、以下その動作について説明
すも まず、標準白原稿を読み取ったアナログ画像信号が端子
１００からＡ／Ｄ変換器１０１に入力され その電圧値
に応じたデジタル出力がデータセレクタ１０２によりメ
モリ１０３に人力され記憶される。次に標準黒原稿を読
み取り、先と同様にアナログ画像信号が端子１００から
Ａ／Ｄ変換器１０１に人力され その電圧値に応じたデ
ジタル比力がデータセレクタ１０２によりメモリ１０４
に入力され記憶される。次に実際の原稿を読み取る際
各光電変換素子の標準白のデジタル値をメモリ１０３よ
りＤ／Ａ変換器１０５に入力し それに対応するアナロ
グ値をＡ／Ｄ変換器１０７の上限基準電圧端子に印加す
る。また同様に標準黒のデジタル値をメモリ１０４より
Ｄ／Ａ変換器１０６に入カレ それに対応するアナログ
値をＡ／Ｄ変換器１０７の下限基準電圧端子に印加して
、各光電変換素子の白シェーディング・黒シェーデイン
グの補正を行うものである。 （特開昭６０−８１９７
７号公報） 発明が解決しようとする課題 しかしながら上記の様な構成では白眉と黒用にメモリと
Ｄ／Ａ変換器が２系統必要で回路規模が増大するという
問題点を有してい九 本発明は上記問題に鑑へ 回路規模の増大のない回路構
成で白補正・黒補正を行う画像読み取り処理装置を提供
するものである。
すものであも 第３図において、 １００は光電変換素
子からのアナログ画像信号入力端子で、 １０１はアナ
ログデジタル変換器（Ａ／Ｄ変換器）で、 １０２はデ
ータセレクタで、 １０３．１０４はメモリである。
１０５、１０６はデジタルアナログ変換器（Ｄ／Ａ変換
器）、 １０７はＡ／Ｄ変換器で、 １０８はデジタル
画像信号出力端子である。以上のように構成された画像
読み取り処理装置について、以下その動作について説明
すも まず、標準白原稿を読み取ったアナログ画像信号が端子
１００からＡ／Ｄ変換器１０１に入力され その電圧値
に応じたデジタル出力がデータセレクタ１０２によりメ
モリ１０３に人力され記憶される。次に標準黒原稿を読
み取り、先と同様にアナログ画像信号が端子１００から
Ａ／Ｄ変換器１０１に人力され その電圧値に応じたデ
ジタル比力がデータセレクタ１０２によりメモリ１０４
に入力され記憶される。次に実際の原稿を読み取る際
各光電変換素子の標準白のデジタル値をメモリ１０３よ
りＤ／Ａ変換器１０５に入力し それに対応するアナロ
グ値をＡ／Ｄ変換器１０７の上限基準電圧端子に印加す
る。また同様に標準黒のデジタル値をメモリ１０４より
Ｄ／Ａ変換器１０６に入カレ それに対応するアナログ
値をＡ／Ｄ変換器１０７の下限基準電圧端子に印加して
、各光電変換素子の白シェーディング・黒シェーデイン
グの補正を行うものである。 （特開昭６０−８１９７
７号公報） 発明が解決しようとする課題 しかしながら上記の様な構成では白眉と黒用にメモリと
Ｄ／Ａ変換器が２系統必要で回路規模が増大するという
問題点を有してい九 本発明は上記問題に鑑へ 回路規模の増大のない回路構
成で白補正・黒補正を行う画像読み取り処理装置を提供
するものである。
課題を解決するための手段
上記問題点を解決するために本発明の画像読み取り処理
装置は 光電変換素子からの画像情報をデジタル信号に
変換するＡ／Ｄ変換器と、標準の白を読んだ時の光電変
換素子からの画像情報へ前記Ａ／Ｄ変換器からのデジタ
ル信号および黒を読んだ時の光電変換素子からの画像情
報へ 前記Ａ／Ｄ変換器からのデジタル信号を記憶する
第１の記憶手段と、前記第１の記憶手段からのデジタル
信号をアナログ信号に変換するＤ／Ａ変換器と、前記Ｄ
／Ａ変換器からのアナログ信号を記憶する第２の記憶手
段とを備え 前記第１の記憶手段からの黒情報を光電変
換素子からの画像情報から差し引く構成を備えたもので
ある。
装置は 光電変換素子からの画像情報をデジタル信号に
変換するＡ／Ｄ変換器と、標準の白を読んだ時の光電変
換素子からの画像情報へ前記Ａ／Ｄ変換器からのデジタ
ル信号および黒を読んだ時の光電変換素子からの画像情
報へ 前記Ａ／Ｄ変換器からのデジタル信号を記憶する
第１の記憶手段と、前記第１の記憶手段からのデジタル
信号をアナログ信号に変換するＤ／Ａ変換器と、前記Ｄ
／Ａ変換器からのアナログ信号を記憶する第２の記憶手
段とを備え 前記第１の記憶手段からの黒情報を光電変
換素子からの画像情報から差し引く構成を備えたもので
ある。
作用
本発明は上記した構成によって、白眉・黒用のメモリ・
Ｄ／Ａ変換器がそれぞれ１系統で済み回路規模が削減で
きる。
Ｄ／Ａ変換器がそれぞれ１系統で済み回路規模が削減で
きる。
実施例
以下本発明の１実施例の画像読み取り処理装置について
、図面を参照しながら説明する。
、図面を参照しながら説明する。
第１図は本発明の実施例における画像読み取り処理装置
のブロック図を示すものである。第１図において、 ｌ
は光電変換素子からのアナログ画像信号入力端子、 ２
はＡ／Ｄ変換縁 ３．４はそれぞれＡ／Ｄ変換器２の下
限基準電圧端子、上限基準電圧端子であも ５はメモリ
（第１の記憶手段）、６はＤ／Ａ変換器 ７はデジタ
ル画像信号出力端子であも ９、１０は切り換えスイッ
チ、 １１．１２、１３はスイッチ、 １４はコンデン
サであム以上のように構成された画像読み取り処理装置
について、以下第１＠ 及び第２図を用いてその動作を
説明すも まず第２図は第１図を動作別に示したブロッ
ク図であも 第２図（ａ）は切り換えスイッチ９をｂに接続し スイ
ッチ１２をオンにした状態を示す。この状態で標準黒を
読み取りＡ／Ｄ変換器２によりデジタル化された画像情
報をメモリ５のたとえば奇数番地に記憶すム 第２図（ｂ）は切り換えスイッチ９、１０をそれぞれす
、 ａに接続し スイッチ１３をオンにした状態を示
す。この状態でメモリ５の奇数番地から１ビツト目の画
素の標準黒の画像情報を出力しＤ／Ａ変換器６によりア
ナログ電圧（オフセット電圧と呼ぶ）を出力する。その
後スイッチ１１．１２をいったんオンにしてこの電圧を
コンデンサ１４に伝達したのち再びオフにする。アナロ
グ画像信号入力端子に標準白信号が印加するとＡ／Ｄ変
換器２にはオフセット電圧分が差し引かれた電比 即ち
真の標準白信号電圧が印加される。この真の標準白信号
電圧のデジタル値をメモリ５のたとえば偶数番地に記憶
する。
のブロック図を示すものである。第１図において、 ｌ
は光電変換素子からのアナログ画像信号入力端子、 ２
はＡ／Ｄ変換縁 ３．４はそれぞれＡ／Ｄ変換器２の下
限基準電圧端子、上限基準電圧端子であも ５はメモリ
（第１の記憶手段）、６はＤ／Ａ変換器 ７はデジタ
ル画像信号出力端子であも ９、１０は切り換えスイッ
チ、 １１．１２、１３はスイッチ、 １４はコンデン
サであム以上のように構成された画像読み取り処理装置
について、以下第１＠ 及び第２図を用いてその動作を
説明すも まず第２図は第１図を動作別に示したブロッ
ク図であも 第２図（ａ）は切り換えスイッチ９をｂに接続し スイ
ッチ１２をオンにした状態を示す。この状態で標準黒を
読み取りＡ／Ｄ変換器２によりデジタル化された画像情
報をメモリ５のたとえば奇数番地に記憶すム 第２図（ｂ）は切り換えスイッチ９、１０をそれぞれす
、 ａに接続し スイッチ１３をオンにした状態を示
す。この状態でメモリ５の奇数番地から１ビツト目の画
素の標準黒の画像情報を出力しＤ／Ａ変換器６によりア
ナログ電圧（オフセット電圧と呼ぶ）を出力する。その
後スイッチ１１．１２をいったんオンにしてこの電圧を
コンデンサ１４に伝達したのち再びオフにする。アナロ
グ画像信号入力端子に標準白信号が印加するとＡ／Ｄ変
換器２にはオフセット電圧分が差し引かれた電比 即ち
真の標準白信号電圧が印加される。この真の標準白信号
電圧のデジタル値をメモリ５のたとえば偶数番地に記憶
する。
第２図中（ｃ）は切り換えスイッチ９、１０をそれぞれ
ａ、 ａに接続した状態を示す。この状態でメモリ５
の奇数番地から１ビツト目の画素の黒の画像情報を出力
Ｌ Ｄ／Ａ変換器６からオフセット電圧を出力する。
ａ、 ａに接続した状態を示す。この状態でメモリ５
の奇数番地から１ビツト目の画素の黒の画像情報を出力
Ｌ Ｄ／Ａ変換器６からオフセット電圧を出力する。
その後スイッチ１１、１２をいったんオンにしてオフセ
ット電圧をコンデンサ１４に伝達すム 第２図（ｄ）ｉｌ 切り換えスイッチ９．１０をそれ
ぞれａ、 ｂに接続した状態を示す。この状態でメモ
リ５の偶数番地から１ビツト目の画素の標準白の画像情
報を出力Ｌ Ｄ／Ａ変換器６からオフセット電圧を出
力Ｌ Ａ／Ｄ変換器２の上限基準電圧端子４に印加す
４ この状態で１ビツト目の画素からアナログの画像読
み取り信号が人力されると白シェーディング補正・オフ
セット電圧補正された高精度・高階調なデジタル画像情
報がデジタル画像信号出力端子７に出力されも この動
作を１画素の時間内に実行する。即ち第２図（ｃ）の動
作でオフセット電圧をコンデンサ１４に伝達し 第２図
（ｄ）の動作で標準白電圧をＡ／Ｄ変換器の上限基準電
圧端子に印加した後、画素からアナログの画像読み取り
信号を入力して白シェーディング補正・オフセット補正
すも この動作を光電変換素子画素数分各画素に対応し
て行う。
ット電圧をコンデンサ１４に伝達すム 第２図（ｄ）ｉｌ 切り換えスイッチ９．１０をそれ
ぞれａ、 ｂに接続した状態を示す。この状態でメモ
リ５の偶数番地から１ビツト目の画素の標準白の画像情
報を出力Ｌ Ｄ／Ａ変換器６からオフセット電圧を出
力Ｌ Ａ／Ｄ変換器２の上限基準電圧端子４に印加す
４ この状態で１ビツト目の画素からアナログの画像読
み取り信号が人力されると白シェーディング補正・オフ
セット電圧補正された高精度・高階調なデジタル画像情
報がデジタル画像信号出力端子７に出力されも この動
作を１画素の時間内に実行する。即ち第２図（ｃ）の動
作でオフセット電圧をコンデンサ１４に伝達し 第２図
（ｄ）の動作で標準白電圧をＡ／Ｄ変換器の上限基準電
圧端子に印加した後、画素からアナログの画像読み取り
信号を入力して白シェーディング補正・オフセット補正
すも この動作を光電変換素子画素数分各画素に対応し
て行う。
以上のように本実施例によれば １系統のメモリ・Ｄ／
Ａ変換器で高精度・高階調デジタル画像情報が得られ原
稿に忠実な読み取りが可能になる。
Ａ変換器で高精度・高階調デジタル画像情報が得られ原
稿に忠実な読み取りが可能になる。
発明の効果
以上のように本発明は光電変換素子からの画像情報をデ
ジタル信号に変換するＡ／Ｄ変換器と、標準の白を読ん
だ時の光電変換素子からの画像情報へ Ａ／Ｄ変換器か
らのデジタル信号および黒を読んだ時の光電変換素子か
らの画像情報へ Ａ／Ｄ変換器からのデジタル信号を記
憶する第１の記憶手段と、第１の記憶手段からのデジタ
ル信号をアナログ信号に変換するデジタルＤ／Ａ変換器
と、Ｄ／Ａ変換器からのアナログ信号を記憶する第２の
記憶手段とをｉＭＬ 第１の記憶手段からの黒情報を
光電変換素子からの画像情報から差し引く構成にしたこ
とにより、小規模の回路構成で高精度・高階調なデジタ
ル画像情報が得られ原稿に忠実な読み取りが可能になも
ジタル信号に変換するＡ／Ｄ変換器と、標準の白を読ん
だ時の光電変換素子からの画像情報へ Ａ／Ｄ変換器か
らのデジタル信号および黒を読んだ時の光電変換素子か
らの画像情報へ Ａ／Ｄ変換器からのデジタル信号を記
憶する第１の記憶手段と、第１の記憶手段からのデジタ
ル信号をアナログ信号に変換するデジタルＤ／Ａ変換器
と、Ｄ／Ａ変換器からのアナログ信号を記憶する第２の
記憶手段とをｉＭＬ 第１の記憶手段からの黒情報を
光電変換素子からの画像情報から差し引く構成にしたこ
とにより、小規模の回路構成で高精度・高階調なデジタ
ル画像情報が得られ原稿に忠実な読み取りが可能になも
第１図は本発明の実施例における画像読み取り処理装置
のブロック図 第２図は第１図を動作別に説明するため
のブロック図 第３図は従来の画像読み取り処理装置の
ブロック図である。 １・・・アナログ画像信号入力端子、 ２・・・Ａ／Ｄ変換器 ３・・・Ａ／Ｄ変換器の下限基準電圧端子、４・・・Ａ
／Ｄ変換器の上限基準電圧端子、５・・・メモリ （第
１の記憶手段）、６・・・Ｄ／Ａ変換器 ７・・・デジタル画像信号出力端子、 ９、１０・・・切り換えスイッチ、 １１、１２、１３・・・スイッチ、 １４・・・コンデンサ。 代理人の氏名 弁理士 小鍜治 明 はか２名 ／−一一アナログ几像范号入力＠壬 ５−一−メモリ ９、／θ −−一 ｔＯり才史久スイ・Ｙラヒｎ 、
１２ 、１３ −・−ス／１．テ／４−−コンテソサ 第１図 １に２［Ａ
のブロック図 第２図は第１図を動作別に説明するため
のブロック図 第３図は従来の画像読み取り処理装置の
ブロック図である。 １・・・アナログ画像信号入力端子、 ２・・・Ａ／Ｄ変換器 ３・・・Ａ／Ｄ変換器の下限基準電圧端子、４・・・Ａ
／Ｄ変換器の上限基準電圧端子、５・・・メモリ （第
１の記憶手段）、６・・・Ｄ／Ａ変換器 ７・・・デジタル画像信号出力端子、 ９、１０・・・切り換えスイッチ、 １１、１２、１３・・・スイッチ、 １４・・・コンデンサ。 代理人の氏名 弁理士 小鍜治 明 はか２名 ／−一一アナログ几像范号入力＠壬 ５−一−メモリ ９、／θ −−一 ｔＯり才史久スイ・Ｙラヒｎ 、
１２ 、１３ −・−ス／１．テ／４−−コンテソサ 第１図 １に２［Ａ
Claims (4)
- （１）複数の光電変換素子に画像を投影し、その光電変
換素子からの画像情報をデジタル信号に変換する画像読
み取り処理装置において、 光電変換素子からの画像情報をデジタル信号に変換する
Ａ／Ｄ変換器と、標準の白を読んだ時の光電変換素子か
らの画像情報の、前記Ａ／Ｄ変換器からのデジタル信号
および黒を読んだ時の光電変換素子からの画像情報の、
前記Ａ／Ｄ変換器からのデジタル信号を記憶する第１の
記憶手段と、前記第１の記憶手段からのデジタル信号を
アナログ信号に変換するＤ／Ａ変換器と、前記Ｄ／Ａ変
換器からのアナログ信号を記憶する第２の記憶手段とを
備え、前記第１の記憶手段からの黒情報を光電変換素子
からの画像情報から差し引く構成にしたことを特徴とす
る画像読み取り処理装置。 - （２）Ｄ／Ａ変換器からのアナログ信号を記憶する第２
の記憶手段として、コンデンサとスイッチで構成した記
憶器を備えたことを特徴とする請求項１記載の画像読み
取り処理装置。 - （３）標準の黒を読んだ時の光電変換素子からの画像情
報を黒とする請求項２記載の画像読み取り処理装置。 - （４）照明を消した時の光電変換素子からの画像情報を
黒とする請求項２記載の画像読み取り処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2328719A JPH04196760A (ja) | 1990-11-27 | 1990-11-27 | 画像読み取り処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2328719A JPH04196760A (ja) | 1990-11-27 | 1990-11-27 | 画像読み取り処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04196760A true JPH04196760A (ja) | 1992-07-16 |
Family
ID=18213420
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2328719A Pending JPH04196760A (ja) | 1990-11-27 | 1990-11-27 | 画像読み取り処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04196760A (ja) |
-
1990
- 1990-11-27 JP JP2328719A patent/JPH04196760A/ja active Pending
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