JPH04207670A - エッジ強調回路 - Google Patents
エッジ強調回路Info
- Publication number
- JPH04207670A JPH04207670A JP2337639A JP33763990A JPH04207670A JP H04207670 A JPH04207670 A JP H04207670A JP 2337639 A JP2337639 A JP 2337639A JP 33763990 A JP33763990 A JP 33763990A JP H04207670 A JPH04207670 A JP H04207670A
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- JP
- Japan
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- signal
- outputs
- correction section
- constant multiplier
- horizontal
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は、ＭＵＳＥ方式（ハイビジョン）を７ノンイン
ターレースのＮＴＳＣ方式に変換するコンバータにおい
て、ＭＵＳＥ信号を内挿しノンインターレースのＮＴＳ
Ｃ方式に変換した後のディジタ、ル輝度信号またはＭＵ
ＳＥ信号を内挿した後のディジタル輝度信号における水
平成分中および垂直成分中のエツジ部分を検出しその部
分を強調する所謂輪郭補正をディジタル信号処理して画
質向上を図るエツジ強調回路に関する。
ターレースのＮＴＳＣ方式に変換するコンバータにおい
て、ＭＵＳＥ信号を内挿しノンインターレースのＮＴＳ
Ｃ方式に変換した後のディジタ、ル輝度信号またはＭＵ
ＳＥ信号を内挿した後のディジタル輝度信号における水
平成分中および垂直成分中のエツジ部分を検出しその部
分を強調する所謂輪郭補正をディジタル信号処理して画
質向上を図るエツジ強調回路に関する。
従来、ＭＵＳＥ方式をＮＴＳＣ方式に変換するコンバー
タではＭＵＳＥ方式の鮮明な画像をＮＴＳＣ方式に変換
するので変換後も通常のＮＴＳＣ方式よりも帯域が広い
との理由から特に輪郭補正をする必要はないと考えられ
ていた。
タではＭＵＳＥ方式の鮮明な画像をＮＴＳＣ方式に変換
するので変換後も通常のＮＴＳＣ方式よりも帯域が広い
との理由から特に輪郭補正をする必要はないと考えられ
ていた。
しかしながら、前記コンバータで実際に画像を再現した
場合前記の如く帯域が広いにもかかわらず画像の鮮明不
足は否定しがたいという欠点を有していた。
場合前記の如く帯域が広いにもかかわらず画像の鮮明不
足は否定しがたいという欠点を有していた。
本発明は、上記欠点に鑑みディジタル輝度信号をディジ
タル信号処理により輪郭補正して画質の向上を図るエツ
ジ強調回路を提供することを目的とする。
タル信号処理により輪郭補正して画質の向上を図るエツ
ジ強調回路を提供することを目的とする。
本発明は、ＭＵＳＥ方式ディジタル信号をノンインター
レースのＮＴＳＣ方式ディジタル信号に変換するコンバ
ータにおいて、該ＭＵＳＥ方式ディジタル信号を内挿し
該ノンインターレースのＮＴＳＣ方式に変換した後のデ
ィジタル輝度信号または該ＭＵＳＥ方式ディジタル信号
を内挿した後のディジタル輝度信号における垂直成分中
のエツジ部分を検出し強調成分の出力と該ディジタル輝
度信号を１水平周期（１Ｈ）時間分遅延した水平エツジ
補正部に対する出力とをなす垂直エツジ補正部と、該垂
直エツジ補正部よりの輝度信号における水平成分中のエ
ツジ部分を検出し強調成分の出力と該垂直エツジ補正部
よりの輝度信号をクロック信号周期の２倍の時間（２Ｄ
）分遅延して第２の加算器に対する出力とをなす水平エ
ツジ補正部と、該垂直エツジ補正部よりの信号を遅延し
原輝度信号との位相を適性化する第１の遅延回路と、該
第１の遅延回路よりの信号と該水平エツジ補正部よりの
各強調成分とを加算する第１の加算器と、第１の加算器
よりの信号をノイズ軽減し利得調整して出力するコアリ
ング／利得調整部と、該コアリング／利得調整部よりの
信号と水平エツジ補正部よりの輝度信号とを加算して出
力する第２の加算器とで構成したエツジ強調回路を提供
するものである。
レースのＮＴＳＣ方式ディジタル信号に変換するコンバ
ータにおいて、該ＭＵＳＥ方式ディジタル信号を内挿し
該ノンインターレースのＮＴＳＣ方式に変換した後のデ
ィジタル輝度信号または該ＭＵＳＥ方式ディジタル信号
を内挿した後のディジタル輝度信号における垂直成分中
のエツジ部分を検出し強調成分の出力と該ディジタル輝
度信号を１水平周期（１Ｈ）時間分遅延した水平エツジ
補正部に対する出力とをなす垂直エツジ補正部と、該垂
直エツジ補正部よりの輝度信号における水平成分中のエ
ツジ部分を検出し強調成分の出力と該垂直エツジ補正部
よりの輝度信号をクロック信号周期の２倍の時間（２Ｄ
）分遅延して第２の加算器に対する出力とをなす水平エ
ツジ補正部と、該垂直エツジ補正部よりの信号を遅延し
原輝度信号との位相を適性化する第１の遅延回路と、該
第１の遅延回路よりの信号と該水平エツジ補正部よりの
各強調成分とを加算する第１の加算器と、第１の加算器
よりの信号をノイズ軽減し利得調整して出力するコアリ
ング／利得調整部と、該コアリング／利得調整部よりの
信号と水平エツジ補正部よりの輝度信号とを加算して出
力する第２の加算器とで構成したエツジ強調回路を提供
するものである。
水平エツジ補正部は前記輝度信号の水平成分中のエツジ
部分を検出しかつその部分の強調成分を出力し、垂直エ
ツジ補正部は該信号の垂直成分中のエツジ部分を検出し
かつその部分の強調成分を出力する。双方の該出力を加
算器にて加算しその出力をコアリングおよび利得調整し
て原輝度信号に加算する。尚、水平エツジ補正部および
垂直エツジ補正部は所謂２次微分作用をなすものである
。
部分を検出しかつその部分の強調成分を出力し、垂直エ
ツジ補正部は該信号の垂直成分中のエツジ部分を検出し
かつその部分の強調成分を出力する。双方の該出力を加
算器にて加算しその出力をコアリングおよび利得調整し
て原輝度信号に加算する。尚、水平エツジ補正部および
垂直エツジ補正部は所謂２次微分作用をなすものである
。
以下、図面に基づいて本発明によるエツジ強調回路を説
明する。第１図は本発明によるエツジ強調回路の一実施
例の要部ブロック図である。
明する。第１図は本発明によるエツジ強調回路の一実施
例の要部ブロック図である。
図において、１はＭＵＳＥ方式ディジタル信号を内挿し
ノンインターレースのＮＴＳ Ｃ方式に変換した後のデ
ィジタル輝度信号または該ＭＵＳＥ方式ディジタル信号
を内挿した後のディジタル輝度信号入力端子、２は該入
力端子Ｉよりのディジタル輝度信号における垂直成分中
のエツジ部分を検出し強調成分の出力と該ディジタル輝
度信号を１水平周期（１Ｈ）時間分遅延した水平エツジ
補正部に対する出力とをなす垂直エツジ補正部、３は該
垂直エツジ補正部２よりの輝度信号における水平成分中
のエツジ部分を検出し強調成分の出力と該垂直エツジ補
正部よりの輝度信号をクロック信号周期の２倍の時間（
２Ｄ）分遅延した第２の加算器に対する出力とをなす水
平エツジ補正部、４は該垂直エツジ補正部２よりの信号
を遅延し原輝度信号との位相を適性化する第１の遅延回
路、５は該第１の遅延回路４よりの信号と該水平エツジ
補正部３よりの各強調成分とを加算する第１の加算器、
６は第１の加算器５よりの信号をノイズ軽減し利得調整
して出力するコアリング／利得調整眼７は該コアリング
／利得調整部６よりの信号と水平エツジ補正部３よりの
輝度信号とを加算して出力する第２の加算器、８はエツ
ジ強調した信号の出力端子、９は該入力端子１よりのデ
ィジタル輝度信号を１水平周期（１Ｈ）時間分遅延して
出力する第２の遅延回路、１０は水平エツジ補正部３の
入力信号となす第２の遅延回路９よりの信号出力端子、
１１は該第２の遅延回路９よりの信号をさらに１Ｈ時間
分遅延して出力する第３の遅延回路、１２は該入力端子
１よりのディジタル輝度信号をマイナス１／４倍して出
力する第１の定数倍回路、１３は該第２の遅延回路９よ
りの信号をプラス１／２倍して出力する第２の定数倍回
路、１４は該第３の遅延回路１１よりの信号をマイナス
１／４倍して出力する第３の定数倍回路、１５は第１の
定数倍回路１２よりの出力信号と第２の定数倍回路１３
よりの出力信号と第３の定数倍回路工４よりの出力信号
とを加算して出力する第３の加算器、１昨よ該出力端子
１０よりの信号をクロック信号周期の２倍時間（２Ｄ）
分遅延して出力する第４の遅延回路、１７は第２の加算
器７の人力信号となす第４の遅延回路１６よりの信号出
力端子、１８は該第４の遅延回路よりの信号をさらに２
Ｄ時間分遅延して出力する第５の遅延回路、１９は該出
力端子１０よりの信号をマイナス１／４倍して出力する
第４の定数倍回路、２０は該第４の遅延回路よりの信号
をプラス１／２倍して出力する第５の定数倍回路、２１
は該第５の遅延回路よりの信号をマイナス１／４倍して
出力する第６の定数倍回路、２２は第４の定数倍回路１
９よりの出力信号と第５の定数倍回路２０よりの出力信
号と第６の定数倍回路２１よりの出力信号とを加算して
出力する第４の加算器である。
ノンインターレースのＮＴＳ Ｃ方式に変換した後のデ
ィジタル輝度信号または該ＭＵＳＥ方式ディジタル信号
を内挿した後のディジタル輝度信号入力端子、２は該入
力端子Ｉよりのディジタル輝度信号における垂直成分中
のエツジ部分を検出し強調成分の出力と該ディジタル輝
度信号を１水平周期（１Ｈ）時間分遅延した水平エツジ
補正部に対する出力とをなす垂直エツジ補正部、３は該
垂直エツジ補正部２よりの輝度信号における水平成分中
のエツジ部分を検出し強調成分の出力と該垂直エツジ補
正部よりの輝度信号をクロック信号周期の２倍の時間（
２Ｄ）分遅延した第２の加算器に対する出力とをなす水
平エツジ補正部、４は該垂直エツジ補正部２よりの信号
を遅延し原輝度信号との位相を適性化する第１の遅延回
路、５は該第１の遅延回路４よりの信号と該水平エツジ
補正部３よりの各強調成分とを加算する第１の加算器、
６は第１の加算器５よりの信号をノイズ軽減し利得調整
して出力するコアリング／利得調整眼７は該コアリング
／利得調整部６よりの信号と水平エツジ補正部３よりの
輝度信号とを加算して出力する第２の加算器、８はエツ
ジ強調した信号の出力端子、９は該入力端子１よりのデ
ィジタル輝度信号を１水平周期（１Ｈ）時間分遅延して
出力する第２の遅延回路、１０は水平エツジ補正部３の
入力信号となす第２の遅延回路９よりの信号出力端子、
１１は該第２の遅延回路９よりの信号をさらに１Ｈ時間
分遅延して出力する第３の遅延回路、１２は該入力端子
１よりのディジタル輝度信号をマイナス１／４倍して出
力する第１の定数倍回路、１３は該第２の遅延回路９よ
りの信号をプラス１／２倍して出力する第２の定数倍回
路、１４は該第３の遅延回路１１よりの信号をマイナス
１／４倍して出力する第３の定数倍回路、１５は第１の
定数倍回路１２よりの出力信号と第２の定数倍回路１３
よりの出力信号と第３の定数倍回路工４よりの出力信号
とを加算して出力する第３の加算器、１昨よ該出力端子
１０よりの信号をクロック信号周期の２倍時間（２Ｄ）
分遅延して出力する第４の遅延回路、１７は第２の加算
器７の人力信号となす第４の遅延回路１６よりの信号出
力端子、１８は該第４の遅延回路よりの信号をさらに２
Ｄ時間分遅延して出力する第５の遅延回路、１９は該出
力端子１０よりの信号をマイナス１／４倍して出力する
第４の定数倍回路、２０は該第４の遅延回路よりの信号
をプラス１／２倍して出力する第５の定数倍回路、２１
は該第５の遅延回路よりの信号をマイナス１／４倍して
出力する第６の定数倍回路、２２は第４の定数倍回路１
９よりの出力信号と第５の定数倍回路２０よりの出力信
号と第６の定数倍回路２１よりの出力信号とを加算して
出力する第４の加算器である。
次に、以上の構成に基づく水平エツジ強調のプロセスを
例に説明する。第２図（Ａ）は入力信号を矩形波とした
ときの第１図の水平エツジ補正部３に図示した各ポイン
ト（Ｈｌ乃至Ｈｌ）と信号、レベルとの相関を示した相
関図、第２図（Ｂ）は第２Ｉｋ （Ａ）の結果を波形的
に入力原信号とエツジ強調された信号との相関を図示し
た相関図である。
例に説明する。第２図（Ａ）は入力信号を矩形波とした
ときの第１図の水平エツジ補正部３に図示した各ポイン
ト（Ｈｌ乃至Ｈｌ）と信号、レベルとの相関を示した相
関図、第２図（Ｂ）は第２Ｉｋ （Ａ）の結果を波形的
に入力原信号とエツジ強調された信号との相関を図示し
た相関図である。
第２図（Ａ）においτ矩形波人力（ポイン） ）１１）
は１間隔をＩＤとする■乃至■の各時間的位置でレベル
が「０」から「Ａ」まで変化するものとする。またＨ２
は第４の遅延回路１６によりＨｌより２Ｄ遅延し、Ｈ３
は第５の遅延回路１８によりＨ２より２Ｄ遅延した信号
となる。従ってＨｌ、Ｈ２、Ｈ３は図示のようになる。
は１間隔をＩＤとする■乃至■の各時間的位置でレベル
が「０」から「Ａ」まで変化するものとする。またＨ２
は第４の遅延回路１６によりＨｌより２Ｄ遅延し、Ｈ３
は第５の遅延回路１８によりＨ２より２Ｄ遅延した信号
となる。従ってＨｌ、Ｈ２、Ｈ３は図示のようになる。
Ｈ２における信号は以下説明のエツジ強調成分が加算さ
れる原輝度信号でもある。Ｈ４、Ｈ５、Ｈ６は図示のと
うりＨｌ、 Ｈ２、Ｈ３に対しそれぞれの定数倍回路で
定数倍される。ここで各定数倍回路の各定数を前記の値
としたのは、輝度信号に変化がなくエツジ強調が不要な
部分ではＨｌの信号として「０」にするためと、二次微
分の離散形式を回路化すると該定数になるからである。
れる原輝度信号でもある。Ｈ４、Ｈ５、Ｈ６は図示のと
うりＨｌ、 Ｈ２、Ｈ３に対しそれぞれの定数倍回路で
定数倍される。ここで各定数倍回路の各定数を前記の値
としたのは、輝度信号に変化がなくエツジ強調が不要な
部分ではＨｌの信号として「０」にするためと、二次微
分の離散形式を回路化すると該定数になるからである。
この定数は垂直エツジ補正部２の第１の定数倍回路１２
乃至第３の定数倍回路１４においても同様である。この
結果Ｈ４、Ｈ５、Ｈ６は図示のようになりこれらを加算
するとＨｌに示す信号出力になる。第２図（Ｂ）にポイ
ントＨＬに対するＨ２、さ′らにエツジ強調成分（Ｈ７
）が第２の加算器７でＨ２の信号に加算された出力端子
８における信号出力（水平分のみ）を示す。該信号出力
波形に示すように矩形波のエツジ部が強調されている。
乃至第３の定数倍回路１４においても同様である。この
結果Ｈ４、Ｈ５、Ｈ６は図示のようになりこれらを加算
するとＨｌに示す信号出力になる。第２図（Ｂ）にポイ
ントＨＬに対するＨ２、さ′らにエツジ強調成分（Ｈ７
）が第２の加算器７でＨ２の信号に加算された出力端子
８における信号出力（水平分のみ）を示す。該信号出力
波形に示すように矩形波のエツジ部が強調されている。
垂直成分に対するエツジ強調作用も水平の場合と同様に
して行われるが原理は同じのため説明は省略する。出力
端子８の実際的信号出力は上記説明の水平成分に対する
エツジ強調に垂直成分に対するエツジ強調も含まれた出
力である。尚、コアリング／利得調整６における利得調
整の目的、は輪郭補正として視覚的な適性補正量を得る
ためである。
して行われるが原理は同じのため説明は省略する。出力
端子８の実際的信号出力は上記説明の水平成分に対する
エツジ強調に垂直成分に対するエツジ強調も含まれた出
力である。尚、コアリング／利得調整６における利得調
整の目的、は輪郭補正として視覚的な適性補正量を得る
ためである。
以上説明したように、本発明によれば、コンバータによ
りＭＵＳＥ方式をＮＴＳＣ一方式に変換した画像の鮮明
不足をディジタル信号処理により水平成分および垂直成
分双方の輪郭補正を行うことができ画質を向上させる効
果を奏し該コンバータ等における性能向上に寄与すると
ころが大きい。
りＭＵＳＥ方式をＮＴＳＣ一方式に変換した画像の鮮明
不足をディジタル信号処理により水平成分および垂直成
分双方の輪郭補正を行うことができ画質を向上させる効
果を奏し該コンバータ等における性能向上に寄与すると
ころが大きい。
第１図は本発明によるエツジ強調回路の一実施例の要部
ブロック図、第２図（Ａ）および第２０（Ｂ）は入力信
号と出力信号との相関を示す相関図である。 図中、ｌはディジタル輝度信号入力端子、２は垂直エツ
ジ補正部、３は水平エツジ補正部、４は第１の遅延回路
、５は第１の加算器、６はコアリング／利得調整部、７
は第２の加算器、８．１０．１７は出力端子、９は第２
の遅延回路、１１は第３の遅延回路、１２は第１の定数
倍回路、１３は第２の定数倍回路、１４は第３の定数倍
回路、１５は第３の加算器、１６は第４の遅延回路、１
８は第５の遅延回路、１９は第４の定数倍回路、２０は
第５の定数倍回路、２１は第６の定数倍回路、２２は第
４の加算器である。 特許出願人 株式会社富士通ゼネラル
ブロック図、第２図（Ａ）および第２０（Ｂ）は入力信
号と出力信号との相関を示す相関図である。 図中、ｌはディジタル輝度信号入力端子、２は垂直エツ
ジ補正部、３は水平エツジ補正部、４は第１の遅延回路
、５は第１の加算器、６はコアリング／利得調整部、７
は第２の加算器、８．１０．１７は出力端子、９は第２
の遅延回路、１１は第３の遅延回路、１２は第１の定数
倍回路、１３は第２の定数倍回路、１４は第３の定数倍
回路、１５は第３の加算器、１６は第４の遅延回路、１
８は第５の遅延回路、１９は第４の定数倍回路、２０は
第５の定数倍回路、２１は第６の定数倍回路、２２は第
４の加算器である。 特許出願人 株式会社富士通ゼネラル
Claims (3)
- （１）ＭＵＳＥ方式ディジタル信号をノンインターレー
スのＮＴＳＣ方式ディジタル信号に変換するコンバータ
において、該ＭＵＳＥ方式ディジタル信号を内挿し該ノ
ンインターレースのＮＴＳＣ方式に変換した後のディジ
タル輝度信号または該ＭＵＳＥ方式ディジタル信号を内
挿した後のディジタル輝度信号における垂直成分中のエ
ッジ部分を検出し強調成分の出力と該ディジタル輝度信
号を１水平周期時間分遅延した水平エッジ補正部に対す
る出力とをなす垂直エッジ補正部と、該垂直エッジ補正
部よりの輝度信号における水平成分中のエッジ部分を検
出し強調成分の出力と該垂直エッジ補正部よりの輝度信
号をクロック信号周期の２倍の時間分遅延して第２の加
算器に対する出力とをなす水平エッジ補正部と、該垂直
エッジ補正部よりの信号を遅延し原輝度信号との位相を
適性化する第１の遅延回路と、該第１の遅延回路よりの
信号と該水平エッジ補正部よりの各強調成分とを加算す
る第１の加算器と、第１の加算器よりの信号をノイズ軽
減し利得調整して出力するコアリング／利得調整部と、
該コアリング／利得調整部よりの信号と水平エッジ補正
部よりの輝度信号とを加算して出力する第２の加算器と
で構成したことを特徴とするエッジ強調回路。 - （２）前記垂直エッジ補正部において、前記輝度信号を
入力信号として１水平周期時間分遅延して出力する第２
の遅延回路と、該第２の遅延回路よりの信号をさらに１
水平周期時間分遅延して出力する第３の遅延回路と、前
記輝度信号をマイナス１／４倍して出力する第１の定数
倍回路と、該第２の遅延回路よりの信号をプラス１／２
倍して出力する第２の定数倍回路と、該第３の遅延回路
よりの信号をマイナス１／４倍して出力する第３の定数
倍回路と、第１の定数倍回路よりの出力信号と第２の定
数倍回路よりの出力信号と第３の定数倍回路よりの出力
信号とを加算して出力する第３の加算器とで構成したこ
とを特徴とする請求項（１）記載のエッジ強調回路。 - （３）前記水平エッジ補正部において、前記輝度信号を
１水平周期時間分遅延した信号を入力信号としてクロッ
ク信号周期の２倍時間分遅延して出力する第４の遅延回
路と、該第４の遅延回路よりの信号をさらにクロック信
号周期の２倍時間分遅延して出力する第５の遅延回路と
、前記輝度信号を１Ｈ時間分遅延した信号をマイナス１
／４倍して出力する第４の定数倍回路と、該第４の遅延
回路よりの信号をプラス１／２倍して出力する第５の定
数倍回路と、該第５の遅延回路よりの信号をマイナス１
／４倍して出力する第６の定数倍回路と、第４の定数倍
回路よりの出力信号と第５の定数倍回路よりの出力信号
と第６の定数倍回路よりの出力信号とを加算して出力す
る第４の加算器とで構成したことを特徴とする請求項（
１）記載のエッジ強調回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2337639A JPH04207670A (ja) | 1990-11-30 | 1990-11-30 | エッジ強調回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2337639A JPH04207670A (ja) | 1990-11-30 | 1990-11-30 | エッジ強調回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04207670A true JPH04207670A (ja) | 1992-07-29 |
Family
ID=18310554
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2337639A Pending JPH04207670A (ja) | 1990-11-30 | 1990-11-30 | エッジ強調回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04207670A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5537154A (en) * | 1993-12-18 | 1996-07-16 | Samsung Electronics Co., Ltd. | Edge compensation method and apparatus of image signal |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6145691A (ja) * | 1984-08-09 | 1986-03-05 | Nippon Hoso Kyokai <Nhk> | テレビジヨンカメラビユ−フアインダ− |
| JPS6188667A (ja) * | 1984-10-05 | 1986-05-06 | Nec Home Electronics Ltd | カラ−テレビジヨン画質改善装置 |
| JPS61225979A (ja) * | 1985-03-30 | 1986-10-07 | Toshiba Corp | 輪郭自動調整回路 |
-
1990
- 1990-11-30 JP JP2337639A patent/JPH04207670A/ja active Pending
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