JPH04209064A - プロセッサ間接続制御装置 - Google Patents

プロセッサ間接続制御装置

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Publication number
JPH04209064A
JPH04209064A JP2315363A JP31536390A JPH04209064A JP H04209064 A JPH04209064 A JP H04209064A JP 2315363 A JP2315363 A JP 2315363A JP 31536390 A JP31536390 A JP 31536390A JP H04209064 A JPH04209064 A JP H04209064A
Authority
JP
Japan
Prior art keywords
diagnostic
microprocessor
processor
connection circuit
main
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP2315363A
Other languages
English (en)
Inventor
Sumitaka Matsutani
松谷 純孝
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Software Shikoku Ltd
Original Assignee
NEC Software Shikoku Ltd
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Filing date
Publication date
Application filed by NEC Software Shikoku Ltd filed Critical NEC Software Shikoku Ltd
Priority to JP2315363A priority Critical patent/JPH04209064A/ja
Publication of JPH04209064A publication Critical patent/JPH04209064A/ja
Pending legal-status Critical Current

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  • Hardware Redundancy (AREA)
  • Multi Processors (AREA)
  • Test And Diagnosis Of Digital Computers (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、情報処理装置のプロセッサ間制御装置に関し
、特に、診断プロセッサとメインプロセッサとをもつプ
ロセッサを2台使用した場合、プロセッサ間通信用の接
続回路およびそれを構成する回路の異常時における対策
方式に関する。
〔従来の技術〕
従来、この種のプロセッサ間制御方式では、メインプロ
セッサ間で通信を行う場合、直接メインプロセッサ間で
接続されている接続回路だけを使用しており、接続回路
に異常が発生した場合、それ以降のプロセッサ間での通
信は実行しないようになっている。
〔発明が解決しようとする課題〕
上述した従来のメインプロセッサ間で通信を行う時、直
接マイクロプロセッサ間で接続されている接続回路に異
常が発生した場合には、以降のプロセッサ間での通信は
実行できないという欠点がある。
〔課題を解決するための手段〕
診断制御を行う診断制御マイクロプロセッサと、他装置
の診断プロセッサとの通信制御を行う手段をもつ診断プ
ロセッサ間接続回路からなる診断プロセッサおよび診断
制御マイクロプロセッサと診断パスで接続されていて装
置の主たる機能を実現するマイクロプロセッサと、他装
置のこれに対応するマイクロプロセッサとの通信を行う
手段を持つプロセッサ間接続回路からなるメインマイク
ロプロセッサとで構成されるプロセッサ2組において、
一方のメインマイクロプロセッサと他方のメインマイク
ロプロセッサとの間で通信を行う場合、診断プロセッサ
間接続回路とマイクロプロセッサ間の接続回路が異常、
プロセッサ間の接続回路の異常、あるいはプロセッサ接
続回路間の接続回路異常等が発生した時、診断制御マイ
クロプロセッサとマイクロプロセッサとの間にある診断
パスを介し、診断プロセッサから他方の診断プロセッサ
へ、他方の診断プロセッサから他方のメインマイクロプ
ロセッサへとつながるパスを用いて他方のマイクロプロ
セッサとの通信を可能にしている。
〔実施例〕
本発明の実施例について図面に基づいて説明する。
第1図は本発明の一実施例のプロセッサ間接続制御装置
の回路図である。
第1図において、本実施例のプロセッサ間接続制御装置
1は、各プロセッサ2,3、各診断プロセッサ21.3
1、各メインプロセッサ22゜32、各診断制御マイク
ロプロセッサ211゜311、各診断プロセッサ間接続
回路212,312、各プロセッサ間接続回路221,
321、各マイクロプロセッサ222,322で構成さ
れている。
メインプロセッサ22からメインプロセッサ32へとプ
ロセッサ間通信を実行する際、プロセッサ間接続回路2
21とマイクロプロセッサ222間の接続回路が異常、
プロセッサ間接続回路221および321の故障、プロ
セッサ間接続回路321とマイクロプロセッサ322間
の接続回路が異常等が発生し、正常な通信ができながっ
た場合、マイクロプロセッサ222がら自身の診断制御
を行っている診断制御マイクロプロセッサ211に対し
、診断パス2aを使用し、その旨を報告する。
それを受けた診断制御マイクロプロセッサ211は、診
断パス2aを介して、マイクロプロセッサ222からの
通信データを受信する。
診断制御マイクロプロセッサ211は、他方の診断制御
マイクロプロセッサ311に対し、診断プロセッサ間接
続回路212と診断プロセッサ間接続回路312を介し
て、マイクロプロセッサ222から受信したデータを送
信する。
受信データを受取った診断制御マイクロプロセッサ31
1は、マイクロプロセッサ322に繋がっている診断パ
ス3aを通じて受信データを送信する。
これによってメインプロセッサ22とメインプロセッサ
32との間で通信を実行することが可能になる。
また、メインプロセッサ32からメインプロセッサ22
への通信は上記の逆のルートにより行われる。
〔発明の効果〕
以上説明したように本発明によれば、診断プロセッサと
メインプロセッサとを含むプロセッサを2台使用時にお
いて、メインプロセッサ間で通信を行う場合、メインプ
ロセッサ間にある接続回路に異常、もしくは、接続回路
を構成するプロセッサ間接続回路に異常が生じた時、診
断制御マイクロプロセッサとマイクロプロセッサとの間
にある診断パスを介し、正常なパスを用いて、他方のマ
イクロプロセッサとの診断を実行できるという効果があ
る。
【図面の簡単な説明】
第1図は本発明の一実施例のプロセッサ間接続制御装置
の回F#1図である。 1・・・プロセッサ間接続制御装置、2.3・・・プロ
セッサ、2a、3a・・・診断パス、21.31・・・
診断プロセッサ、22.32・・・メインプロセッサ、
211,311・・・診断制御マイクロプロセッサ、2
12,312・・・診断プロセッサ間接続回路、221
,321・・・各プロセッサ間接続回路、222.32
2・・・マイクロプロセッサ。

Claims (1)

  1. 【特許請求の範囲】 診断制御を行う診断制御マイクロプロセッサと、他装置
    の診断プロセッサとの通信制御を行う手段をもつ診断プ
    ロセッサ間接続回路からなる診断プロセッサ、および前
    記診断制御マイクロプロセッサと診断パスで接続されて
    いて装置の主たる機能を実現するマイクロプロセッサと
    、他装置のこれに対応するマイクロプロセッサとの通信
    を行う手段を持つプロセッサ間接続回路からなるメイン
    マイクロプロセッサとで構成されるプロセッサ2組にお
    いて、 一方の前記メインマイクロプロセッサと他方の前記メイ
    ンマイクロプロセッサとの間で通信を行う場合、前記診
    断プロセッサ間接続回路と前記マイクロプロセッサ間の
    接続回路が異常、前記プロセッサ間の接続回路の異常、
    あるいは前記プロセッサ接続回路間の接続回路異常等が
    発生した時、前記診断制御マイクロプロセッサと前記マ
    イクロプロセッサとの間にある前記診断パスを介し、前
    記診断プロセッサから他方の前記診断プロセッサへ、他
    方の前記診断プロセッサから他方の前記メインマイクロ
    プロセッサへとつながるパスを用いて他方の前記マイク
    ロプロセッサとの通信を可能にすることを特徴とするプ
    ロセッサ間接続制御装置。
JP2315363A 1990-11-20 1990-11-20 プロセッサ間接続制御装置 Pending JPH04209064A (ja)

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JP2315363A JPH04209064A (ja) 1990-11-20 1990-11-20 プロセッサ間接続制御装置

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JPH04209064A true JPH04209064A (ja) 1992-07-30

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JP2315363A Pending JPH04209064A (ja) 1990-11-20 1990-11-20 プロセッサ間接続制御装置

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