JPH04215461A - 半導体パッケージ - Google Patents

半導体パッケージ

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JPH04215461A
JPH04215461A JP40210490A JP40210490A JPH04215461A JP H04215461 A JPH04215461 A JP H04215461A JP 40210490 A JP40210490 A JP 40210490A JP 40210490 A JP40210490 A JP 40210490A JP H04215461 A JPH04215461 A JP H04215461A
Authority
JP
Japan
Prior art keywords
wiring board
printed wiring
semiconductor package
resin
sealed
Prior art date
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Application number
JP40210490A
Other languages
English (en)
Other versions
JP2723195B2 (ja
Inventor
Hitoshi Arai
荒井 斉
Shuichi Furuichi
修一 古市
Takeshi Kano
武司 加納
Toru Higuchi
徹 樋口
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Panasonic Electric Works Co Ltd
Original Assignee
Matsushita Electric Works Ltd
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、半導体チップが搭載さ
れたプリント配線板の一部又は全部が樹脂封止された半
導体パッケージに関する。
【0002】
【従来の技術】従来より、プリント配線板などに搭載さ
れた半導体チップを保護するためにエポキシ樹脂とかシ
リコン樹脂により封止された半導体パッケージが提供さ
れていいる。
【0003】
【発明が解決しようとする課題】例えばQFP9の場合
は、第8図及び第9図に示すように封止部分内には半導
体チップ1、アイランド10及びリードフレーム6の一
部が位置しているだけであり、薄いものであって、半導
体パッケージA′の厚さ全体にしめる割合が小さく、又
、金型5の上型5bと下型5aの分離部分に位置するの
もアイランド10のみであり、しかもパッケージ面積に
占めるリードフレーム6の面積も小さく(通常50%以
下)できることから、金型5内に樹脂封止剤3を均一に
流入させることができる。
【0004】しかしながら、プリント配線板2から形成
される半導体パッケージA″にあっては、封止する部分
の形状により封止剤3の流れが部分的に乱れボイド等の
欠陥が発生する。即ち、第10図に示すようにプリント
配線板2が金型5の上型5aと下型5bの分離部分に位
置しており、従って、a>bとなり、このため、ランナ
ー8から注入され流路Faを流れる樹脂封止剤3は流路
Fbに流れ込み図中11で示す箇所にボイドを発生して
しまうものである。従って、特にプリント配線板2全体
を封止する場合は金型5内でのプリント配線板2の位置
、形状等を配慮して充填しなければならないという問題
があった。
【0005】本発明は上記問題を解決するためになされ
たものであり、その目的とするところは封止剤の充填性
が向上し、信頼性の高い半導体パッケージを提供するこ
とにある。
【0006】
【課題を解決するための手段】本発明の半導体パッケー
ジは、半導体チップ1が搭載されたプリント配線板2の
一部又は全部が樹脂封止剤3により封止された半導体パ
ッケージであって、プリント配線板2上の封止される箇
所に凸部4を設けて成るものであり、この構成により上
記課題が解決されたものである。
【0007】
【作用】プリント配線板2上の封止される箇所に凸部4
を設けているので、金型5内での樹脂封止剤3の流れる
スペースが均一化され、封止の際に生ずるボイド等の欠
陥の発生を防止でき、信頼性を高めることができるもの
である。
【0008】
【実施例】プリント配線板2上には半導体チップ1が搭
載されており、4方向にリードフレーム6が引き出され
ている。プリント配線板2の中央部には半導体チップ1
が搭載されており、ボンディングワイヤ7によりリード
フレーム6に接続されている。第1図乃至第2図に示す
実施例にあっては、凸部4として半導体チップ1を囲む
ように突脈4aが形成されている。このプリント配線板
2は第3図に示すように金型5内に配置され、下型5b
のランナー8からエポキシ樹脂やシリコン樹脂のような
樹脂封止剤が注入され封止される。この場合、突脈4a
が形成されているので、プリント配線板2が金型5の上
型5aと下型5bの分離部分に位置しており、従って、
a>bとなっているが、突脈4aにより流路Faを流れ
る樹脂封止剤3と流路Fbを流れる樹脂封止剤3の量は
略等しくなり、下型5a部分にボイド等の欠陥が発生す
ることがなく信頼性の高い半導体パッケージAとなるも
のである。
【0009】第4図に示す実施例にあっては、凸部4は
円柱体4bであり、プリント配線板2の4隅に設けられ
ている。この場合、凸部4の形状及び設置の位置はプリ
ント配線板2の形状等により変更される。尚、第5図に
示すように凸部4の断面が方形状であり、プリント配線
板2とのなす角度が90°以下であれば、矢印で示すよ
うに、この部分で樹脂封止剤3に乱流を生じるおそれが
あるが、第6図に示すように凸部4の断面形状を台形と
して凸部4とプリント配線板2のなす角度が90°以上
であれば、第7図に示すように樹脂封止剤3がスムーズ
に流れてより一層樹脂封止剤3の流れを均一化させるこ
とができる。
【0010】
【発明の効果】本発明は半導体チップが搭載されたプリ
ント配線板の一部又は全部が樹脂封止剤により封止され
た半導体パッケージであって、プリント配線板上の封止
される箇所に凸部を設けているので、封止に際してプリ
ント配線板が金型の上型と下型の分離部分に位置してい
ても、凸部により上型と下型の樹脂封止剤の流入量が略
等しくなり、従って、上型を流れていた樹脂封止剤が下
型に流れ込んでボイドを発生させることなどないもので
ある。
【図面の簡単な説明】
【図1】本発明の一実施例を示す断面図である。
【図2】本発明の一実施例におけるプリント配線板を示
す斜視図である。
【図3】本発明の一実施例の製造を示す断面図である。
【図4】本発明の他の実施例におけるプリント配線板を
示す斜視図である。
【図5】本発明の実施例のおける樹脂封止剤の流れを示
す断面図である。
【図6】本発明の更に他の実施例におけるプリント配線
板を示す断面図である。
【図7】本発明の更に他の実施例におけるプリント配線
板の作用を示す断面図である。
【図8】QFPにて形成された従来例を示す断面図であ
る。
【図9】従来例におけるQFPを示す平面図である。
【図10】プリント配線板にて形成された従来例を示す
断面図である。
【符号の説明】
A  半導体パッケージ 1  半導体チップ 2  プリント配線板 3  樹脂封止剤 4  凸部

Claims (4)

    【特許請求の範囲】
  1. 【請求項1】半導体チップが搭載されたプリント配線板
    の一部又は全部が樹脂封止剤により封止された半導体パ
    ッケージであって、プリント配線板上の封止される箇所
    に凸部を設けて成ること特徴とする半導体パッケージ。
  2. 【請求項2】凸部がプリント配線板上の封止される箇所
    を囲む環状の突脈であることを特徴とする請求項1記載
    の半導体パッケージ。
  3. 【請求項3】凸部がプリント配線板上の封止される箇所
    に1個又は分離した複数個形成されて成ることを特徴と
    する請求項1記載の半導体パッケージ。
  4. 【請求項4】凸部の側部とプリント配線板のなす角度が
    90°以上であることを特徴とする請求項1、2又は3
    記載の半導体パッケージ。
JP2402104A 1990-12-14 1990-12-14 半導体パッケージ Expired - Lifetime JP2723195B2 (ja)

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Legal Events

Date Code Title Description
A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 19950822