JPH04256150A - 個別アドレス設定システム - Google Patents
個別アドレス設定システムInfo
- Publication number
- JPH04256150A JPH04256150A JP3018052A JP1805291A JPH04256150A JP H04256150 A JPH04256150 A JP H04256150A JP 3018052 A JP3018052 A JP 3018052A JP 1805291 A JP1805291 A JP 1805291A JP H04256150 A JPH04256150 A JP H04256150A
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- JP
- Japan
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- 230000005540 biological transmission Effects 0.000 claims abstract description 13
- 230000007257 malfunction Effects 0.000 abstract description 3
- 238000010586 diagram Methods 0.000 description 4
- 238000010276 construction Methods 0.000 description 3
- 230000003247 decreasing effect Effects 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
Landscapes
- Information Transfer Systems (AREA)
- Computer And Data Communications (AREA)
- Small-Scale Networks (AREA)
- Selective Calling Equipment (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【０００１】
【産業上の利用分野】本発明は個別アドレス設定システ
ムに関し、特に、ホームバス・システム等の端末装置に
おける個別アドレスを自動的に設定する個別アドレス設
定システムに関する。
ムに関し、特に、ホームバス・システム等の端末装置に
おける個別アドレスを自動的に設定する個別アドレス設
定システムに関する。
【０００２】
【従来の技術】従来の、この種の個別アドレス設定シス
テムにおいては、図３に示されるように、ホームバス・
システム等の端末装置には、複数のディップ・スイッチ
Ｓ１ ，Ｓ２ ，……，Ｓ８ を含むデイップ・スイッ
チ部１４と、複数の抵抗Ｒ１ ，Ｒ２ ，……，Ｒ８
と、制御部１５とが備えられており、これらの各端末装
置の個別アドレスを設定する場合には、ディップ・スイ
ッチ部１４に含まれているデイップ・スイッチＳ１ ，
Ｓ２ ，……，Ｓ８ を、工事担当者がオン・オフする
ことにより設定しているが一般である。
テムにおいては、図３に示されるように、ホームバス・
システム等の端末装置には、複数のディップ・スイッチ
Ｓ１ ，Ｓ２ ，……，Ｓ８ を含むデイップ・スイッ
チ部１４と、複数の抵抗Ｒ１ ，Ｒ２ ，……，Ｒ８
と、制御部１５とが備えられており、これらの各端末装
置の個別アドレスを設定する場合には、ディップ・スイ
ッチ部１４に含まれているデイップ・スイッチＳ１ ，
Ｓ２ ，……，Ｓ８ を、工事担当者がオン・オフする
ことにより設定しているが一般である。
【０００３】例えば、個別アドレスの設定値が００００
１０１１の場合には、ディップ・スイッチＳ１ ，Ｓ２
およびＳ４ をオンとし、その他のディップ・スイッ
チを全てオフとして、制御部１５を介して、当該個別ア
ドレスが設定される。
１０１１の場合には、ディップ・スイッチＳ１ ，Ｓ２
およびＳ４ をオンとし、その他のディップ・スイッ
チを全てオフとして、制御部１５を介して、当該個別ア
ドレスが設定される。
【０００４】
【発明が解決しようとする課題】上述した従来の個別ア
ドレス設定システムにおいては、各端末装置に設けられ
ているデイップ・スイッチＳ１ ，Ｓ２ ，……，Ｓ８
を、工事担当者がオン・オフすることにより個別アド
レスを設定する構成がとられているため、具体的作業と
しては設定作業が煩雑となり、端末装置数が多い場合に
おいては、同一の個別アドレスを各端末装置に対応して
多数に亘り重複して設定されてしまう危険があるという
欠点があり、また、ディップ・スイッチを介して、利用
者側において、勝手に個別アドレスを変更することがで
きるため、当該端末装置を含むシステムに誤動作が発生
するという欠点がある。
ドレス設定システムにおいては、各端末装置に設けられ
ているデイップ・スイッチＳ１ ，Ｓ２ ，……，Ｓ８
を、工事担当者がオン・オフすることにより個別アド
レスを設定する構成がとられているため、具体的作業と
しては設定作業が煩雑となり、端末装置数が多い場合に
おいては、同一の個別アドレスを各端末装置に対応して
多数に亘り重複して設定されてしまう危険があるという
欠点があり、また、ディップ・スイッチを介して、利用
者側において、勝手に個別アドレスを変更することがで
きるため、当該端末装置を含むシステムに誤動作が発生
するという欠点がある。
【０００５】
【課題を解決するための手段】本発明の個別アドレス設
定システムは、乱数を用いて暫定個別アドレスを生成す
る暫定アドレス生成手段と、前記暫定個別アドレスを外
部に送出するための送信タイミング信号を生成するタイ
マと、前記暫定個別アドレスおよび送信タイミング信号
等を含む情報の送受信制御を行う第１の制御回路とを含
む端末制御部と、前記暫定個別アドレス等を含むアドレ
ス情報を格納する第１の記憶手段と、を少なくとも備え
て構成される端末装置と、前記端末装置から送られてく
る暫定個別アドレスを受けて、正規の個別アドレスを決
定するアドレス決定手段と、前記暫定個別アドレス等を
含む情報の送受信制御を行う第２の制御回路とを含む制
御部と、前記制御部から伝達されるアドレス情報を格納
する第２の記憶部と、を少なくとも備えて構成される制
御装置と、を備えて構成される。
定システムは、乱数を用いて暫定個別アドレスを生成す
る暫定アドレス生成手段と、前記暫定個別アドレスを外
部に送出するための送信タイミング信号を生成するタイ
マと、前記暫定個別アドレスおよび送信タイミング信号
等を含む情報の送受信制御を行う第１の制御回路とを含
む端末制御部と、前記暫定個別アドレス等を含むアドレ
ス情報を格納する第１の記憶手段と、を少なくとも備え
て構成される端末装置と、前記端末装置から送られてく
る暫定個別アドレスを受けて、正規の個別アドレスを決
定するアドレス決定手段と、前記暫定個別アドレス等を
含む情報の送受信制御を行う第２の制御回路とを含む制
御部と、前記制御部から伝達されるアドレス情報を格納
する第２の記憶部と、を少なくとも備えて構成される制
御装置と、を備えて構成される。
【０００６】
【実施例】次に、本発明について図面を参照して説明す
る。
る。
【０００７】図１は本発明の一実施例を示すブロック図
である。図１に示されるように、本実施例は、インター
フェース部２と、制御回路４、乱数により暫定アドレス
を生成する暫定アドレス生成回路５およびタイマー６を
含む端末制御部３と、端末制御部３から伝達されるアド
レスを格納する記憶部７とにより構成される端末装置１
と、インターフェース部９と、制御回路１１、および端
末装置１から伝達される暫定アドレス情報を受けて、正
規の個別アドレスを決定するアドレス決定回路１２を含
む制御部１０と、制御部１０から伝達される個別アドレ
スを格納する記憶部１３とにより構成される制御装置８
とを備えて構成される。また、図２に示されるのは、本
実施例における動作フロー・チャートである。
である。図１に示されるように、本実施例は、インター
フェース部２と、制御回路４、乱数により暫定アドレス
を生成する暫定アドレス生成回路５およびタイマー６を
含む端末制御部３と、端末制御部３から伝達されるアド
レスを格納する記憶部７とにより構成される端末装置１
と、インターフェース部９と、制御回路１１、および端
末装置１から伝達される暫定アドレス情報を受けて、正
規の個別アドレスを決定するアドレス決定回路１２を含
む制御部１０と、制御部１０から伝達される個別アドレ
スを格納する記憶部１３とにより構成される制御装置８
とを備えて構成される。また、図２に示されるのは、本
実施例における動作フロー・チャートである。
【０００８】次に、図１および図２を参照して、本実施
例の動作について説明する。なお、図１において、制御
装置８におけるアドレスは、自動的に０１Ｈ（１６進表
示）であるものとする。電源立上り後（ステップ１０１
）、暫定アドレス生成回路５においては、乱数により暫
定アドレスが生成され（ステップ１０２）、制御回路４
に対しては、生成終了信号および当該暫定アドレスが出
力される。制御回路４においては、前記生成終了信号を
受けて、タイマー６の動作が開始され、制御装置８に対
して暫定アドレスを送信するための送信タイミング信号
が生成される（ステップ１０３）。送信タイミング信号
は、暫定アドレスの値に比例した時間を基準として生成
されており、この送信タイミング信号を介して、暫定ア
ドレスは端末制御部３よりインターフェース部２を介し
て制御装置８に送信されると同時に、記憶部７に伝達さ
れて格納される（ステップ１０４および１０５）。
例の動作について説明する。なお、図１において、制御
装置８におけるアドレスは、自動的に０１Ｈ（１６進表
示）であるものとする。電源立上り後（ステップ１０１
）、暫定アドレス生成回路５においては、乱数により暫
定アドレスが生成され（ステップ１０２）、制御回路４
に対しては、生成終了信号および当該暫定アドレスが出
力される。制御回路４においては、前記生成終了信号を
受けて、タイマー６の動作が開始され、制御装置８に対
して暫定アドレスを送信するための送信タイミング信号
が生成される（ステップ１０３）。送信タイミング信号
は、暫定アドレスの値に比例した時間を基準として生成
されており、この送信タイミング信号を介して、暫定ア
ドレスは端末制御部３よりインターフェース部２を介し
て制御装置８に送信されると同時に、記憶部７に伝達さ
れて格納される（ステップ１０４および１０５）。
【０００９】制御回路１１においては、インターフェー
ス部９を介して送られてきた暫定アドレスを受けて、こ
れをアドレス決定回路１２に送出する。アドレス決定回
路１２においては、入力される暫定アドレスを受けて（
ステップ１０６）、この暫定アドレスの値の小さい順に
個別アドレスが決定される（ステップ１０７）。この決
定された個別アドレスは、暫定アドレスを有する端末装
置１に対して、インターフェース部９を介して送信され
るとともに、記憶部１３に伝達されて格納される（ステ
ップ１０８および１０９）。また、端末装置１において
は、受信された個別アドレス情報は、正規の個別アドレ
スとして記憶部７に伝達されて格納される。前述のよう
に、個別アドレスの決定は、暫定アドレスの値の小さい
順に行われるため、上記の手順を繰返して行うことによ
り、複数の端末装置においては、連続した個別の番号に
よるアドレス設定が行われることになる。
ス部９を介して送られてきた暫定アドレスを受けて、こ
れをアドレス決定回路１２に送出する。アドレス決定回
路１２においては、入力される暫定アドレスを受けて（
ステップ１０６）、この暫定アドレスの値の小さい順に
個別アドレスが決定される（ステップ１０７）。この決
定された個別アドレスは、暫定アドレスを有する端末装
置１に対して、インターフェース部９を介して送信され
るとともに、記憶部１３に伝達されて格納される（ステ
ップ１０８および１０９）。また、端末装置１において
は、受信された個別アドレス情報は、正規の個別アドレ
スとして記憶部７に伝達されて格納される。前述のよう
に、個別アドレスの決定は、暫定アドレスの値の小さい
順に行われるため、上記の手順を繰返して行うことによ
り、複数の端末装置においては、連続した個別の番号に
よるアドレス設定が行われることになる。
【００１０】また、図１において、タイマー６を手動に
より操作することにより、制御装置８の選択動作が可能
となることは云うまでもなく、自明のことである。
より操作することにより、制御装置８の選択動作が可能
となることは云うまでもなく、自明のことである。
【００１１】
【発明の効果】以上説明したように、本発明は、乱数に
より生成された暫定アドレズ値を基ににして自動的に正
規の個別アドレスを決定することにより、工事担当者に
よるアドレス設定作業を排除し、且つ個別アドレスの重
複設定を防止することができるとともに、利用者の個別
アドレス設定に伴なうシステムの誤動作を防止すること
ができるという効果がある。
より生成された暫定アドレズ値を基ににして自動的に正
規の個別アドレスを決定することにより、工事担当者に
よるアドレス設定作業を排除し、且つ個別アドレスの重
複設定を防止することができるとともに、利用者の個別
アドレス設定に伴なうシステムの誤動作を防止すること
ができるという効果がある。
【図１】本発明の一実施例を示すブロック図である。
【図２】本実施例における動作のフローチャートを示す
図である。
図である。
【図３】従来例を示すブロック図である。
１ 端末装置
２，９ インターフェース部
３ 端末制御部
４，１１ 制御回路
５ 暫定アドレス生成回路
６ タイマー
７，１３ 記憶部
８ 制御装置
１０ 制御部
１２ アドレス決定回路
１４ ディップ・スイッチ部
１５ 制御部
Ｓ１ 〜Ｓ８ デイップ・スイッチＲ１ 〜Ｒ
８ 抵抗
８ 抵抗
Claims (1)
- 【請求項１】 乱数を用いて暫定個別アドレスを生成
する暫定アドレス生成手段と、前記暫定個別アドレスを
外部に送出するための送信タイミング信号を生成するタ
イマと、前記暫定個別アドレスおよび送信タイミング信
号等を含む情報の送受信制御を行う第１の制御回路とを
含む端末制御部と、前記暫定個別アドレス等を含むアド
レス情報を格納する第１の記憶手段と、を少なくとも備
えて構成される端末装置と、前記端末装置から送られて
くる暫定個別アドレスを受けて、正規の個別アドレスを
決定するアドレス決定手段と、前記暫定個別アドレス等
を含む情報の送受信制御を行う第２の制御回路とを含む
制御部と、前記制御部から伝達されるアドレス情報を格
納する第２の記憶部と、を少なくとも備えて構成される
制御装置と、を備えることを特徴とする個別アドレス設
定回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3018052A JPH04256150A (ja) | 1991-02-08 | 1991-02-08 | 個別アドレス設定システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3018052A JPH04256150A (ja) | 1991-02-08 | 1991-02-08 | 個別アドレス設定システム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH04256150A true JPH04256150A (ja) | 1992-09-10 |
Family
ID=11960930
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3018052A Pending JPH04256150A (ja) | 1991-02-08 | 1991-02-08 | 個別アドレス設定システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH04256150A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5689675A (en) * | 1993-11-29 | 1997-11-18 | U.S. Philips Corporation | Ranking-based address assignment in a modular system |
-
1991
- 1991-02-08 JP JP3018052A patent/JPH04256150A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5689675A (en) * | 1993-11-29 | 1997-11-18 | U.S. Philips Corporation | Ranking-based address assignment in a modular system |
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