JPH0427057Y2 - - Google Patents
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- Publication number
- JPH0427057Y2 JPH0427057Y2 JP1983092711U JP9271183U JPH0427057Y2 JP H0427057 Y2 JPH0427057 Y2 JP H0427057Y2 JP 1983092711 U JP1983092711 U JP 1983092711U JP 9271183 U JP9271183 U JP 9271183U JP H0427057 Y2 JPH0427057 Y2 JP H0427057Y2
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- JP
- Japan
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- turned
- transistor
- charging
- relay
- main switch
- Prior art date
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- Relay Circuits (AREA)
Description
【考案の詳細な説明】
(イ) 産業上の利用分野
本考案はリレー装置を用いて負荷への通電を制
御する負荷制御装置に設けられたチヤタリング防
止回路に関する。
御する負荷制御装置に設けられたチヤタリング防
止回路に関する。
(ロ) 従来技術
交流電源に機械式スイツチであるメインスイツ
チを介して接続されたリレーコイルの通電により
オンするリレースイツチのオンオフにより負荷へ
の通電を制御する負荷制御装置において、メイン
スイツチが例えばオフからオンに切り換つた際
に、前記メインスイツチにチヤタリングが発生し
たときには、リレースイツチもチヤタリングを起
こしこのリレースイツチは負荷へ流れる大きな電
流を制御しているため、リレースイツチは短時間
例えば２〜３秒にて焼損、溶着等により使用不可
能になるという欠点が発生していた。
チを介して接続されたリレーコイルの通電により
オンするリレースイツチのオンオフにより負荷へ
の通電を制御する負荷制御装置において、メイン
スイツチが例えばオフからオンに切り換つた際
に、前記メインスイツチにチヤタリングが発生し
たときには、リレースイツチもチヤタリングを起
こしこのリレースイツチは負荷へ流れる大きな電
流を制御しているため、リレースイツチは短時間
例えば２〜３秒にて焼損、溶着等により使用不可
能になるという欠点が発生していた。
(ハ) 考案の目的
メインスイツチにチヤタリングが発生した際に
はこのチヤタリングを検出して負荷への通電を制
御するリレー装置への通電を遮断し、該リレー装
置のリレースイツチもチヤタリングを起すことを
確実に防止して該リレースイツチの焼損、溶着等
を防止することを目的とする。
はこのチヤタリングを検出して負荷への通電を制
御するリレー装置への通電を遮断し、該リレー装
置のリレースイツチもチヤタリングを起すことを
確実に防止して該リレースイツチの焼損、溶着等
を防止することを目的とする。
(ニ) 考案の構成
本考案は交流電源に接続されたメインスイツチ
と、リレーコイル及びリレースイツチを備えたリ
レー装置と、該リレースイツチのオンオフにより
通電が制御される負荷とを備えた負荷制御装置
に、交流電源に整流回路を介して接続され、該メ
インスイツチのオンオフに伴いオンオフする第１
トランジスタと、該第１トランジスタのオン時に
オフ、オフ時にオンする第２トランジスタと、該
第２トランジスタと並列に接続され該第２トラン
ジスタのオン時に放電しオフ時に充電する充放電
コンデンサと、該充放電コンデンサの充電が所定
時間継続したときトリガーを出力するスイツチン
グ素子と、前記トリガーにより導通して前記リレ
ーコイルへ通電させる３端子スイツチング素子と
を備えたチヤタリング防止回路を設け、前記メイ
ンスイツチにチヤタリングが発生した際に前記第
１、第２トランジスタのオンオフの繰り返しによ
り前記充放電コンデンサを所定時間内に放電さ
せ、前記スイツチング素子から前記３端子スイツ
チング素子にトリガーが与えられることを防止
し、前記リレーコイルに通電されることを防止し
て前記リレースイツチをオフ状態に保ち、該リレ
ースイツチにチヤタリングが発生することを確実
に防止するものである。
と、リレーコイル及びリレースイツチを備えたリ
レー装置と、該リレースイツチのオンオフにより
通電が制御される負荷とを備えた負荷制御装置
に、交流電源に整流回路を介して接続され、該メ
インスイツチのオンオフに伴いオンオフする第１
トランジスタと、該第１トランジスタのオン時に
オフ、オフ時にオンする第２トランジスタと、該
第２トランジスタと並列に接続され該第２トラン
ジスタのオン時に放電しオフ時に充電する充放電
コンデンサと、該充放電コンデンサの充電が所定
時間継続したときトリガーを出力するスイツチン
グ素子と、前記トリガーにより導通して前記リレ
ーコイルへ通電させる３端子スイツチング素子と
を備えたチヤタリング防止回路を設け、前記メイ
ンスイツチにチヤタリングが発生した際に前記第
１、第２トランジスタのオンオフの繰り返しによ
り前記充放電コンデンサを所定時間内に放電さ
せ、前記スイツチング素子から前記３端子スイツ
チング素子にトリガーが与えられることを防止
し、前記リレーコイルに通電されることを防止し
て前記リレースイツチをオフ状態に保ち、該リレ
ースイツチにチヤタリングが発生することを確実
に防止するものである。
(ホ) 実施例
以下、第１図および第２図に基づいて本考案の
一実施例を説明する。
一実施例を説明する。
第１図は負荷制御装置の概略回路図で、１は交
流電源、２はリレー装置、３は例えば圧縮機等の
負荷、４は機械式のメインスイツチ、５はダイオ
ードブリツジ整流回路、６はチヤタリング防止回
路である。尚、チヤタリング防止回路６はメイン
スイツチ４のオンが所定時間例えば３秒以上継続
しなかつた際には前記リレー装置２への通電を遅
延させるものである。
流電源、２はリレー装置、３は例えば圧縮機等の
負荷、４は機械式のメインスイツチ、５はダイオ
ードブリツジ整流回路、６はチヤタリング防止回
路である。尚、チヤタリング防止回路６はメイン
スイツチ４のオンが所定時間例えば３秒以上継続
しなかつた際には前記リレー装置２への通電を遅
延させるものである。
電源１にはリレー装置２のリレースイツチ２Ｓ
と負荷３との直列回路が接続され、さらにメイン
スイツチ４と整流回路５とリレー装置２のリレー
コイル２Ｃとの直列回路が接続されている。チヤ
タリング防止回路６は整流回路５と、この整流回
路の出力端子５Ａに接続された第１ライン７と入
力端子５Ｂに接続された第２ライン８と、第１、
第２ライン７，８間に接続された第１、第２抵抗
R1，R2の直列回路と、この直列回路の中点９に
ベースが接続されエミツタが第２ライン８に接続
されコレクタが第３、第４抵抗R3，R4を介して
第１ライン７に接続された第1NPN型トランジス
タジ（以下第１トランジスタという）１０と、ベ
ースが第１トランジスタ１０のコレクタに接続さ
れ、エミツタは第２ライン８に、コレクタは第５
抵抗R5を介して第４抵抗R4に接続された第２ト
ランジスタ１１と、第５抵抗R5および第２トラ
ンジスタ１１に並列接続され第４、第５抵抗R4，
R5と第２トランジスタ１１と共に充放電回路を
構成する充放電コンデンサ１２と、第１、第２ラ
イン７，８間にアノード、カソードが接続された
３端子スイツチング素子（以下サイリスタと称す
る）１３と、サイリスタ１３のゲートと充放電コ
ンデンサ１２の第４抵抗R4側との間に接続され
充放電コンデンサ１２の充電が所定時間例えば３
秒継続しスイツチング電圧に達したときにオンす
るスイツチング素子１４と、サイリスタ１３のゲ
ートと第２ライン８との間に接続された第６抵抗
R6とサイリスタ１３のオンを確実に保持するた
めのコンデンサ１５とから構成されている。
と負荷３との直列回路が接続され、さらにメイン
スイツチ４と整流回路５とリレー装置２のリレー
コイル２Ｃとの直列回路が接続されている。チヤ
タリング防止回路６は整流回路５と、この整流回
路の出力端子５Ａに接続された第１ライン７と入
力端子５Ｂに接続された第２ライン８と、第１、
第２ライン７，８間に接続された第１、第２抵抗
R1，R2の直列回路と、この直列回路の中点９に
ベースが接続されエミツタが第２ライン８に接続
されコレクタが第３、第４抵抗R3，R4を介して
第１ライン７に接続された第1NPN型トランジス
タジ（以下第１トランジスタという）１０と、ベ
ースが第１トランジスタ１０のコレクタに接続さ
れ、エミツタは第２ライン８に、コレクタは第５
抵抗R5を介して第４抵抗R4に接続された第２ト
ランジスタ１１と、第５抵抗R5および第２トラ
ンジスタ１１に並列接続され第４、第５抵抗R4，
R5と第２トランジスタ１１と共に充放電回路を
構成する充放電コンデンサ１２と、第１、第２ラ
イン７，８間にアノード、カソードが接続された
３端子スイツチング素子（以下サイリスタと称す
る）１３と、サイリスタ１３のゲートと充放電コ
ンデンサ１２の第４抵抗R4側との間に接続され
充放電コンデンサ１２の充電が所定時間例えば３
秒継続しスイツチング電圧に達したときにオンす
るスイツチング素子１４と、サイリスタ１３のゲ
ートと第２ライン８との間に接続された第６抵抗
R6とサイリスタ１３のオンを確実に保持するた
めのコンデンサ１５とから構成されている。
以下、上記負荷制御装置の動作を第１図及び第
２図に基づいて説明する。尚、第２図において
V1は第１ライン７に表われる電圧波形、Tr1と
Tr2は夫々第１、第２トランジスタ１０，１１の
オン、オフ状態、V2は充放電コンデンサ１２の
充電電圧、SCRはサイリスタ１３のオン、オフ
状態を示している。
２図に基づいて説明する。尚、第２図において
V1は第１ライン７に表われる電圧波形、Tr1と
Tr2は夫々第１、第２トランジスタ１０，１１の
オン、オフ状態、V2は充放電コンデンサ１２の
充電電圧、SCRはサイリスタ１３のオン、オフ
状態を示している。
負荷に通電するためにメインスイツチ４をオン
する時に、メインスイツチ４に対する温度、湿
度、圧力又は塵埃の影響等により、メインスイツ
チ４にチヤタリングが発生すると、メインスイツ
チ４がオフして第１ライン７の電圧V1がゼロに
なる時間Ｔが繰り返し発生する。時刻T1にて電
圧V1がゼロになると第１トランジスタ１０はオ
フし、第２トランジスタ１１のベースに充放電コ
ンデンサ１２の充電電圧が加わると第２トランジ
スタ１１はオンし、充放電コンデンサ１２は放電
し充電電圧は略ゼロまで低下する。時間Ｔが経過
して時刻T2にて再びメインスイツチ４がオンす
ると第１トランジスタ１０のベースには第１、第
２抵抗R1，R2により分圧された電圧が加わり、
第１トランジスタ１０はオンして第２トランジス
タ１１のベース電圧は低下して第２トランジスタ
１１はオフする。第２トランジスタ１１がオフす
ると充放電コンデンサ１２は第４抵抗R4を介し
て再び充電が開始される。しかし乍ら、充電が開
始された所定時間経過して充電電圧がスイツチン
グ素子１４のスイツチング電圧に達する前に再び
メインスイツチ４のチヤタリングにより第１ライ
ン７の電圧がゼロになり、時間T′第１トランジ
スタ１０がオフすると、第２トランジスタ１１は
その間オンして充放電コンデンサ１２は放電す
る。
する時に、メインスイツチ４に対する温度、湿
度、圧力又は塵埃の影響等により、メインスイツ
チ４にチヤタリングが発生すると、メインスイツ
チ４がオフして第１ライン７の電圧V1がゼロに
なる時間Ｔが繰り返し発生する。時刻T1にて電
圧V1がゼロになると第１トランジスタ１０はオ
フし、第２トランジスタ１１のベースに充放電コ
ンデンサ１２の充電電圧が加わると第２トランジ
スタ１１はオンし、充放電コンデンサ１２は放電
し充電電圧は略ゼロまで低下する。時間Ｔが経過
して時刻T2にて再びメインスイツチ４がオンす
ると第１トランジスタ１０のベースには第１、第
２抵抗R1，R2により分圧された電圧が加わり、
第１トランジスタ１０はオンして第２トランジス
タ１１のベース電圧は低下して第２トランジスタ
１１はオフする。第２トランジスタ１１がオフす
ると充放電コンデンサ１２は第４抵抗R4を介し
て再び充電が開始される。しかし乍ら、充電が開
始された所定時間経過して充電電圧がスイツチン
グ素子１４のスイツチング電圧に達する前に再び
メインスイツチ４のチヤタリングにより第１ライ
ン７の電圧がゼロになり、時間T′第１トランジ
スタ１０がオフすると、第２トランジスタ１１は
その間オンして充放電コンデンサ１２は放電す
る。
再びメインスイツチ４が時刻T3にてオンした
ときチヤタリングが発生しなかつた場合には、第
１トランジスタ１０はオンして第２トランジスタ
１１はオフして再び充放電コンデンサ１２の充電
が開始される。充電が開始されてから所定時間例
えば３秒経過して充電電圧がスイツチング素子１
４のスイツチング電圧Ｖに達すると、スイツチン
グ素子１４はオンしてサイリスタ１３のゲートに
トリガーが与えられサイリスタ１３はオンする。
サイリスタ１３のオンによりメインスイツチ４、
整流回路５、及びサイリスタ１３を介してリレー
装置２のリレーコイル２Ｃは通電され、リレース
イツチ２Ｓはオンして負荷３は通電され、負荷３
の運転は開始される。
ときチヤタリングが発生しなかつた場合には、第
１トランジスタ１０はオンして第２トランジスタ
１１はオフして再び充放電コンデンサ１２の充電
が開始される。充電が開始されてから所定時間例
えば３秒経過して充電電圧がスイツチング素子１
４のスイツチング電圧Ｖに達すると、スイツチン
グ素子１４はオンしてサイリスタ１３のゲートに
トリガーが与えられサイリスタ１３はオンする。
サイリスタ１３のオンによりメインスイツチ４、
整流回路５、及びサイリスタ１３を介してリレー
装置２のリレーコイル２Ｃは通電され、リレース
イツチ２Ｓはオンして負荷３は通電され、負荷３
の運転は開始される。
従つて、メインスイツチ４がオフからオンにな
る際にチヤタリングが発生し、メインスイツチ４
のオン、第１トランジスタ１０のオン、第２トラ
ンジスタ１１のオフによる充放電コンデンサ１２
の充電時間が所定時間に達しないときには、サイ
リスタ１３へトリガーは与えられずにサイリスタ
１３はオフを継続するため、リレー装置２のリレ
ーコイル２Ｃは非通電でリレースイツチ２Ｓはオ
フを継続し、メインスイツチ４のオンが所定時間
以上継続してからサイリスタ１３はオンしてリレ
ースイツチ２はオンするため、リレースイツチ２
Ｓのオンと次のリレースイツチ２Ｓのオンとの間
には所定時間以上の間隔が必ず設けられ、その間
にリレースイツチ２Ｓのオン時に発生した熱は放
熱され、リレースイツチ２Ｓの焼損、溶着等を確
実に防止できると共に、チヤタリングによりリレ
ーコイル２Ｃが高温になることを防止でき保護を
図ることができる。さらにメインスイツチ４がチ
ヤタリングを起こしている際にはメインスイツチ
４がオフになり、第１トランジスタ１０はオフ、
第２トランジスタ１１はオンして、充放電コンデ
ンサ１２に蓄えられた電荷を略放電させ、メイン
スイツチ４のオン時ごとに充放電コンデンサ１２
の充電電圧が上昇することを確実に防止でき、メ
インスイツチ４にチヤタリングが発生していると
きにサイリスタ１３がオンし、オフを繰り返し、
リレー装置２にチヤタリングが発生することを確
実に防止することができる。尚、整流回路２を電
源１とメインスイツチ４との間又はリレーコイル
２Ｃと電源１との間に設けチヤタリング防止回路
６を接続しても同様な作用効果を得ることができ
る。
る際にチヤタリングが発生し、メインスイツチ４
のオン、第１トランジスタ１０のオン、第２トラ
ンジスタ１１のオフによる充放電コンデンサ１２
の充電時間が所定時間に達しないときには、サイ
リスタ１３へトリガーは与えられずにサイリスタ
１３はオフを継続するため、リレー装置２のリレ
ーコイル２Ｃは非通電でリレースイツチ２Ｓはオ
フを継続し、メインスイツチ４のオンが所定時間
以上継続してからサイリスタ１３はオンしてリレ
ースイツチ２はオンするため、リレースイツチ２
Ｓのオンと次のリレースイツチ２Ｓのオンとの間
には所定時間以上の間隔が必ず設けられ、その間
にリレースイツチ２Ｓのオン時に発生した熱は放
熱され、リレースイツチ２Ｓの焼損、溶着等を確
実に防止できると共に、チヤタリングによりリレ
ーコイル２Ｃが高温になることを防止でき保護を
図ることができる。さらにメインスイツチ４がチ
ヤタリングを起こしている際にはメインスイツチ
４がオフになり、第１トランジスタ１０はオフ、
第２トランジスタ１１はオンして、充放電コンデ
ンサ１２に蓄えられた電荷を略放電させ、メイン
スイツチ４のオン時ごとに充放電コンデンサ１２
の充電電圧が上昇することを確実に防止でき、メ
インスイツチ４にチヤタリングが発生していると
きにサイリスタ１３がオンし、オフを繰り返し、
リレー装置２にチヤタリングが発生することを確
実に防止することができる。尚、整流回路２を電
源１とメインスイツチ４との間又はリレーコイル
２Ｃと電源１との間に設けチヤタリング防止回路
６を接続しても同様な作用効果を得ることができ
る。
(ヘ) 考案の効果
本考案は交流電源に整流回路を介して接続さ
れ、第１、第２トランジスタと、該第１、第２ト
ランジスタにより充放電が制御される充放電コン
デンサと、該充放電コンデンサの充電電圧が所定
電圧になつたときすなわち所定時間メインスイツ
チのオンが継続したときオンするスイツチング素
子と、該スイツチング素子を介して送られてくる
トリガーによりオンし導通する３端子スイツチン
グ素子等から構成された負荷制御回路のチヤタリ
ング防止回路であるから、メインスイツチにチヤ
タリングが発生し所定時間充放電コンデンサへの
充電が継続する前にメインスイツチがオフした際
には該充放電コンデンサは放電し、前記３端子ス
イツチング素子がオンすることはなくリレーコイ
ルへの通電を確実に防止してリレースイツチのオ
フ状態を維持して該リレースイツチにチヤタリン
グが発生することを確実に防止でき、リレースイ
ツチの焼損、溶着等を防止すると共にリレーコイ
ルを確実に保護してリレー装置の総合的な保護を
図ることができる。
れ、第１、第２トランジスタと、該第１、第２ト
ランジスタにより充放電が制御される充放電コン
デンサと、該充放電コンデンサの充電電圧が所定
電圧になつたときすなわち所定時間メインスイツ
チのオンが継続したときオンするスイツチング素
子と、該スイツチング素子を介して送られてくる
トリガーによりオンし導通する３端子スイツチン
グ素子等から構成された負荷制御回路のチヤタリ
ング防止回路であるから、メインスイツチにチヤ
タリングが発生し所定時間充放電コンデンサへの
充電が継続する前にメインスイツチがオフした際
には該充放電コンデンサは放電し、前記３端子ス
イツチング素子がオンすることはなくリレーコイ
ルへの通電を確実に防止してリレースイツチのオ
フ状態を維持して該リレースイツチにチヤタリン
グが発生することを確実に防止でき、リレースイ
ツチの焼損、溶着等を防止すると共にリレーコイ
ルを確実に保護してリレー装置の総合的な保護を
図ることができる。
第１図及び第２図は本考案の一実施例を示し、
第１図はチヤタリング防止回路を備えた負荷制御
装置の概略回路図、第２図はチヤタリング防止回
路の動作状態図である。 １……電源、２……リレー装置、２Ｃ……リレ
ーコイル、２Ｓ……リレースイツチ、３……負
荷、４……メインスイツチ、５……整流回路、６
……チヤタリング防止回路、１０，１１……第
１、第２トランジスタ、１２……充放電コンデン
サ、１３……３端子スイツチング素子、１４……
スイツチング素子。
第１図はチヤタリング防止回路を備えた負荷制御
装置の概略回路図、第２図はチヤタリング防止回
路の動作状態図である。 １……電源、２……リレー装置、２Ｃ……リレ
ーコイル、２Ｓ……リレースイツチ、３……負
荷、４……メインスイツチ、５……整流回路、６
……チヤタリング防止回路、１０，１１……第
１、第２トランジスタ、１２……充放電コンデン
サ、１３……３端子スイツチング素子、１４……
スイツチング素子。
Claims (1)
- 交流電源に接続されたメインスイツチと、該メ
インスイツチのオンオフにより 前記電源からの
通電が制御されるリレーコイルおよび該リレーコ
イルの通電非通電によりオンオフするリレースイ
ツチからなるリレー装置と、該リレースイツチの
オンオフにより通電が制御される負荷とを備えた
負荷制御装置において、交流電源に整流回路を介
して接続され、前記メインスイツチのオンオフに
伴いオンオフする第１トランジスタと、該第１ト
ランジスタのオン時にオフしオフ時にオンする第
２トランジスタと、該第２トランジスタと並列に
接続され該第２トランジスタのオン時に放電さ
れ、オフ時に充電される充放電コンデンサと、該
充放電コンデンサの充電が所定時間継続したとき
トリガーを出力するスイツチング素子と、前記ト
リガーにより導通して前記リレーコイルへ通電さ
せる３端子スイツチング素子とを備えたことを特
徴とする負荷制御装置のチヤタリング防止回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9271183U JPS60818U (ja) | 1983-06-15 | 1983-06-15 | 負荷制御装置のチヤタリング防止回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9271183U JPS60818U (ja) | 1983-06-15 | 1983-06-15 | 負荷制御装置のチヤタリング防止回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60818U JPS60818U (ja) | 1985-01-07 |
| JPH0427057Y2 true JPH0427057Y2 (ja) | 1992-06-29 |
Family
ID=30223057
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9271183U Granted JPS60818U (ja) | 1983-06-15 | 1983-06-15 | 負荷制御装置のチヤタリング防止回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60818U (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0215041U (ja) * | 1988-07-15 | 1990-01-30 | ||
| JPH0716731U (ja) * | 1993-08-18 | 1995-03-20 | 武盛 豊永 | 多目的オーブンプレート |
| JP6646902B2 (ja) * | 2015-09-16 | 2020-02-14 | 嶋田 隆一 | 再起電圧制御装置 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5130912U (ja) * | 1974-08-30 | 1976-03-05 |
-
1983
- 1983-06-15 JP JP9271183U patent/JPS60818U/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60818U (ja) | 1985-01-07 |
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