JPH04320024A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

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JPH04320024A
JPH04320024A JP4049780A JP4978092A JPH04320024A JP H04320024 A JPH04320024 A JP H04320024A JP 4049780 A JP4049780 A JP 4049780A JP 4978092 A JP4978092 A JP 4978092A JP H04320024 A JPH04320024 A JP H04320024A
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は半導体装置の配線工程に
関したものである。より具体的には本発明は半導体装置
の平坦な金属層の形成方法に関したものである。
【0002】
【従来の技術】半導体装置が超高集積化されることによ
り、半導体配線方法は半導体装置の速度性能、収率およ
び信頼性を決定する要因になるので半導体製造工程で一
番重要な位置を占めている。従来、アスペクト比(幅に
対する深さの比率)が低い接触口か深さが浅い段差等の
ような比較的屈曲が少ない外面的形状を塗布しようとす
るとき金属段差塗布性は大きな問題にはならなかった。 だが、半導体装置の集積度が増加することにより接触口
は顕著に小さくなり半導体基板の表面部位に形成された
不純物が塗布された領域はより薄くなった。従来のアル
ミニウム配線工程は接触口の高いアスペクト比およびス
パッタされたAlの不良な段差塗布性に起因したアルミ
ニウム相互接触の信頼性の失敗、Si沈殿物に起因した
接触抵抗の増加およびアルミニウムスパイキングにより
浅い接合特性の劣化等のような多くの問題点を内包して
いるので接触口の高いアスペクト比および段差の深い深
さにもかかわらず半導体装置の高速性能、高収率および
良好な信頼性のために改善する必要性がある。
【0003】したがって、前記した従来の配線工程の問
題点を克服するために、新しい方法が提案されてきた。 例えば、アルミニウム配線工程においての高いアスペク
ト比およびスパッタされたAlの不良な段差塗布性に起
因したアルミニウム接続の失敗による半導体装置の信頼
性低下を防止するために次のような方法が公知されてい
る。
【0004】日本国特許公開公報第62−132348
号(Yukiyasu  Sugano等)には半導体
装置の不規則な段差に対してフィルム形態を向上させる
ために半導体基板上の段差上に金属配線層を形成した後
、前記配線層を加熱溶融させ、平坦化する方法が記載さ
れている。日本国特許公開公報第63−99549号(
Shinpei  Lijima等)には、配線の信頼
性を向上させ、多層間の相互接触を可能にさせるために
、接触口および段差がある半導体基板上に金属配線層を
形成させ、これを加熱溶融させる方法が記載されている
。前記公報には、半導体基板上に複数の素子を形成し、
前記素子を含む基板上に絶縁膜を蒸着し、前記絶縁膜に
前記素子の所定位置に達する接触口を形成し、前記接触
口および前記絶縁膜の表面に窒化チタン膜を形成し、前
記窒化チタン膜前面上に金属配線層を蒸着化させた後、
前記金属層を加熱溶融させ当該金属層の表面を平坦にし
た後、所定の配線パターンにより当該金属層と前記窒化
チタン膜をエッチングし、少なくとも第1層配線層を形
成することを含む半導体基板に金属配線層を形成し多層
間相互接続を形成する半導体装置の製造方法が記載され
ている。
【0005】日本国特許公開公報第62−109341
号(Masahiro  Shimizu等)には、配
線不良による半導体装置の信頼性を向上させるために、
電極か配線フィルムを形成する場合に絶縁膜表面の接触
のような段差に良好な塗布性を持つアルミニウム合金膜
のようなアルミニウム伝導性膜を形成させる方法が開示
されている。Masahiro  Shimizu等に
よると、シリコン基板上に液相アルミニウム化合物かア
ルミニウムを含む溶液を塗布した後、熱処理しアルミニ
ウム導電性膜を形成させることを含む半導体装置の製造
方法が提供される。
【0006】前述した方法によると、接触口を埋立てる
ためにアルミニウムかアルミニウム合金を溶融させリフ
ローする。前記したすべての公報にはアルミニウムまた
はアルミニウム合金が溶融されるリフロー法を含むので
、この技法により製造される半導体ウェハーは水平的に
位置させ流動する溶融物質が接触口を接合するように埋
立てるようにしなけらばならない。また、温度変化によ
る絶縁地域で金属収縮が起こる。すなわち金属相をアル
ミニウムかアルミニウム合金の溶融点以上に加熱し液化
された流動性金属層が接触口を埋立てる。前記液相金属
相は表面張力を小さくしようとするだろうし、したがっ
て、固化時には収縮するか歪められ低部の半導体物質を
露出させることになる。その上に、熱処理温度は正確に
調節できないので同一な結果を得にくい。また。前記方
法によると接触口を埋立てられるとしても、金属膜の残
余部門は荒くなり後続写真工程はできなくなる。したが
って2次的な金属形成工程が必要となる。
【0007】またアルミニウムスパイキングによる浅い
接合領域の劣化を防止し半導体装置の信頼性を向上させ
るために半導体基板上に形成された接触口に障壁層を形
成する方法が公知されている。例えば、アメリカ合衆国
特許第4,897,709号には配線と半導体基板間の
反応を防止するために接触口内に障壁層として窒化チタ
ン膜を含む半導体装置が記載されている。前記窒化チタ
ン膜は低温形CVD装置を使い、低壓CVD法により形
成され、アスペクト比が大きい。とても微細な接触口で
良好な段差塗布性をもつ優秀な特性がある。前記窒化チ
タン膜形成後アルミニウム合金を使いスパッタリング方
法により配線層を形成させる。
【0008】前記以外にも、アルミニウムかアルミニウ
ム合金を溶融させる代わりに、金属の段差塗布性を向上
させるため、アメリカ合衆国特許第4,970,176
号(Tracy等)には多段階金属配線方法が記載され
ている。前記した特許によると、低温で半導体ウェハー
上に所定厚さの厚い金属層を蒸着させた後、金属がリフ
ローするように温度を高温(約400〜500℃)に上
げ所定厚さの金属層の残りの部分を蒸着させるか、また
は第1金属層を蒸着させた後温度を金属がリフローする
程度の高温に上げながら第2金属層を蒸着させる。金属
層のリフローは粒子成長、再結晶およびバルク拡散を通
じて起こる。
【0009】一方、オノ(Ono)等は、半導体基板を
500℃以上で維持する場合にAl−Siの液体性が急
に増加すると発表した。(Hisako  Onoet
  al.,  in  Proc.,  1990 
 VMIC  Conference  June  
11〜12、pp76〜82)。Ono等はAl−1%
Si膜のストレスは500℃で急に変わり、前記温度で
Al−1%Si膜のストレス弛緩が急激に発生すると教
示している。また、接触口を満足に埋立てるためには基
板温度を500℃ないし550℃に維持しなければなら
ないいと教示している。
【0010】前記した現状とTracy等の方法におい
ての金属層のリフロー現状とは互いに他のメカニズムに
よるものである。本発明者のうち一人は、前記した金属
層のストレス弛緩(stress  relaxati
on)により金属原子の移動現状を利用し低温(200
℃以下)で金属を蒸着させた後金属溶融点の80%ない
し金属溶融点の温度で前記蒸着された金属を後処理し半
導体装置の接触口を完全に埋立てる方法(発明の名称:
半導体装置の金属層形成方法)を発明しこれをアメリカ
合衆国特許出願第07/585,218号に出願し前記
出願は現在アメリカ合衆国特許願いに係属中である。
【0011】図1Aないし図2Cは前記方法を示す概略
図である。図1Aは第1金属層4の形成工程を図示した
もので、まず段差物1が形成された半導体基板10上に
コンタクトホール2のパターンを形成した後、前記基板
10をスパッタリング反応室に入れ一定値の真空度を維
持し、150℃以下の温度で金属、例えばアルミニウム
かアルミニウム合金を蒸着し第1金属層4を形成する。 この層は組立てた構造を持っている。
【0012】図1Bは前記コンタクトホールの埋没工程
を図示したもので、前記図1Aの工程で得た基板真空ブ
レイク(break)なしに他のスパッタリング反応室
に移動した後550℃で2分以上加熱し前記図1Bに図
示されたようにコンタクトホールを埋没させる。このと
き反応室の壓力はAlの表面自由エネルギを増加させる
ために低いほどよい。したがって接触口は容易に金属と
して埋没させられる。図1Bで符号4aは前記図1Aの
第1金属層がコンタクトホール内に埋め合せられたもの
を示している。
【0013】ここで、前記図1Bの熱処理温度は前記A
lまたはAl合金の種類により異なるが、その溶融点の
80%から溶融点までの範囲内の温度である。前記金属
層はアルミニウムの溶融点である660℃より低い温度
で熱処理されるので、溶融されない。550℃では溶融
する代わりにスパッタリング法により150℃の低温で
蒸着されたアルミニウム原子は高温熱処理により移動す
る。このような移動現状は表面がなめらかでないか粗粒
状(grainy)のとき増加し、周囲の原子と完全に
接触しない表面原子のエネルギー増加に起因する。した
がって、初期スパッタリングされた粗粒層は熱処理すれ
ば原子移動の現状が増加することを示す。
【0014】図2Cは第2金属層5の形成工程を図示し
たもので、前記図1B工程以後必要な総配線の厚さの残
りを信頼性を考慮した温度で蒸着し2次金属層5を形成
することにより金属配線層の形成を完成する。前記した
方法によると通常使われている物理蒸着方式のスパッタ
リング装備を使い1次に金属を蒸着した後この蒸着され
た金属を熱処置することにより、コンタクトホール内部
を埋没させられる。したがってアスペクト比が高いコン
タクトホールに対しても完全埋没が可能である。
【0015】だが、接触口にボイドが形成されたかまた
は金属層の段差塗布性が適当でない場合には、金属層が
蒸着された半導体ウェハーを真空で所定の温度で維持し
た後にも接触口が埋没されない。その上に、金属層が蒸
着された半導体ウェハー上に第2金属層を後に形成させ
るとしても接触口の良好な段差塗布性を得られず、不充
分な段差塗布性により半導体装置の信頼性は低下する。
【0016】また、シリコン技術の初期段階ではSi上
に直接純粋アルミニウムが蒸着された接触構造を使った
。だが、AlのSiに対する接触はシンタリングの途中
に接合スパイキングのような不良な接合特性を示す。 シンタ段階は接触金属膜が蒸着およびパターンされた後
に遂行される。Al−Si接触の場合には、前記シンタ
リングによりAlはシリコン表面を形成する自然的な酸
化物層と反応する。Alは薄いSiO2 層と反応しな
がらAl2 O3 を形成し、良好な抵抗接触状態にあ
る自然酸化物は結局完全に消耗される。次にAlは生成
されたAl2 O3 層を拡散して通過しSi表面に到
達し金属とシリコンを密接に接触させる。AlはAl2
 O3 層を拡散通過し残留SiO2 に達する。Al
2 O3 層の厚さが増加することによりAlが通過す
る時間は長くかかる。 したがって、自然酸化物層があまり厚ければ。Al2 
O3 層もまたあまり厚くなりAlが通過できなくなる
。この場合、すべてのSiO2 が消耗されないだろう
し、抵抗接触は不良である。Al2O3 を通過するA
lの通過速度は温度関数である。許容するシンタ温度お
よび時間に対してAl2 O3 の厚さは5〜10Åの
範囲内出なければならない。最大Al2 O3 の厚さ
は消耗される自然酸化物の厚さとだいたい似ているので
、自然酸化物層の許容可能な厚さの大量的な上限値が決
まる。シリコン表面を酸素含有の雰囲気でより長く露出
させるほど、自然酸化物はより厚くなる。したがって、
大部分の接触工程の表面洗浄節次は金属蒸着用蒸着チャ
ンバにウェハーをローディングする直前に遂行される。
【0017】シンタ段階は必須的である。アルミニウム
−シリコン系の状態図によるとアルミニウムは450℃
ないし500℃の接触合金(contact−allo
ying)温度で0.5ないし1%のシリコンを吸収す
ることが判る。純粋アルミニウムを450℃まで加熱し
シリコン源を提供すれば、アルミニウムはSi濃度が0
.5wt%になるまで溶液状態でシリコンを吸収する。 半導体基板がシリコン源として役割をし、シリコンは高
温ではAl内に拡散し注入される。Alの量が多ければ
、Al−Si界面から相当量のSiがAl膜内に拡散す
ることができる。同時にAlは膜から、Siが離脱して
できたボイド内に迅速に埋立てられる。Alの浸透の深
さが接合領域のP−N接合の深さより深ければ、接合は
漏泄電流を大きく現わし、甚だしくは電気的に短絡され
る。これを接合スパイキングという。
【0018】前記した接触において接合スパイキングを
避けるため蒸着時にAl膜にSiを加する。接触および
集積回路の相互接触を形成するのにAl−Si合金(S
i:1.0wt%)が広く使われている。純粋アルミニ
ウムの代わりにAl−Si合金を使うことにより接合ス
パイキングを避けられるが、これはまた他の問題点があ
る。熱アニーリングの冷却の途中に温度が低下すること
によりアルミニウム中のシリコンの高溶度(Solid
  Solubility)は減少する。したがってア
ルミニウムはSiに過飽和状態になり、これは核を形成
しAl−Si溶液からSi残砂を成長させる。前記残砂
は接触でAl−SiO2界面およびAl−Si界面すべ
てに発生する。もしこれら残砂が境界面でn+ Siに
形成されるとすれば接触抵抗が望まず増加する結果にな
る。 それだけではなく1.5μm程度の大きさの残砂が形成
される位置では電流の大量磁束発散(flux−div
ergence)が生成される。
【0019】これにより電子移動誘導開放回路により半
導体が故障になる。図3は金属配線パターン形成後半導
体表面上にSi残砂が析出されていることを示す。した
がって、前記Si残砂は除去することが望ましい。従来
には前記Si残砂を除去するため洗浄するか過度エッチ
ング、漏式エッチング等で除去するかAlエッチング時
Siを除去する基を入れた方法を使った。だが、高温沈
積する場合には前記Si残砂は除去されない。また、過
度エッチングする場合にもSiが析出された模様が下層
膜に転写され残るので外観が不良になる。
【0020】前記した問題点を解決するために本発明者
が研究した結果本発明を完成した。
【0021】
【発明が解決しようとする課題】したがって、本発明の
目的は、金属を蒸着させた後、半導体基板上に形成され
たすべての接触口を完全に埋立て、半導体装置の金属配
線の良好な信頼性を得た半導体装置の金属層の形成方法
の改良方法を提供するところにある。本発明の他の目的
は後続工程でのSi残砂を生じないようにする金属配線
層の形成方法を提供することにある。
【0022】
【課題を解決するための手段】本発明によると、半導体
基板上に層間絶縁膜を形成し、前記層間絶縁膜に半導体
基板が露出するように開口部を形成し、前記得た半導体
ウェハー上に第1金属層を形成し、前記第1金属層を熱
処理し開口部を埋立て、前記第1金属層上に第2金属層
を形成した後、前記第2金属層を熱処理し平坦化する工
程を含む半導体装置の製造方法が提供される。前記第1
金属層はアルミニウムまたはアルミニウム合金のような
金属を低温真空で蒸着させ形成する。AlまたはAl合
金としては純粋Al、Al−0.5%Cu、Al−1%
Si、Al−1%Si−0.5%Cu等がある。第1金
属層は150℃以下で蒸着させる。蒸着温度が低いほど
熱処理時に金属原子の移動が活発になるので温度は低い
ほうが望ましい。第1金属層の厚さは最終金属層の厚さ
の1/3〜2/3であることが望ましい。
【0023】第1金属層を真空で形成した後、前記第1
金属層を真空を壊さず熱処理する。熱処理は10mTo
rr以下の不活性ガス雰囲気で装置内の真空度は5×1
0−7Torr以下の真空で、0.8Tm以上Tm、望
ましくは500〜550℃の温度でガス伝導法または、
RTA法により半導体基板を加熱し遂行する。前記熱処
理は不活性ガス(N2 、Ar)か還元性ガス(H2 
)の雰囲気下で遂行することもできる。金属層を熱処理
すれば、金属原子は表面自由エネルギーを減少させるた
め開口部内に移動し開口部が金属に埋立てられる。開口
部内に金属原子が移動すれば金属層の表面積が減少され
る。 したがって、開口部の上部に存在する金属層のオーバー
ハンギング部位がなくなり、開口部の入口部は大きくな
る。したがって、以後第2金属層を蒸着することになる
と、良好な段差塗布性を得られる。前記熱処理時に真空
が壊れると、Al原子はAl2 O3 を形成し、これ
はAl原子が前記温度で開口部内に移動できないように
する。したがって、この場合には開口部が金属に完全に
埋立てられず、望ましくない。
【0024】前記熱処理はガス伝導法により望ましくは
アルゴンガスを使い1〜5分間遂行する。RTA装置を
使う場合には20〜30秒間数回反復するか2分程度金
属層を熱処理する。次に、蒸着を350℃以下で遂行す
ることを除けば第1金属層形成時と同一な方法で金属を
蒸着し第2金属層を形成する。第2金属層を形成した後
、第1金属層の熱処理時と同一な方法で第2金属層を熱
処理する。前記したすべての段階は10mTorr以下
の不活性気体雰囲気の真空中でスパートの真空度は5×
10−7Torrを維持し真空を壊さず遂行し、これは
本発明の重要な特徴の一つである。
【0025】本発明の一つの具体例によると、基板上に
開口部を形成した後、前記開口部を含む半導体ウェハー
の全表面に拡散障壁層を形成する。前記障壁層はチタン
のような遷移金属または窒化チタンのような遷移金属化
合物で構成される。アルミニウムかアルミニウム合金膜
で構成された配線が接触口を通じて不純物がドーピング
された浅い領域の表面と連結されており、熱処理を遂行
する場合にはアルミニウムは前記不純物がドーピングさ
れた領域に拡散され、P−n接合を通過することになり
P−n接合が破壊される難点を発生させる。アルミニウ
ムと半導体基板間の反応を防止するためにアルミニウム
またはアルミニウム合金で構成された配線と半導体基板
の表面の間に窒化チタンで構成された障壁層を形成する
方法が提案された。例えば反応性スパッタリング法によ
り窒化チタン膜を形成することが文献(J.Vac,S
ci.Technol.,A4(4),1986,pp
.1850〜1854)に開示されており、またアメリ
カ合衆国特許第4,897,709号によると、アスペ
クト比が大きい極めて微細な穴の内面に、厚さが均一で
障壁特性が優秀な窒化チタン膜が提供される。また、Y
odaTakashi等は配線と半導体基板または絶縁
層間の反応を防止するために接触口の内面に二重障壁層
を形成した後加熱し所定温度を維持しながらアルミニウ
ム合金のような蒸着された金属で接触口を埋立てること
を含む半導体装置の製造方法を提示した。(韓国特許公
開第90−15277号、日本国特許願第1−6155
7号)。
【0026】前記記載した方法により、本発明の開口部
内面に拡散障壁層は容易に形成される。障壁層はTi金
属層のような第1障壁層およびTiNのような第2障壁
層で構成されているのが望ましい。前記第1障壁層の厚
さは100〜300Åであり第2障壁層の厚さは200
〜1500Åであることが望ましい。本発明の他の態様
によると、前記第2金属層上に反射防止膜を形成し金属
配線の信頼性も向上させる。
【0027】本発明の開口部はその上部に段差場が形成
された接触口形態で形成されることもありえる。また、
本発明によると、半導体ウェハー上に開口部を形成し、
前記半導体ウエハー上に金属層を形成し、前記金属層を
熱処理することを含む半導体装置の製造方法において、
金属形成時金属としてSi成分を含まない純粋アルミニ
ウムかアルミニウム合金を使うことを特徴とする方法が
提供される。本発明で使用できる前記金属としては純粋
Al、Al−CuおよびAl−Ti等がある。
【0028】本発明の望ましい態様によると、前記金属
層は第1金属を蒸着し、第1金属層を形成し前記金属層
を熱処理し、第2金属を蒸着し第2金属層を形成させ完
成する。前記第1および第2金属のうち一つはSi成分
がない純粋AlまたはAl合金であり、他の一つはSi
成分が含まれたAl合金である。前記金属は所定温度で
通常的なスパッタリング法により蒸着される。前記金属
層はまたSi成分を含む金属とSi成分を含まない金属
を少なくとも一回反復し蒸着することにより形成される
【0029】前記のようなSi成分がない金属を使えば
、温度が低下するとき前記金属はSi成分を含む金属か
らSi原子を吸収する。したがって、半導体基板上にS
i残砂が形成されることを防止できる。また、Siがな
い金属はSiが含まれた金属から半導体基板からよりは
容易にSi原子を吸収する。したがって、Alスパイキ
ングを防止することもできる。
【0030】本発明の他の態様によると、開口部形成後
半導体ウェハーの全面に障壁層を形成し金属と半導体基
板または絶縁層間の反応を防止することができる。前記
障壁層はTiNのような高融点金属化合物で構成される
。本発明によると、前記開口部はアスペクト比が1.0
以上の段差部が形成された接触口でもありえる。前記金
属層は真空スパッタリングチャンバで150℃以下の低
温で形成させることが望ましい。金属層は前記金属の融
点の0.8Tm〜Tmの温度で熱処理する。
【0031】前記金属配線を形成するすべての段階は真
空で真空を壊さず遂行することが望ましい。
【0032】
【作用】本発明による金属配線方法によると、高いアス
ペクト比にもかかわらず接触口が金属で完全に埋立てら
れ、配線以後後続工程でSi残砂かAlスパイキングが
生じない。
【0033】
【実施例】以下実施例を示し、本発明をより具体的に記
述するが、これは本発明の範囲を限定するのではない。 図4A〜図4Dは本発明による金属層形成方法の一実施
例を示す。図4Aは第1金属層形成段階を示す。層間絶
縁膜22が塗布された半導体基板21上に大きさが0.
8μmであり、段差部が形成された開口部23を形成し
た後基板を洗浄する。
【0034】次に、前記得た半導体基板21の全面にT
iNのような高融点化合物で形成された障壁層24を形
成する。形成された障壁層の厚さは200〜1500Å
である。次に基板をスパッタリング反応チャンバに入れ
、ここで、所定の真空度で150℃以下の温度で金属、
例えばSi成分がないAlかAl合金を金属の厚さの2
/3すなわち厚さが6000Åの場合4000Åの厚さ
に蒸着し金属層25を形成する。このようにして形成さ
れた金属層はアルミニウムグレーンサイズが小さく表面
自由エネルギーが大きい。
【0035】図4Bは開口部を埋没する段階を示す。前
記で得た半導体ウェハーを真空を壊さず他のスパッタリ
ング反応チャンバ内に移送し550℃の温度で3分間前
記金属層25を熱処理すれば、アルミニウム粒子を移動
させアルミニウムのグレーン境界がその表面エネルギを
減少させその表面積を最小化する。図4Bに示したよう
に開口部を金属で埋められる。
【0036】図4Cは前記金属層25上に第2金属層2
6を形成する段階を示す。前記第2金属層26は350
℃以下の温度で金属層所定総厚さの残りの部分を蒸着さ
せ形成し金属層を形成する。前記第2金属層はAl−S
iまたは、Al−Cu−Si等のようなSi成分を含む
アルミニウム合金を使って形成する。図4Dは通常的な
リソグラフィック工程により第2金属層26、第1金属
層25および障壁層24の所定部分を除去した後に得た
金属配線パターン27形成段階を示す。
【0037】図5Aないし図5Dは本発明による金属配
線方法のまた他の一例を示したものである。図5Aは第
1金属層形成段階を示す。半導体基板31の上部にSi
O2 で構成された絶縁膜33を形成し、この絶縁膜3
3の所定部分に大きさが0.8μmであり、上部に段差
部が形成された開口部35を形成した後半導体基板31
を洗浄する。その次、前記開口部35を含む半導体ウェ
ハーの全表面にこの半導体基板31または絶縁膜33と
配線との反応を抑制するためTiで構成されたこの第1
拡散防止膜37を100〜500Å程度の厚さに形成し
、TiNで構成された第2拡散防止膜39を200〜1
500Å程度の厚さで第1拡散防止膜37上に形成した
後、N2 の雰囲気で450℃で30分間熱処理する。 その次、前記第2拡散防止膜39の表面にアルミニウム
系の合金で2000〜4000Å程度の厚さの第1金属
膜41を蒸着する。前記で第1金属膜41はAl−0.
5%Cu、Al−1%SiまたはAl−0.5%Cu−
1%Siのうちひとつをスパッタリングまたは真空蒸着
等の物理方法で150℃以下の低温で形成する。
【0038】図5Bは前記金属層41の第1熱処理段階
を示す。スパッタ真空度を5×10−7Torr以下に
維持し、真空ブレイク(Vacuum  break)
せずに10−2Torr以下の不活性気体の雰囲気の真
空度で1〜5分の間前記金属層はガス伝導(Gas  
conduction)方法を使い1次熱処理する。 図5Cは、前記真空状態を壊さずに350℃以下の温度
で前記第1金属層41の全表面に第2金属層43を20
00〜4000Åの厚さに蒸着して形成する段階を示す
【0039】図5Dは前記真空状態を壊さず前記第2金
属層43を前記1次熱処理方法と同一な方法で2次熱処
理し前記第2金属膜43を形成する金属原子が移動し金
属層の表面が平坦になる段階を示す。引き続き、前記第
2金属層43の上部にTiNのような遷移金属化合物を
200〜500Å程度の厚さに蒸着し反射防止膜45を
形成する。
【0040】次に通常的なリソーグラフィック工程によ
り金属配線パターンを得ることもできる(図示されてい
ない)。本発明によると、開口部が形成されたウェハー
上にスパッタリング方法により蒸着させ形成された金属
層を熱処理すると前記金属層の金属原子が開口部内に移
動する。前記金属層をより低温で蒸着するほど熱処理時
に金属原子はより容易に移動する。
【0041】また、第1蒸着された金属層を熱処理した
後、低温で第2金属層を蒸着させた後熱処理する。した
がって平坦な金属層を得られ以後のリソーグラフィック
工程を容易に遂行できる。
【0042】
【発明の効果】本発明によると、第2蒸着された金属層
を熱処理した後には金属で完全に埋め立てられた開口部
を得られる。前記完全埋没されたSEM写真を図6に示
す。また、発明によると、Si成分を含む金属とSi成
分を含まない金属を蒸着し金属層を形成する。半導体基
板の温度が低下するとSi成分を含まない金属はSi成
分を含む金属からSi原子を吸収する。したがって、金
属配線形成後にも半導体基板の表面上にSi残砂が形成
されずAlスパイキングも起こらない。図7に示したよ
うに半導体基板の表面がとても滑らかであることが判る
【0043】したがって、本発明によると、半導体ウェ
ハーの金属配線の信頼性が良好になる。
【図面の簡単な説明】
【図1】AおよびBはアメリカ合衆国特許出願第07/
585218号に記載された方法により金属層を形成す
る方法の一実施例を示した図である。
【図2】Cはアメリカ合衆国特許出願第07/5852
18号に記載された方法により金属層を形成する方法の
一実施例を示した図である。
【図3】金属配線工程後半導体基板の表面に形成された
Si残砂を示した図である。
【図4】AおよびDは本発明による金属配線方法の一例
を示した図である。
【図5】AおよびDは本発明による金属配線方法の他の
一例を示した図である。
【図6】本発明の方法により得た半導体基板の上の形成
されて完全に埋め立てられた開口部の金属組織を示す写
真である。
【図7】本発明の方法により得た半導体基板の滑らかな
表面を示した図である。
【符号の説明】
1    段差部 2    コンタクトホール 4、25、41  第1金属層 5、26、43  第2金属層 10、21、31  半導体基板 22、33  絶縁膜 23    開口部 24    障壁層 27    金属配線パターン 35    開口部 37    第1拡散防止膜 39    第2拡散防止膜 45    反射防止膜

Claims (37)

    【特許請求の範囲】
  1. 【請求項1】  半導体基板上に層間絶縁膜を形成し、
    前記層間絶縁膜に半導体基板が露出されるように開口部
    を形成し、前記得た半導体ウェハー上に第1金属層を形
    成し、前記第1金属層を熱処理し、開口部を埋め立て、
    前記第1金属層上に第2金属層を形成した後前記第2金
    属層を熱処理し平坦化する工程を含む半導体装置の製造
    方法。
  2. 【請求項2】  前記開口部の表面に拡散防止膜を形成
    することを特徴とする請求項1記載の半導体装置の製造
    方法。
  3. 【請求項3】  前記拡散防止膜が遷移金属または遷移
    金属化合物で構成されたことを特徴とする請求項2記載
    の半導体装置の製造方法。
  4. 【請求項4】  前記遷移金属がチタンであり、前記遷
    移金属化合物は窒化チタンであることを特徴とする請求
    項3記載の半導体装置の製造方法。
  5. 【請求項5】  前記拡散防止膜が第1防止膜および第
    2防止膜で構成されることを特徴とする請求項2記載の
    半導体装置の製造方法。
  6. 【請求項6】  前記第1防止膜がチタンで構成され、
    前記第2防止膜が窒化チタンで構成されることを特徴と
    する請求項5記載の半導体装置の製造方法。
  7. 【請求項7】  前記第1防止膜の厚さが100〜50
    0Åであり、前記第2防止膜の厚さが200〜1500
    Åであることを特徴とする請求項5記載の半導体装置の
    製造方法。
  8. 【請求項8】  前記第1金属層は真空低温で蒸着し形
    成させることを特徴とする請求項1記載の半導体装置の
    製造方法。
  9. 【請求項9】  前記金属は150℃以下で蒸着される
    ことを特徴とする請求項8記載の半導体装置の製造方法
  10. 【請求項10】  前記第1金属層を0.8Tm〜Tm
    の温度で熱処理することを特徴とする請求項1記載の半
    導体装置の製造方法。
  11. 【請求項11】  前記第1金属層を真空を壊さず熱処
    理することを特徴とする請求項1記載の半導体装置の製
    造方法。
  12. 【請求項12】  前記第1金属層の厚さが最終金属層
    厚さの1/3〜2/3であることを特徴とする請求項1
    記載の半導体装置の製造方法。
  13. 【請求項13】  前記第2金属層は350℃以下の温
    度で金属を蒸着し形成されることを特徴とする請求項1
    記載の半導体装置の製造方法。
  14. 【請求項14】  前記第2金属層は厚さが最終金属層
    厚さの1/3〜2/3であることを特徴とする請求項1
    記載の半導体装置の製造方法。
  15. 【請求項15】  前記第2金属層を0.8Tmないし
    Tmの温度で熱処理することを特徴とする請求項1記載
    の半導体装置の製造方法。
  16. 【請求項16】  前記すべての工程を真空で真空を壊
    さず遂行するか不活性または還元性ガス雰囲気下で遂行
    することを特徴とする請求項1記載の半導体装置の製造
    方法。
  17. 【請求項17】  前記すべての工程を10mTorr
    以下の不活性気体の雰囲気で遂行することを特徴とする
    請求項16記載の半導体装置の製造方法。
  18. 【請求項18】  前記第2金属層上に反射防止幕を形
    成させることを特徴とする請求項1記載の半導体装置の
    製造方法。
  19. 【請求項19】  前記反射防止膜が遷移金属化合物で
    構成されることを特徴とする請求項18記載の半導体装
    置の製造方法。
  20. 【請求項20】  前記遷移金属化合物が窒化チタンで
    あることを特徴とする請求項19記載の半導体装置の製
    造方法。
  21. 【請求項21】  前記金属がAlまたはAl合金であ
    ることを特徴とする請求項1記載の半導体装置の製造方
    法。
  22. 【請求項22】  前記開口部はその上部に段差部が形
    成された接触口であることを特徴とする請求項1記載の
    半導体装置の製造方法。
  23. 【請求項23】  前記第1金属および第2金属層のう
    ちいずれか一つはSiを含まない純粋なAlまたはAl
    合金であることを特徴とする請求項1記載の半導体装置
    の製造方法。
  24. 【請求項24】  半導体ウェハー上に開口部を形成し
    、前記半導体ウェハー上に金属層を形成し、前記金属層
    を熱処理し前記開口部を金属に埋没することを含む半導
    体装置の製造方法において、金属形成時金属としてSi
    成分を含まない純粋なアルミニウムかアルミニウム合金
    を使うことを特徴とする半導体装置の製造方法。
  25. 【請求項25】  前記開口部形成後、半導体ウェハー
    上の前面に障壁層を形成することを特徴とする請求項2
    4記載の半導体装置の製造方法。
  26. 【請求項26】  前記アルミニウム合金がAl−Cu
    合金またはAl−Ti合金であることを特徴とする請求
    項24記載の半導体装置の製造方法。
  27. 【請求項27】  前記開口部はその上に段差部が存在
    する接触口であることを特徴とする請求項24記載の半
    導体装置の製造方法。
  28. 【請求項28】  前記金属層は真空でスパッタリング
    法により蒸着させ形成させることを特徴とする請求項2
    4記載の半導体装置の製造方法。
  29. 【請求項29】  前記金属を150℃以下で蒸着させ
    ることを特徴とする請求項28記載の半導体装置の製造
    方法。
  30. 【請求項30】  前記開口部のアスペクト比が1.0
    以上であることを特徴とする請求項24記載の半導体装
    置の製造方法。
  31. 【請求項31】  前記金属層を他のスパッタリングチ
    ャンバで真空を壊さず熱処理することを特徴とする請求
    項24記載の半導体装置の製造方法。
  32. 【請求項32】  前記金属層を金属溶融点の80%な
    いし金属の溶融点の温度未満で熱処理することを特徴と
    する請求項24記載の半導体装置の製造方法。
  33. 【請求項33】  前記障壁層が高融点金属化合物で構
    成されることを特徴とする請求項25記載の半導体装置
    の製造方法。
  34. 【請求項34】  前記金属化合物が窒化チタンである
    ことを特徴とする請求項33記載の半導体装置の製造方
    法。
  35. 【請求項35】  前記金属層上にSi成分を含有する
    金属層を形成させることを特徴とする請求項24記載の
    半導体装置の製造方法。
  36. 【請求項36】  スパッタリング法により第1金属層
    を形成し前記金属層を熱処理した後スパッタリング方法
    により第2金属層を形成することにより半導体上に前記
    金属層を形成することを特徴とする請求項24記載の半
    導体装置の製造方法。
  37. 【請求項37】  前記第1金属および第2金属のうち
    いずれか一つはSi成分がない純粋なAlまたはAl合
    金であり、他のうちいずれか一つはSi成分があるAl
    合金であることを特徴とする請求項36記載の半導体装
    置の製造方法。
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