JPH0444469A - 水平同期信号分離回路 - Google Patents

水平同期信号分離回路

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Publication number
JPH0444469A
JPH0444469A JP15348790A JP15348790A JPH0444469A JP H0444469 A JPH0444469 A JP H0444469A JP 15348790 A JP15348790 A JP 15348790A JP 15348790 A JP15348790 A JP 15348790A JP H0444469 A JPH0444469 A JP H0444469A
Authority
JP
Japan
Prior art keywords
signal
synchronization signal
synchronizing signal
noise
horizontal synchronizing
Prior art date
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Pending
Application number
JP15348790A
Other languages
English (en)
Inventor
Toru Oki
透 大木
Hiroyuki Okagaki
岡垣 広之
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Faurecia Clarion Electronics Co Ltd
Original Assignee
Clarion Co Ltd
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Filing date
Publication date
Application filed by Clarion Co Ltd filed Critical Clarion Co Ltd
Priority to JP15348790A priority Critical patent/JPH0444469A/ja
Publication of JPH0444469A publication Critical patent/JPH0444469A/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [産業上の利用分野] 本発明は、テレビジョン信号の複合同期信号より水平同
期信号を分離する水平同期信号分離回路に関する。
[発明の概要] 本発明は、入力された複合同期信号の立上りエツジを検
出して得られる、一定パルス幅の整形信号を通過又は阻
止するゲートと、このゲートの出力信号と内部水平同期
信号とを選択的に出力する水平同期信号切替器と、この
水平同期信号切替器の出力をトリガとして、整形信号の
立上り又は立下りエツジを計数してノイズの混合状態を
検出する計数器と、この計数器の出力に基づいて、ゲー
トの開閉および水平同期信号切替器の切替えを制御する
制御信号発生器とを備え、複合同期信号へのノイズの混
入に対処するものである。
[従来の技術] 従来のこの種の水平同期信号分離回路として、例えば、
特開平1−55775号公報記載のように、複合同期信
号を波形整形回路で波形整形して整形信号として出力し
、その出力信号をゲートに通して水平同期信号を得るも
のが知られている。
[発明が解決しようとする課題] このような従来の水平同期信号分離回路では、複合同期
信号にノイズが混入した場合の対処がなされていないの
で、複合同期信号にノイズが混入すると正常な同期信号
が得られなくなり、誤動作するというI¥1!題があっ
た。
[発明の目的] 本発明の目的は、複合同期信号にノイズが混入しても正
常な同期信号を得ることができる水平同期信号分離回路
を提供することにある。
[課題を解決するための手段] このような目的を達成するために、本発明は、水平同期
信号分離回路にノイズ検出手段を付加することにより、
複合同期信号にノイズが混入した場合、直ちに複合同期
信号から分離した水平同期信号の出力を停止し、内部水
平同期信号に切り替えることに特徴がある。
[作用] 本発明では、複合同期信号に混入したノイズを検出し、
ノイズがある場合は、内部水平同期信号に切り替えてい
るので、複合同期信号へのノイズ混入の有無に拘らず、
常に正常な水平同期信号を得ることができる。
[実施例] 以下、本発明の実施例を図面により詳細に説明する。
第1図は、本発明による水平同期信号分離回路の一実施
例の構成図で、lOは複合同期信号の入力端子、11は
波形整形回路、12はカウンタ回路、13はゲート、1
4はゲート制御信号発生器、15は水平同期信号切替器
、16は内部水平同期信号発生器、17は水平同期信号
の出力端子である。
第2図は第1図の各部の信号波形図である。
第1図の入力端子lOに第2図(a)に示す複合同期信
号が入力されると、その信号は波形整形回路11により
、第2図(b)に示す信号に整形される(以下、この信
号を整形信号と呼ぶ)、この波形整形回路11は、入力
信号の立上りエツジを検出し、所定パルス幅のパルスを
出力するものである。
次に、この整形信号を、カウンタ回路12に入力する。
このカウンタ回路12は、複合同期信号にノイズが混入
しているかどうかの検出を行うもので、第2図(e)に
示す水平同期信号をトリガとして計数を行う、この水平
同期信号は、水平同期信号切替器15の出力である。
この水平同期信号切替器15では、複合同期信号より分
離された外部水平同期信号、すなわち、ゲート13を通
した整形信号および内部水平同期信号発生器16で作ら
れた内部水平同期信号を入力し、これらの信号のいずれ
かを選択し出力する。
この切替制御をゲート制御信号発生器14の出力で行う
なお、内部水平同期信号発生816では、外部水平同期
信号に常に同期した水平同期信号を発生する。そして、
第2図(e)に示すように、信号の立下りエツジから期
間t、の間、計数を行い、カウント値1以上の場合をノ
イズ有り、カウント値0の場合をノイズ無しとし、その
情報をゲート制御信号発生器14に入力する。この情報
を基にゲート制御信号発生器14は、第2図(f)。
(g)、  (h)に示す3種類の制御を選択し、ゲー
ト13の開閉、水平同期信号切替器15の切替の制御を
行う。
第3図は、これらの制御パターンを示すフローチャート
である。
(1)ノイズ無しの場合(ノイズの無い複合同期信号が
入力された場合) 第2図(f)に示すように、期間℃、の間の計数後、期
間t、の間、ゲート13を閉じる。これにより、破線で
示す垂直同期信号成分を除き、外部水平同期信号を得る
。その後、期間t、の間、ゲート13を開き、水平同期
信号切替器15よりの出力信号を待つ、この場合、外部
水平同期信号が出力される。ここで、期間し、は、次の
外部水平同期信号の立下りエツジが検出されるまで続く
が、これにより、複合同期信号の同期がずれた場合にも
、常に複合同期信号に同期した水平同期信号が得られる
(2)ノイズ有りの場合(複合同期信号にノイズが混入
した場合) 第2図(c)に示すように、複合同期信号にノイズが混
入した場合、波形整形回路11により第2図(d)に示
すように整形されるが、その一部の波形を拡大したもの
を、第2図(g)として示す。
まず、期間t の間、計数を行うが、この時、カウント
値は1以上となるので、ノイズ有りと判断し、期間し、
の間、ゲート13を閉じ、水平同期信号切替器15の出
力を内部水平同期信号に切替える。この場合、期間L4
は、内部水平同期信号の立下りエツジが検出されるまで
続く。
(3)ノイズが有りから無しになった場合(複合同期信
号のノイズが消えた場合) ノイズ有りの状態からノイズ無しの状態に変化したとき
は、その変化したlサイクルに限り、第2図(h)に示
すように、期間t1の間の計数後、水平同期信号切替器
15の出力を外部水平同期信号に切替え、期間t、の間
、ゲート13を開く。
これは、ノイズの無くなった正常な外部水平同期信号の
最初の信号を捕らえるためであり、期間し、の間のゲー
ト開放は、最初の正常な外部水平同期信号の立下りエツ
ジが検出されるまで続く。
以上の制御により、水平同期信号切替器15から、複合
同期信号の状態に応じた水平同期信号、すなわち、外部
水平同期信号あるいは内部水平同期信号が得られ、水平
同期信号出力端子17へ出力される。
[発明の効果コ 以上述べたように、本発明によれば、複合同期信号にノ
イズが混入したとき、すぐに内部水平同期信号に切替え
ることが可能となり、常に正常な同期分離が行え、この
ため誤動作が起きないので、特に回路動作が同期信号に
依存する回路ではその効果は大である。
【図面の簡単な説明】
第1図は本発明による水平同期信号分離回路の一実施例
の構成図、第213!7は第1図の各部の信号を示す波
形図、第3図はゲート制御を示すフローチャートである
。 10・・・・・・・・・複合同期信号入力端子、11・
・・・・・・・・波形整形回路、12・・・・・・・・
・カウンタ回路、13・・・・・・・・・ゲート、14
・・・・・・・・・ゲート制御信号発生回路、15・・
・・・・・・・水平同期信号切替器、16・・・・・・
・・・内部水平同期信号発生器、17・・・・・・・・
・水平同期信号出力端子。 第3図

Claims (1)

    【特許請求の範囲】
  1. 入力された複合同期信号の立上りエッジを検出し、所定
    パルス幅の整形信号を出力する波形整形回路と、該波形
    整形回路の出力を通過又は阻止するゲートと、内部水平
    同期信号を発生する水平同期信号発生器と、上記ゲート
    の出力信号と内部水平同期信号とを選択的に出力する水
    平同期信号切替器と、該水平同期信号切替器の出力をト
    リガとして、上記整形信号の立上り又は立下りエッジを
    計数する計数手段と、該計数手段の出力に基づいて、上
    記ゲートの開閉および上記水平同期信号切替器の切替え
    を制御する制御信号発生器とからなることを特徴とする
    水平同期信号分離回路。
JP15348790A 1990-06-12 1990-06-12 水平同期信号分離回路 Pending JPH0444469A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP15348790A JPH0444469A (ja) 1990-06-12 1990-06-12 水平同期信号分離回路

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JP15348790A JPH0444469A (ja) 1990-06-12 1990-06-12 水平同期信号分離回路

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Publication Number Publication Date
JPH0444469A true JPH0444469A (ja) 1992-02-14

Family

ID=15563647

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Application Number Title Priority Date Filing Date
JP15348790A Pending JPH0444469A (ja) 1990-06-12 1990-06-12 水平同期信号分離回路

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JP (1) JPH0444469A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5315387A (en) * 1992-01-27 1994-05-24 Mitsubishi Denki Kabushiki Kaisha Horizontal synchronization circuit

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5315387A (en) * 1992-01-27 1994-05-24 Mitsubishi Denki Kabushiki Kaisha Horizontal synchronization circuit

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