JPH0445983U - - Google Patents
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- Publication number
- JPH0445983U JPH0445983U JP8763390U JP8763390U JPH0445983U JP H0445983 U JPH0445983 U JP H0445983U JP 8763390 U JP8763390 U JP 8763390U JP 8763390 U JP8763390 U JP 8763390U JP H0445983 U JPH0445983 U JP H0445983U
- Authority
- JP
- Japan
- Prior art keywords
- phase
- target
- outputs
- correction coefficient
- phase correction
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- Pending
Links
- 230000015654 memory Effects 0.000 claims description 9
- 230000001427 coherent effect Effects 0.000 claims description 6
- 230000006870 function Effects 0.000 claims description 4
- 230000010354 integration Effects 0.000 claims 3
- 238000001514 detection method Methods 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 8
Landscapes
- Radar Systems Or Details Thereof (AREA)
Description
第1図は本考案の一実施例を示す構成図、第2
図は本考案の他の実施例を示す構成図、第3図は
位相量変換器の詳細な構成図、第4図は本考案の
さらに他の実施例を示す構成図、第5図は位相量
検出器の詳細な構成図、第6図は本考案のさらに
他の実施例を示す構成図、第7図は従来のパルス
ドツプラフイルタの構成図、第8図は従来の移動
目標指示装置の構成図、第9図は従来のレーダ信
号処理装置の構成図であり、図において1a,1
b,1c,1dは1PRIの遅延メモリ、2a,
2b,2c,2dは乗算器、3a,3b,3c,
3dは加算器、4a,4b,4c,4dはセレク
タ、5a,5b,5c,5d5e,5f,5g,
5h,5i,5j,5k,5lはコヒーレント積
分器、6a,6b,は追尾プロセツサ、7は位相
量変換、12は位相量検出器、13はセレクタ、
18a,18b,18cは乗算器、27a,27
b,27cはウエイテイング関数メモリー、19
は入力バツフアメモリ20はバタフライ演算器、
21は演算メモリ、24a,24b,24cはデ
イジタルフイルタ、25はMTI、26はパルス
ドツプラフイルタである。なお、各図中同一符号
は同一または相当部分を示す。
図は本考案の他の実施例を示す構成図、第3図は
位相量変換器の詳細な構成図、第4図は本考案の
さらに他の実施例を示す構成図、第5図は位相量
検出器の詳細な構成図、第6図は本考案のさらに
他の実施例を示す構成図、第7図は従来のパルス
ドツプラフイルタの構成図、第8図は従来の移動
目標指示装置の構成図、第9図は従来のレーダ信
号処理装置の構成図であり、図において1a,1
b,1c,1dは1PRIの遅延メモリ、2a,
2b,2c,2dは乗算器、3a,3b,3c,
3dは加算器、4a,4b,4c,4dはセレク
タ、5a,5b,5c,5d5e,5f,5g,
5h,5i,5j,5k,5lはコヒーレント積
分器、6a,6b,は追尾プロセツサ、7は位相
量変換、12は位相量検出器、13はセレクタ、
18a,18b,18cは乗算器、27a,27
b,27cはウエイテイング関数メモリー、19
は入力バツフアメモリ20はバタフライ演算器、
21は演算メモリ、24a,24b,24cはデ
イジタルフイルタ、25はMTI、26はパルス
ドツプラフイルタである。なお、各図中同一符号
は同一または相当部分を示す。
Claims (1)
- 【実用新案登録請求の範囲】 (1) 位相検波後A/D変換された1PRI(パ
ルス繰り返し周期)の受信信号を入力し、1PR
I間遅延して出力するメモリー、位相補正係数と
して、目標のドツプラ周波数に対応した位相量ま
たは“−1”を供給する手段、前記メモリーの出
力データに前記位相補正係数を掛け位相補正を行
なう乗算器、この乗算器出力に受信信号を加算す
ることによつてコヒーレント積分を行ない積分結
果を出力する加算器、この加算器出力と前記乗算
器出力のいずれか一方のデータを選択し出力する
セレクタ、以上のメモリー、乗算器、加算器、セ
レクタから構成されるコヒーレント積分器と、こ
のコヒーレント積分器に直列接続された1個以上
のコヒーレント積分器とを備えたことを特徴とす
るレーダ信号処理装置。 (2) 前記位相補正係数を供給する手段として、
目標情報を入力し、目標の速度を予測して出力す
る追尾プロセツサと、この予測速度を目標のドツ
プラ周波数に対応した位相量を変換する位相量変
換器とを備えたことを特徴とする実用新案登録請
求の範囲第(1)項記載のレーダ信号処理装置。 (3) 前記位相補正係数を供給する手段として、
目標情報を入力し、目標の位置を予測して出力す
る追尾プロセツサと、この予測位置の複数PRI
の受信信号を処理することによつて、目標のドツ
プラ周波数に対応した位相量を検出する位相量検
出器とを備えたことを特徴とする実用新案登録請
求の範囲第(1)項記載のレーダ信号処理装置。 (4) 前記位相補正係数にウエイテイングを行な
いコヒーレント積分時のサイドローブ抑圧行なう
手段として、ウエイテイング関数を記憶したウエ
イテイング関数メモリーと、目標のドツプラ周波
数に対応した位相量にウエイテイング関数メモリ
ー出力を掛け合わせる乗算器とを備えたことを特
徴とする実用新案登録請求の範囲第(1)項記載の
レーダ信号処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8763390U JPH0445983U (ja) | 1990-08-22 | 1990-08-22 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8763390U JPH0445983U (ja) | 1990-08-22 | 1990-08-22 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0445983U true JPH0445983U (ja) | 1992-04-20 |
Family
ID=31820146
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8763390U Pending JPH0445983U (ja) | 1990-08-22 | 1990-08-22 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0445983U (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006258786A (ja) * | 2005-02-15 | 2006-09-28 | Mitsubishi Electric Corp | レーダ装置 |
| JP2010281689A (ja) * | 2009-06-04 | 2010-12-16 | Toshiba Corp | レーダ装置及びレーダ信号処理方法 |
| JP2011133406A (ja) * | 2009-12-25 | 2011-07-07 | Denso It Laboratory Inc | 観測信号処理装置 |
-
1990
- 1990-08-22 JP JP8763390U patent/JPH0445983U/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006258786A (ja) * | 2005-02-15 | 2006-09-28 | Mitsubishi Electric Corp | レーダ装置 |
| JP2010281689A (ja) * | 2009-06-04 | 2010-12-16 | Toshiba Corp | レーダ装置及びレーダ信号処理方法 |
| JP2011133406A (ja) * | 2009-12-25 | 2011-07-07 | Denso It Laboratory Inc | 観測信号処理装置 |
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