JPH044758A - インバータ装置 - Google Patents
インバータ装置Info
- Publication number
- JPH044758A JPH044758A JP2103643A JP10364390A JPH044758A JP H044758 A JPH044758 A JP H044758A JP 2103643 A JP2103643 A JP 2103643A JP 10364390 A JP10364390 A JP 10364390A JP H044758 A JPH044758 A JP H044758A
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- JP
- Japan
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- inverter circuit
- inverter
- circuit
- modulation rate
- pwm
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- Pending
Links
- 230000006698 induction Effects 0.000 claims description 8
- 230000006378 damage Effects 0.000 abstract 2
- 238000010586 diagram Methods 0.000 description 12
- 230000000694 effects Effects 0.000 description 3
- 230000007423 decrease Effects 0.000 description 2
- 235000009508 confectionery Nutrition 0.000 description 1
- 238000001816 cooling Methods 0.000 description 1
- 238000010438 heat treatment Methods 0.000 description 1
- 230000001788 irregular Effects 0.000 description 1
- 230000004048 modification Effects 0.000 description 1
- 238000012986 modification Methods 0.000 description 1
Landscapes
- Control Of Ac Motors In General (AREA)
- Inverter Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
［産業上の利用分野コ
本発明は、冷熱機器およびその他のインバータ応用機器
等における誘導モータを可変速駆動するのに好適なイン
バータ装置に関する。
等における誘導モータを可変速駆動するのに好適なイン
バータ装置に関する。
［従来の技術］
第５図に従来のインバータ装置の構成を示す。
図示の如く本装置は交流電源５１に接続されたコンバー
タ回路５２と、このコンバータ回路５２に接続され、誘
導モータ５４に交流電力を出力するインバータ回路５３
と、このインバータ回路５３にパルス幅変調（以下ＰＷ
Ｍと略称する）制御信号５６を出力する制御回路５５と
から構成される。
タ回路５２と、このコンバータ回路５２に接続され、誘
導モータ５４に交流電力を出力するインバータ回路５３
と、このインバータ回路５３にパルス幅変調（以下ＰＷ
Ｍと略称する）制御信号５６を出力する制御回路５５と
から構成される。
コンバータ回路５２に交流電源５１が供給されると、コ
ンバータ回路５２からは整流された直流電圧が出力され
、それかインバータ回路５３に入力する。インバータ回
路５３は制御回飴５５から出力されるＰＷＭ制御信号５
６により制御される。
ンバータ回路５２からは整流された直流電圧が出力され
、それかインバータ回路５３に入力する。インバータ回
路５３は制御回飴５５から出力されるＰＷＭ制御信号５
６により制御される。
このためインバータ回路５３からは交流電圧か出力され
、それが誘導モータ５４に加えられる。なお制御回路５
５の内臓メモリには、第６図に示されている正弦波６１
と三角波６２との比較により得られ、かつインバータ周
波数とインバータ回路５３の出力電圧との関係を考慮さ
れた数種類のＰＷＭパターン６３が記憶されている。こ
れを読み出し、出力したものが前記ＰＷＭ制御信号５６
である。
、それが誘導モータ５４に加えられる。なお制御回路５
５の内臓メモリには、第６図に示されている正弦波６１
と三角波６２との比較により得られ、かつインバータ周
波数とインバータ回路５３の出力電圧との関係を考慮さ
れた数種類のＰＷＭパターン６３が記憶されている。こ
れを読み出し、出力したものが前記ＰＷＭ制御信号５６
である。
［発明が解決しようとする課題］
制御回路５５の内臓メモリには、インバータ周波数に対
応したＰＷＭパターン６３が記憶されているが、上記Ｐ
ＷＭパターン６３は、変調率（正弦波６１と三角波６２
との振幅比： ｂ ／ ａ ）で決まり、変調率は表−
２に示すように「・・・、Ａ１゜Ａ２．・・・」という
具合に飛び飛びの値になっている。なお表−２は変調率
とインバータ周波数の関係を表わしている。
応したＰＷＭパターン６３が記憶されているが、上記Ｐ
ＷＭパターン６３は、変調率（正弦波６１と三角波６２
との振幅比： ｂ ／ ａ ）で決まり、変調率は表−
２に示すように「・・・、Ａ１゜Ａ２．・・・」という
具合に飛び飛びの値になっている。なお表−２は変調率
とインバータ周波数の関係を表わしている。
したがってインバータ装置のインバータ周波数を上昇さ
せると、変調率は第７図に示すように、ステップ状に変
化し、この変調率に対応してインバータ回路５３の出力
電圧も第８図に示すようにステップ状に変化する。この
時、インバータ回路５３を流れるモータ電流は、出力電
圧が急激に変化するため、第９図に示すように急に上昇
し、先のとがったパルス波形になる。このためインバー
タ回路５３に対し、過電流が通流する可能性が高く、イ
ンバータ回路５３中のパワートランジスタを破壊しやす
い欠点がある。
せると、変調率は第７図に示すように、ステップ状に変
化し、この変調率に対応してインバータ回路５３の出力
電圧も第８図に示すようにステップ状に変化する。この
時、インバータ回路５３を流れるモータ電流は、出力電
圧が急激に変化するため、第９図に示すように急に上昇
し、先のとがったパルス波形になる。このためインバー
タ回路５３に対し、過電流が通流する可能性が高く、イ
ンバータ回路５３中のパワートランジスタを破壊しやす
い欠点がある。
そこで本発明の目的は、インバータ回路の出力電圧の変
化がなめらかで、インバータ回路を流れるモータ電流変
化を極小化でき、インバータ回路中のパワートランジス
タの破壊を防止できるインバータ装置を提供することに
ある。
化がなめらかで、インバータ回路を流れるモータ電流変
化を極小化でき、インバータ回路中のパワートランジス
タの破壊を防止できるインバータ装置を提供することに
ある。
［課題を解決するための手段］
上記課題を解決し目的を達成するために本発明では次の
ような手段を講じた。
ような手段を講じた。
交流電源に接続されたコンバータ回路と、このコンバー
タ回路に接続され誘導モータに交流電力を出力するイン
バータ回路と、このインバータ回路に対して内部に記憶
されたＰＷＭパターンを出力する制御回路とから構成さ
れるインバータ装置において、 一周期中に変調率が変化するＰＷＭパターンを前記制御
回路に格納しておくようにする。
タ回路に接続され誘導モータに交流電力を出力するイン
バータ回路と、このインバータ回路に対して内部に記憶
されたＰＷＭパターンを出力する制御回路とから構成さ
れるインバータ装置において、 一周期中に変調率が変化するＰＷＭパターンを前記制御
回路に格納しておくようにする。
すなわちインバータ装置は、第６図に示した正弦波６１
と三角波６２の比（変調率：ｂ／ａ）を正弦波−周期中
に変化させ、それによって得られる一周期中のＰＷＭパ
ターン６３と、変調率を変化させないで得られる一周期
中のＰＷＭパターン６３とを組み合わせ、インバータの
Ｖ／Ｆ （電圧／周波数）制御に適用し、そのＰＷＭパ
ターン６３を制御回路のメモリに記憶させるように構成
したことを特徴とする。
と三角波６２の比（変調率：ｂ／ａ）を正弦波−周期中
に変化させ、それによって得られる一周期中のＰＷＭパ
ターン６３と、変調率を変化させないで得られる一周期
中のＰＷＭパターン６３とを組み合わせ、インバータの
Ｖ／Ｆ （電圧／周波数）制御に適用し、そのＰＷＭパ
ターン６３を制御回路のメモリに記憶させるように構成
したことを特徴とする。
［作用］
上記手段を講じた結果、次のような作用が生じる。
制御回路のメモリに記憶された変調率可変のＰＷＭパタ
ーン６３と変調率一定のＰＷＭパターン６３とは、イン
バータ周波数の上昇または下降時に、順次相互に選択さ
れて制御回路から出力される。
ーン６３と変調率一定のＰＷＭパターン６３とは、イン
バータ周波数の上昇または下降時に、順次相互に選択さ
れて制御回路から出力される。
［実施例］
第１図は本発明の一実施例の構成を示すブロック図であ
る。図示の如く、本装置は交流電源１１に接続されたコ
ンバータ回路１２と、このコンバータ回路に接続され、
誘導モータ１４に交流電力を出力するインバータ回路１
３と、このインバータ回路１３にＰＷＭ制御信号１６を
出力する制御回路１５とから構成されている。
る。図示の如く、本装置は交流電源１１に接続されたコ
ンバータ回路１２と、このコンバータ回路に接続され、
誘導モータ１４に交流電力を出力するインバータ回路１
３と、このインバータ回路１３にＰＷＭ制御信号１６を
出力する制御回路１５とから構成されている。
制御回路１５の内臓メモリには、第６図に示した正弦波
６１と三角波６２との比（変調率・ｂ／ａ）を正弦波−
周期中に変化させ、それによって得られる一周期中のＰ
ＷＭパターン６３と、変調率を変化させないで得られる
一周期中のＰＷＭパターン６３とを組み合わせ、かつイ
ンバータ周波数とインバータ回路１３の出力電圧との関
係を考慮されたＰＷＭパターン６３が記憶されている。
６１と三角波６２との比（変調率・ｂ／ａ）を正弦波−
周期中に変化させ、それによって得られる一周期中のＰ
ＷＭパターン６３と、変調率を変化させないで得られる
一周期中のＰＷＭパターン６３とを組み合わせ、かつイ
ンバータ周波数とインバータ回路１３の出力電圧との関
係を考慮されたＰＷＭパターン６３が記憶されている。
コンバータ回路１２に交流電源１１が供給されると、コ
ンバータ回路１２からは整流された直流電圧が出力され
、それがインバータ回路１３に入力する。インバータ回
路１３は制御回路１５から出力されるＰＷＭ制御回路１
６により制御される。
ンバータ回路１２からは整流された直流電圧が出力され
、それがインバータ回路１３に入力する。インバータ回
路１３は制御回路１５から出力されるＰＷＭ制御回路１
６により制御される。
このためインバータ回路１３からは交流電圧が出力され
、それが誘導モータ１４に加えられる。
、それが誘導モータ１４に加えられる。
制御回路１５の内臓メモリに記憶された変調率可変のＰ
ＷＭパターン６゛３と変調率一定のＰＷＭパターン６３
とは、表−１に示す通り、インバータ周波数の上昇また
は下降に対し、順次相互に選択され、制御回路１５から
出力される。なお表１は変調率とインバータ周波数の関
係を表わしている。
ＷＭパターン６゛３と変調率一定のＰＷＭパターン６３
とは、表−１に示す通り、インバータ周波数の上昇また
は下降に対し、順次相互に選択され、制御回路１５から
出力される。なお表１は変調率とインバータ周波数の関
係を表わしている。
表−１
この時、ＰＷＭパターン６３の変調率は第２図に示す通
りなめらかに変化することになる。このためインバータ
回路１３の出力電圧も第３図に示すように、なめらかに
変化する。その結果、インバータ回路１３を流れるモー
タ電流変化を、第４図に示す通り極めて小さなものとな
し得る。かくしてインバータ回路１３に過電流が通流す
る可能性が低く、インバータ回路１３中のパワートラン
ジスタが破壊されるのを防止できる。
りなめらかに変化することになる。このためインバータ
回路１３の出力電圧も第３図に示すように、なめらかに
変化する。その結果、インバータ回路１３を流れるモー
タ電流変化を、第４図に示す通り極めて小さなものとな
し得る。かくしてインバータ回路１３に過電流が通流す
る可能性が低く、インバータ回路１３中のパワートラン
ジスタが破壊されるのを防止できる。
なお、本発明は上述した実施例に限定されるものではな
く、本発明の要旨を逸脱しない範囲で種々変形実施可能
であるのは勿論である。
く、本発明の要旨を逸脱しない範囲で種々変形実施可能
であるのは勿論である。
［発明の効果］
本発明によればインバータ回路の出力電圧の変化がなめ
らかで、インバータ回路を流れるモータ電流変化を極小
化でき、インバータ回路中のパワートランジスタの破壊
を防止できるインバータ装置を提供できる。
らかで、インバータ回路を流れるモータ電流変化を極小
化でき、インバータ回路中のパワートランジスタの破壊
を防止できるインバータ装置を提供できる。
第１図〜第４図は本発明の一実施例を示す図で、第１図
はインバータ装置の基本回路を示すブロック図、第２図
は変調率の変化を示す特性図、第３図はインバータ出力
電圧を示す特性図、第４図はモータ電流を示す特性図で
ある。第５図〜第９図は従来技術を示す図で、第５図は
インバータ装置の構成を示すブロック図、第６図はＰＷ
〜１パターン作成方法を示す図、第７図は変調率を示す
特性図、第８図はインバータ出力電圧を示す特性図、第
９図はモータ電流を示す特性図である。 １１・・・電源電圧、１２・・・コンバータ回路、１３
・・・インバータ回路、１４・・・誘導モータ、１５・
制御回路、１６・・・ＰＷＭ制御信号、６１・・・正弦
波、６２・・・三角波、６３・・・ＰＷＭパターン。
はインバータ装置の基本回路を示すブロック図、第２図
は変調率の変化を示す特性図、第３図はインバータ出力
電圧を示す特性図、第４図はモータ電流を示す特性図で
ある。第５図〜第９図は従来技術を示す図で、第５図は
インバータ装置の構成を示すブロック図、第６図はＰＷ
〜１パターン作成方法を示す図、第７図は変調率を示す
特性図、第８図はインバータ出力電圧を示す特性図、第
９図はモータ電流を示す特性図である。 １１・・・電源電圧、１２・・・コンバータ回路、１３
・・・インバータ回路、１４・・・誘導モータ、１５・
制御回路、１６・・・ＰＷＭ制御信号、６１・・・正弦
波、６２・・・三角波、６３・・・ＰＷＭパターン。
Claims (1)
- 【特許請求の範囲】 交流電源に接続されたコンバータ回路と、このコンバー
タ回路に接続され誘導モータに交流電力を出力するイン
バータ回路と、このインバータ回路に対して内部に記憶
されたＰＷＭパターンを出力する制御回路とから構成さ
れるインバータ装置において、 一周期中に変調率が変化するＰＷＭパターンを前記制御
回路に格納しておく事を特徴とするインバータ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2103643A JPH044758A (ja) | 1990-04-19 | 1990-04-19 | インバータ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2103643A JPH044758A (ja) | 1990-04-19 | 1990-04-19 | インバータ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH044758A true JPH044758A (ja) | 1992-01-09 |
Family
ID=14359453
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2103643A Pending JPH044758A (ja) | 1990-04-19 | 1990-04-19 | インバータ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH044758A (ja) |
-
1990
- 1990-04-19 JP JP2103643A patent/JPH044758A/ja active Pending
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