JPH0453232A - 半導体装置の製造方法 - Google Patents
半導体装置の製造方法Info
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- JPH0453232A JPH0453232A JP2162039A JP16203990A JPH0453232A JP H0453232 A JPH0453232 A JP H0453232A JP 2162039 A JP2162039 A JP 2162039A JP 16203990 A JP16203990 A JP 16203990A JP H0453232 A JPH0453232 A JP H0453232A
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- Semiconductor Integrated Circuits (AREA)
- Semiconductor Memories (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔概要」
半導体装置の製造方法に関し、
シリコン酸化膜に高電界を長時間加えても正札蓄積によ
る絶縁破壊を生じ難くすることができる半導体装置の製
造方法を提供することを目的とし、少なくともシリコン
を含有する酸化膜に該酸化膜耐圧を向トさせるために水
酸イオンまたは塩素イオンをイオン注入し、次いで熱処
理する工程を含むように構成する。
る絶縁破壊を生じ難くすることができる半導体装置の製
造方法を提供することを目的とし、少なくともシリコン
を含有する酸化膜に該酸化膜耐圧を向トさせるために水
酸イオンまたは塩素イオンをイオン注入し、次いで熱処
理する工程を含むように構成する。
本発明は、シリコン酸化膜を有する半導体装置の製造方
法において、電界を加えたときの長ル1信頼性を向上す
るためにシリコン酸化膜にOHイオンあるいはC4イオ
ンを注入した絶縁膜に関する。
法において、電界を加えたときの長ル1信頼性を向上す
るためにシリコン酸化膜にOHイオンあるいはC4イオ
ンを注入した絶縁膜に関する。
近年のコンピユークーシステムの高度化に伴い、その頭
脳となるLSIは増々信頼性を向上することが要求され
ている。このため、1.slの製造プロセスはクリーン
化を図り、シリコン酸化膜に耐圧劣化の原因となるパー
ティクルや不純物(重金属、アルカリ系金属等)が混入
しないように努力しているが、更に信頼性を向上させる
必要がある。
脳となるLSIは増々信頼性を向上することが要求され
ている。このため、1.slの製造プロセスはクリーン
化を図り、シリコン酸化膜に耐圧劣化の原因となるパー
ティクルや不純物(重金属、アルカリ系金属等)が混入
しないように努力しているが、更に信頼性を向上させる
必要がある。
従来の半導体装置においては、ゲート酸化膜(シリご1
ン酸化膜)や蓄積キャパシター酸化膜(シリご1ン酸化
膜)を酸素雰囲気中で熱処理あるいはCVD法により形
成し、そのシリコン酸化膜上部にポリSi等の電極を堆
積する等してMO3構造を得ていた。
ン酸化膜)や蓄積キャパシター酸化膜(シリご1ン酸化
膜)を酸素雰囲気中で熱処理あるいはCVD法により形
成し、そのシリコン酸化膜上部にポリSi等の電極を堆
積する等してMO3構造を得ていた。
ところが、上記した半導体装置の製造方法では、素子が
微細化されるとスケーリングの法則により設31上シリ
コン酸化膜の膜厚を薄<シなければならず、このため、
シリコン酸化膜に加わる電界強度が大きくなりトンネル
電流が流れ易くなる。以下、これについては第7図に示
すシリコン酸化膜のエネルギーバンドを用いて具体的に
説明する。
微細化されるとスケーリングの法則により設31上シリ
コン酸化膜の膜厚を薄<シなければならず、このため、
シリコン酸化膜に加わる電界強度が大きくなりトンネル
電流が流れ易くなる。以下、これについては第7図に示
すシリコン酸化膜のエネルギーバンドを用いて具体的に
説明する。
まず、ポリSiから電子を注入する場合を考える。シリ
コン酸化膜膜厚が厚い場合は、第7図(a)に示すバリ
ア幅H1が大きくなり電界強度が小さいためトンネル電
流はほとんど流れない。
コン酸化膜膜厚が厚い場合は、第7図(a)に示すバリ
ア幅H1が大きくなり電界強度が小さいためトンネル電
流はほとんど流れない。
とごろが、シリコン酸化膜膜厚が薄くなると、第7図(
b)に示すバリア幅1−12が小さくなり電界強度が大
きくなるため、シリコン酸化膜に注入された電子は高い
エネルギーを持つので、インパクト・アイオニゼーシシ
ンを引き起こし電子と正孔が発生する。この時、シリコ
ン酸化膜中の移動度が高い電子は抜りるが正孔は酸化膜
中に残る。そして、時間とともに正孔は酸化膜中に蓄積
され、それに伴い電子のトンネル確率が増加してI・ン
ネル電流が増加するく第7図(C))。トンネル電流が
増加すると蓄積される正孔も増えて電流増加に加速がつ
き、遂には絶縁破壊に到る。
b)に示すバリア幅1−12が小さくなり電界強度が大
きくなるため、シリコン酸化膜に注入された電子は高い
エネルギーを持つので、インパクト・アイオニゼーシシ
ンを引き起こし電子と正孔が発生する。この時、シリコ
ン酸化膜中の移動度が高い電子は抜りるが正孔は酸化膜
中に残る。そして、時間とともに正孔は酸化膜中に蓄積
され、それに伴い電子のトンネル確率が増加してI・ン
ネル電流が増加するく第7図(C))。トンネル電流が
増加すると蓄積される正孔も増えて電流増加に加速がつ
き、遂には絶縁破壊に到る。
したがっ°ζ、初期不良の少ない酸化膜が得られたとし
ても、長時間高電界を印加すると正孔が蓄積され絶縁破
壊するといった問題を生じていた。
ても、長時間高電界を印加すると正孔が蓄積され絶縁破
壊するといった問題を生じていた。
そこで本発明は、シリコン酸化膜に高電界を長時間加え
ても正孔蓄積による絶縁破壊を生じ難くすることができ
る半導体装置の製造方法を提供することを目的とする。
ても正孔蓄積による絶縁破壊を生じ難くすることができ
る半導体装置の製造方法を提供することを目的とする。
本発明による半導体装置の製造方法は上記目的達成のた
め、少なくともシリコンを含有する酸化膜に該酸化膜耐
圧を向上さ・已るために水酸イオンまたは塩素イオンを
イオン注入し、次いで熱処理する工程を含むものである
。
め、少なくともシリコンを含有する酸化膜に該酸化膜耐
圧を向上さ・已るために水酸イオンまたは塩素イオンを
イオン注入し、次いで熱処理する工程を含むものである
。
本発明においては、前記酸化膜はリンが含有されている
PSG膜、リン及びホロンが含有されているBPSG膜
であってもよい。
PSG膜、リン及びホロンが含有されているBPSG膜
であってもよい。
本発明の○l−1が含有されたシリコン酸化膜の場合で
は、第5図(b)に示す如くシリコン酸化膜中にOH−
を位置するようにすることにより、初期状態ではシリコ
ン酸化膜のエネルギー・ハンドが凸型になり、バリア幅
X1が従来の第5図(a)に示す何もイオン注入してい
ない場合のバリア幅H1よりも大きくなり、トンネル電
流の注入が抑制される。そして、経過時間とともに正孔
が蓄積されたとしても0II−と打ち消し合い(1+、
t2)、エネルギー・ハンドが凹型になるまでの時間を
従来の第5図(a)に示す何もイオン注入していない場
合よりも長く引き延ばすようにしている。
は、第5図(b)に示す如くシリコン酸化膜中にOH−
を位置するようにすることにより、初期状態ではシリコ
ン酸化膜のエネルギー・ハンドが凸型になり、バリア幅
X1が従来の第5図(a)に示す何もイオン注入してい
ない場合のバリア幅H1よりも大きくなり、トンネル電
流の注入が抑制される。そして、経過時間とともに正孔
が蓄積されたとしても0II−と打ち消し合い(1+、
t2)、エネルギー・ハンドが凹型になるまでの時間を
従来の第5図(a)に示す何もイオン注入していない場
合よりも長く引き延ばすようにしている。
したがって、このシリコン酸化膜をMOSゲーI〜やキ
ャパシターの絶縁膜に用いた場合には、絶縁破壊に到る
までの時間を長くすることができるため、信頼性の高い
LSIを構成することができる。
ャパシターの絶縁膜に用いた場合には、絶縁破壊に到る
までの時間を長くすることができるため、信頼性の高い
LSIを構成することができる。
また、本発明の(17−が含有されたシリコン酸化膜の
場合では、第6図(1〕)に示す如くシリコン酸化膜中
にCβ−を位置するようにすることにより、初期状態で
シリコン酸化膜のエネルギー・ハンドが凸型になり、バ
リア幅Yが従来の第6図(a)に示す何もイオン注入し
ていない場合のバリア幅1(1よりも大きくなり、トン
ネル電流の注入が抑制される。そして、経過時間ととも
に正孔が蓄積されたとしてもC4−と打ち消し合い(t
(2)、エネルギー・バンドが凹型になるまでの時間を
従来の第6図(a)に示す何もイオン注入していない場
合よりも長く引き延ばすようにしている。
場合では、第6図(1〕)に示す如くシリコン酸化膜中
にCβ−を位置するようにすることにより、初期状態で
シリコン酸化膜のエネルギー・ハンドが凸型になり、バ
リア幅Yが従来の第6図(a)に示す何もイオン注入し
ていない場合のバリア幅1(1よりも大きくなり、トン
ネル電流の注入が抑制される。そして、経過時間ととも
に正孔が蓄積されたとしてもC4−と打ち消し合い(t
(2)、エネルギー・バンドが凹型になるまでの時間を
従来の第6図(a)に示す何もイオン注入していない場
合よりも長く引き延ばすようにしている。
したがって、このシリコン酸化膜をMOSゲートやキャ
パシターの絶縁膜に用いた場合には、絶縁破壊に到るま
での時間を長くすることができるため、信頼性の高い[
,31を構成することができる。
パシターの絶縁膜に用いた場合には、絶縁破壊に到るま
での時間を長くすることができるため、信頼性の高い[
,31を構成することができる。
(実施例〕
以下、本発明を図面に基づいて説明する。
第1図及び第2図は本発明に係る半導体装置の製造方法
の一実施例を説明する図である。第1図は−・実施例の
製造方法を説明する図、第2図は一実施例の効果を説明
する図である。図示例の製造方法はMOS)ランジスク
等の製造方法に適用することができる。第1図において
、1ばSi等からなる基板、2は5102等からなるシ
リコン酸化膜、2aば○I]−が含有されたシリコン酸
化膜である。
の一実施例を説明する図である。第1図は−・実施例の
製造方法を説明する図、第2図は一実施例の効果を説明
する図である。図示例の製造方法はMOS)ランジスク
等の製造方法に適用することができる。第1図において
、1ばSi等からなる基板、2は5102等からなるシ
リコン酸化膜、2aば○I]−が含有されたシリコン酸
化膜である。
次に、その製造方法について説明する。
ます、第1図(a)に示す例えばp型S i (100
)からなる基板1を用い、第1図(b)に示すように、
例えば1000℃の乾燥酸素雰囲気中で基板1上にシリ
コン酸化膜2を膜厚が例えば20nmで形成す次に、第
1図(c)に示すように、OH−を7゜の角度、エネル
ギー1.OKeVでシリコン酸化膜2に・イオン注入す
ることにより第1図(d)に示すような中央にR,(分
布のピーク)を持つOH−が含有されたシリコン酸化膜
2aを得ることができる。
)からなる基板1を用い、第1図(b)に示すように、
例えば1000℃の乾燥酸素雰囲気中で基板1上にシリ
コン酸化膜2を膜厚が例えば20nmで形成す次に、第
1図(c)に示すように、OH−を7゜の角度、エネル
ギー1.OKeVでシリコン酸化膜2に・イオン注入す
ることにより第1図(d)に示すような中央にR,(分
布のピーク)を持つOH−が含有されたシリコン酸化膜
2aを得ることができる。
そして、このシリコン酸化膜2aをゲート酸化膜や蓄積
キャパシター酸化膜として用い、半導体装置を構成する
。
キャパシター酸化膜として用い、半導体装置を構成する
。
ずなわら、」二層実施例では、第2図に示すように、M
OSダイオードの信頼性が向上しているかと・うかの効
果を示ずT D D B (time−depende
nむdielectric breakdown)特性
を調べたところ、OH−を注入した場合では、何も注入
していない従来の場合(レファレンス○)と比較して累
積破壊率が著しく低減していることが判った。なお、こ
こで累積破壊率は低いものから順にlXl0”lXl0
”、L ×10”cm−2のドーズ量となり、ドーズ量
1. XIO”cm−2が一番効果的で、例えば5%破
壊されるまでの時間は、約1000倍長くなっているこ
とが判る。
OSダイオードの信頼性が向上しているかと・うかの効
果を示ずT D D B (time−depende
nむdielectric breakdown)特性
を調べたところ、OH−を注入した場合では、何も注入
していない従来の場合(レファレンス○)と比較して累
積破壊率が著しく低減していることが判った。なお、こ
こで累積破壊率は低いものから順にlXl0”lXl0
”、L ×10”cm−2のドーズ量となり、ドーズ量
1. XIO”cm−2が一番効果的で、例えば5%破
壊されるまでの時間は、約1000倍長くなっているこ
とが判る。
次に、第3図及び第4図は本発明に係る半導体装置の製
造方法の他の実施例を説明する図である。
造方法の他の実施例を説明する図である。
第3図は一実施例の製造方法を説明する図、第4図は一
実施例の効果を説明する図である。図示例の製造方法は
MO3+−ランジスタ等の製造方法に適用することがで
きる。第3図において、第1図と同一・符号ば同一また
は相当部分を示し、12はSiO2等からなるシリコン
酸化膜、12aはClが含有されたシリコン酸化膜であ
る。
実施例の効果を説明する図である。図示例の製造方法は
MO3+−ランジスタ等の製造方法に適用することがで
きる。第3図において、第1図と同一・符号ば同一また
は相当部分を示し、12はSiO2等からなるシリコン
酸化膜、12aはClが含有されたシリコン酸化膜であ
る。
次に、その製造方法について説明する。
まず、第3図(a)に示す例えばp型S i (100
)からなる基板Jを用い、第3図(b)に示すように、
例えば1000℃の乾燥酸素雰囲気中で基板1」二にシ
リコン酸化膜12を膜厚が例えば20nmで形成する。
)からなる基板Jを用い、第3図(b)に示すように、
例えば1000℃の乾燥酸素雰囲気中で基板1」二にシ
リコン酸化膜12を膜厚が例えば20nmで形成する。
次に、第3図(C)に示すように、Cp−を7゜の角度
、エネルギー20 KeVでシリコン酸化膜12にイオ
ン注入することにより、第3図(d)に示すような中央
δこRF (分布のピーク)を持つClが含有された
シリコン酸化膜12aを得ることができる。
、エネルギー20 KeVでシリコン酸化膜12にイオ
ン注入することにより、第3図(d)に示すような中央
δこRF (分布のピーク)を持つClが含有された
シリコン酸化膜12aを得ることができる。
そして、このシリコン酸化膜12aをゲート酸化膜や蓄
積キャパシクー酸化膜として用い、半導体装置を構成す
る。
積キャパシクー酸化膜として用い、半導体装置を構成す
る。
ずなわら、上記実施例では、第4図に示すように、M
OSダイオードの信頼性が向−)−しているかどうかの
効果を示ずTD D B (time−depende
ntdielectric breakdown)特性
を調べたところ、C4−を注入した場合では、何も注入
していない従来の場合(レファレンス○)と比較して累
積破壊率が著しく低減していることが判った。なお、こ
こで累積破壊率より例えば5%破壊されるまでの時間は
、約3倍、20%破壊されるまでの時間は約100倍長
くなっていることが判る。
OSダイオードの信頼性が向−)−しているかどうかの
効果を示ずTD D B (time−depende
ntdielectric breakdown)特性
を調べたところ、C4−を注入した場合では、何も注入
していない従来の場合(レファレンス○)と比較して累
積破壊率が著しく低減していることが判った。なお、こ
こで累積破壊率より例えば5%破壊されるまでの時間は
、約3倍、20%破壊されるまでの時間は約100倍長
くなっていることが判る。
なお、上記各実施例では、シリコン酸化膜にイオン注入
した際の耐圧特性が向上している場合について説明した
が、本発明はこれに限定されるものではなく、イオン注
入後熱処理(例えば1000゜■0 10分、N2ガス雰囲気中)が加わってもよく、イオン
注入の場合と同様耐圧特性は優れている。
した際の耐圧特性が向上している場合について説明した
が、本発明はこれに限定されるものではなく、イオン注
入後熱処理(例えば1000゜■0 10分、N2ガス雰囲気中)が加わってもよく、イオン
注入の場合と同様耐圧特性は優れている。
1・・・・・・基板、
2.2a、1.2.12a・・・・・・シリコン酸化膜
。
。
本発明によれば、シリ:1ン酸化膜に高電界を長時間加
えても正孔蓄積による絶縁破壊を生じ難くすることがで
きるという効果がある。
えても正孔蓄積による絶縁破壊を生じ難くすることがで
きるという効果がある。
第1図及び第2図は本発明に係る半導体装置の製造方法
の一実施例を説明する図であり、第1図は−・実施例の
製造方法を説明する図、第2図は一実施例の効果を説明
する図、第3図及び第4図は本発明に係る半導体装置の
製造方法の他の実施例を説明する図であり、第3図は他
の実施例の製造方法を説明する図、第4図は他の実施例
の効果を説明する図、第5図及び第6図は本発明の詳細
な説明する図、第7図は従来例の課題を説明する図であ
る。 工) 22′l (b) する図
の一実施例を説明する図であり、第1図は−・実施例の
製造方法を説明する図、第2図は一実施例の効果を説明
する図、第3図及び第4図は本発明に係る半導体装置の
製造方法の他の実施例を説明する図であり、第3図は他
の実施例の製造方法を説明する図、第4図は他の実施例
の効果を説明する図、第5図及び第6図は本発明の詳細
な説明する図、第7図は従来例の課題を説明する図であ
る。 工) 22′l (b) する図
Claims (1)
- 少なくともシリコンを含有する酸化膜に該酸化膜耐圧
を向上させるために水酸イオンまたは塩素イオンをイオ
ン注入し、次いで熱処理する工程を含むことを特徴とす
る半導体装置の製造方法。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2162039A JP2551681B2 (ja) | 1990-06-20 | 1990-06-20 | 半導体装置の製造方法 |
| EP91110092A EP0465886B1 (en) | 1990-06-20 | 1991-06-19 | Semiconductor device having an insulator film of silicon oxide in which OH ions are incorporated |
| KR1019910010170A KR950003929B1 (ko) | 1990-06-20 | 1991-06-19 | Oh 이온이 내포된 산화실리콘 절연막을 구비하는 반도체장치 |
| US07/718,381 US5217908A (en) | 1990-06-20 | 1991-06-20 | Semiconductor device having an insulator film of silicon oxide in which oh ions are incorporated |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2162039A JP2551681B2 (ja) | 1990-06-20 | 1990-06-20 | 半導体装置の製造方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0453232A true JPH0453232A (ja) | 1992-02-20 |
| JP2551681B2 JP2551681B2 (ja) | 1996-11-06 |
Family
ID=15746925
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2162039A Expired - Fee Related JP2551681B2 (ja) | 1990-06-20 | 1990-06-20 | 半導体装置の製造方法 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US5217908A (ja) |
| EP (1) | EP0465886B1 (ja) |
| JP (1) | JP2551681B2 (ja) |
| KR (1) | KR950003929B1 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2013061519A (ja) * | 2011-09-14 | 2013-04-04 | Ricoh Co Ltd | レンズキャップ |
Families Citing this family (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5563093A (en) * | 1993-01-28 | 1996-10-08 | Kawasaki Steel Corporation | Method of manufacturing fet semiconductor devices with polysilicon gate having large grain sizes |
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