JPH0457300A - ピークホールド回路 - Google Patents
ピークホールド回路Info
- Publication number
- JPH0457300A JPH0457300A JP2163838A JP16383890A JPH0457300A JP H0457300 A JPH0457300 A JP H0457300A JP 2163838 A JP2163838 A JP 2163838A JP 16383890 A JP16383890 A JP 16383890A JP H0457300 A JPH0457300 A JP H0457300A
- Authority
- JP
- Japan
- Prior art keywords
- signal
- input
- hold
- output
- comparator
- Prior art date
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- Pending
Links
- 230000007423 decrease Effects 0.000 abstract description 2
- 238000010586 diagram Methods 0.000 description 4
Landscapes
- Measurement Of Current Or Voltage (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はピークホールド回路に関し、特に正弦波が振幅
変調されたアナログ信号のピークホールド回路に関する
。
変調されたアナログ信号のピークホールド回路に関する
。
従来、この種のピークホールド回路は、入力信号がホー
ルド出力信号よりレベルが低い場合、ホールド出力信号
を抵抗回路により放電する方式となっていた。
ルド出力信号よりレベルが低い場合、ホールド出力信号
を抵抗回路により放電する方式となっていた。
上述した従来のピークホールド回路は、ホールト出力信
号を抵抗回路により放電する方式となっているので、入
力信号がホールド出力信号の放電カーブより低い場合に
は、入力信号のピークまでホールド信号が低下しないた
め、ホールド出力信号が入力信号より高い電圧になると
いう欠点がある。
号を抵抗回路により放電する方式となっているので、入
力信号がホールド出力信号の放電カーブより低い場合に
は、入力信号のピークまでホールド信号が低下しないた
め、ホールド出力信号が入力信号より高い電圧になると
いう欠点がある。
本発明のピークホールド回路は、入力信号とピークホー
ルド出力信号とを比較する第1のコンパレータと、前記
入力信号とレベル信号とを比較する第2のコンパレータ
と、前記第1のコンパレータの出力を反転させるインバ
ータと、前記第1のコンパレータ及び前記第2のコンパ
レータの出力信号からディスチャージ信号を生成するデ
ィスチャーシコンロール回路と、前記インバータの出力
信号及び前記ディスチャージ信号から前記ピークホール
ド出力信号を生成するホールド回路より構成されている
。
ルド出力信号とを比較する第1のコンパレータと、前記
入力信号とレベル信号とを比較する第2のコンパレータ
と、前記第1のコンパレータの出力を反転させるインバ
ータと、前記第1のコンパレータ及び前記第2のコンパ
レータの出力信号からディスチャージ信号を生成するデ
ィスチャーシコンロール回路と、前記インバータの出力
信号及び前記ディスチャージ信号から前記ピークホール
ド出力信号を生成するホールド回路より構成されている
。
次に、本発明について図面を参照して説明する。
第1図は本発明の一実施例を示すブロック図である。
第2図は第1図の動作を説明するタイミングチャート図
である。なお、図中の記号は第1図に示す記号にそれぞ
れ対応している。第1図及び第2図において入出力コン
パレータ10は入力信号1とホールド出力信号3を比較
し、入力信号が低いときハイレベルの入出力コンパレー
ト信号4を出力し、インバータ11及びディスチャージ
コントロール回路14に供給する。インバータ11は入
出力コンパレート信号4を反転させチャージ信号5を圧
力する。レベルコンパレータ13は入力信号1がレベル
信号2より高いときレベルコンパ−レート信号6を出力
する。ディスチャージコントロール回路14は入出力コ
ンパレート信号4がハイレベルのとき、レベルコンパレ
ート信号6の立ち上がりでハイレベルとなり、入出力コ
ンパレート信号4がローレベルでローレベルになるディ
スチャージ信号7を出力する。ホールド回路12はチャ
ージ信号5でホールド出力電圧3を上昇させ、ディスチ
ャージ信号7でホールド出力電圧3を降下させる。
である。なお、図中の記号は第1図に示す記号にそれぞ
れ対応している。第1図及び第2図において入出力コン
パレータ10は入力信号1とホールド出力信号3を比較
し、入力信号が低いときハイレベルの入出力コンパレー
ト信号4を出力し、インバータ11及びディスチャージ
コントロール回路14に供給する。インバータ11は入
出力コンパレート信号4を反転させチャージ信号5を圧
力する。レベルコンパレータ13は入力信号1がレベル
信号2より高いときレベルコンパ−レート信号6を出力
する。ディスチャージコントロール回路14は入出力コ
ンパレート信号4がハイレベルのとき、レベルコンパレ
ート信号6の立ち上がりでハイレベルとなり、入出力コ
ンパレート信号4がローレベルでローレベルになるディ
スチャージ信号7を出力する。ホールド回路12はチャ
ージ信号5でホールド出力電圧3を上昇させ、ディスチ
ャージ信号7でホールド出力電圧3を降下させる。
以上説明したように本発明のピークホールド回路は、ホ
ールド出力電圧を強制的に下降させることにより、入力
信号のピーク電圧を正確にホールドできる効果がある。
ールド出力電圧を強制的に下降させることにより、入力
信号のピーク電圧を正確にホールドできる効果がある。
第1図は本発明の一実施例を示すブロック図、第2図は
第1図の動作を説明するタイミングチャート図である。 1・・・・・・入力信号、2・・・・・・レベル信号、
3・・・・・・ホールド出力信号、4・・・・・・入出
力コンパレート信号、5・・・・・・チャージ信号、6
・・・・・・レベルコンパレート信号、7・・・・・・
ディスチャージ信号、8・・・・・・入出力コンパレー
タ、11・・・・・・インバータ、12・・・・・・ホ
ールド回路、13・・・・・・レベルコンパレータ、1
4・・・・・・ディスチャージコントロール回路。
第1図の動作を説明するタイミングチャート図である。 1・・・・・・入力信号、2・・・・・・レベル信号、
3・・・・・・ホールド出力信号、4・・・・・・入出
力コンパレート信号、5・・・・・・チャージ信号、6
・・・・・・レベルコンパレート信号、7・・・・・・
ディスチャージ信号、8・・・・・・入出力コンパレー
タ、11・・・・・・インバータ、12・・・・・・ホ
ールド回路、13・・・・・・レベルコンパレータ、1
4・・・・・・ディスチャージコントロール回路。
Claims (1)
- 入力信号とピークホールド出力信号とを比較する第1の
コンパレータと、前記入力信号とレベル信号とを比較す
る第2のコンパレータと、前記第1のコンパレータの出
力を反転させるインバータと、前記第1のコンパレータ
及び前記第2のコンパレータの出力信号からディスチャ
ージ信号を生成するディスチャージコントロール回路と
、前記インバータの出力信号及び前記ディスチャージ信
号から前記ピークホールド出力信号を生成するホールド
回路とを備えたことを特徴とするピークホールド回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2163838A JPH0457300A (ja) | 1990-06-21 | 1990-06-21 | ピークホールド回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2163838A JPH0457300A (ja) | 1990-06-21 | 1990-06-21 | ピークホールド回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0457300A true JPH0457300A (ja) | 1992-02-25 |
Family
ID=15781711
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2163838A Pending JPH0457300A (ja) | 1990-06-21 | 1990-06-21 | ピークホールド回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0457300A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008086986A (ja) * | 2006-09-06 | 2008-04-17 | Nippon Mizushori Giken:Kk | マイクロバブル発生装置およびこれを用いた水処理装置 |
-
1990
- 1990-06-21 JP JP2163838A patent/JPH0457300A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008086986A (ja) * | 2006-09-06 | 2008-04-17 | Nippon Mizushori Giken:Kk | マイクロバブル発生装置およびこれを用いた水処理装置 |
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