JPH0470797A - 画像信号合成装置 - Google Patents
画像信号合成装置Info
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- JPH0470797A JPH0470797A JP2183016A JP18301690A JPH0470797A JP H0470797 A JPH0470797 A JP H0470797A JP 2183016 A JP2183016 A JP 2183016A JP 18301690 A JP18301690 A JP 18301690A JP H0470797 A JPH0470797 A JP H0470797A
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- Japan
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- Pending
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- 239000000203 mixture Substances 0.000 title abstract description 3
- 230000015654 memory Effects 0.000 claims abstract description 52
- 230000015572 biosynthetic process Effects 0.000 claims description 12
- 238000003786 synthesis reaction Methods 0.000 claims description 12
- 230000002194 synthesizing effect Effects 0.000 claims description 3
- 239000002131 composite material Substances 0.000 abstract description 7
- 230000001360 synchronised effect Effects 0.000 abstract description 5
- 238000010586 diagram Methods 0.000 description 7
- 230000002123 temporal effect Effects 0.000 description 2
- 238000006243 chemical reaction Methods 0.000 description 1
- 230000000694 effects Effects 0.000 description 1
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- Image Processing (AREA)
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- Studio Circuits (AREA)
- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は画像信号合成装置に関し、特にＮＴＳＣ方式の
画像信号とコンピュータの画像信号とを合成する画像信
号合成装置に関する。
画像信号とコンピュータの画像信号とを合成する画像信
号合成装置に関する。
一般にコンピュータ画像信号はＮＴＳＣ方式画像信号と
は異なり、ノンインタレースであって垂直走査周波数お
よび水平走査周波数が相違している。このため、ＮＴＳ
Ｃ方式画像信号とコンピュータ画像信号とを合成する場
合は、第３図に示すように、ディジタル変換されたＮＴ
ＳＣ方式画像信号の１フレーム分を記憶するフレームメ
モリ２１を設け、メモリ制御回路２２によりＮＴＳＣ方
式の水平同期レート１５−７ｋＨｚ 、垂直同期レート
６０Ｈｚで書込みアドレスＷを生成して入力画像信号Ａ
１をフレームメモリ２１に書込み、読出すときは、コン
ピュータ画像信号Ｂ１の水平、垂直同期レートで読出し
アドレスＲを生成してフレームメモリ２１から画像信号
Ａ２として読出す。このようにして、ＮＴＳＣ方式入力
画像信号Ａ１をノンインタレース変換し、コンピュータ
画像信号Ｂ１と同期した画像信号Ａ２とした後、合成回
路２３により画像信号Ａ２およびＢ１を画像合成して合
成画像信号Ｃを出力している。
は異なり、ノンインタレースであって垂直走査周波数お
よび水平走査周波数が相違している。このため、ＮＴＳ
Ｃ方式画像信号とコンピュータ画像信号とを合成する場
合は、第３図に示すように、ディジタル変換されたＮＴ
ＳＣ方式画像信号の１フレーム分を記憶するフレームメ
モリ２１を設け、メモリ制御回路２２によりＮＴＳＣ方
式の水平同期レート１５−７ｋＨｚ 、垂直同期レート
６０Ｈｚで書込みアドレスＷを生成して入力画像信号Ａ
１をフレームメモリ２１に書込み、読出すときは、コン
ピュータ画像信号Ｂ１の水平、垂直同期レートで読出し
アドレスＲを生成してフレームメモリ２１から画像信号
Ａ２として読出す。このようにして、ＮＴＳＣ方式入力
画像信号Ａ１をノンインタレース変換し、コンピュータ
画像信号Ｂ１と同期した画像信号Ａ２とした後、合成回
路２３により画像信号Ａ２およびＢ１を画像合成して合
成画像信号Ｃを出力している。
この従来の画像信号合成装置では、通常コンピュータ画
像信号の垂直走査周波数はＮＴＳＣ方式画像信号の垂直
走査周波数６０Ｈｚよりも低い。このため、第４図に示
すように、フレームメモリ２１に画像ラインを書込む速
さよりも画像ラインを読出す速さの方が遅いので、ｄ点
の前後で１フレーム分の時間のずれが生じ、ＮＴＳＣ方
式画像の動きが速い場合には、ｄ点のラインを境にして
上下に画像がずれるという問題点があった。
像信号の垂直走査周波数はＮＴＳＣ方式画像信号の垂直
走査周波数６０Ｈｚよりも低い。このため、第４図に示
すように、フレームメモリ２１に画像ラインを書込む速
さよりも画像ラインを読出す速さの方が遅いので、ｄ点
の前後で１フレーム分の時間のずれが生じ、ＮＴＳＣ方
式画像の動きが速い場合には、ｄ点のラインを境にして
上下に画像がずれるという問題点があった。
また、コンピュータ画像信号の有効画像ライン数がＮＴ
ＳＣ方式画像信号の有効画像ライン数４８３本よりも少
ない場合には、ＮＴＳＣ方式画像信号の画像ラインを全
て表示できないという問題点もあった。
ＳＣ方式画像信号の有効画像ライン数４８３本よりも少
ない場合には、ＮＴＳＣ方式画像信号の画像ラインを全
て表示できないという問題点もあった。
本発明の目的は、動きの速いＮＴＳＣ方式画像信号に対
して合成画面に時間的画像ずれが生しることなく、また
、ＮＴＳＣ方式画像信号の画像ラインを全て合成表示で
きる画像信号合成装置を提供することにある。
して合成画面に時間的画像ずれが生しることなく、また
、ＮＴＳＣ方式画像信号の画像ラインを全て合成表示で
きる画像信号合成装置を提供することにある。
本発明の画像信号合成装置は、ＮＴＳＣ方式の画像信号
およびコンピュータの画像信号を合成する画像信号合成
装置において、前記ＮＴＳＣ方式の画像信号の１フレー
ム分を記憶する第１のメモリと、前記コンピュータの画
像信号の１フレーム分を記憶する第２のメモリと、前記
第１のメモリの書込みアドレスおよび読出しアドレスを
生成する第１のメモリ制御回路と、前記第２のメモリの
書込みアドレスお、よび続出しアドレスを生成する第２
のメモリ制御回路と、前記第１および第２のメモリから
読出された画像信号を合成する合成回路とを備えて構成
されている。また、前記第１および第２のメモリ制御回
路は、前記ＮＴＳＣ方式の画像信号の垂直捜査周波数お
よび水平走査周波数の２倍に同期して前記読出しアドレ
スを生成するように構成してもよい。
およびコンピュータの画像信号を合成する画像信号合成
装置において、前記ＮＴＳＣ方式の画像信号の１フレー
ム分を記憶する第１のメモリと、前記コンピュータの画
像信号の１フレーム分を記憶する第２のメモリと、前記
第１のメモリの書込みアドレスおよび読出しアドレスを
生成する第１のメモリ制御回路と、前記第２のメモリの
書込みアドレスお、よび続出しアドレスを生成する第２
のメモリ制御回路と、前記第１および第２のメモリから
読出された画像信号を合成する合成回路とを備えて構成
されている。また、前記第１および第２のメモリ制御回
路は、前記ＮＴＳＣ方式の画像信号の垂直捜査周波数お
よび水平走査周波数の２倍に同期して前記読出しアドレ
スを生成するように構成してもよい。
次に図面を参照して本発明を説明する。
第１図は本発明の一実施例を示すブロック図であり、デ
ィジタル変換されたＮＴＳＣ方式画像信号を１フレーム
分記憶するフレームメモリ１１と、コンピュータ画像信
号を１フレーム分記憶するフレームメモリ１２と、フレ
ームメモリ１１の書込み読出しを制御するメモリ制御回
路１３と、フレームメモリ１２の書込み読出しを制御す
るメモリ制御回路１４と、２つの画像信号を合成する合
成回路１５とを備えている。
ィジタル変換されたＮＴＳＣ方式画像信号を１フレーム
分記憶するフレームメモリ１１と、コンピュータ画像信
号を１フレーム分記憶するフレームメモリ１２と、フレ
ームメモリ１１の書込み読出しを制御するメモリ制御回
路１３と、フレームメモリ１２の書込み読出しを制御す
るメモリ制御回路１４と、２つの画像信号を合成する合
成回路１５とを備えている。
ＮＴＳＣ方式の画像信号ＡＩは、メモリ制御回路１３で
生成される書込みアドレスＷＡによってフレームメモリ
１］−に書込まれる。この場合、書込みアドレスＷＡは
、ＮＴＳＣ方式の水平および垂直同期レートで生成され
る。また、フレームメモリ１１に書込まれた画像信号は
、メモリ制御回路１３で生成される読出しアドレスＲＡ
によって画像信号Ａ２として読出される。この場合、読
出しアドレスＲＡは、書込み時の水平走査周波数の２倍
で生成されるので、読出された画像信号Ａ２はノンイン
タレース変換された画像信号となる。
生成される書込みアドレスＷＡによってフレームメモリ
１］−に書込まれる。この場合、書込みアドレスＷＡは
、ＮＴＳＣ方式の水平および垂直同期レートで生成され
る。また、フレームメモリ１１に書込まれた画像信号は
、メモリ制御回路１３で生成される読出しアドレスＲＡ
によって画像信号Ａ２として読出される。この場合、読
出しアドレスＲＡは、書込み時の水平走査周波数の２倍
で生成されるので、読出された画像信号Ａ２はノンイン
タレース変換された画像信号となる。
一方、コンピュータ画像信号Ｂ１は、メモリ制御回路１
４で生成される書込みアドレスＷＢによってフレームメ
モリ１２に書込まれる。この場合、書込みアドレスＷＢ
は、コンピュータ画像信号の水平、垂直同期レートで生
成される。また、フレームメモリ１２に書込まれた画像
信号は、メモリ制御回路１４で生成される読出しアドレ
スＲＢによって画像信号Ｂ２として読出される。この場
合、読出しアドレスＲＢは、読出しアドレスＲＡと同じ
水平および垂直同期レート、すなわち、３１．５ｋＨ１
および６０Ｈｚで生成される。従って、フレームメモリ
１１および１２から読出された画像信号Ａ２およびＢ２
は互いに同期している。画像信号Ａ２およびＢ２は、合
成回路１５によって合成され合成信号Ｃとなって出力さ
れる。
４で生成される書込みアドレスＷＢによってフレームメ
モリ１２に書込まれる。この場合、書込みアドレスＷＢ
は、コンピュータ画像信号の水平、垂直同期レートで生
成される。また、フレームメモリ１２に書込まれた画像
信号は、メモリ制御回路１４で生成される読出しアドレ
スＲＢによって画像信号Ｂ２として読出される。この場
合、読出しアドレスＲＢは、読出しアドレスＲＡと同じ
水平および垂直同期レート、すなわち、３１．５ｋＨ１
および６０Ｈｚで生成される。従って、フレームメモリ
１１および１２から読出された画像信号Ａ２およびＢ２
は互いに同期している。画像信号Ａ２およびＢ２は、合
成回路１５によって合成され合成信号Ｃとなって出力さ
れる。
第２図（ａ）、（ｂ）は画像ラインの書込みおよび読出
しの速さを示す図である。同図（ａ）はフレームメモリ
１１における書込みおよび読出しの速さを示しており、
互いに同期しているので追越し現象は発生しない。同図
（ｂ）はフレームメモリ１２における書込みおよび読出
しの速さを示しており、互いに異なる同期レートである
ので追越し現象が発生する（ｅ点）。通常コンピュータ
画像信号の垂直走査周波数はＮＴＳＣ方式画像信号の垂
直走査周波数６０Ｈｚよりも低いので、フレームメモリ
１２に画像ラインを書込む速さよりも画像ラインを読出
す速さの方が速いので、ｅ点で追い越し現象が生じる。
しの速さを示す図である。同図（ａ）はフレームメモリ
１１における書込みおよび読出しの速さを示しており、
互いに同期しているので追越し現象は発生しない。同図
（ｂ）はフレームメモリ１２における書込みおよび読出
しの速さを示しており、互いに異なる同期レートである
ので追越し現象が発生する（ｅ点）。通常コンピュータ
画像信号の垂直走査周波数はＮＴＳＣ方式画像信号の垂
直走査周波数６０Ｈｚよりも低いので、フレームメモリ
１２に画像ラインを書込む速さよりも画像ラインを読出
す速さの方が速いので、ｅ点で追い越し現象が生じる。
しかし、コンピュータ画像は動きが少なく、更に連続し
た動きをしないので、ｅ点でラインを境にして上下に画
像がずれても目立つことはない。また、コンピュータ画
像信号の有効画像ライン数がＮＴＳＣ方式画像信号の有
効画像ライン数よりも少ない場合でも、ＮＴＳＣ方式画
像信号の画像ラインを全て表示できる。
た動きをしないので、ｅ点でラインを境にして上下に画
像がずれても目立つことはない。また、コンピュータ画
像信号の有効画像ライン数がＮＴＳＣ方式画像信号の有
効画像ライン数よりも少ない場合でも、ＮＴＳＣ方式画
像信号の画像ラインを全て表示できる。
以上説明したように本発明によれば、ＮＴＳＣ方式の画
像信号およびコンピュータの画像信号の１フレーム分を
記憶するメモリをそれぞれ設け、画像信号をそれぞれの
同期レートで書込み、読出すときはＮＴＳＣ方式の垂直
走査周波数および水平走査周波数の２倍に同期して読出
すことによって、動きの速いＮＴＳＣ方式画像信号に対
しても合成画面に時間的画像ずれが生じることなく、ま
た、コンピュータ画像信号の有効画像ライン数がＮＴＳ
Ｃ方式画像信号の有効画像ライン数よりも少ない場合で
も、ＮＴＳＣ方式の画像ラインを全て合成表示できる。
像信号およびコンピュータの画像信号の１フレーム分を
記憶するメモリをそれぞれ設け、画像信号をそれぞれの
同期レートで書込み、読出すときはＮＴＳＣ方式の垂直
走査周波数および水平走査周波数の２倍に同期して読出
すことによって、動きの速いＮＴＳＣ方式画像信号に対
しても合成画面に時間的画像ずれが生じることなく、ま
た、コンピュータ画像信号の有効画像ライン数がＮＴＳ
Ｃ方式画像信号の有効画像ライン数よりも少ない場合で
も、ＮＴＳＣ方式の画像ラインを全て合成表示できる。
第１図は本発明の一実施例を示すブロック図、第２図（
ａ）は第１図に示したフレームメモリ１１の書込みおよ
び読出しの速さを示す図、第２図（ｂ）は第１図に示し
たフレームメモリ１２の書込みおよび読出しの速さを示
す図、第３図は従来の画像信号合成装置の一例を示すブ
ロック図、第４図は第３図に示したフレームメモリ２１
の書込みおよび読出しの速さ示す図である。 １１、．１２．２１・・・・・・フレームメモリ、１３
゜１４．２２・・・・・・メモリ制御回路、１５．２３
・・・・・・合成回路、Ａ１・−・・−・ＮＴＳＣ方式
画像信号、Ｂ１・・・−・−コンピュータ画像信号、Ｃ
・・・・・・合成信号、ＷＡ、ＷＢ、Ｗ・−・・・・書
込みアドレス、ＲＡ 、 Ｒａ 。 Ｒ・・・・・・読出しアドレス。
ａ）は第１図に示したフレームメモリ１１の書込みおよ
び読出しの速さを示す図、第２図（ｂ）は第１図に示し
たフレームメモリ１２の書込みおよび読出しの速さを示
す図、第３図は従来の画像信号合成装置の一例を示すブ
ロック図、第４図は第３図に示したフレームメモリ２１
の書込みおよび読出しの速さ示す図である。 １１、．１２．２１・・・・・・フレームメモリ、１３
゜１４．２２・・・・・・メモリ制御回路、１５．２３
・・・・・・合成回路、Ａ１・−・・−・ＮＴＳＣ方式
画像信号、Ｂ１・・・−・−コンピュータ画像信号、Ｃ
・・・・・・合成信号、ＷＡ、ＷＢ、Ｗ・−・・・・書
込みアドレス、ＲＡ 、 Ｒａ 。 Ｒ・・・・・・読出しアドレス。
Claims (1)
- 【特許請求の範囲】 １、ＮＴＳＣ方式の画像信号およびコンピュータの画像
信号を合成する画像信号合成装置において、前記ＮＴＳ
Ｃ方式の画像信号の１フレーム分を記憶する第１のメモ
リと、前記コンピュータの画像信号の１フレーム分を記
憶する第２のメモリと、前記第１のメモリの書込みアド
レスおよび読出しアドレスを生成する第１のメモリ制御
回路と、前記第２のメモリの書込みアドレスおよび読出
しアドレスを生成する第２のメモリ制御回路と、前記第
１および第２のメモリから読出された画像信号を合成す
る合成回路とを備えたことを特徴とする画像信号合成装
置。 ２、前記第１および第２のメモリ制御回路は、前記ＮＴ
ＳＣ方式の画像信号の垂直走査周波数および水平走査周
波数の２倍に同期して前記読出しアドレスを生成するこ
とを特徴とする請求項１記載の画像信号合成装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2183016A JPH0470797A (ja) | 1990-07-11 | 1990-07-11 | 画像信号合成装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2183016A JPH0470797A (ja) | 1990-07-11 | 1990-07-11 | 画像信号合成装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0470797A true JPH0470797A (ja) | 1992-03-05 |
Family
ID=16128265
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2183016A Pending JPH0470797A (ja) | 1990-07-11 | 1990-07-11 | 画像信号合成装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0470797A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6600660B2 (en) | 1999-03-24 | 2003-07-29 | Nec Corporation | Plug-in unit storage rack-type apparatus |
| JP2007086369A (ja) * | 2005-09-21 | 2007-04-05 | Fujitsu Ten Ltd | 表示装置及び表示タイミング調整回路 |
| JP2015192156A (ja) * | 2014-03-27 | 2015-11-02 | セイコーエプソン株式会社 | 表示装置、画像処理装置、及び、表示方法 |
| JP2015192178A (ja) * | 2014-03-27 | 2015-11-02 | セイコーエプソン株式会社 | 表示装置、画像処理装置、及び、表示方法 |
-
1990
- 1990-07-11 JP JP2183016A patent/JPH0470797A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6600660B2 (en) | 1999-03-24 | 2003-07-29 | Nec Corporation | Plug-in unit storage rack-type apparatus |
| JP2007086369A (ja) * | 2005-09-21 | 2007-04-05 | Fujitsu Ten Ltd | 表示装置及び表示タイミング調整回路 |
| JP2015192156A (ja) * | 2014-03-27 | 2015-11-02 | セイコーエプソン株式会社 | 表示装置、画像処理装置、及び、表示方法 |
| JP2015192178A (ja) * | 2014-03-27 | 2015-11-02 | セイコーエプソン株式会社 | 表示装置、画像処理装置、及び、表示方法 |
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