JPH0476539B2 - - Google Patents
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- JPH0476539B2 JPH0476539B2 JP60139113A JP13911385A JPH0476539B2 JP H0476539 B2 JPH0476539 B2 JP H0476539B2 JP 60139113 A JP60139113 A JP 60139113A JP 13911385 A JP13911385 A JP 13911385A JP H0476539 B2 JPH0476539 B2 JP H0476539B2
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- JP
- Japan
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- output
- frequency
- voltage
- circuit
- capacitor
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- 239000003990 capacitor Substances 0.000 claims description 20
- 239000013078 crystal Substances 0.000 claims description 7
- 230000010355 oscillation Effects 0.000 description 7
- 238000010586 diagram Methods 0.000 description 5
- 230000000694 effects Effects 0.000 description 4
- 230000003111 delayed effect Effects 0.000 description 1
- 239000000284 extract Substances 0.000 description 1
- 238000000034 method Methods 0.000 description 1
- 230000035945 sensitivity Effects 0.000 description 1
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-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
- H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
- H03L7/08—Details of the phase-locked loop
- H03L7/085—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal
- H03L7/089—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal the phase or frequency detector generating up-down pulses
- H03L7/0891—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal the phase or frequency detector generating up-down pulses the up-down pulses controlling source and sink current generators, e.g. a charge pump
- H03L7/0895—Details of the current generators
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
- H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
- H03L7/08—Details of the phase-locked loop
- H03L7/10—Details of the phase-locked loop for assuring initial synchronisation or for broadening the capture range
- H03L7/104—Details of the phase-locked loop for assuring initial synchronisation or for broadening the capture range using an additional signal from outside the loop for setting or controlling a parameter in the loop
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
- H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
- H03L7/16—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop
- H03L7/18—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop using a frequency divider or counter in the loop
- H03L7/183—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop using a frequency divider or counter in the loop a time difference being used for locking the loop, the counter counting between fixed numbers or the frequency divider dividing by a fixed number
Landscapes
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明は多チヤンネル切替機能を持つ無線機等
の周波数シンセサイザに関し、特にそのフエーズ
ロツクドループ(PLLともいう)回路に関する
ものである。
の周波数シンセサイザに関し、特にそのフエーズ
ロツクドループ(PLLともいう)回路に関する
ものである。
従来のフエーズドループ方式を利用した周波数
シンセサイザについて第2図を参照して説明す
る。第2図において、1は電圧制御発振器であ
り、この電圧制御発振器1の出力は第1の分周器
2で分周され、位相比較器3の一方の入力101と
なり、水晶基準発振器5の出力は第2の分周器4
で分周され、位相比較器3のもう一方の入力102
となる。位相比較器3は、入力101と入力102の位
相を比較し、入力101の方が入力102より位相が遅
れていると、出力103がその遅れ時間だけ“L”
レベルになる。また、入力101が入力102より位相
が進んでいると、出力104がその進み時間だけ
“H”レベルになる。そして、この位相比較器4
の出力パルスを、コンデンサ21の充放電を行う
チヤージポンプ回路6の経由でそのコンデンサ2
1を含むループフイルタ7で受け位相差に相当す
る差信号電圧に変換したうえ、その電圧を制御電
圧として電圧制御発振器1の制御電圧端子105
へ入力する。これによりフエーズロツクドルーブ
をロツクさせることにより、第1の分周器2の分
周数をM(M:任意の整数)とすると、水晶基準
発振器5にて発生された基準周波数(分周器4の
出力)のM倍の周波数を電圧制御発振器1から取
り出すものとなつている。
シンセサイザについて第2図を参照して説明す
る。第2図において、1は電圧制御発振器であ
り、この電圧制御発振器1の出力は第1の分周器
2で分周され、位相比較器3の一方の入力101と
なり、水晶基準発振器5の出力は第2の分周器4
で分周され、位相比較器3のもう一方の入力102
となる。位相比較器3は、入力101と入力102の位
相を比較し、入力101の方が入力102より位相が遅
れていると、出力103がその遅れ時間だけ“L”
レベルになる。また、入力101が入力102より位相
が進んでいると、出力104がその進み時間だけ
“H”レベルになる。そして、この位相比較器4
の出力パルスを、コンデンサ21の充放電を行う
チヤージポンプ回路6の経由でそのコンデンサ2
1を含むループフイルタ7で受け位相差に相当す
る差信号電圧に変換したうえ、その電圧を制御電
圧として電圧制御発振器1の制御電圧端子105
へ入力する。これによりフエーズロツクドルーブ
をロツクさせることにより、第1の分周器2の分
周数をM(M:任意の整数)とすると、水晶基準
発振器5にて発生された基準周波数(分周器4の
出力)のM倍の周波数を電圧制御発振器1から取
り出すものとなつている。
なお、チヤージポンプ回路6およびループフイ
ルタ7は、トランジスタ11〜12と、コンデン
サ21と、抵抗31〜37と、ダイオード51,
52とから構成されるもので、これら回路構成の
詳細は、プレツシー(PLESSEY)社のインテグ
レツド サーキツト データブツク
〔INTEGRA TED CIRCUIT DATABOOK〕
(MAY1981、Pub lication No.P.S.1540−J)中
のSP8760のオペレーシヨンマニユアルに掲載さ
れているので、省略する。
ルタ7は、トランジスタ11〜12と、コンデン
サ21と、抵抗31〜37と、ダイオード51,
52とから構成されるもので、これら回路構成の
詳細は、プレツシー(PLESSEY)社のインテグ
レツド サーキツト データブツク
〔INTEGRA TED CIRCUIT DATABOOK〕
(MAY1981、Pub lication No.P.S.1540−J)中
のSP8760のオペレーシヨンマニユアルに掲載さ
れているので、省略する。
ところで、チヤージポンプ回路6の電源電圧
Vccは、レギユレータの出力電圧であつて、例え
ば携帯形無線機の場合は+5Vになる。そのため、
従来の周波数シンセサイザでは、電圧制御発振器
1の制御電圧端子105の電圧の可変範囲は0〜
Vccに限られていた。第3図は電圧制御発振器1
の中で制御電圧端子に接続されている可変容量ダ
イオードの逆電圧VRと容量値Cの関係を示すも
ので、従来は、上述したようにVccまでしか電圧
が変化しないため、容量の変化がわずかしかな
い。第4図は電圧制御発振器1の制御電圧Vcpと
発振周波数fの関係を示すものであつて、従来の
ものによるとその発振周波数はAの範囲しか変化
しなかつた。
Vccは、レギユレータの出力電圧であつて、例え
ば携帯形無線機の場合は+5Vになる。そのため、
従来の周波数シンセサイザでは、電圧制御発振器
1の制御電圧端子105の電圧の可変範囲は0〜
Vccに限られていた。第3図は電圧制御発振器1
の中で制御電圧端子に接続されている可変容量ダ
イオードの逆電圧VRと容量値Cの関係を示すも
ので、従来は、上述したようにVccまでしか電圧
が変化しないため、容量の変化がわずかしかな
い。第4図は電圧制御発振器1の制御電圧Vcpと
発振周波数fの関係を示すものであつて、従来の
ものによるとその発振周波数はAの範囲しか変化
しなかつた。
このため、車載形または携帯形の無線機等にお
いては電源電圧が低いので、電圧制御発振器1に
与える制御電圧の可変範囲が狭くなる。この可変
周波数範囲を広げるために制御電圧の範囲を広げ
ると、制御電圧の最も低いチヤンネルから最も高
いチヤンネルにチヤンネル切替を行う時、ループ
フイルタ7内のコンデンサ21の充放電に時間が
かかり、チヤンネル切替時間が長くなつてしま
う。また、制御電圧端子の感度を上げると可変容
量ダイオードのQの影響が表われ、電圧制御発振
器1のC/Nが悪くなつてしまう。
いては電源電圧が低いので、電圧制御発振器1に
与える制御電圧の可変範囲が狭くなる。この可変
周波数範囲を広げるために制御電圧の範囲を広げ
ると、制御電圧の最も低いチヤンネルから最も高
いチヤンネルにチヤンネル切替を行う時、ループ
フイルタ7内のコンデンサ21の充放電に時間が
かかり、チヤンネル切替時間が長くなつてしま
う。また、制御電圧端子の感度を上げると可変容
量ダイオードのQの影響が表われ、電圧制御発振
器1のC/Nが悪くなつてしまう。
このように従来の周波数シンセサイザでは、チ
ヤージポンプ回路に加える電源電圧が低くなる
と、電圧制御発振器の可変周波数範囲が広くとれ
ないという欠点があつた。
ヤージポンプ回路に加える電源電圧が低くなる
と、電圧制御発振器の可変周波数範囲が広くとれ
ないという欠点があつた。
本発明は、このような点に鑑み、上記した従来
の問題点を解消した周波数シンセサイザを提供す
るものである。
の問題点を解消した周波数シンセサイザを提供す
るものである。
本発明の周波数シンセサイザは、電圧制御発振
器と、該電圧制御発振器の出力を分周する第1の
分周器と、水晶基準発振器と、該水晶基準発振器
の出力を分周する第2の分周器と、前記第1の分
周器の出力と前記第2の分周器の出力の位相を比
較する位相比較器と、この位相比較器の出力パル
スによつてコンデンサの充放電を行うチヤージポ
ンプ回路と、前記コンデンサを含み前記電圧制御
発振器に制御電圧を与えるループフイルタとを有
する周波数シンセサイザにおいて、前記第2の分
周器の分周出力を昇圧する昇圧回路と、該昇圧回
路の出力を直流電圧に変換する整流回路とからな
る電源回路を備え、前記電源回路の出力の直流電
圧を前記チヤージポンプ回路の電源電圧として供
給するようにしたものである。
器と、該電圧制御発振器の出力を分周する第1の
分周器と、水晶基準発振器と、該水晶基準発振器
の出力を分周する第2の分周器と、前記第1の分
周器の出力と前記第2の分周器の出力の位相を比
較する位相比較器と、この位相比較器の出力パル
スによつてコンデンサの充放電を行うチヤージポ
ンプ回路と、前記コンデンサを含み前記電圧制御
発振器に制御電圧を与えるループフイルタとを有
する周波数シンセサイザにおいて、前記第2の分
周器の分周出力を昇圧する昇圧回路と、該昇圧回
路の出力を直流電圧に変換する整流回路とからな
る電源回路を備え、前記電源回路の出力の直流電
圧を前記チヤージポンプ回路の電源電圧として供
給するようにしたものである。
本発明に係る周波数シンセサイザにおいては、
チヤージポンプ回路に加える電源電圧を昇圧する
ことにより、電圧制御発振器の発振周波数の可変
範囲を広げることができる。
チヤージポンプ回路に加える電源電圧を昇圧する
ことにより、電圧制御発振器の発振周波数の可変
範囲を広げることができる。
次に、本発明について図面を参照して説明す
る。
る。
第1図は本発明に係る周波数シンセサイザの一
実施例を示す回路構成図であり、同図において第
2図と同一符号は同一または相当部分を示す。こ
の実施例の周波数シンセサイザが第2図に示すも
のと異なる点は、水晶基準発振器5の発振出力を
分周する第2の分周器4の分周出力を昇圧するト
ランス41を有する昇圧回路8と、この昇圧回路
8の出力電圧を整流して直流電圧に変換するブリ
ツジ形ダイオード53〜56およびコンデンサ2
2を含む整流回路9とからなる電源回路10を設
け、この電源回路10の直流電圧をチヤージポン
プ回路6の電源電圧として供給するようにしたこ
とである。この場合、整流回路9の出力端とアー
スとの間に挿入されたコンデンサ22は、ループ
フイルタ7に含まれるコンデンサ21よりも大き
な容量を有している。なお、チヤージポンプ回路
6において片方のトランジスタ11のベースと位
相比較器3の出力103側との間にはトランジス
タ13が挿入され、このトランジスタ13はその
ベースに加える電源電圧Vccにより位相比較器3
の出力103に応じてオン、オフ動作するものとな
つている。
実施例を示す回路構成図であり、同図において第
2図と同一符号は同一または相当部分を示す。こ
の実施例の周波数シンセサイザが第2図に示すも
のと異なる点は、水晶基準発振器5の発振出力を
分周する第2の分周器4の分周出力を昇圧するト
ランス41を有する昇圧回路8と、この昇圧回路
8の出力電圧を整流して直流電圧に変換するブリ
ツジ形ダイオード53〜56およびコンデンサ2
2を含む整流回路9とからなる電源回路10を設
け、この電源回路10の直流電圧をチヤージポン
プ回路6の電源電圧として供給するようにしたこ
とである。この場合、整流回路9の出力端とアー
スとの間に挿入されたコンデンサ22は、ループ
フイルタ7に含まれるコンデンサ21よりも大き
な容量を有している。なお、チヤージポンプ回路
6において片方のトランジスタ11のベースと位
相比較器3の出力103側との間にはトランジス
タ13が挿入され、このトランジスタ13はその
ベースに加える電源電圧Vccにより位相比較器3
の出力103に応じてオン、オフ動作するものとな
つている。
このように構成された周波数シンセサイザによ
ると、第2の分周器4の分周出力はトランス41
で昇圧された後、その昇圧出力がフリツジ形ダイ
オード53〜56で整流されたうえコンデンサ2
2で保持され、チヤージポンプ回路6の電源とな
る。この時、チヤージポンプ回路6の電源はルー
プフイルタ7のコンデンサ21を充電するために
必要であるから、前記コンデンサ22の容量をコ
ンデンサ21の容量より大きくすれば、このコン
デンサ21の充電をコンデンサ22で行うことが
できる。また、フエーズロツクドループがロツク
すると、電圧制御発振器1の制御電圧は一定とな
り、チヤージ回路6にはわずかの電流しか流れな
い。このため、前記コンデンサ22を入れること
により、昇圧回路8のトランス41の出力電流容
量は非常に小さくでき、そのトランス41の体積
を小さくすることができる。したがつて、昇圧し
たチヤージポンプ回路6の電源電圧をVHとする
と、電圧制御発振器1の発振周波数は第4図の符
号Bで示す範囲となり、その発振周波数の可変範
囲を広げることができる。
ると、第2の分周器4の分周出力はトランス41
で昇圧された後、その昇圧出力がフリツジ形ダイ
オード53〜56で整流されたうえコンデンサ2
2で保持され、チヤージポンプ回路6の電源とな
る。この時、チヤージポンプ回路6の電源はルー
プフイルタ7のコンデンサ21を充電するために
必要であるから、前記コンデンサ22の容量をコ
ンデンサ21の容量より大きくすれば、このコン
デンサ21の充電をコンデンサ22で行うことが
できる。また、フエーズロツクドループがロツク
すると、電圧制御発振器1の制御電圧は一定とな
り、チヤージ回路6にはわずかの電流しか流れな
い。このため、前記コンデンサ22を入れること
により、昇圧回路8のトランス41の出力電流容
量は非常に小さくでき、そのトランス41の体積
を小さくすることができる。したがつて、昇圧し
たチヤージポンプ回路6の電源電圧をVHとする
と、電圧制御発振器1の発振周波数は第4図の符
号Bで示す範囲となり、その発振周波数の可変範
囲を広げることができる。
なお、本発明は上記した実施例に限定されるも
のではなく、昇圧回路の昇圧出力を整流する整流
回路を変形したり、あるいはチヤージポンプ回路
やループフイルタも変形したりできることはいう
までもない。
のではなく、昇圧回路の昇圧出力を整流する整流
回路を変形したり、あるいはチヤージポンプ回路
やループフイルタも変形したりできることはいう
までもない。
以上説明したように、本発明の周波数シンセサ
イザは、チヤージポンプ回路の電源電圧を昇圧す
ることにより、電圧制御発振器の発振周波数の可
変範囲を広げることができ、特に電源電圧の低い
携帯形無線機に適用して非常にすぐれた効果があ
る。また、電圧制御発振器の制御電圧が上がるた
め、その可変容量ダイオードのQが上がり、電圧
制御発振器のC/Nが良くなる効果がある。
イザは、チヤージポンプ回路の電源電圧を昇圧す
ることにより、電圧制御発振器の発振周波数の可
変範囲を広げることができ、特に電源電圧の低い
携帯形無線機に適用して非常にすぐれた効果があ
る。また、電圧制御発振器の制御電圧が上がるた
め、その可変容量ダイオードのQが上がり、電圧
制御発振器のC/Nが良くなる効果がある。
第1図は本発明の一実施例による周波数シンセ
サイザの回路構成図、第2図は従来の周波数シン
セサイザの回路構成図、第3図は電圧制御発振器
内の可変容量ダイオードの逆電圧VRと容量Cの
関係を表わす図、第4図は電圧制御発振器の制御
電圧Vcpと発振周波数fの関係を表わす図である。 1……電圧制御発振器、2……第1の分周器、
3……位相比較器、4……第2の分周器、5……
水晶基準発振器、6……チヤージポンプ回路、7
……ループフイルタ、8……昇圧回路、9……整
流回路、10……電源回路、21,22……コン
デンサ、41……トランス、53〜56……ダイ
オード。
サイザの回路構成図、第2図は従来の周波数シン
セサイザの回路構成図、第3図は電圧制御発振器
内の可変容量ダイオードの逆電圧VRと容量Cの
関係を表わす図、第4図は電圧制御発振器の制御
電圧Vcpと発振周波数fの関係を表わす図である。 1……電圧制御発振器、2……第1の分周器、
3……位相比較器、4……第2の分周器、5……
水晶基準発振器、6……チヤージポンプ回路、7
……ループフイルタ、8……昇圧回路、9……整
流回路、10……電源回路、21,22……コン
デンサ、41……トランス、53〜56……ダイ
オード。
Claims (1)
- 【特許請求の範囲】 1 電圧制御発振器と、該電圧制御発振器の出力
を分周する第1の分周器と、水晶基準発振器と、
該水晶基準発振器の出力を分周する第2の分周器
と、前記第1の分周器の出力と前記第2の分周器
の出力の位相を比較する位相比較器と、この位相
比較器の出力パルスによつてコンデンサの充放電
を行うチヤージポンプ回路と、前記コンデンサを
含み前記電圧制御発振器に制御電圧を与えるルー
プフイルタとを有する周波数シンセサイザにおい
て、前記第2の分周回路の分周出力を昇圧する昇
圧回路と、該昇圧回路の出力を直流電圧に変換す
る整流回路とからなる電源回路を備え、前記電源
回路の出力の直流電圧を前記チヤージポンプ回路
の電源電圧として供給するようにしたことを特徴
とする周波数シンセサイザ。 2 電源回路においてその整流回路の出力端とア
ースの間に、ループフイルタに含まれるコンデン
サよりも容量の大きいコンデンサを挿入してなる
ことを特徴とする特許請求の範囲第1項記載の周
波数シンセサイザ。
Priority Applications (8)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60139113A JPS621322A (ja) | 1985-06-27 | 1985-06-27 | 周波数シンセサイザ |
| US06/877,408 US4736167A (en) | 1985-06-27 | 1986-06-23 | PLL frequency synthesizer |
| CA000512487A CA1283957C (en) | 1985-06-27 | 1986-06-26 | Pll frequency synthesizer |
| DE8686305056T DE3671686D1 (de) | 1985-06-27 | 1986-06-27 | Frequenzsynthesator mit phasenverriegelter schleife. |
| AU59336/86A AU582516B2 (en) | 1985-06-27 | 1986-06-27 | PLL frequency synthesizer |
| EP86305056A EP0212810B1 (en) | 1985-06-27 | 1986-06-27 | Pll frequency synthesizer |
| SG1196/92A SG119692G (en) | 1985-06-27 | 1992-11-16 | Pll frequency synthesizer |
| HK396/93A HK39693A (en) | 1985-06-27 | 1993-04-22 | Pll frequency synthesizer |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60139113A JPS621322A (ja) | 1985-06-27 | 1985-06-27 | 周波数シンセサイザ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS621322A JPS621322A (ja) | 1987-01-07 |
| JPH0476539B2 true JPH0476539B2 (ja) | 1992-12-03 |
Family
ID=15237791
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60139113A Granted JPS621322A (ja) | 1985-06-27 | 1985-06-27 | 周波数シンセサイザ |
Country Status (8)
| Country | Link |
|---|---|
| US (1) | US4736167A (ja) |
| EP (1) | EP0212810B1 (ja) |
| JP (1) | JPS621322A (ja) |
| AU (1) | AU582516B2 (ja) |
| CA (1) | CA1283957C (ja) |
| DE (1) | DE3671686D1 (ja) |
| HK (1) | HK39693A (ja) |
| SG (1) | SG119692G (ja) |
Families Citing this family (22)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07116724B2 (ja) * | 1988-07-11 | 1995-12-13 | 建設省北陸地方建設局長 | モータグレーダのブレード押付力制御装置 |
| JPH04223716A (ja) * | 1990-12-26 | 1992-08-13 | Fujitsu Ltd | Pllシンセサイザ回路 |
| JP2984448B2 (ja) * | 1992-01-13 | 1999-11-29 | 日本電気株式会社 | 周波数シンセサイザ |
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