JPH0477093A - ハウリング防止機能を備えた音響装置 - Google Patents
ハウリング防止機能を備えた音響装置Info
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- JPH0477093A JPH0477093A JP18767690A JP18767690A JPH0477093A JP H0477093 A JPH0477093 A JP H0477093A JP 18767690 A JP18767690 A JP 18767690A JP 18767690 A JP18767690 A JP 18767690A JP H0477093 A JPH0477093 A JP H0477093A
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- audio signal
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- frequency
- multiplier
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04R—LOUDSPEAKERS, MICROPHONES, GRAMOPHONE PICK-UPS OR LIKE ACOUSTIC ELECTROMECHANICAL TRANSDUCERS; ELECTRIC HEARING AIDS; PUBLIC ADDRESS SYSTEMS
- H04R3/00—Circuits for transducers
- H04R3/02—Circuits for transducers for preventing acoustic reaction, i.e. acoustic oscillatory feedback
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- Engineering & Computer Science (AREA)
- Acoustics & Sound (AREA)
- Signal Processing (AREA)
- Circuit For Audible Band Transducer (AREA)
- Filters That Use Time-Delay Elements (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
技術分野
本発明はハウリング防止機能を備えた音響装置に関する
。
。
背景技術
従来のハウリング防止機能を備えた音響装置としてマイ
クロホンとスピーカとの間にピッチ変換装置及び帯域阻
止フィルタを備えた装置が例えば、特開昭６０−２８３
９９号公報に示されており、公知である。かかる装置に
おいては、第９図に示すようにマイクロホン１からのオ
ーディオ信号はマイクアンプ２を介してピッチ変換装置
３に供給される。ピッチ変換装置３は入力オーディオ信
号の周波数を変化させる。ピッチ変換装置３の出力信号
は帯域阻止フィルタ４に供給される。帯域阻止フィルタ
４は第１０図に示すように等間隔毎の通過阻止中心周波
数が配置する特性を有するくし型フィルタからなる。帯
域阻止フィルタ４の出力信号がパワーアンプ５によって
増幅されてスピーカ６を駆動するようになっている。
クロホンとスピーカとの間にピッチ変換装置及び帯域阻
止フィルタを備えた装置が例えば、特開昭６０−２８３
９９号公報に示されており、公知である。かかる装置に
おいては、第９図に示すようにマイクロホン１からのオ
ーディオ信号はマイクアンプ２を介してピッチ変換装置
３に供給される。ピッチ変換装置３は入力オーディオ信
号の周波数を変化させる。ピッチ変換装置３の出力信号
は帯域阻止フィルタ４に供給される。帯域阻止フィルタ
４は第１０図に示すように等間隔毎の通過阻止中心周波
数が配置する特性を有するくし型フィルタからなる。帯
域阻止フィルタ４の出力信号がパワーアンプ５によって
増幅されてスピーカ６を駆動するようになっている。
かかる構成においては、マイクロホン１からのオーディ
オ信号がピッチ変換装置３に供給されると、オーディオ
信号の周波数が変化される。その周波数が変化されたオ
ーディオ信号は帯域阻止フィルタ４を通過すると、更に
パワーアンプ５を介してスピーカ已に供給されて音響出
力となる。このスピーカ６からの出力音がマイクロホン
１によって受音されると、ハウリングを生ずるループが
形成される。受音によるオーディオ信号はピッチ変換装
置３によって更にその周波数を変化されることとなる。
オ信号がピッチ変換装置３に供給されると、オーディオ
信号の周波数が変化される。その周波数が変化されたオ
ーディオ信号は帯域阻止フィルタ４を通過すると、更に
パワーアンプ５を介してスピーカ已に供給されて音響出
力となる。このスピーカ６からの出力音がマイクロホン
１によって受音されると、ハウリングを生ずるループが
形成される。受音によるオーディオ信号はピッチ変換装
置３によって更にその周波数を変化されることとなる。
今、第１１図（ａ）に示すようマイクロホン１からのオ
ーディオ信号の周波数をｆａとすると、ループを１周す
る時間τだけ経過した後においてはピンチ変換装置３に
より周波数ｆｂのオーディオ信号となる（第１１図（ｂ
））。更にループを１周して時間τだけ経過した後にお
いてはピッチ変換装置３により周波数ｆｃのオーディオ
信号となる（第１１図（Ｃ））。この周波数ｆｃが帯域
阻止フィルタ４の通過阻止中心周波数ならば、周波数ｆ
ｃのオーディオ信号は帯域阻止フィルタ４によって通過
を阻止され、これによりハウリングが防止されるのであ
る。
ーディオ信号の周波数をｆａとすると、ループを１周す
る時間τだけ経過した後においてはピンチ変換装置３に
より周波数ｆｂのオーディオ信号となる（第１１図（ｂ
））。更にループを１周して時間τだけ経過した後にお
いてはピッチ変換装置３により周波数ｆｃのオーディオ
信号となる（第１１図（Ｃ））。この周波数ｆｃが帯域
阻止フィルタ４の通過阻止中心周波数ならば、周波数ｆ
ｃのオーディオ信号は帯域阻止フィルタ４によって通過
を阻止され、これによりハウリングが防止されるのであ
る。
かかる従来のハウリング防止機能を備えた音響装置にお
いては、ハウリング防止効果を高めるたるには各通過阻
止中心周波数の間隔を狭くしてハウリングを生ずる信号
の帯域阻止フィルタ４の通過を阻止しなければならない
。しかしながら、各通過阻止中心周波数の間隔を狭くす
ると、狭くした周波数部分の利得が低下して音質が劣化
するという問題点があった。
いては、ハウリング防止効果を高めるたるには各通過阻
止中心周波数の間隔を狭くしてハウリングを生ずる信号
の帯域阻止フィルタ４の通過を阻止しなければならない
。しかしながら、各通過阻止中心周波数の間隔を狭くす
ると、狭くした周波数部分の利得が低下して音質が劣化
するという問題点があった。
発明の概要
［発明の目的］
本発明の目的は、音質を劣化させることなくハウリング
を防止することができる音響装置を提供することである
。
を防止することができる音響装置を提供することである
。
［発明の構成］
本発明の音響装置は、マイクロホンから出力されたオー
ディオ信号を入力するハウリング防止機能を備えた音響
装置であり、オーディオ信号の伝送ラインに通過阻止中
心周波数が時間変化するノツチフィルタを少なくとも１
つ有することを特徴としている。
ディオ信号を入力するハウリング防止機能を備えた音響
装置であり、オーディオ信号の伝送ラインに通過阻止中
心周波数が時間変化するノツチフィルタを少なくとも１
つ有することを特徴としている。
実施例
以下、本発明の実施例を図面を参照しつつ詳細に説明す
る。
る。
第１図に示した音響装置においては、マイクロホン１か
らの出力信号がマイクアンプ２に供給され、マイクアン
プ２の出力にはＡ／Ｄ変換器７が接続されている。Ａ／
Ｄ変換器７の出力にはＤＳＰ（ディジタル信号処理プロ
セッサ）９が接続されている。ＤＳＰ９は後述の如く構
成され、マイクロコンピュータ１０によって制御される
ようになっている。ＤＳＰ９の出力にはＤ／Ａ変換器８
が接続され、ＤＳＰ９から出力されたディジタルオーデ
ィオ信号がアナログオーディオ信号に変換される。Ｄ／
Ａ変換器８の出力には従来と同様にパワーアンプ５を介
してスピーカ６が接続される。
らの出力信号がマイクアンプ２に供給され、マイクアン
プ２の出力にはＡ／Ｄ変換器７が接続されている。Ａ／
Ｄ変換器７の出力にはＤＳＰ（ディジタル信号処理プロ
セッサ）９が接続されている。ＤＳＰ９は後述の如く構
成され、マイクロコンピュータ１０によって制御される
ようになっている。ＤＳＰ９の出力にはＤ／Ａ変換器８
が接続され、ＤＳＰ９から出力されたディジタルオーデ
ィオ信号がアナログオーディオ信号に変換される。Ｄ／
Ａ変換器８の出力には従来と同様にパワーアンプ５を介
してスピーカ６が接続される。
ＤＳＰ９の構成を概略的に示すと第２図の如くである。
すなわち、Ａ／Ｄ変換器７からのディジタル信号はＤＳ
Ｐ２内の入力インターフェース１３に供給される。入力
インターフェース１３にはデータバス１４が接続されて
おり、このデータバス１４は信号データ群を一時記憶す
るデータメモリ１２及び乗算器１５の一方の人力に接続
されている。乗算器１５の他方の入力には係数データを
保持するためのバッファメモリ１６が接続されている。
Ｐ２内の入力インターフェース１３に供給される。入力
インターフェース１３にはデータバス１４が接続されて
おり、このデータバス１４は信号データ群を一時記憶す
るデータメモリ１２及び乗算器１５の一方の人力に接続
されている。乗算器１５の他方の入力には係数データを
保持するためのバッファメモリ１６が接続されている。
バッファメモリ１６には係数ＲＡＭ１７が接続され、Ｒ
ＡＭ１７には複数の係数データが記憶される。後述のシ
ーケンスコントローラ２０からのタイミング信号に応じ
てＲＡＭ１７に記憶された係数データ群のうちから１つ
の係数データが順次読み出され、それがバッファメモリ
１６に供給されて保持される。バッファメモリ１６に保
持された係数データは乗算器１５に供給される。ＡＬ
Ｕ （Ａｒｌｉｈｍｅｔｌｃ Ｌｏｇｌｃ Ｕｎｌｔ）
１８は乗算器１５の計算出力を累算するために設けら
れており、方の入力に乗算器１５の計算出力が供給され
、他方はデータバス１４に接続されている。ＡＬＵＩ８
の計算出力にはアキュムレータ１９が接続され、アキュ
ムレータ１９の出力はデータバス１４に接続されている
。データバス１４には遅延データを作成するために外部
メモリ２１のデータ書き込み及び読み出しを制御するメ
モリ制御回路２２が接続されている。
ＡＭ１７には複数の係数データが記憶される。後述のシ
ーケンスコントローラ２０からのタイミング信号に応じ
てＲＡＭ１７に記憶された係数データ群のうちから１つ
の係数データが順次読み出され、それがバッファメモリ
１６に供給されて保持される。バッファメモリ１６に保
持された係数データは乗算器１５に供給される。ＡＬ
Ｕ （Ａｒｌｉｈｍｅｔｌｃ Ｌｏｇｌｃ Ｕｎｌｔ）
１８は乗算器１５の計算出力を累算するために設けら
れており、方の入力に乗算器１５の計算出力が供給され
、他方はデータバス１４に接続されている。ＡＬＵＩ８
の計算出力にはアキュムレータ１９が接続され、アキュ
ムレータ１９の出力はデータバス１４に接続されている
。データバス１４には遅延データを作成するために外部
メモリ２１のデータ書き込み及び読み出しを制御するメ
モリ制御回路２２が接続されている。
また、データバス１４には出力インターフニス２３が接
続され、出力インターフェース２３から出力されるディ
ジタルオーディオ信号がＤＳＰ９の出力信号とじてＤ／
Ａ変換器７に供給される。
続され、出力インターフェース２３から出力されるディ
ジタルオーディオ信号がＤＳＰ９の出力信号とじてＤ／
Ａ変換器７に供給される。
インターフェース１３．２３、乗算器１５、係数ＲＡＭ
１７、ＡＬＵｌｇ、アキュムレータ１９及びメモリ制御
回路２２の動作タイミングはシーケンスコントローラ２
０によって制御される。シーケンスコントローラ２０は
プログラムメモリ２４に書き込まれた処理プログラムに
従って動作すると共にマイクロコンピュータ１０からの
指令にＯには操作により各種指令を発生するためにキボ
ード１１が接続されている。キーボード１１のキーの操
作に応じてマイクロコンピュータ１０はＲＡＭ１７の係
数データの書き込みを制御する。
１７、ＡＬＵｌｇ、アキュムレータ１９及びメモリ制御
回路２２の動作タイミングはシーケンスコントローラ２
０によって制御される。シーケンスコントローラ２０は
プログラムメモリ２４に書き込まれた処理プログラムに
従って動作すると共にマイクロコンピュータ１０からの
指令にＯには操作により各種指令を発生するためにキボ
ード１１が接続されている。キーボード１１のキーの操
作に応じてマイクロコンピュータ１０はＲＡＭ１７の係
数データの書き込みを制御する。
かかる構成においては、Ａ／Ｄ変換器７に供給されるマ
イクロホン信号は所定のサンプリング周期毎にディジタ
ルオーディオ信号データに変換されてインターフェース
１３を介してデータメモリ１２に供給されて記憶される
。一方、ＲＡＭ１７から読み出された係数データはバッ
ファメモリ１６に供給されて保持される。シーケンスコ
ントローラ２０はインターフェース１３からデータを読
み込むタイミング、データメモリ１２から乗算器１５へ
選択的にデータを転送するタイミング、ＲＡＭ１７から
各係数データを出力するタイミング、乗算器１５の乗算
動作タイミング、ＡＬＵｌｇの加算動作タイミング、ア
キュムレータ１９の出力タイミング及びインターフェー
ス２３から演算結果のデータを出力するタイミング等の
タイミングをとる。これらのタイミングが適切にとられ
ることにより、例えば、バッファメモリ１６から係数デ
ータα１が、またデータメモリ１２からデータｄ１が乗
算器１５に供給され、乗算器１５において先ず、α１
・ｄｌが演算される。このα１ ・ｄｌが演算されると
ＡＬＵｌｇにおいてθ＋α１ｄ１が演算され、その演算
結果がアキュムレータ１９において保持される。次いで
、バッファメモリ１６から係数データα２が、またデー
タメモリ１２からデータｄ２が出力されると、乗算器１
５においてα２ ・ｄ２が演算され、アキュムレータ１
９からα１ ・ｄｌが出力されて、ＡＬＵｌｇにおいて
α１ ・ｄ１＋α２・ｄ２が演算され、その演算結果が
アキュムレータ１９において保持される。これを縁り返
すことによりΣαる ・ｄｔが算出される。
イクロホン信号は所定のサンプリング周期毎にディジタ
ルオーディオ信号データに変換されてインターフェース
１３を介してデータメモリ１２に供給されて記憶される
。一方、ＲＡＭ１７から読み出された係数データはバッ
ファメモリ１６に供給されて保持される。シーケンスコ
ントローラ２０はインターフェース１３からデータを読
み込むタイミング、データメモリ１２から乗算器１５へ
選択的にデータを転送するタイミング、ＲＡＭ１７から
各係数データを出力するタイミング、乗算器１５の乗算
動作タイミング、ＡＬＵｌｇの加算動作タイミング、ア
キュムレータ１９の出力タイミング及びインターフェー
ス２３から演算結果のデータを出力するタイミング等の
タイミングをとる。これらのタイミングが適切にとられ
ることにより、例えば、バッファメモリ１６から係数デ
ータα１が、またデータメモリ１２からデータｄ１が乗
算器１５に供給され、乗算器１５において先ず、α１
・ｄｌが演算される。このα１ ・ｄｌが演算されると
ＡＬＵｌｇにおいてθ＋α１ｄ１が演算され、その演算
結果がアキュムレータ１９において保持される。次いで
、バッファメモリ１６から係数データα２が、またデー
タメモリ１２からデータｄ２が出力されると、乗算器１
５においてα２ ・ｄ２が演算され、アキュムレータ１
９からα１ ・ｄｌが出力されて、ＡＬＵｌｇにおいて
α１ ・ｄ１＋α２・ｄ２が演算され、その演算結果が
アキュムレータ１９において保持される。これを縁り返
すことによりΣαる ・ｄｔが算出される。
また、反射音用等の遅延データを作成する場合にはデー
タメモリ１２からデータが読み出されてデータバス１４
を介してメモリ制御回路２２に供給される。メモリ制御
回路２２は外部メモリ２１に供給されたデータを順次書
き込み、書き込んだ後、定められた遅延時間データだけ
経過するとそのデータを読み出しそれを遅延データとす
る。その遅延データはデータバス１４を介してデータメ
モリ１２に供給されて記憶され上記の演算動作に用いら
れる。
タメモリ１２からデータが読み出されてデータバス１４
を介してメモリ制御回路２２に供給される。メモリ制御
回路２２は外部メモリ２１に供給されたデータを順次書
き込み、書き込んだ後、定められた遅延時間データだけ
経過するとそのデータを読み出しそれを遅延データとす
る。その遅延データはデータバス１４を介してデータメ
モリ１２に供給されて記憶され上記の演算動作に用いら
れる。
かかる本発明による音響装置におけるＤＳＰ９の動作を
等価回路で示すと第３図の如く２次ＩＩＲ型フィルタと
して構成されたものとなる。このフィルタにおいては、
オーディオデータ信号が供給される入力端には係数乗算
器３１及び遅延素子３２が接続されている。遅延素子３
２の出力には係数乗算器３３及び遅延素子３４が接続さ
れている。遅延素子３４の出力には更に係数乗算器３５
が接続されている。係数乗算器３］、３３．３５の各出
力は加算器３６に接続されている。加算器３６の出力に
は遅延素子３７が接続されている。
等価回路で示すと第３図の如く２次ＩＩＲ型フィルタと
して構成されたものとなる。このフィルタにおいては、
オーディオデータ信号が供給される入力端には係数乗算
器３１及び遅延素子３２が接続されている。遅延素子３
２の出力には係数乗算器３３及び遅延素子３４が接続さ
れている。遅延素子３４の出力には更に係数乗算器３５
が接続されている。係数乗算器３］、３３．３５の各出
力は加算器３６に接続されている。加算器３６の出力に
は遅延素子３７が接続されている。
遅延素子３７の出力には係数乗算器３８及び遅延素子３
９が接続されている。遅延素子３つの出力には更に係数
乗算器４０が接続されている。係数乗算器３８．４０の
各出力も加算器３６に接続されている。
９が接続されている。遅延素子３つの出力には更に係数
乗算器４０が接続されている。係数乗算器３８．４０の
各出力も加算器３６に接続されている。
遅延素子３２，３４，３７．３９の各遅延時間は１サン
プリング周期に相当する。よって、乗算器３３に供給さ
れるデータは乗算器３１に供給されるデータより１サン
プル前のデータであり、乗算器３５に供給されるデータ
は乗算器３１に供給されるデータより２サンプル前のデ
ータである。
プリング周期に相当する。よって、乗算器３３に供給さ
れるデータは乗算器３１に供給されるデータより１サン
プル前のデータであり、乗算器３５に供給されるデータ
は乗算器３１に供給されるデータより２サンプル前のデ
ータである。
乗算器３８．４０についても同様である。
乗算器３１の係数がａｏ、乗算器３３の係数がａｌ、乗
算器３５の係数がａ２、乗算器３８の係数がｂｌ、乗算
器４０の係数がｂｌである。これら係数がａＯ−ａ２−
Ａ、ａ１＝−ｂｌ−Ｂ、ｂｌ−任意の値の如く設定され
ることによりノツチフィルタとして動作する。すなわち
、このＡ、 Ｂ及びｂｌの値の設定に応じて通過阻止
中心周波数が変化するので、所望の通過阻止中心周波数
になるようにＡ、 Ｂ及びｂｌが設定される。
算器３５の係数がａ２、乗算器３８の係数がｂｌ、乗算
器４０の係数がｂｌである。これら係数がａＯ−ａ２−
Ａ、ａ１＝−ｂｌ−Ｂ、ｂｌ−任意の値の如く設定され
ることによりノツチフィルタとして動作する。すなわち
、このＡ、 Ｂ及びｂｌの値の設定に応じて通過阻止
中心周波数が変化するので、所望の通過阻止中心周波数
になるようにＡ、 Ｂ及びｂｌが設定される。
かかるノツチフィルタを１つだけＤＳＰ９によってディ
ジタル処理により形成する場合、ＤＳＰ９は次の如く動
作する。
ジタル処理により形成する場合、ＤＳＰ９は次の如く動
作する。
先ず、第１ステツプにおいてデータメモリ１２のｎ番地
から入力オーディオ信号データｄｎを読み出し、またＲ
ＡＭ１７から係数データａ２を読み出してバッファメモ
リ１６に転送することにより乗算器１５にて乗算させる
。その乗算結果ａ２・ｄｏには第１ステツプより２ステ
ツプ後の第３ステツプにおいてＡＬＵ１８によって０が
加算されて、その加算結果がアキュムレータ１９に保持
される。
から入力オーディオ信号データｄｎを読み出し、またＲ
ＡＭ１７から係数データａ２を読み出してバッファメモ
リ１６に転送することにより乗算器１５にて乗算させる
。その乗算結果ａ２・ｄｏには第１ステツプより２ステ
ツプ後の第３ステツプにおいてＡＬＵ１８によって０が
加算されて、その加算結果がアキュムレータ１９に保持
される。
第２ステツプにおいてはデータメモリ１２のｎ−１番地
から信号データｄ。−１を読み出し、読み出された信号
データｄ旧とＲＡＭ１７から新たに読み出した係数デー
タａ１とを乗算器１５にて乗算させる。その乗算結果ａ
１ ・ｄ ｎ−１には第４ステツプにおいてＡＬＵ１８
によってアキュムレータ１９の保持値（第３ステツプの
加算結果）が加算されてその加算結果がアキュムレータ
１９に保持される。次いで、第３ステツプにおいては入
力信号データＩＮをインターフェース１３からデータメ
モリ１２のｎ−２番地及び乗算器１５に転送して係数デ
ータａＱと乗算器１５にて乗算させる。その乗算結果ａ
ｏφＩＮには第５ステツプにおいてＡＬＵ１８によって
アキュムレータ１９の保持値（第４ステツプの加算結果
）が加算されてその加算結果がアキュムレータ１９に保
持される。
から信号データｄ。−１を読み出し、読み出された信号
データｄ旧とＲＡＭ１７から新たに読み出した係数デー
タａ１とを乗算器１５にて乗算させる。その乗算結果ａ
１ ・ｄ ｎ−１には第４ステツプにおいてＡＬＵ１８
によってアキュムレータ１９の保持値（第３ステツプの
加算結果）が加算されてその加算結果がアキュムレータ
１９に保持される。次いで、第３ステツプにおいては入
力信号データＩＮをインターフェース１３からデータメ
モリ１２のｎ−２番地及び乗算器１５に転送して係数デ
ータａＱと乗算器１５にて乗算させる。その乗算結果ａ
ｏφＩＮには第５ステツプにおいてＡＬＵ１８によって
アキュムレータ１９の保持値（第４ステツプの加算結果
）が加算されてその加算結果がアキュムレータ１９に保
持される。
第４ステツプにおいてはデータメモリ１２のｎ＋２番地
から信号データｄ ｎ＋２を読み出し、読み出した信号
データｄ ｎ１２とＲＡＭ１７から新たに読み出した係
数データｂ２とを乗算器１５にて乗算させる。その乗算
結果ｂ２ ・ｄ ｎ＋２には第６ステツプにおいてＡＬ
Ｕ１８によってアキュムレータ１９の保持値（第５ステ
ツプの加算結果）が加算されてその加算結果がアキュム
レータ１９に保持される。そして第５ステツプにおいて
はデータメモリ１２のｎ＋１番地から信号データｄ ｎ
ｎ＋を読み出し、読み出された信号データｄ ｎ４１と
読み出された係数データｂ１とを乗算器１５にて乗算さ
せる。その乗算結果ｂ＋ ・ｄ ｎｉｌには第７ステ
ツプにおいてＡＬυ］８によってアキュムレータ１９の
保持値（第５ステツプの加算結果）が加算されてその加
算結果か出力データとしてアキュムレータ１９に保持さ
れる。
から信号データｄ ｎ＋２を読み出し、読み出した信号
データｄ ｎ１２とＲＡＭ１７から新たに読み出した係
数データｂ２とを乗算器１５にて乗算させる。その乗算
結果ｂ２ ・ｄ ｎ＋２には第６ステツプにおいてＡＬ
Ｕ１８によってアキュムレータ１９の保持値（第５ステ
ツプの加算結果）が加算されてその加算結果がアキュム
レータ１９に保持される。そして第５ステツプにおいて
はデータメモリ１２のｎ＋１番地から信号データｄ ｎ
ｎ＋を読み出し、読み出された信号データｄ ｎ４１と
読み出された係数データｂ１とを乗算器１５にて乗算さ
せる。その乗算結果ｂ＋ ・ｄ ｎｉｌには第７ステ
ツプにおいてＡＬυ］８によってアキュムレータ１９の
保持値（第５ステツプの加算結果）が加算されてその加
算結果か出力データとしてアキュムレータ１９に保持さ
れる。
各係数データａ６−ａ２及びす、、ｂｌはマイクロコン
ピュータ１０の内部メモリ（図示せず）から読み出され
てＲＡＭＩ ７の所定の係数データエリアに転送された
ものである。また、この係数データエリアには係数デー
タＥＩＱ＝ａ２及びｂｌ。
ピュータ１０の内部メモリ（図示せず）から読み出され
てＲＡＭＩ ７の所定の係数データエリアに転送された
ものである。また、この係数データエリアには係数デー
タＥＩＱ＝ａ２及びｂｌ。
ｂｌを１デ一タ群として上記したＡ、 Ｂの値の異な
る複数のデータ群がａ２７ ａｌ、ａｏｌ ｂｌ。
る複数のデータ群がａ２７ ａｌ、ａｏｌ ｂｌ。
ｂｌの順にアドレスの１番地から記憶される。
通過阻止中心周波数が異なる複数（５個）のノツチフィ
ルタ（第１ないし第５ノツチフイルタ）を構成するため
には、第４図に示すように各々が係数データａ２ ＋
ａｌ 、ａｏ ＋ ｂｌ 、ｂｌを有する係数デー
タ群Ｆｌ、Ｆ２．〜Ｆ５．Ｆ、＋ΔＦＦ２＋ΔＦ２．・
・・・・・Ｆ４＋５ΔＦ４．Ｆ５十５ΔＦ５が読み出し
順に記憶される。データ群Ｆ１＋ Ｆ２．Ｆ３．Ｆ４
．ＦＳは第１ないし第５ノツチフイルタの各通過阻止中
心周波数ｆｌ、ｆ２゜ｆ３．ｆ、、ｆ５を得るデータ群
であり、この各通過阻止中心周波数を基準周波数とする
。なお、ｆｌ ＜ｆ２＜ｆ３ ＜ｆ４ ＜ｆ５である。
ルタ（第１ないし第５ノツチフイルタ）を構成するため
には、第４図に示すように各々が係数データａ２ ＋
ａｌ 、ａｏ ＋ ｂｌ 、ｂｌを有する係数デー
タ群Ｆｌ、Ｆ２．〜Ｆ５．Ｆ、＋ΔＦＦ２＋ΔＦ２．・
・・・・・Ｆ４＋５ΔＦ４．Ｆ５十５ΔＦ５が読み出し
順に記憶される。データ群Ｆ１＋ Ｆ２．Ｆ３．Ｆ４
．ＦＳは第１ないし第５ノツチフイルタの各通過阻止中
心周波数ｆｌ、ｆ２゜ｆ３．ｆ、、ｆ５を得るデータ群
であり、この各通過阻止中心周波数を基準周波数とする
。なお、ｆｌ ＜ｆ２＜ｆ３ ＜ｆ４ ＜ｆ５である。
データ群Ｆ１＋ΔＦ１は周波数ｆ１に単位変化幅△ｆ１
を加算した周波数を通過阻止中心周波数とするときのデ
ータ群である。データ群Ｆ１＋２ΔＦ１は周波数ｆ１に
変化幅２×△ｆ１を加算した周波数を通過阻止中心周波
数とするときのデータ群である。
を加算した周波数を通過阻止中心周波数とするときのデ
ータ群である。データ群Ｆ１＋２ΔＦ１は周波数ｆ１に
変化幅２×△ｆ１を加算した周波数を通過阻止中心周波
数とするときのデータ群である。
同様に、データ群Ｆ】＋３ΔＦ＋、Ｆ＋＋４ΔＦ＋、Ｆ
＋ ＋５ΔＦ１は各々周波数ｆ１に変化幅３×△ｆｌ、
４Ｘ△ｆ１，５ｘ△ｆ１を加算した周波数を通過阻止中
心周波数とするときのデータ群である。他のデータ群Ｆ
２．Ｆ３．Ｆ４．Ｆ５についても同様である。また単位
時間当りの変化幅△ｆｌ＋ △ｆ２．△ｆ３．△ｆ４．
△ｆ５は各々独立して設定され、全てが同一値である必
要はない。読み出しの際にはシーケンスコントローラ２
０のタイミング信号によってアドレス１番地から順に、
すなわちデータＩＦ＋の係数データａ２゜ａｌ 、ａ□
ｌ ｂ２ ｒ ｂ Ｉ 、次にＦ２の係数データ
ａ２ 、 ａｌ 、 ａｏ １ ｂ２ 、 ｂｌ
”””の如く係数データが読み出される。そしてデー
タ群Ｆ５＋５ΔＦ５の係数データａ２＋ ａｌ 、ａ
ｏ、ｂ２．ｂｌが読み出されると、再びアドレス１番地
のデータ群Ｆ１の係数データが読み出される。
＋ ＋５ΔＦ１は各々周波数ｆ１に変化幅３×△ｆｌ、
４Ｘ△ｆ１，５ｘ△ｆ１を加算した周波数を通過阻止中
心周波数とするときのデータ群である。他のデータ群Ｆ
２．Ｆ３．Ｆ４．Ｆ５についても同様である。また単位
時間当りの変化幅△ｆｌ＋ △ｆ２．△ｆ３．△ｆ４．
△ｆ５は各々独立して設定され、全てが同一値である必
要はない。読み出しの際にはシーケンスコントローラ２
０のタイミング信号によってアドレス１番地から順に、
すなわちデータＩＦ＋の係数データａ２゜ａｌ 、ａ□
ｌ ｂ２ ｒ ｂ Ｉ 、次にＦ２の係数データ
ａ２ 、 ａｌ 、 ａｏ １ ｂ２ 、 ｂｌ
”””の如く係数データが読み出される。そしてデー
タ群Ｆ５＋５ΔＦ５の係数データａ２＋ ａｌ 、ａ
ｏ、ｂ２．ｂｌが読み出されると、再びアドレス１番地
のデータ群Ｆ１の係数データが読み出される。
読み出された係数データ群Ｆ１〜Ｆ５各々は第１タイミ
ングのサンプリング信号データ群に乗算され、係数デー
タ群Ｆ１＋ΔＦ１〜Ｆ５＋ΔＦ５各々は次の第２タイミ
ングのサンプリング信号データ群に乗算される。以下、
係数データ群Ｆ１ 十２△Ｆ１〜Ｆ５＋２ΔＦ５各々、
ＦＩ＋３ΔＦ１〜Ｆ５＋３ΔＦ５各々、Ｆ１＋４△Ｆ１
〜Ｆ５十４ΔＦ５各々、Ｆ１＋５ΔＦｌ −Ｆ５ ＋５
ΔＦ５各々も同様であり、これを繰り返す。
ングのサンプリング信号データ群に乗算され、係数デー
タ群Ｆ１＋ΔＦ１〜Ｆ５＋ΔＦ５各々は次の第２タイミ
ングのサンプリング信号データ群に乗算される。以下、
係数データ群Ｆ１ 十２△Ｆ１〜Ｆ５＋２ΔＦ５各々、
ＦＩ＋３ΔＦ１〜Ｆ５＋３ΔＦ５各々、Ｆ１＋４△Ｆ１
〜Ｆ５十４ΔＦ５各々、Ｆ１＋５ΔＦｌ −Ｆ５ ＋５
ΔＦ５各々も同様であり、これを繰り返す。
よって、第１ないし第５ノツチフイルタの通過阻止中心
周波数は第５図に示すように読み出される係数データ群
Ｆ１〜Ｆ５に対してｆ１〜ｆ５、係数データ群Ｆ１＋Δ
Ｆ１〜Ｆ５＋ΔＦ５に対してｆｌ ＋△ｆ、−ｆ５＋△
ｆ５．係数データ２！＄ Ｆ１＋２ΔＦ１〜Ｆ５＋２Δ
Ｆ５に対してｆ１＋２△ｆ１〜ｆ５＋２Δｆ５、係数デ
ータ群Ｆ１＋３ΔＦ１〜Ｆ５＋３ΔＦ５に対してｆ１＋
３△ｆ〜ｆ５＋３△ｆ５、係数データ群Ｆ１＋４ΔＦ１
〜Ｆ５＋４ΔＦ５に対してｆ１＋４△ｆ１〜ｆ５十４△
ｆ５、係数データ群Ｆ１＋５ΔＦ１〜Ｆ５十５ΔＦ５に
対してｆ１＋５△ｆ１〜ｆ５＋５△ｆ５となり、これを
繰り返すので、各ノツチフィルタの通過阻止中心周波数
が時間経過と共に変化するのである。例えば、通過阻止
中心周波数ｆ１を基準周波数とする第１ノツチフイルタ
は第６図に示すように、通過阻止中心周波数ｆｌの特性
■２通過阻止中心周波数ｆ１＋△ｆ１の特性■５通過阻
止中心周波数ｆｌ＋２△ｆ１の特性■１通過阻止中心周
波数ｆ１＋３Δｆ１の特性■１通過阻止中心周波数ｆｌ
＋４△ｆ１の特性■１通過阻止中心周波数ｆｌ ＋５△
ｆ１の特性■の如く変化する。
周波数は第５図に示すように読み出される係数データ群
Ｆ１〜Ｆ５に対してｆ１〜ｆ５、係数データ群Ｆ１＋Δ
Ｆ１〜Ｆ５＋ΔＦ５に対してｆｌ ＋△ｆ、−ｆ５＋△
ｆ５．係数データ２！＄ Ｆ１＋２ΔＦ１〜Ｆ５＋２Δ
Ｆ５に対してｆ１＋２△ｆ１〜ｆ５＋２Δｆ５、係数デ
ータ群Ｆ１＋３ΔＦ１〜Ｆ５＋３ΔＦ５に対してｆ１＋
３△ｆ〜ｆ５＋３△ｆ５、係数データ群Ｆ１＋４ΔＦ１
〜Ｆ５＋４ΔＦ５に対してｆ１＋４△ｆ１〜ｆ５十４△
ｆ５、係数データ群Ｆ１＋５ΔＦ１〜Ｆ５十５ΔＦ５に
対してｆ１＋５△ｆ１〜ｆ５＋５△ｆ５となり、これを
繰り返すので、各ノツチフィルタの通過阻止中心周波数
が時間経過と共に変化するのである。例えば、通過阻止
中心周波数ｆ１を基準周波数とする第１ノツチフイルタ
は第６図に示すように、通過阻止中心周波数ｆｌの特性
■２通過阻止中心周波数ｆ１＋△ｆ１の特性■５通過阻
止中心周波数ｆｌ＋２△ｆ１の特性■１通過阻止中心周
波数ｆ１＋３Δｆ１の特性■１通過阻止中心周波数ｆｌ
＋４△ｆ１の特性■１通過阻止中心周波数ｆｌ ＋５△
ｆ１の特性■の如く変化する。
第２ないし第５ノツチフイルタについても第６図には基
準周波数ｆ２．ｆ、、ｆ、、ｆ５のみを示したが、第１
ノツチフイルタと同様に通過阻止中心周波数が時間経過
と共に変化する。
準周波数ｆ２．ｆ、、ｆ、、ｆ５のみを示したが、第１
ノツチフイルタと同様に通過阻止中心周波数が時間経過
と共に変化する。
上記した実施例において、第１ないし第５ノツチフイル
タの周波数変化幅は同一とは限らない。
タの周波数変化幅は同一とは限らない。
一般にハウリングが発生し易い周波数範囲（例えば、１
ｋＨｚ〜４ｋＨｚ）においてはそれ以外の周波数に比べ
てノツチフィルタを多く形成してその通過阻止中心周波
数の変化幅を小さくしかつ単位時間当りの周波数変化速
度を速くするようにしても良い。例えば、１ｋＨｚ〜４
ｋＨｚの通過阻止中心周波数の変化幅を２Ｈｚとし、単
位時間当りの周波数変化幅をＩＨｚとする。
ｋＨｚ〜４ｋＨｚ）においてはそれ以外の周波数に比べ
てノツチフィルタを多く形成してその通過阻止中心周波
数の変化幅を小さくしかつ単位時間当りの周波数変化速
度を速くするようにしても良い。例えば、１ｋＨｚ〜４
ｋＨｚの通過阻止中心周波数の変化幅を２Ｈｚとし、単
位時間当りの周波数変化幅をＩＨｚとする。
また、上記した実施例においては、ＤＳＰ９を用いて本
発明を構成したが、これに限らない。例えば、第７図に
示すようにＡ／Ｄ変換器７とＤ／Ａ変換器８との間に上
記した２次１１Ｒ型フイルタからなる複数のノツチフィ
ルタ４１１，４１２・・・・・・４１ｎを設けても良い
。このノツチフィルタ４１１．４１２・・・・・・４１
ｎは互いに異なる通過阻止中心周波数を有し制御回路４
２によって乗算係数を切替変化させることによりその通
過阻止中心周波数を変化させるようになっている。また
、これらのノツチフィルタをアナログ回路として構成し
ても良い。
発明を構成したが、これに限らない。例えば、第７図に
示すようにＡ／Ｄ変換器７とＤ／Ａ変換器８との間に上
記した２次１１Ｒ型フイルタからなる複数のノツチフィ
ルタ４１１，４１２・・・・・・４１ｎを設けても良い
。このノツチフィルタ４１１．４１２・・・・・・４１
ｎは互いに異なる通過阻止中心周波数を有し制御回路４
２によって乗算係数を切替変化させることによりその通
過阻止中心周波数を変化させるようになっている。また
、これらのノツチフィルタをアナログ回路として構成し
ても良い。
第８図は本発明の他の実施例を示している。この台管装
置においては、第８図に示した装置に更に周波数変調回
路４３が設けられている。周波数変調回路４３はメモリ
（図示せず）を有し、ディジタルオーディオ信号をメモ
リに書き込み、その書き込み速度と異なる速度でメモリ
に書き込まれたディジタルオーディオ信号を読み出すこ
とによりオーディオ信号の周波数を変化させるものであ
る。この周波数変調回路４３については、例えば、特開
昭６１．−１１８７９７号公報や特開昭６１１２１０９
６号公報に音程制御装置として開示されているので、こ
こでは詳述しない。また、かかる周波数変調回路をＤＳ
Ｐによって形成しても良い。この場合には第２図に示し
た外部ＲＡＭ２１へのデータの書き込み及び読み出しを
メモリ制御回路２２によって制御させるようにするので
ある。
置においては、第８図に示した装置に更に周波数変調回
路４３が設けられている。周波数変調回路４３はメモリ
（図示せず）を有し、ディジタルオーディオ信号をメモ
リに書き込み、その書き込み速度と異なる速度でメモリ
に書き込まれたディジタルオーディオ信号を読み出すこ
とによりオーディオ信号の周波数を変化させるものであ
る。この周波数変調回路４３については、例えば、特開
昭６１．−１１８７９７号公報や特開昭６１１２１０９
６号公報に音程制御装置として開示されているので、こ
こでは詳述しない。また、かかる周波数変調回路をＤＳ
Ｐによって形成しても良い。この場合には第２図に示し
た外部ＲＡＭ２１へのデータの書き込み及び読み出しを
メモリ制御回路２２によって制御させるようにするので
ある。
更に、周波数変調回路を公知のアナログ回路で構成して
も良い。
も良い。
発明の効果
以上の如く、本発明のハウリング防止機能を備えた音響
装置においては、マイクロホンからのオディオ信号の伝
送ラインに通過阻止中心周波数が時間変化するノツチフ
ィルタを備えたので、ハウリングが発生する周波数帯域
に通過阻止中心周波数を有するノツチフィルタを集中さ
せることができ、これによりハウリングのループを形成
するようなオーディオ信号を確実に遮断することができ
る。よって、音質を悪化させることなくハウリングを防
止することができる。
装置においては、マイクロホンからのオディオ信号の伝
送ラインに通過阻止中心周波数が時間変化するノツチフ
ィルタを備えたので、ハウリングが発生する周波数帯域
に通過阻止中心周波数を有するノツチフィルタを集中さ
せることができ、これによりハウリングのループを形成
するようなオーディオ信号を確実に遮断することができ
る。よって、音質を悪化させることなくハウリングを防
止することができる。
【図面の簡単な説明】
第１図は本発明の実施例を示すブロック図、第２図は第
１図の装置中のＤＳＰの構成を示すブロック図、第３図
はＤＳＰの動作と同一の動作を行なう等価回路を示す回
路図、第４図はＤＳＰ内のＲＡＭにおける係数データ群
の記憶状態を示す図、第５図は第１ないし第５ノツチフ
イルタの通過阻止中心周波数を示す図、第６図は第１な
いし第５ノツチフイルタの通過阻止特性を示す図、第７
図及び第８図は本発明の他の実施例を示すブロック図、
第９図は従来のハウリング防止機能を備えた音響装置を
示すブロック図、第１０図は第９図に示した従来装置に
おける通ｉｔ！４阻止特性を示す図、第１１図は第９図
に示した従来装置におけるループ形成時のオーディオ信
号の周波数の変化を示す図である。 主要部分の符号の説明 １・・・マイクロホン ９・・・ＤＳＰ ］０・・・マイクロコンピュータ ３１．３３，３５，３８．４０・・・乗算器３２．３４
，３７．３９・・・遅延素子３６・・加算器 第１図
１図の装置中のＤＳＰの構成を示すブロック図、第３図
はＤＳＰの動作と同一の動作を行なう等価回路を示す回
路図、第４図はＤＳＰ内のＲＡＭにおける係数データ群
の記憶状態を示す図、第５図は第１ないし第５ノツチフ
イルタの通過阻止中心周波数を示す図、第６図は第１な
いし第５ノツチフイルタの通過阻止特性を示す図、第７
図及び第８図は本発明の他の実施例を示すブロック図、
第９図は従来のハウリング防止機能を備えた音響装置を
示すブロック図、第１０図は第９図に示した従来装置に
おける通ｉｔ！４阻止特性を示す図、第１１図は第９図
に示した従来装置におけるループ形成時のオーディオ信
号の周波数の変化を示す図である。 主要部分の符号の説明 １・・・マイクロホン ９・・・ＤＳＰ ］０・・・マイクロコンピュータ ３１．３３，３５，３８．４０・・・乗算器３２．３４
，３７．３９・・・遅延素子３６・・加算器 第１図
Claims (4)
- （１）マイクロホンから出力されたオーディオ信号を入
力するハウリング防止機能を備えた音響装置であって、
前記オーディオ信号の伝送ラインに通過阻止中心周波数
が時間変化するノッチフィルタを少なくとも１つ有する
ことを特徴とするハウリング防止機能を備えた音響装置
。 - （２）前記オーディオ信号の伝送ラインには周波数変調
回路が設けられることを特徴とする請求項１記載の音響
装置。 - （３）前記ノッチフィルタはＩＩＲ型フィルタからなる
ことを特徴とする請求項１記載の音響装置。 - （４）ＩＩＲ型フィルタはディジタル信号プロセッサに
おいて演算処理により形成されることを特徴とする請求
項３記載の音響装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18767690A JPH0477093A (ja) | 1990-07-16 | 1990-07-16 | ハウリング防止機能を備えた音響装置 |
| EP19910301941 EP0467499A3 (en) | 1990-07-16 | 1991-03-08 | Audio apparatus with anti-howl function |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18767690A JPH0477093A (ja) | 1990-07-16 | 1990-07-16 | ハウリング防止機能を備えた音響装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0477093A true JPH0477093A (ja) | 1992-03-11 |
Family
ID=16210199
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18767690A Pending JPH0477093A (ja) | 1990-07-16 | 1990-07-16 | ハウリング防止機能を備えた音響装置 |
Country Status (2)
| Country | Link |
|---|---|
| EP (1) | EP0467499A3 (ja) |
| JP (1) | JPH0477093A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0750897A (ja) * | 1993-02-19 | 1995-02-21 | Onkyo Corp | 音声信号増幅装置 |
| JP2014042103A (ja) * | 2012-08-21 | 2014-03-06 | Oki Electric Ind Co Ltd | ハウリング抑圧装置及びプログラム、並びに、適応ノッチフィルタ及びプログラム |
Families Citing this family (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE4228479A1 (de) * | 1992-08-27 | 1994-03-03 | Sel Alcatel Ag | Schaltungsanordnung für elektroakustische Anlagen |
| DE4229912A1 (de) * | 1992-09-08 | 1994-03-10 | Sel Alcatel Ag | Verfahren zum Verbessern der Übertragungseigenschaften einer elektroakustischen Anlage |
| DE4229910A1 (de) * | 1992-09-08 | 1994-03-10 | Sel Alcatel Ag | Verfahren zum Verbessern der akustischen Rückhördämpfung von elektroakustischen Anlagen |
| US5999631A (en) * | 1996-07-26 | 1999-12-07 | Shure Brothers Incorporated | Acoustic feedback elimination using adaptive notch filter algorithm |
| US7280958B2 (en) * | 2005-09-30 | 2007-10-09 | Motorola, Inc. | Method and system for suppressing receiver audio regeneration |
| CN105228056B (zh) * | 2015-10-21 | 2018-06-19 | 西安航空学院 | 一种消除麦克风啸叫的方法及系统 |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4091236A (en) * | 1976-09-07 | 1978-05-23 | The University Of Akron | Automatically tunable notch filter and method for suppression of acoustical feedback |
| US4232192A (en) * | 1978-05-01 | 1980-11-04 | Starkey Labs, Inc. | Moving-average notch filter |
| US4722009A (en) * | 1985-04-02 | 1988-01-26 | Matsushita Electric Industrial Co., Ltd. | Tone restoring apparatus |
-
1990
- 1990-07-16 JP JP18767690A patent/JPH0477093A/ja active Pending
-
1991
- 1991-03-08 EP EP19910301941 patent/EP0467499A3/en not_active Withdrawn
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0750897A (ja) * | 1993-02-19 | 1995-02-21 | Onkyo Corp | 音声信号増幅装置 |
| JP2014042103A (ja) * | 2012-08-21 | 2014-03-06 | Oki Electric Ind Co Ltd | ハウリング抑圧装置及びプログラム、並びに、適応ノッチフィルタ及びプログラム |
Also Published As
| Publication number | Publication date |
|---|---|
| EP0467499A2 (en) | 1992-01-22 |
| EP0467499A3 (en) | 1992-05-27 |
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