JPH05211279A - 混成集積回路 - Google Patents
混成集積回路Info
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- JPH05211279A JPH05211279A JP3303671A JP30367191A JPH05211279A JP H05211279 A JPH05211279 A JP H05211279A JP 3303671 A JP3303671 A JP 3303671A JP 30367191 A JP30367191 A JP 30367191A JP H05211279 A JPH05211279 A JP H05211279A
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- Japan
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- pellet
- integrated circuit
- board
- substrate
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W72/00—Interconnections or connectors in packages
- H10W72/50—Bond wires
- H10W72/531—Shapes of wire connectors
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-
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- H10W72/552—Materials of bond wires comprising metals or metalloids, e.g. silver
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
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- H10W72/853—On the same surface
- H10W72/859—Bump connectors and bond wires
-
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- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
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- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/721—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bump connectors
- H10W90/728—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bump connectors between a chip and a stacked discrete passive device, e.g. resistors, capacitors or inductors
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- Wire Bonding (AREA)
Abstract
(57)【要約】
【目的】高周波特性にすぐれかつ高集積度の実装が可能
な混成集積回路を得る。 【構成】半導体ペレット1と薄膜基板2をそれぞれの機
能素子が向合う形で接続し、厚膜多層基板6の上に搭載
する。
な混成集積回路を得る。 【構成】半導体ペレット1と薄膜基板2をそれぞれの機
能素子が向合う形で接続し、厚膜多層基板6の上に搭載
する。
Description
【0001】
【産業上の利用分野】本発明は混成集積回路に関し、特
に、高周波動作且つ高密度実装の必要な混成集積回路に
関する。
に、高周波動作且つ高密度実装の必要な混成集積回路に
関する。
【0002】
【従来の技術】従来の混成集積回路で、高密度実装が必
要なものについては、厚膜多層基板(多層セラミック基
板または多層有機基板)を用いて実装密度をたかめてい
る。また高周波動作の必要なものについては、導体や抵
抗等の受動素子が表面に形成された薄膜基板により対応
しているのが一般的である。
要なものについては、厚膜多層基板(多層セラミック基
板または多層有機基板)を用いて実装密度をたかめてい
る。また高周波動作の必要なものについては、導体や抵
抗等の受動素子が表面に形成された薄膜基板により対応
しているのが一般的である。
【0003】このように従来の混成集積回路では、高密
度化への対応基板技術としては、多層厚膜基板が主に用
いられており、また、高周波化に対する基板としては、
薄膜基板が用いられているが、高密度化及び高周波数化
の両者を同時に満たそうとすると、厚膜多層基板では、
配線抵抗が高くなりすぎ高周波動作が難しくなってしま
い、一方薄膜基板では集積度を上げようとすると、実用
的な価格の上限をこえてしまう。
度化への対応基板技術としては、多層厚膜基板が主に用
いられており、また、高周波化に対する基板としては、
薄膜基板が用いられているが、高密度化及び高周波数化
の両者を同時に満たそうとすると、厚膜多層基板では、
配線抵抗が高くなりすぎ高周波動作が難しくなってしま
い、一方薄膜基板では集積度を上げようとすると、実用
的な価格の上限をこえてしまう。
【0004】従来から、このように点を改良することを
目的として、図3に示すように、厚膜多層基板3上に薄
膜基板2を半導体ペレット1と共に部品として搭載し、
両者の特長を引きだそうとした構造の製品が作られてい
る。
目的として、図3に示すように、厚膜多層基板3上に薄
膜基板2を半導体ペレット1と共に部品として搭載し、
両者の特長を引きだそうとした構造の製品が作られてい
る。
【0005】
【発明が解決しようとする課題】しかしながら、図3に
示した従来の混成集積回路では、厚膜多層基板3と薄膜
基板2の接続のためには、金ワイヤ5やフェースダウン
による半田7により接続を行なっているが、高周波特性
上最も重要な半導体ペレット1との接続には、どうして
も厚膜多層基板3上に形成された厚膜導体8を経由する
ことになり、周波数帯域が100MHzをこえる高周波
においては、表皮効果により抵抗値が上るため、要求特
性を満たせなくなることがしばしば発生している。特に
ワイヤボンディングについては、その金ワイヤの形状自
体が特性に大きな影響を与えてしまい、製品の特性がば
らつき、混成集積回路の信頼性や歩留りを低下させると
いう問題点がある。
示した従来の混成集積回路では、厚膜多層基板3と薄膜
基板2の接続のためには、金ワイヤ5やフェースダウン
による半田7により接続を行なっているが、高周波特性
上最も重要な半導体ペレット1との接続には、どうして
も厚膜多層基板3上に形成された厚膜導体8を経由する
ことになり、周波数帯域が100MHzをこえる高周波
においては、表皮効果により抵抗値が上るため、要求特
性を満たせなくなることがしばしば発生している。特に
ワイヤボンディングについては、その金ワイヤの形状自
体が特性に大きな影響を与えてしまい、製品の特性がば
らつき、混成集積回路の信頼性や歩留りを低下させると
いう問題点がある。
【0006】本発明の目的は、高周波動作が可能で且
つ、高密度実装ができる混成集積回路を提供することに
ある。
つ、高密度実装ができる混成集積回路を提供することに
ある。
【0007】
【課題を解決するための手段】第1の発明の混成集積回
路は、厚膜多層基板上に固着された少くとも能動素子を
有する半導体ペレットと、この半導体ペレット上に固着
された受動素子を有する薄膜基板とを含むものである。
路は、厚膜多層基板上に固着された少くとも能動素子を
有する半導体ペレットと、この半導体ペレット上に固着
された受動素子を有する薄膜基板とを含むものである。
【0008】第2の発明の混成集積回路は、厚膜多層基
板上に固着された受動素子を有する薄膜基板と、この薄
膜基板上に固着された少くとも能動素子を有する半導体
ペレットとを含むものである。
板上に固着された受動素子を有する薄膜基板と、この薄
膜基板上に固着された少くとも能動素子を有する半導体
ペレットとを含むものである。
【0009】
【実施例】次に本発明について図面を参照して説明す
る。図1は本発明の第1の実施例の断面図である。
る。図1は本発明の第1の実施例の断面図である。
【0010】図1において混成集積回路は、厚膜多層基
板3上に半田等により固着された少くともトランジスタ
等の能動素子を有する半導体ペレット1と、この半導体
ペレット1の上に半田バンプ4により固着された受動素
子を有する薄膜基板2とから主に構成されている。半導
体ペレット1は金ワイヤ5のボンディングによって厚膜
多層基板3上に電気的に接続をされている。薄膜基板2
には半導体ペレット1の電気的機能のうち特に高周波特
性を左右するような抵抗やコンデンサ等の受動素子を基
本的に高周波対応の薄膜パターンで形成してあり、この
薄膜基板2を受動素子が能動素子に向い合うように半田
バンプ4により半導体ペレット1に接続する。このこと
により、機能素子間に不要なインダクタンス等の寄生素
子の生じることなく接続することができる。
板3上に半田等により固着された少くともトランジスタ
等の能動素子を有する半導体ペレット1と、この半導体
ペレット1の上に半田バンプ4により固着された受動素
子を有する薄膜基板2とから主に構成されている。半導
体ペレット1は金ワイヤ5のボンディングによって厚膜
多層基板3上に電気的に接続をされている。薄膜基板2
には半導体ペレット1の電気的機能のうち特に高周波特
性を左右するような抵抗やコンデンサ等の受動素子を基
本的に高周波対応の薄膜パターンで形成してあり、この
薄膜基板2を受動素子が能動素子に向い合うように半田
バンプ4により半導体ペレット1に接続する。このこと
により、機能素子間に不要なインダクタンス等の寄生素
子の生じることなく接続することができる。
【0011】このように高周波特性の重要な部分につい
て回路構成のできた状態で、半導体ペレット1を厚膜多
層基板3に金ワイヤ5でボンディングにより接続する。
この際、半導体ペレット1の接続を金ワイヤのボンディ
ングでおこなえるのは、重要な高周波特性については既
に薄膜基板2との間で完了しているので、ここでは金ワ
イヤの長さを1mmを越えるようなボンディングを行な
っても特性に影響を与えることはない。また、厚膜多層
基板3として、セラミックの多層基板を用いることによ
り、全体としての高集積化を実現する事が可能となる。
て回路構成のできた状態で、半導体ペレット1を厚膜多
層基板3に金ワイヤ5でボンディングにより接続する。
この際、半導体ペレット1の接続を金ワイヤのボンディ
ングでおこなえるのは、重要な高周波特性については既
に薄膜基板2との間で完了しているので、ここでは金ワ
イヤの長さを1mmを越えるようなボンディングを行な
っても特性に影響を与えることはない。また、厚膜多層
基板3として、セラミックの多層基板を用いることによ
り、全体としての高集積化を実現する事が可能となる。
【0012】図2は本発明の第2の実施例の断面図であ
る。薄膜基板2Aの上に半田バンプ4による接続で半導
体ペレット1Aを搭載し、薄膜基板2Aはさらに薄膜基
板内部に形成したスルーホール6をかいして半田7によ
って厚膜多層基板3上に電気的に接続されている。
る。薄膜基板2Aの上に半田バンプ4による接続で半導
体ペレット1Aを搭載し、薄膜基板2Aはさらに薄膜基
板内部に形成したスルーホール6をかいして半田7によ
って厚膜多層基板3上に電気的に接続されている。
【0013】この第2の実施例は、半導体ペレット1A
の接続は全て薄膜基板2Aをかいしておこなわれること
になる。従って第1の実施例に比べ、金ワイヤのボンデ
ィングに要する領域だけ厚膜多層基板の面積を少くでき
るため、集積度を向上させることができる。
の接続は全て薄膜基板2Aをかいしておこなわれること
になる。従って第1の実施例に比べ、金ワイヤのボンデ
ィングに要する領域だけ厚膜多層基板の面積を少くでき
るため、集積度を向上させることができる。
【0014】
【発明の効果】以上説明したように本発明は、薄膜基板
と半導体ペレットを半田バンプにより接続した後に、厚
膜多層基板に搭載する構造としたので、高価な薄膜基板
の使用量を少なくできるとともに、半田バンプ接続で高
周波特性の改善を図っているため、従来の薄膜基板のみ
を用いた場合と同等の高周波特性に選ぐれ、かつ厚膜多
層基板をも使用する事によって、高集積化を比較的低価
格で実現する事ができるという効果を有する。従って混
成集積回路の信頼性及び歩留りは向上する。
と半導体ペレットを半田バンプにより接続した後に、厚
膜多層基板に搭載する構造としたので、高価な薄膜基板
の使用量を少なくできるとともに、半田バンプ接続で高
周波特性の改善を図っているため、従来の薄膜基板のみ
を用いた場合と同等の高周波特性に選ぐれ、かつ厚膜多
層基板をも使用する事によって、高集積化を比較的低価
格で実現する事ができるという効果を有する。従って混
成集積回路の信頼性及び歩留りは向上する。
【図面の簡単な説明】
【図1】本発明の第1の実施例の断面図。
【図2】本発明の第2の実施例の断面図。
【図3】従来の混成集積回路の一例の断面図。
1,1A 半導体ペレット 2,2A 薄膜基板 3 厚膜多層基板 4 半田バンプ 5 金ワイヤ 6 スルーホール 7 半田
Claims (3)
- 【請求項1】 厚膜多層基板上に固着された少くとも能
動素子を有する半導体ペレットと、この半導体ペレット
上に固着された受動素子を有する薄膜基板とを含むこと
を特徴とする混成集積回路。 - 【請求項2】 厚膜多層基板上に固着された受動素子を
有する薄膜基板と、この薄膜基板上に固着された少くと
も能動素子を有する半導体ペレットとを含むことを特徴
とする混成集積回路。 - 【請求項3】 能動素子と受動素子とは向い合う形状に
半導体ペレットと薄膜基板とが固着されている請求項1
または請求項2記載の混成集積回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3303671A JPH05211279A (ja) | 1991-11-20 | 1991-11-20 | 混成集積回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3303671A JPH05211279A (ja) | 1991-11-20 | 1991-11-20 | 混成集積回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05211279A true JPH05211279A (ja) | 1993-08-20 |
Family
ID=17923830
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3303671A Withdrawn JPH05211279A (ja) | 1991-11-20 | 1991-11-20 | 混成集積回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05211279A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1998013873A1 (en) * | 1996-09-27 | 1998-04-02 | The Whitaker Corporation | Integrated emitter drain bypass capacitor for microwave/rf power device applications |
| US5883422A (en) * | 1996-06-28 | 1999-03-16 | The Whitaker Corporation | Reduced parasitic capacitance semiconductor devices |
| JP2005117038A (ja) * | 2003-10-03 | 2005-04-28 | Agilent Technol Inc | 集積回路および集積回路アセンブリ |
-
1991
- 1991-11-20 JP JP3303671A patent/JPH05211279A/ja not_active Withdrawn
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5883422A (en) * | 1996-06-28 | 1999-03-16 | The Whitaker Corporation | Reduced parasitic capacitance semiconductor devices |
| WO1998013873A1 (en) * | 1996-09-27 | 1998-04-02 | The Whitaker Corporation | Integrated emitter drain bypass capacitor for microwave/rf power device applications |
| JP2005117038A (ja) * | 2003-10-03 | 2005-04-28 | Agilent Technol Inc | 集積回路および集積回路アセンブリ |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Application deemed to be withdrawn because no request for examination was validly filed |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19990204 |