JPH05226641A - 高速半導体装置及びその製造方法 - Google Patents

高速半導体装置及びその製造方法

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JPH05226641A
JPH05226641A JP4027753A JP2775392A JPH05226641A JP H05226641 A JPH05226641 A JP H05226641A JP 4027753 A JP4027753 A JP 4027753A JP 2775392 A JP2775392 A JP 2775392A JP H05226641 A JPH05226641 A JP H05226641A
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JP
Japan
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layer
collector
mesa
emitter
base
Prior art date
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Withdrawn
Application number
JP4027753A
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English (en)
Inventor
Kenichi Imamura
健一 今村
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Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Publication date
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Abstract

(57)【要約】 【目的】 高速半導体装置及びその製造方法に関し、H
ETなど縦型の高速半導体装置に於けるベース・コレク
タ間容量を低減して高速動作性を向上し、且つ、ベース
抵抗を小さく維持することが可能であると共に強度的な
信頼性も充分に高め得るようにしようとする。 【構成】 メサ状になっているn+ −InGaAsエミ
ッタ層6の下方に在るi−In(AlGa)Asコレク
タ・バリヤ層3とn+ −InGaAsコレクタ・コンタ
クト層2との間にそれ等i−In(AlGa)Asコレ
クタ・バリヤ層3並びにn+ −InGaAsコレクタ・
コンタクト層2とは組成を異にし且つ選択的にエッチン
グ可能であると共に前記メサ化されたn+ −InGaA
sエミッタ層6と略同面積であるi−InPスペーサ層
11が介挿されている。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、ホット・エレクトロン
・トランジスタ(hot electrontrans
istor:HET)、共鳴トンネリング・ホット・エ
レクトロン・トランジスタ(resonant tun
neling hot electron trans
istor:RHET)、ヘテロ接合バイポーラ・トラ
ンジスタ(heterojunction bipol
ar transistor:HBT)など縦型の高速
半導体装置及びそれを製造する方法の改良に関する。
【0002】現在、この種の高速半導体装置は、かなり
の高性能を発揮するものが実現されているのであるが、
その高速性について、未だ改良しなければならない点が
存在している。
【0003】
【従来の技術】図2は従来例を解説する為のHETを表
す要部切断側面図である。図に於いて、1は半絶縁性I
nP基板、2はn+ −InGaAsコレクタ・コンタク
ト層、3はi−In(AlGa)Asコレクタ・バリヤ
層、4はn−InGaAsベース層、5はi−InAl
Asエミッタ・バリヤ層、6はn+ −InGaAsエミ
ッタ層、7はエミッタ電極、8はベース電極、9はコレ
クタ電極をそれぞれ示している。
【0004】図示した各部分に関する主要なデータを例
示すると次の通りである。 (1) コレクタ・コンタクト層2について 厚さ:300〔nm〕 不純物濃度:5×1018〔cm-3〕 (2) コレクタ・バリヤ層3について 厚さ:200〔nm〕
【0005】(3) ベース層4について 厚さ:30〔nm〕 不純物濃度:1×1018〔cm-3〕 (4) エミッタ・バリヤ層5について 厚さ:10〔nm〕
【0006】(5) エミッタ層6について 厚さ:200〔nm〕 不純物濃度:1×1018〔cm-3〕 (6) エミッタ電極7について 材料:Cr/Au 厚さ:20〔nm〕/300〔nm〕
【0007】(7) ベース電極8について 材料:Cu/Au、或いは、AuGe/Ti/Pt/A
u 厚さ:20〔nm〕/300〔nm〕(Cu/Au) 20〔nm〕/100〔nm〕/20〔nm〕/200
〔nm〕(AuGe/Ti/Pt/Au) (8) コレクタ電極9について 材料:Cu/Au 厚さ:20〔nm〕/300〔nm〕
【0008】図2に見られるHETでは、ベース層4の
下にi−In(AlGa)Asからなるコレクタ・バリ
ヤ層3が在り、更に、その下にコレクタ・コンタクト層
2が在る構成になっていて、ベース・コレクタ間の容量
が影響が大きく、高速動作を妨げている。このようなベ
ース・コレクタ間の容量を低減する試みを施したHET
も提案されている。
【0009】図3は改良された従来例を解説する為のH
ETを表す要部切断側面図であり、図2に於いて用いた
記号と同記号は同部分を表すか或いは同じ意味を持つも
のとする。
【0010】この従来例に於いては、コレクタ・バリヤ
層3を構成する材料としてi−In(AlGa)Asの
代わりにi−InPを用い、そして、InPはHClを
エッチャントにすればInGaAsに対して選択的にエ
ッチング可能であることを利用し、図に見られるよう
に、コレクタ・バリヤ層3がエミッタ層6の直下にのみ
残るようサイド・エッチングすることでコレクタ・コン
タクト層2との接触面積を小さくし、それに依ってベー
ス・コレクタ間容量の低減を図っている。
【0011】
【発明が解決しようとする課題】図3に見られるHET
に於いては、確かにベース・コレクタ間容量は低減され
ているが、ベース層4に於ける空乏層が増加し、今度は
ベース抵抗が大きくなってしまう旨の欠点が現れてく
る。
【0012】即ち、図2に見られるHETに於いても、
図3に見られるHETに於いても、ベース電極8がコン
タクトしている近傍のベース層4の表面には空乏層が生
成されているのであるが、図3に見られるHETでは、
ベース電極8の下方に於けるベース層4の裏面にも空乏
層が生成されてしまうので、ベース抵抗が大きくなるの
である。
【0013】しかも、このベース抵抗の問題とは別に、
ベース層4は、先に説明してあるように、厚さが30
〔nm〕程度と極めて薄いものであるから剛性が小さ
く、その下側に大きな空所が存在していると、衝撃に依
って簡単に折れた状態となってしまい、先端が落ちてコ
レクタ層2と短絡する旨の事故が起こる。
【0014】本発明は、HETなど縦型の高速半導体装
置に於けるベース・コレクタ間容量を低減して高速動作
性を向上し、且つ、ベース抵抗を小さく維持することが
可能であると共に強度的な信頼性も充分に高め得るよう
にしようとする。
【0015】
【課題を解決するための手段】本発明に依る高速半導体
装置及びその製造方法に於いては、 (1)メサ化されたエミッタ層(例えばn+ −InGa
Asエミッタ層6)の下方に於けるコレクタ・バリヤ層
(例えばi−In(AlGa)Asコレクタ・バリヤ層
3)とコレクタ・コンタクト層(例えばn+ −InGa
Asコレクタ・コンタクト層2)との間にコレクタ・バ
リヤ層並びにコレクタ・コンタクト層と組成を異にし且
つ選択的にエッチング可能な材料で構成されると共にメ
サ化されたエミッタ層と略同面積であるスペーサ層(例
えばi−InPスペーサ層11)が介挿されてなること
を特徴とするか、
【0016】(2)メサ化されたエミッタ層の下方に於
けるコレクタ層(例えばn−InGaAs或いはn−I
nAlAsで構成される)とコレクタ・コンタクト層
(例えばn−InGaAsで構成される)との間にコレ
クタ層並びにコレクタ・コンタクト層と組成を異にし且
つ選択的にエッチング可能な材料で構成されると共にメ
サ化されたエミッタ層と略同面積であるスペーサ層(例
えばi−InPで構成される)が介挿されてなることを
特徴とするか、
【0017】(3)コレクタ・コンタクト層(例えばn
+ −InGaAsコレクタ・コンタクト層2)とコレク
タ・バリヤ層(例えばi−In(AlGa)Asコレク
タ・バリヤ層3)との間に介挿されコレクタ・コンタク
ト層並びにコレクタ・バリヤ層と組成を異にし且つ選択
的にエッチング可能な材料で構成されたスペーサ層(例
えばi−InPスペーサ層11)を含む所要の半導体層
(例えばn+ −InGaAsコレクタ・コンタクト層
2、i−InPスペーサ層11、i−In(AlGa)
Asコレクタ・バリヤ層3、n−InGaAsベース層
4、i−InAlAsエミッタ・バリヤ層5、n+ −I
nGaAsエミッタ層6など)を積層形成する工程と、
表面側に在るエミッタ層(n+ −InGaAsエミッタ
層6)からコレクタ・コンタクト層(n+ −InGaA
sコレクタ・コンタクト層2)に達する階段状メサ・エ
ッチングを行ってベース電極コンタクト領域(n−In
GaAsベース層4の一部)並びにコレクタ電極コンタ
クト領域(n+ −InGaAsコレクタ・コンタクト層
2の一部)をそれぞれ表出させてからスペーサ層(i−
InPスペーサ層11)のみ選択的にサイド・エッチン
グしてメサ化されたエミッタ層(n+ −InGaAsエ
ミッタ層6)と略同面積にする工程とが含まれてなるこ
とを特徴とするか、或いは、
【0018】(4)コレクタ・コンタクト層(例えばn
−InGaAsで構成される)とコレクタ層(例えばn
−InGaAs或いはn−InAlAsで構成される)
との間に介挿されコレクタ・コンタクト層並びにコレク
タ層と組成を異にし且つ選択的にエッチング可能な材料
で構成されたスペーサ層(例えばi−InPで構成され
る)を含む所要の半導体層を積層形成する工程と、表面
側に在るエミッタ層からコレクタ・コンタクト層に達す
る階段状メサ・エッチングを行ってベース電極コンタク
ト領域並びにコレクタ電極コンタクト領域をそれぞれ表
出させてからスペーサ層のみ選択的にサイド・エッチン
グしてメサ化されたエミッタ層と略同面積にする工程と
が含まれてなることを特徴とする。
【0019】
【作用】前記手段を採ることに依り、ベース電極直下に
存在するベース・コレクタ間容量は充分に低減され、し
かも、ベース層の表裏両面から空乏層が延び出てベース
抵抗を大きくするなどの虞は皆無であるから、HETな
どを更に高速化することができ、そして、薄いベース層
のみが単独で宙に浮いた状態の構成はなくなり、下地が
空所になっている部分の剛性は高くなっているから、衝
撃や振動でベース層が折れるなどの問題は解消され、信
頼性が高い高速半導体装置を歩留り良く製造することが
できる。
【0020】
【実施例】図1は本発明の実施例を解説する為の高速半
導体装置の一種であるHETを表す要部切断側面図であ
り、図2及び図3に於いて用いた記号と同記号は同部分
を表すか或いは同じ意味を持つものとする。図に於い
て、11は厚さが例えば10〔nm〕程度の薄いi−I
nPスペーサ層を示している。
【0021】このように、コレクタ・コンタクト層2と
コレクタ・バリヤ層3の間にスペーサ層を介挿しても、
HETとしての動作には変わりない。即ち、InGaA
sとIn(AlGa)Asとの間の伝導帯のエネルギ・
バンド不連続値は約0.25〔eV〕であり、InGa
AsとInPとの不連続値で0.22〔eV〕〜0.2
5〔eV〕と略等しく、HETとしての動作上からは全
く問題にならない。
【0022】本実施例のHETは、従来のHETを製造
する場合と殆ど変わりない工程で製造することができる
ので、以下、簡単に説明する。 (1) ガス・ソース分子線エピタキシャル成長(ga
s source molecular beam e
pitaxy:GS−MBE)法を適用することに依
り、半絶縁性InP基板1上に n+ −InGaAsコレクタ・コンタクト層2 i−InPスペーサ層11 In(AlGa)Asコレクタ・バリヤ層3 n−InGaAsベース層4 i−InAlAsエミッタ・バリヤ層5 n+ −InGaAsエミッタ層6 を成長させる。尚、i−InPスペーサ層11の厚さは
10〔nm〕であり、他の各半導体層に関するデータ
は、図2及び図3について説明した従来例と変わりな
い。また、GS−MBE法は有機金属化学気相堆積(m
etalorganic chemical vapo
ur deposition:MOCVD)法に代替し
ても良い。
【0023】(2) エミッタ層6が表出されているウ
エハに、通常の技法を適用することに依り、階段状のメ
サ・エッチングを行ってベース層4の電極コンタクト領
域、並びに、コレクタ・コンタクト層2の電極コンタク
ト領域を表出させる。
【0024】(3) エッチャントをHCl水溶液とす
るウエット・エッチング法を適用することに依り、i−
InPスペーサ層11のサイド・エッチングを行い、メ
サ化されているエミッタ層6に対向する領域を残して他
は除去する。
【0025】(4) 通常のリソグラフィ技術に於ける
レジスト・プロセス、及び、真空蒸着法、及び、リフト
・オフ法を適用することにより、エミッタ電極7、ベー
ス電極8、コレクタ電極9を形成する。
【0026】このように、本発明に依る高速半導体装置
は容易に製造することができ、前記工程(3)に於ける
i−InPスペーサ層11のサイド・エッチングは、時
間制御で行うのであるが、HCl水溶液はInPをエッ
チングするがInGaAsやInAlAsはエッチング
しないので、図1に見られる構成を得ることは簡単であ
る。
【0027】前記したところから明らかなように、ベー
ス電極8の下方に於けるコレクタ・バリヤ層3とコレク
タ・コンタクト層2とは分離されてベース・コレクタ容
量は低減されるのであるが、この他に、イオン注入やア
ロイ化する場合にも、コレクタ・バリヤ層3とコレクタ
・コンタクト層2とが分離されていることから、コレク
タ・ベース耐圧が低下するなどの虞も少ないことは当然
である。
【0028】前記実施例では、HETを対象にして説明
したが、RHETやHBTにも同様に実施することがで
きる。例えば、HBTに於いては、n−InGaAsコ
レクタ・コンタクト層上にn−InGaAsコレクタ層
或いはn−InAlAsコレクタ層、p+ −InGaA
sベース層、n−InAlAsエミッタ層、n+ −In
GaAsエミッタ・コンタクト層を積層形成した構成に
なっていて、ベース・コレクタ間容量についてはHET
やRHETと全く同じ問題を抱えているのであるが、前
記説明したHETに関する実施例と同様、例えばi−I
nPからなるスペーサ層をn−InGaAsコレクタ・
コンタクト層とn−InGaAs或いはn−InAlA
sコレクタ層との間に介挿し、且つ、そのスペーサ層の
面積をメサ化されたエミッタ層と同程度にすることで全
く同じ効果が得られる。
【0029】
【発明の効果】本発明に依る高速半導体装置及びその製
造方法に於いては、HETやRHETであれば、メサ状
エミッタ層の下方に於けるコレクタ・バリヤ層とコレク
タ・コンタクト層との間にそれ等と組成を異にし且つ選
択的にエッチング可能な材料で構成されると共にメサ状
エミッタ層と略同面積であるスペーサ層が介挿されてな
り、また、HBTであれば、メサ状エミッタ層の下方に
於けるコレクタ層とコレクタ・コレクタ層との間にそれ
等と組成を異にし且つ選択的にエッチング可能な材料で
構成されると共にメサ状エミッタ層と略同面積であるス
ペーサ層が介挿されている。
【0030】前記構成を採ることに依り、ベース電極直
下に存在するベース・コレクタ間容量は充分に低減さ
れ、しかも、ベース層の表裏両面から空乏層が延び出て
ベース抵抗を大きくするなどの虞は皆無であるから、H
ETなどを更に高速化することができ、そして、薄いベ
ース層のみが単独で宙に浮いた状態の構成はなくなり、
下地が空所になっている部分の剛性は高くなっているか
ら、衝撃や振動でベース層が折れるなどの問題は解消さ
れ、信頼性が高い高速半導体装置を歩留り良く製造する
ことができる。
【図面の簡単な説明】
【図1】本発明の実施例を解説する為の高速半導体装置
の一種であるHETを表す要部切断側面図である。
【図2】従来例を解説する為のHETを表す要部切断側
面図である。
【図3】改良された従来例を解説する為のHETを表す
要部切断側面図である。
【符号の説明】
1 半絶縁性InP基板 2 n+ −InGaAsコレクタ・コンタクト層 3 i−In(AlGa)Asコレクタ・バリヤ層 4 n−InGaAsベース層 5 i−InAlAsエミッタ・バリヤ層 6 n+ −InGaAsエミッタ層 7 エミッタ電極 8 ベース電極 9 コレクタ電極 11 i−InPスペーサ層

Claims (4)

    【特許請求の範囲】
  1. 【請求項1】メサ化されたエミッタ層の下方に於けるコ
    レクタ・バリヤ層とコレクタ・コンタクト層との間にコ
    レクタ・バリヤ層並びにコレクタ・コンタクト層と組成
    を異にし且つ選択的にエッチング可能な材料で構成され
    ると共にメサ化されたエミッタ層と略同面積であるスペ
    ーサ層が介挿されてなることを特徴とし、ホット・エレ
    クトロン・トランジスタ或いは共鳴トンネリング・ホッ
    ト・エレクトロン・トランジスタとして動作する高速半
    導体装置。
  2. 【請求項2】メサ化されたエミッタ層の下方に於けるコ
    レクタ層とコレクタ・コンタクト層との間にコレクタ層
    並びにコレクタ・コンタクト層と組成を異にし且つ選択
    的にエッチング可能な材料で構成されると共にメサ化さ
    れたエミッタ層と略同面積であるスペーサ層が介挿され
    てなることを特徴とし、ヘテロ接合バイポーラ・トラン
    ジスタとして動作する高速半導体装置。
  3. 【請求項3】コレクタ・コンタクト層とコレクタ・バリ
    ヤ層との間に介挿されコレクタ・コンタクト層並びにコ
    レクタ・バリヤ層と組成を異にし且つ選択的にエッチン
    グ可能な材料で構成されたスペーサ層を含む所要の半導
    体層を積層形成する工程と、 表面側に在るエミッタ層からコレクタ・コンタクト層に
    達する階段状メサ・エッチングを行ってベース電極コン
    タクト領域並びにコレクタ電極コンタクト領域をそれぞ
    れ表出させてからスペーサ層のみ選択的にサイド・エッ
    チングしてメサ化されたエミッタ層と略同面積にする工
    程とが含まれてなることを特徴とする高速半導体装置の
    製造方法。
  4. 【請求項4】コレクタ・コンタクト層とコレクタ層との
    間に介挿されコレクタ・コンタクト層並びにコレクタ層
    と組成を異にし且つ選択的にエッチング可能な材料で構
    成されたスペーサ層を含む所要の半導体層を積層形成す
    る工程と、 表面側に在るエミッタ層からコレクタ・コンタクト層に
    達する階段状メサ・エッチングを行ってベース電極コン
    タクト領域並びにコレクタ電極コンタクト領域をそれぞ
    れ表出させてからスペーサ層のみ選択的にサイド・エッ
    チングしてメサ化されたエミッタ層と略同面積にする工
    程とが含まれてなることを特徴とする高速半導体装置の
    製造方法。
JP4027753A 1992-02-14 1992-02-14 高速半導体装置及びその製造方法 Withdrawn JPH05226641A (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2016219726A (ja) * 2015-05-26 2016-12-22 日本電信電話株式会社 電界効果トランジスタ

Cited By (1)

* Cited by examiner, † Cited by third party
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JP2016219726A (ja) * 2015-05-26 2016-12-22 日本電信電話株式会社 電界効果トランジスタ

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Effective date: 19990518