JPH05274816A - エラー処理装置 - Google Patents
エラー処理装置Info
- Publication number
- JPH05274816A JPH05274816A JP6648692A JP6648692A JPH05274816A JP H05274816 A JPH05274816 A JP H05274816A JP 6648692 A JP6648692 A JP 6648692A JP 6648692 A JP6648692 A JP 6648692A JP H05274816 A JPH05274816 A JP H05274816A
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- JP
- Japan
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- data
- circuit
- buffer
- error
- error correction
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Abstract
(57)【要約】
【構成】 ホストコンピュータから送られてくる書き込
み用のデータは、データバッファ３５に保持される。こ
のとき、１ブロック前のデータは光ディスクに書き込ま
れており、この１ブロック前のデータが再生されてセレ
クタ４１を介してデータバッファ３３に保持される。次
に、セレクタ３１、４１が切り替わり、データバッファ
３５に保持されたデータは、エラー訂正回路３９により
訂正コードが付加されて光ディスクに記録される。この
とき、データバッファ３３に保持されたデータは、エラ
ー訂正回路によりエラーチェックが行われる。 【効果】 ＲＡＷ処理を効率良く行うことができる。
み用のデータは、データバッファ３５に保持される。こ
のとき、１ブロック前のデータは光ディスクに書き込ま
れており、この１ブロック前のデータが再生されてセレ
クタ４１を介してデータバッファ３３に保持される。次
に、セレクタ３１、４１が切り替わり、データバッファ
３５に保持されたデータは、エラー訂正回路３９により
訂正コードが付加されて光ディスクに記録される。この
とき、データバッファ３３に保持されたデータは、エラ
ー訂正回路によりエラーチェックが行われる。 【効果】 ＲＡＷ処理を効率良く行うことができる。
Description
【０００１】
【産業上の利用分野】本発明は、光ディスク装置等に用
いられ、ホストコンピュータと光ディスクの間に設けら
れるエラー処理装置に関するものである。
いられ、ホストコンピュータと光ディスクの間に設けら
れるエラー処理装置に関するものである。
【０００２】
【従来の技術】一般に、光ディスク装置等においては、
光ディスクにデータを書き込んだ後、そのデータが正し
く書き込まれたか否かを判断するために、リードアフタ
ライト（ＲＡＷ）処理が行われる。このＲＡＷは、光デ
ィスクにデータを書き込む時に、データに対して訂正コ
ードを付加して光ディスクに書き込み、書き込まれたデ
ータを再生して、再生されたデータにエラーがあるかな
いかをチェックし訂正するものである。
光ディスクにデータを書き込んだ後、そのデータが正し
く書き込まれたか否かを判断するために、リードアフタ
ライト（ＲＡＷ）処理が行われる。このＲＡＷは、光デ
ィスクにデータを書き込む時に、データに対して訂正コ
ードを付加して光ディスクに書き込み、書き込まれたデ
ータを再生して、再生されたデータにエラーがあるかな
いかをチェックし訂正するものである。
【０００３】すなわち、ホストコンピュータから送られ
てきたデータを一旦バッファに保存し、保存されたデー
タに対してエラー訂正回路により訂正コードを付加して
光ディスクに書き込む。そして、光ディスクから書き込
まれたデータを読み出して、読み出されたデータが正し
いものであるか否かを訂正コード等を用いて判断し、エ
ラーがある場合には、エラー訂正回路により訂正を行
う。
てきたデータを一旦バッファに保存し、保存されたデー
タに対してエラー訂正回路により訂正コードを付加して
光ディスクに書き込む。そして、光ディスクから書き込
まれたデータを読み出して、読み出されたデータが正し
いものであるか否かを訂正コード等を用いて判断し、エ
ラーがある場合には、エラー訂正回路により訂正を行
う。
【０００４】
【発明が解決しようとする課題】ところで、このような
ＲＡＷ処理において、ブロック単位のデータで書き込み
および再生が行われるが、ＲＡＷ処理で再生したデータ
のエラー訂正が終了するまでは、次のブロックをバッフ
ァに記憶することができず、エラー訂正処理が終了した
後、初めて次のブロックのデータをバッファに書き込ま
ざるを得なかった。
ＲＡＷ処理において、ブロック単位のデータで書き込み
および再生が行われるが、ＲＡＷ処理で再生したデータ
のエラー訂正が終了するまでは、次のブロックをバッフ
ァに記憶することができず、エラー訂正処理が終了した
後、初めて次のブロックのデータをバッファに書き込ま
ざるを得なかった。
【０００５】このため、記録時のスループット（効率）
が極めて悪くなるという問題があった。
が極めて悪くなるという問題があった。
【０００６】本発明は、このような問題に鑑みてなされ
たもので、その目的とするところは、ＲＡＷ処理を効率
良く行うことができるエラー処理装置を提供することに
ある。
たもので、その目的とするところは、ＲＡＷ処理を効率
良く行うことができるエラー処理装置を提供することに
ある。
【０００７】
【課題を解決するための手段】前述した目的を達成する
ために本発明は、ホストコンピュータと光ディスクの間
に設けられ、リードアフタライト処理を行うエラー処理
装置であって、第１のデータバッファと、前記第１のデ
ータバッファに接続された第１のエラー訂正回路と、第
２のデータバッファと、前記第２のデータバッファに接
続された第２のエラー訂正回路と、を備え、ホスト側か
ら送られてくるデータを前記第２のバッファに書き込ん
でいる間に、光ディスク側から読み出されたデータを前
記第１のバッファに書き込む第１の動作と、前記第２の
バッファに書き込まれたデータを第２のエラー訂正回路
で訂正コードを付加して光ディスクに書き込むために光
ディスク側に送る間に、前記第１のデータバッファに書
き込まれたデータを第１のエラー訂正回路でエラー訂正
してホスト側に送る第２の動作を行うエラー処理装置で
ある。
ために本発明は、ホストコンピュータと光ディスクの間
に設けられ、リードアフタライト処理を行うエラー処理
装置であって、第１のデータバッファと、前記第１のデ
ータバッファに接続された第１のエラー訂正回路と、第
２のデータバッファと、前記第２のデータバッファに接
続された第２のエラー訂正回路と、を備え、ホスト側か
ら送られてくるデータを前記第２のバッファに書き込ん
でいる間に、光ディスク側から読み出されたデータを前
記第１のバッファに書き込む第１の動作と、前記第２の
バッファに書き込まれたデータを第２のエラー訂正回路
で訂正コードを付加して光ディスクに書き込むために光
ディスク側に送る間に、前記第１のデータバッファに書
き込まれたデータを第１のエラー訂正回路でエラー訂正
してホスト側に送る第２の動作を行うエラー処理装置で
ある。
【０００８】
【作用】本発明では、ホスト側から送られてくるデータ
を前記第２のバッファに書き込んでいる間に、光ディス
ク側から読み出されたデータを前記第１のバッファに書
き込む第１の動作と、前記第２のバッファに書き込まれ
たデータを第２のエラー訂正回路で訂正コードを付加し
て光ディスクに書き込むために光ディスク側に送る間
に、前記第１のデータバッファに書き込まれたデータを
第１のエラー訂正回路でエラー訂正してホスト側に送る
第２の動作を行う。
を前記第２のバッファに書き込んでいる間に、光ディス
ク側から読み出されたデータを前記第１のバッファに書
き込む第１の動作と、前記第２のバッファに書き込まれ
たデータを第２のエラー訂正回路で訂正コードを付加し
て光ディスクに書き込むために光ディスク側に送る間
に、前記第１のデータバッファに書き込まれたデータを
第１のエラー訂正回路でエラー訂正してホスト側に送る
第２の動作を行う。
【０００９】
【実施例】以下、図面に基づいて本発明の実施例を詳細
に説明する。
に説明する。
【００１０】図１は、本発明の一実施例に係るエラー処
理回路１１を有する光ディスクコントローラ１の構成を
示すブロック図である。
理回路１１を有する光ディスクコントローラ１の構成を
示すブロック図である。
【００１１】光ディスクコントローラ１は、ＣＰＵ３、
ＲＯＭ５、ＳＣＳＩコントローラ７、タイミング制御回
路９、エラー処理回路１１、シリアルパラレル変換回路
（Ｓ／Ｐ変換回路）１３、変復調回路１５、マスタクロ
ックＰＬＬ回路１７、ＰＬＬ回路１９、ドライブインタ
フェース回路２１、ヘッダ検知回路２３、ヘッダ比較回
路２５、ＩＤカウンタ２７を有する。
ＲＯＭ５、ＳＣＳＩコントローラ７、タイミング制御回
路９、エラー処理回路１１、シリアルパラレル変換回路
（Ｓ／Ｐ変換回路）１３、変復調回路１５、マスタクロ
ックＰＬＬ回路１７、ＰＬＬ回路１９、ドライブインタ
フェース回路２１、ヘッダ検知回路２３、ヘッダ比較回
路２５、ＩＤカウンタ２７を有する。
【００１２】ＳＣＳＩコントローラ７は、ホストコンピ
ュータとの間でデータのやりとりを行う。
ュータとの間でデータのやりとりを行う。
【００１３】タイミング制御回路９は、ヘッダ検知回路
２３およびヘッダ比較回路２５から送られる信号をもと
にして、各タイミング信号を生成する。
２３およびヘッダ比較回路２５から送られる信号をもと
にして、各タイミング信号を生成する。
【００１４】エラー処理回路１１は、ホストコンピュー
タから送られてくる書き込み用のデータに訂正コードを
付加してＳ／Ｐ変換回路１３に送り、また、光ディスク
から読取られＳ／Ｐ変換回路１３を介したデータのエラ
ーチェックおよびエラー訂正を行う。この詳細は後述す
る。
タから送られてくる書き込み用のデータに訂正コードを
付加してＳ／Ｐ変換回路１３に送り、また、光ディスク
から読取られＳ／Ｐ変換回路１３を介したデータのエラ
ーチェックおよびエラー訂正を行う。この詳細は後述す
る。
【００１５】Ｓ／Ｐ変換回路１３は、エラー処理回路１
１から送られてくるパラレルデータをシリアルデータに
変換して変復調回路１５に送り、また、変復調回路１５
から送られるシリアルデータをパラレルデータに変換し
てエラー処理回路１１に送る。 変復調回路１５は、記
録データを変調してＰＬＬ回路１９に送り、また、再生
データを変調してＳ／Ｐ変換回路１３に送る。
１から送られてくるパラレルデータをシリアルデータに
変換して変復調回路１５に送り、また、変復調回路１５
から送られるシリアルデータをパラレルデータに変換し
てエラー処理回路１１に送る。 変復調回路１５は、記
録データを変調してＰＬＬ回路１９に送り、また、再生
データを変調してＳ／Ｐ変換回路１３に送る。
【００１６】マスタクロックＰＬＬ回路１７は、記録時
におけるマスタクロックを発生し、ＰＬＬ回路１９に送
る。ＰＬＬ回路１９は、記録データをクロックに載せて
ドライブインタフェース回路２１に送り、再生データを
マスタクロックで打ち抜いて変復調回路１５に送る。
におけるマスタクロックを発生し、ＰＬＬ回路１９に送
る。ＰＬＬ回路１９は、記録データをクロックに載せて
ドライブインタフェース回路２１に送り、再生データを
マスタクロックで打ち抜いて変復調回路１５に送る。
【００１７】ヘッダ検知回路２３は、光ディスクから再
生されたデータのヘッダ（アドレス）を検知する。
生されたデータのヘッダ（アドレス）を検知する。
【００１８】ヘッダ比較回路２５は、ヘッダ検知回路２
３で読取られたヘッダ（アドレス）と、ＣＰＵ３で指定
したヘッダ（アドレス）が一致しているか否か等の判断
を行う。
３で読取られたヘッダ（アドレス）と、ＣＰＵ３で指定
したヘッダ（アドレス）が一致しているか否か等の判断
を行う。
【００１９】図２および図３は、エラー処理回路の構成
を示すブロック図である。このエラー処理回路１１は、
セレクタ３１、４１、データバッファ３３、３５、エラ
ー訂正回路３７、３９、インバータ４３を有する。
を示すブロック図である。このエラー処理回路１１は、
セレクタ３１、４１、データバッファ３３、３５、エラ
ー訂正回路３７、３９、インバータ４３を有する。
【００２０】セレクタ３１、４１は、タイミング制御回
路９から送られるタイミング制御信号に応じて、内部の
スイッチが図２および図３に示すように切り替わる。
路９から送られるタイミング制御信号に応じて、内部の
スイッチが図２および図３に示すように切り替わる。
【００２１】データバッファ３３は、光ディスクから再
生されたデータを一時保存するものである。
生されたデータを一時保存するものである。
【００２２】データバッファ３５は、ホストコンピュー
タから送られてくる書き込み用のデータを一時保存する
ものである。
タから送られてくる書き込み用のデータを一時保存する
ものである。
【００２３】エラー訂正回路３７は、光ディスクから再
生されたデータのエラーチェックおよびエラー訂正を行
う。
生されたデータのエラーチェックおよびエラー訂正を行
う。
【００２４】エラー訂正回路３９は、ホストコンピュー
タから送られてくる書き込み用のデータにエラー訂正コ
ードを付加して、Ｓ／Ｐ変換回路１３に送る。
タから送られてくる書き込み用のデータにエラー訂正コ
ードを付加して、Ｓ／Ｐ変換回路１３に送る。
【００２５】図４は、光ディスクに書き込まれるデータ
５１とこれに付加されたエラーコード５３を示すもので
ある。
５１とこれに付加されたエラーコード５３を示すもので
ある。
【００２６】インバータ４３は、タイミング制御回路９
から送られてくる信号を反転させてセレクタ３１に送
る。
から送られてくる信号を反転させてセレクタ３１に送
る。
【００２７】次に、本実施例の概略動作を説明する。
【００２８】図１において、光ディスクにデータを書き
込む場合、ホストコンピュータが書き込み用のデータを
ＳＣＳＩコントローラ７を介してエラー処理回路１１に
送る。このとき、エラー処理回路１１のセレクタ３１、
４１は、図２の状態になっており、ホストコンピュータ
から送られてきたデータがデータバッファ３５に一旦保
存される。
込む場合、ホストコンピュータが書き込み用のデータを
ＳＣＳＩコントローラ７を介してエラー処理回路１１に
送る。このとき、エラー処理回路１１のセレクタ３１、
４１は、図２の状態になっており、ホストコンピュータ
から送られてきたデータがデータバッファ３５に一旦保
存される。
【００２９】また、このとき、前のブロックのデータが
ＲＡＷ処理を行うために光ディスクから読取られ、この
データは、ドライブインタフェース回路２１、ＰＬＬ回
路１９、変復調回路１５、Ｓ／Ｐ変換回路１３を介し
て、エラー処理回路１１に入力され、データバッファ３
３に保存される。
ＲＡＷ処理を行うために光ディスクから読取られ、この
データは、ドライブインタフェース回路２１、ＰＬＬ回
路１９、変復調回路１５、Ｓ／Ｐ変換回路１３を介し
て、エラー処理回路１１に入力され、データバッファ３
３に保存される。
【００３０】データバッファ３５にすべてデータが書き
込まれると、タイミング制御回路９から送られる信号が
反転することによって、セレクタ３１、４１は図３で示
す状態に切り替わる。
込まれると、タイミング制御回路９から送られる信号が
反転することによって、セレクタ３１、４１は図３で示
す状態に切り替わる。
【００３１】すなわち、データバッファ３５に記録され
たデータ５１は、エラー訂正回路３９により訂正コード
５３が付加され、Ｓ／Ｐ変換回路１３、変復調回路１
５、ＰＬＬ回路１９、ドライブインタフェース回路２１
を介して光ディスクに書き込まれる。
たデータ５１は、エラー訂正回路３９により訂正コード
５３が付加され、Ｓ／Ｐ変換回路１３、変復調回路１
５、ＰＬＬ回路１９、ドライブインタフェース回路２１
を介して光ディスクに書き込まれる。
【００３２】このとき、データバッファ３３に保存され
たデータは、エラー訂正回路３７によりエラーチェック
が行われ、ＣＰＵ３がエラー訂正の結果を検出する。
たデータは、エラー訂正回路３７によりエラーチェック
が行われ、ＣＰＵ３がエラー訂正の結果を検出する。
【００３３】このように本実施例では、セレクタ３１、
４１が図２に示す状態にあるときに、ホストコンピュー
タから送られてくる書き込み用のデータをデータバッフ
ァ３５に書き込んでいる間に、光ディスクから読み出さ
れた再生データをデータバッファ３３に書き込む。
４１が図２に示す状態にあるときに、ホストコンピュー
タから送られてくる書き込み用のデータをデータバッフ
ァ３５に書き込んでいる間に、光ディスクから読み出さ
れた再生データをデータバッファ３３に書き込む。
【００３４】また、セレクタ３１、４１が図３に示す状
態にあるときに、データバッファ３５に書き込まれたデ
ータをエラー訂正回路３９で訂正コードを付加して、光
ディスクに送る間にデータバッファ３３に書き込まれた
データをエラー訂正回路３７でエラー訂正してＲＡＷ処
理を行うので、効率良くＲＡＷ処理を行うことができ
る。
態にあるときに、データバッファ３５に書き込まれたデ
ータをエラー訂正回路３９で訂正コードを付加して、光
ディスクに送る間にデータバッファ３３に書き込まれた
データをエラー訂正回路３７でエラー訂正してＲＡＷ処
理を行うので、効率良くＲＡＷ処理を行うことができ
る。
【００３５】
【発明の効果】以上、詳細に説明したように本発明によ
れば、ＲＡＷ処理を効率良く行うことができるエラー処
理装置を提供することができる。
れば、ＲＡＷ処理を効率良く行うことができるエラー処
理装置を提供することができる。
【図１】 本発明の一実施例に係るエラー処理回路１１
が用いられた光ディスクコントローラ１の構成を示すブ
ロック図
が用いられた光ディスクコントローラ１の構成を示すブ
ロック図
【図２】 エラー処理回路１１の構成を示すブロック図
【図３】 エラー処理回路１１の構成を示すブロック図
【図４】 光ディスクに書き込まれるデータとこれに付
加された訂正コードを示す図
加された訂正コードを示す図
【符号の説明】 １１………エラー処理回路 ３１、４１…セレクタ ３３、３５…データバッファ ３７、３９…エラー訂正回路 ４３………インバータ
Claims (1)
- 【請求項１】 ホストコンピュータと光ディスクの間に
設けられ、リードアフタライト処理を行うエラー処理装
置であって、 第１のデータバッファと、 前記第１のデータバッファに接続された第１のエラー訂
正回路と、 第２のデータバッファと、 前記第２のデータバッファに接続された第２のエラー訂
正回路と、 を備え、 ホスト側から送られてくるデータを前記第２のバッファ
に書き込んでいる間に、光ディスク側から読み出された
データを前記第１のバッファに書き込む第１の動作と、 前記第２のバッファに書き込まれたデータを第２のエラ
ー訂正回路で訂正コードを付加して光ディスクに書き込
むために光ディスク側に送る間に、前記第１のデータバ
ッファに書き込まれたデータを第１のエラー訂正回路で
エラー訂正してホスト側に送る第２の動作を行うエラー
処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6648692A JPH05274816A (ja) | 1992-03-25 | 1992-03-25 | エラー処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP6648692A JPH05274816A (ja) | 1992-03-25 | 1992-03-25 | エラー処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05274816A true JPH05274816A (ja) | 1993-10-22 |
Family
ID=13317174
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6648692A Withdrawn JPH05274816A (ja) | 1992-03-25 | 1992-03-25 | エラー処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05274816A (ja) |
-
1992
- 1992-03-25 JP JP6648692A patent/JPH05274816A/ja not_active Withdrawn
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19990608 |