JPH0536736A - 混成集積回路 - Google Patents

混成集積回路

Info

Publication number
JPH0536736A
JPH0536736A JP3188863A JP18886391A JPH0536736A JP H0536736 A JPH0536736 A JP H0536736A JP 3188863 A JP3188863 A JP 3188863A JP 18886391 A JP18886391 A JP 18886391A JP H0536736 A JPH0536736 A JP H0536736A
Authority
JP
Japan
Prior art keywords
resin layer
insulating resin
substrate
chip
hybrid integrated
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP3188863A
Other languages
English (en)
Inventor
Noriaki Sakamoto
則明 阪本
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Sanyo Electric Co Ltd
Original Assignee
Sanyo Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Sanyo Electric Co Ltd filed Critical Sanyo Electric Co Ltd
Priority to JP3188863A priority Critical patent/JPH0536736A/ja
Publication of JPH0536736A publication Critical patent/JPH0536736A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/02Details
    • H05K1/03Use of materials for the substrate
    • H05K1/05Insulated conductive substrates, e.g. insulated metal substrate
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K1/00Printed circuits
    • H05K1/18Printed circuits structurally associated with non-printed electric components
    • H05K1/181Printed circuits structurally associated with non-printed electric components associated with surface mounted components
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistors
    • H05K3/303Assembling printed circuits with electric components, e.g. with resistors with surface mounted components
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistors
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistors electrically connecting electric components or wires to printed circuits
    • H05K3/34Assembling printed circuits with electric components, e.g. with resistors electrically connecting electric components or wires to printed circuits by soldering
    • H05K3/341Surface mounted components
    • H05K3/3431Leadless components
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/50Bond wires
    • H10W72/531Shapes of wire connectors
    • H10W72/5363Shapes of wire connectors the connected ends being wedge-shaped
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/851Dispositions of multiple connectors or interconnections
    • H10W72/874On different surfaces
    • H10W72/884Die-attach connectors and bond wires
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W90/00Package configurations
    • H10W90/701Package configurations characterised by the relative positions of pads or connectors relative to package parts
    • H10W90/731Package configurations characterised by the relative positions of pads or connectors relative to package parts of die-attach connectors
    • H10W90/734Package configurations characterised by the relative positions of pads or connectors relative to package parts of die-attach connectors between a chip and a stacked insulating package substrate, interposer or RDL
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W90/00Package configurations
    • H10W90/701Package configurations characterised by the relative positions of pads or connectors relative to package parts
    • H10W90/751Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
    • H10W90/754Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked insulating package substrate, interposer or RDL

Landscapes

  • Structures For Mounting Electric Components On Printed Circuit Boards (AREA)
  • Die Bonding (AREA)

Abstract

(57)【要約】 【目的】 大出力回路と小出力回路とが形成された大出
力用の混成集積回路の大出力用回路の熱放散を向上させ
且つ小出力回路を形成するチップ部品の半田接合部にお
ける温度サイクルによる半田接合部へのクラック発生を
防止し、且つチップ部品の熱放散性を向上させる。 【構成】 基板(1)の一主面上に低熱抵抗の第1の絶
縁樹脂層(2)と所定位置に孔(7B)を有した延性特
性を有する第2の絶縁樹脂層(5)を設け、第1の絶縁
樹脂層(2)上にパワー半導体素子(6)を搭載し、チ
ップ部品(4)を孔(7B)領域内に配置した接着剤層
(12)で基板(1)上に固定されるように第2の絶縁
樹脂層(5)上に搭載する。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は混成集積回路に関し、特
にパワー素子が搭載された混成集積回路の改良に関す
る。
【0002】
【従来の技術】従来の混成集積回路を図5に示す。混成
集積回路基板(21)は表面をアルマイト処理したアル
ミニウム基板を用い、基板(21)上に絶縁樹脂層を介
して所望形状の導電路(22)が形成されている。かか
る導電路(22)上あるいは導電路(22)間に半導体
チップ、チップコンデンサー及び印刷抵抗体等の回路素
子(23)が搭載され、導電路(22)を介して相互接
続されている。尚、図示されないが導電路(22)は基
板(21)に貼着されたエポキシ樹脂等の絶縁性接着剤
層を介して形成されている。
【0003】上述した混成集積回路は一般的に小電力用
に用いられる。これは、基板(21)上に絶縁樹脂層
(図示しない)を介して回路形成されるため熱抵抗が大
きくなるからである。そこで、かかる混成集積回路構造
の絶縁樹脂層中にアルミナ、シリカ、ボロン等のフィラ
ーを含有させて熱抵抗を小さくした混成集積回路が種々
提案されている。従って、大出力用あるいは大出力回路
とその周辺の小信号回路を有する混成集積回路にあって
は、一般的に熱抵抗を優先させたフィラー入り樹脂層を
有した基板上にそれらの回路が形成される。
【0004】
【発明が解決しようとする課題】斯上した混成集積回路
上に搭載されるチップ抵抗、チップコンデンサー等のチ
ップ部品は一般に半田で導電路上に接続されているため
に以下の問題が発生する。即ち、アルミニウム基板をベ
ース基板とした基板の熱膨張係数αが23×10 -6/℃
であり、上記したチップ部品、例えばチップ抵抗の熱膨
張係数αが7×10-6/℃、チップコンデンサーの熱膨
張係数αが10×10-6/℃であるため両者の膨張係数
αが著しく異なるために温度サイクルによってチップ部
品と導電路を接続する半田固着部分に温度サイクルによ
るストレスが加わり、半田固着部分にクラックが発生し
接続不良となる問題がある。
【0005】次にクラックが発生するメカニズムについ
て説明する。上記したようにアルミニウム基板の膨張係
数αが23×10-6/℃、チップ部品の膨張係数αが7
〜10×10-6/℃であり、チップ部品を接合する半田
の膨張係数αが約23×10 -6/℃であるため、室温状
態では図6のAの如く、基板、半田、チップ部に応力が
加わらない。しかし、高温状態では図6のBの如く、基
板と半田のαがチップ部品より大きいため矢印方向に引
張られ、その結果、接合半田は矢印の方向にのみすそが
広がるように変形する。又、低温状態では図6のCに示
す如く、反対の矢印方向に圧縮力が加えられその結果、
接合半田は矢印方向にのみすそが広がる。例えば、−5
0〜+150℃の条件の厳しい温度サイクル条件で数十
〜数百サイクルくり返すことにより、上述したようにα
の著しく異なるチップ部品と半田の接合面にクラックが
発生する。何故なら、温度サイクルにより微結晶状態に
ある半田成分のスズと鉛成分が分離し凝集して半田内に
連続的な鉛層を形成するため機械的強度を低下させるか
らである。
【0006】上述した問題は金属基板、特にアルミニウ
ム基板をベースとした集積回路特有の問題であり、プリ
ント基板等の他の基板をベースとした集積回路では問題
にならない。何故なら、そのようなベース基板であって
はチップ部品あるいは印刷抵抗体の膨張係数αと基板の
膨張係数αの差による上述した問題が発生しないからで
ある。
【0007】
【課題を解決するための手段】本発明は、上述した課題
に鑑みて為されたものであり、金属基板の同一主面に低
熱抵抗樹脂層と延性特性を有する絶縁樹脂層が存在し、
前記両樹脂層上に所望形状の導電路が形成され、前記低
熱抵抗樹脂層上にパワー半導体素子を固着搭載し前記絶
縁樹脂層上にチップ抵抗等の回路素子を固着搭載した混
成集積回路において、前記回路素子は前記絶縁樹脂層に
設けられた孔をまたぎ、前記孔内に配置されたフィラー
入りの接着樹脂層を介して基板上に搭載したことを特徴
とする。
【0008】また、前記延性特性を有した絶縁樹脂層と
してポリイミド樹脂を用いたことを特徴とする。
【0009】
【作用】以上のように構成される混成集積回路において
は、パワー半導体素子が低熱抵抗樹脂層上に搭載され、
それ以外の他の回路素子、例えばチップ抵抗、チップコ
ンデンサー等のチップ部分は延性特性を有する絶縁樹脂
層上に搭載された構造となるために、混成集積回路の使
用等により、厳しい条件下の温度サイクルが生じたとし
ても延性特性を有する絶縁樹脂層上に搭載されたチップ
抵抗、チップコンデンサー等のチップ部品状の回路素子
にあっては、温度サイクルにより生じるチップ部品の半
田接合部のストレスは延性特性を有する絶縁樹脂層によ
って緩和することができるとともにチップ部品がフィラ
ー入りの接着樹脂層を介して基板上に仮接着されるため
チップ部品の熱放散性を向上することができる。
【0010】
【実施例】以下に図1に示した実施例に基づいて本発明
の混成集積回路を説明する。図1は本発明の混成集積回
路を示す要部拡大断面図であり、(1)は金属基板、
(2)は第1の絶縁樹脂層、(3)は導電路、(4)は
チップ抵抗、チップコンデンサー等のチップ部品、(1
2)はチップ部品を仮接着する仮接着剤層、(5)は第
2の絶縁樹脂層、(6)はパワー半導体素子である。
【0011】金属基板(1)としては、例えば、アルミ
ニウム基板あるいはアルミニウム基板表面をアルマイト
処理したものを用い、ここでは後者のアルミニウム基板
を用いるものとする。その基板(1)の一主面上には絶
縁樹脂層を介して所望形状の導電路が形成され、その導
電路上に種々の回路素子が固着搭載される。さて、本発
明においては基板(1)上に材質の異なる二種類の絶縁
樹脂層(2)(5)が存在する。即ち、パワートランジ
スタ等のパワー半導体素子(6)が搭載される第1の絶
縁樹脂層(2)とパワー半導体素子(6)以外の回路素
子(4)が搭載される第2の絶縁樹脂層(5)を有す
る。
【0012】第1の絶縁樹脂層(2)はパワー半導体素
子(6)の熱放散を向上させるために低熱抵抗タイプの
絶縁樹脂層が用いられている。かかる第1の絶縁樹脂層
(2)は、例えばエポキシ樹脂、フェノール樹脂、キシ
レン樹脂等の樹脂中に、所定重量比、例えば30〜80
%の割合のBeO,MgO,Al23等の酸化物セラミ
ックス,AIN,BN等の窒化物セラミックスの所定粒
径のフィラーが混入されており、第1の絶縁樹脂層
(2)の熱抵抗を低く設定している。
【0013】一方、第2の絶縁樹脂層(5)はヒートサ
イクル時に基板(1)と第2の絶縁樹脂層(5)上に搭
載する回路素子(4)の熱膨張率αの差によるストレス
を吸収緩和できる延性特性を有する絶縁樹脂層が用いら
れる。第2の絶縁樹脂層(5)としてカプトン(商品
名)等のポリイミド樹脂が用いられる。かかるポリイミ
ド樹脂の延性特性は約80〜85%位有し、十分にヒー
トサイクルによるストレスを吸収緩和できるものであ
る。
【0014】ところで、パワー半導体素子(6)が搭載
される第1の絶縁樹脂層(2)は基板(1)の全面に貼
着される。このとき、第1の絶縁樹脂層(2)のパワー
半導体素子(6)の固着領域には、あらかじめ銅箔が一
体化されている。そして、その銅箔をエッチングしてパ
ワー半導体素子(6)が固着される固着パッド(3)と
その固着パッド(3)から延在されたパワー用導電路
(図示しない)が形成される。
【0015】パワー半導体素子(6)の固着領域以外の
第1の絶縁樹脂層(2)上に接着剤層(6A)を介して
上記した第2の絶縁樹脂層(5)が貼着される。第2の
絶縁樹脂層(5)上にはあらかじめ接着剤層(6B)を
介して銅箔が一体化され、上述した、パワー半導体素子
(6)の固着領域を囲むような孔(7A)とチップ部品
(4)を仮接着するための孔(7B)が設けられてい
る。この孔(7)により先に形成した固着パッド(3)
及びパワー用導電路及び第1の絶縁樹脂層(2)の一部
が露出されることになる。第1の絶縁樹脂層(2)上に
第2の絶縁樹脂層(5)を貼着した後、第2の絶縁樹脂
層(5)上の銅箔をエッチングして所望形状の導電路
(3)が形成される。このとき、第1の絶縁樹脂層
(2)の露出部分、即ち、パワー半導体固着パッド
(3)及びパワー用導電路上には保護用のレジストイン
クが塗布されているために何んら悪影響は発生しない。
【0016】基板(1)上に第1の絶縁樹脂層(2)及
び第2の絶縁樹脂層(5)を貼着し、夫々の樹脂層
(2)(5)上に所定の導電路(3)(3)を形成した
後、かかる導電路(3)(3)上に所定の回路素子が搭
載される。即ち、第1の絶縁樹脂層(2)上の固着パッ
ド(3)にはろう材により固着された銅片等のヒートシ
ンク(8)を介してパワー半導体素子(6)が搭載接続
される。一方、第2の絶縁樹脂層(5)上の導電路
(3)にはチップ抵抗、チップコンデンサー等のチップ
部品(4)及び図示はされないがその他の小信号系の半
導体素子が半田等のろう材により固着搭載されている。
【0017】ところで、本発明にあっては、チップコン
デンサー、チップ抵抗のチップ部品(4)を導電路
(3)上に接続する場合、上述したようにそれらのチッ
プ部品(4)が搭載される領域の第2の絶縁樹脂層
(5)の孔(7B)によって露出された第1の絶縁樹脂
層(2)とチップ部品(4)とが固定されている。即
ち、チップ部品(4)の接続電極と導電路とを半田接合
する前に基板(1)上にチップ部品(4)を仮接着する
仮接着剤(12)によって低熱抵抗の第1の絶縁樹脂層
(2)とチップ部品(4)とが仮接着される。仮接着剤
(12)はチップ部品(4)を仮接着するだけでなく、
チップ部品(4)の発熱を効果的に放熱させるためにア
クリル樹脂、シリコン樹脂等の接着剤中に所望重量比の
フィラーが混入されている。この構造によれば、チップ
部品(4)を基板(1)上に仮接着できるとともにチッ
プ部品(4)が発熱したとしてもその熱を効果的に外部
へ放出することができる。
【0018】また、パワー半導体素子(6)は第2の絶
縁樹脂層(5)の孔(7)の周端部に延材された導電路
(3)とワイヤ線(9)により接続され、パワー半導体
素子(6)と他の回路素子(4)とが相互に電気接続さ
れることになる。このとき、導電路(3)上にはワイヤ
ボンディングを容易にするためにNiメッキ(10)処
理が施されている。
【0019】本発明の構造に依れば、基板(1)上に上
述したように低熱抵抗樹脂層の第1の絶縁樹脂層(2)
と延性特性を有する第2の絶縁樹脂層(5)とを備えて
いるために発熱を有するパワー半導体素子の熱量を十分
に放散できると共に厳しい温度サイクル、例えば−50
〜+150℃範囲であってもαの差によるチップ抵抗、
チップコンデンサー等のチップ部品(4)の半田接合部
に生ずるストレスは第2の絶縁樹脂層(5)によって吸
収されるため、従来の如き、半田接合部のクラック発生
を著しく抑制することができる。
【0020】それでは、本発明構造を用いると何故チッ
プコンデンサー、チップ抵抗等のチップ部品(4)の半
田接合部にクラックが生じにくくなることを図2を示し
て説明する。チップ部品(4)を固着した基板(1)を
約150℃の高温状態に放置すると基板(1)のαが2
3×10-6/℃と大きいために基板(1)には矢印に示
す大きな応力が生じる。そして、第1の絶縁樹脂層
(2)も所定含有量のフィラーが混入されているために
αが約23×10-6/℃と大きくなるため基板(1)と
同様に大きな応力が生じる。この第1の絶縁樹脂層
(2)に生じる応力は、膜厚が約数十μと薄いため実質
的には基板(1)の応力がそのまま第1の絶縁樹脂層
(2)に伝達される。しかし、チップ部品(4)は延性
特性を有する第2の絶縁樹脂層(5)上に搭載されてい
るため、基板(1)で生じた大きな応力は第2の絶縁樹
脂層(5)内で厚み方向に従って矢印の如く吸収緩和さ
れ、半田接合部(11)には基板(1)で生じた大きな
応力が加わらないことになる。このとき、第2の絶縁樹
脂層(5)の膜厚が約10μ以下だと基板(1)で生じ
た応力を有効に緩和することができないために、第2の
絶縁樹脂層(5)の膜厚を約10μ以上に設定すると十
分に基板(1)で発生した応力を緩和することができ
る。以上に述べたように基板(1)で発生した応力は第
2の絶縁樹脂層(5)内で緩和されるために、半田接合
部(11)の半田成分の微結晶状態が保持され半田接合
部とコンデンサー等のチップ部品(4)の界面にクラッ
クが発生しないものである。
【0021】一方、図3は本発明の構造(A)と従来の
構造(B)上にチップコンデンサー(4)を搭載したと
きの温度サイクル試験での半田接合部へのクラック発生
不良率を示した特性図である。尚、温度サイクル条件は
−40℃(30分)〜+125℃(30分)で行い、ア
ルミニウム基板上に3.2×1.6mmのチップコンデ
ンサーを搭載した。図から明らかな如く、従来の(B)
では670サイクルで不良が発生し始め、1000サイ
クルでは試験サンプル数8個中全てのサンプルで半田ク
ラックによる接続不良が発生した。それに対して、本発
明の(A)では1500サイクルにおいても半田接合部
のクラックの発生が全くないことが確認された。
【0022】図4は他の実施例を示す断面図であり、基
板(1)の同一主面の同一層に略同一膜厚の第1の絶縁
樹脂層(2)と第2の絶縁樹脂層(5)とを形成したも
のである。かかる構造によれば第2の絶縁樹脂層(5)
に孔(7B)を設けると基板(1)のアルマイト層が露
出され放熱作用は向上するものの耐圧を考慮すれば先に
述べた実施例の方が好ましい。
【0023】
【発明の効果】以上に詳述した如く、本発明に依れば、
厳い条件下の温度サイクルにおいても、チップコンデン
サー、チップ抵抗等のチップ部品の半田接合部に生じて
いたクラック発生を略完全に防止することができる。そ
の結果、パワー半導体素子の熱放散性に優れかつ極めて
厳い温度サイクル条件下に適合した高信頼性の大出力用
の混成集積回路を実現することができる。
【0024】また、本発明によれば、延性特性を有する
第1の絶縁樹脂層上に搭載されるチップ部品は第1の絶
縁樹脂層に設けられた孔領域内に配置された熱伝性の優
れた接着剤を介して基板と固定されることにより、チッ
プ部品が発熱したとしてもその熱を効率よく放出するこ
とができる。
【図面の簡単な説明】
【図1】図1は本発明の一の実施例を示す要部拡大断面
図である。
【図2】図2は本発明の実施例の半田接合部における応
力を説明する図である。
【図3】図3は温度サイクル試験における半田接合部の
クラック発生不良率を示す特性図である。
【図4】図4は他の実施例を示す要部拡大断面図であ
る。
【図5】図5は従来の混成集積回路を示す断面図であ
る。
【図6】図6は従来の半田接合部における応力を説明す
る図である。
【符号の説明】
(1) 金属基板 (2) 第1の絶縁樹脂層 (3) 導電路 (4) チップ部品 (5) 第2の絶縁樹脂層 (6) パワー半導体素子 (12) 仮接着剤層

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】 金属基板の同一主面に低熱抵抗樹脂層と
    延性特性を有する絶縁樹脂層が存在し、前記両樹脂層上
    に所望形状の導電路が形成され、前記低熱抵抗樹脂層上
    にパワー半導体素子を固着搭載し前記絶縁樹脂層上にチ
    ップ抵抗等の回路素子を固着搭載した混成集積回路にお
    いて、 前記回路素子は前記絶縁樹脂層に設けられた孔をまた
    ぎ、前記孔内に配置されたフィラー入りの接着樹脂層を
    介して基板上に搭載固定したことを特徴とする混成集積
    回路。
  2. 【請求項2】 前記延性特性を有した絶縁樹脂層として
    ポリイミド樹脂を用いたことを特徴とする請求項1記載
    の混成集積回路。
JP3188863A 1991-07-29 1991-07-29 混成集積回路 Pending JPH0536736A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP3188863A JPH0536736A (ja) 1991-07-29 1991-07-29 混成集積回路

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP3188863A JPH0536736A (ja) 1991-07-29 1991-07-29 混成集積回路

Publications (1)

Publication Number Publication Date
JPH0536736A true JPH0536736A (ja) 1993-02-12

Family

ID=16231186

Family Applications (1)

Application Number Title Priority Date Filing Date
JP3188863A Pending JPH0536736A (ja) 1991-07-29 1991-07-29 混成集積回路

Country Status (1)

Country Link
JP (1) JPH0536736A (ja)

Similar Documents

Publication Publication Date Title
CN100444356C (zh) 功率组件
JPH04162756A (ja) 半導体モジュール
JPH09275170A (ja) 半導体装置
JP2803603B2 (ja) マルチチップパッケージ構造
JP2919651B2 (ja) 混成集積回路
CN115136297A (zh) 功率模块及其制造方法
JPH06334286A (ja) 回路基板
JPH0536736A (ja) 混成集積回路
JPH1117081A (ja) 電力用半導体モジュール
JPH0537106A (ja) 混成集積回路
JPH06310564A (ja) 半導体装置
JP2005285885A (ja) 半導体装置
JPS61156754A (ja) 高熱伝導性金属ベ−スプリント基板
JP2884872B2 (ja) 半導体装置の実装構造
JPS63173348A (ja) 半導体装置
JP2521624Y2 (ja) 半導体装置
JP3022738B2 (ja) マルチチップモジュール
JPH10256413A (ja) 半導体パッケージ
JPH08222670A (ja) 半導体素子搭載用パッケージ
JPH0773110B2 (ja) 半導体集積回路装置
JP2001135753A (ja) 半導体モジュール用基板及びその製造方法
JP2804765B2 (ja) 電子部品塔載用基板
JP3170004B2 (ja) セラミック回路基板
JPH0864711A (ja) 半導体用パッケージ
JPS60250655A (ja) 集積回路パツケ−ジ